1/* 2 * Copyright (c) 2022, NXP 3 * SPDX-License-Identifier: Apache-2.0 4 * 5 * Note: File generated by rt_cfg_utils.py 6 * from configuration data for MIMXRT1015CAF4A 7 */ 8 9/* 10 * SOC level pinctrl defintions 11 * These definitions define SOC level defaults for each pin, 12 * and select the pinmux for the pin. Pinmux entries are a tuple of: 13 * <mux_register mux_mode input_register input_daisy config_register> 14 * the mux_register and input_daisy reside in the IOMUXC peripheral, and 15 * the pinctrl driver will write the mux_mode and input_daisy values into 16 * each register, respectively. The config_register is used to configure 17 * the pin based on the devicetree properties set 18 */ 19 20&iomuxc { 21 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpio1_io00: IOMUXC_GPIO_AD_B0_00_GPIO1_IO00 { 22 pinmux = <0x401f80bc 5 0x0 0 0x401f8230>; 23 }; 24 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpt1_compare1: IOMUXC_GPIO_AD_B0_00_GPT1_COMPARE1 { 25 pinmux = <0x401f80bc 7 0x0 0 0x401f8230>; 26 }; 27 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_jtag_tms: IOMUXC_GPIO_AD_B0_00_JTAG_TMS { 28 pinmux = <0x401f80bc 0 0x0 0 0x401f8230>; 29 }; 30 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpio1_io01: IOMUXC_GPIO_AD_B0_01_GPIO1_IO01 { 31 pinmux = <0x401f80c0 5 0x0 0 0x401f8234>; 32 }; 33 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpt1_capture2: IOMUXC_GPIO_AD_B0_01_GPT1_CAPTURE2 { 34 pinmux = <0x401f80c0 7 0x0 0 0x401f8234>; 35 }; 36 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_jtag_tck: IOMUXC_GPIO_AD_B0_01_JTAG_TCK { 37 pinmux = <0x401f80c0 0 0x0 0 0x401f8234>; 38 }; 39 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_gpio1_io02: IOMUXC_GPIO_AD_B0_02_GPIO1_IO02 { 40 pinmux = <0x401f80c4 5 0x0 0 0x401f8238>; 41 }; 42 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_gpt1_capture1: IOMUXC_GPIO_AD_B0_02_GPT1_CAPTURE1 { 43 pinmux = <0x401f80c4 7 0x0 0 0x401f8238>; 44 }; 45 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_jtag_mod: IOMUXC_GPIO_AD_B0_02_JTAG_MOD { 46 pinmux = <0x401f80c4 0 0x0 0 0x401f8238>; 47 }; 48 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_ccm_pmic_rdy: IOMUXC_GPIO_AD_B0_03_CCM_PMIC_RDY { 49 pinmux = <0x401f80c8 7 0x401f8300 2 0x401f823c>; 50 }; 51 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_gpio1_io03: IOMUXC_GPIO_AD_B0_03_GPIO1_IO03 { 52 pinmux = <0x401f80c8 5 0x0 0 0x401f823c>; 53 }; 54 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_jtag_tdi: IOMUXC_GPIO_AD_B0_03_JTAG_TDI { 55 pinmux = <0x401f80c8 0 0x0 0 0x401f823c>; 56 }; 57 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_sai1_mclk: IOMUXC_GPIO_AD_B0_03_SAI1_MCLK { 58 pinmux = <0x401f80c8 3 0x401f8430 1 0x401f823c>; 59 }; 60 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_usb_otg1_oc: IOMUXC_GPIO_AD_B0_03_USB_OTG1_OC { 61 pinmux = <0x401f80c8 6 0x401f848c 0 0x401f823c>; 62 }; 63 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_wdog1_b: IOMUXC_GPIO_AD_B0_03_WDOG1_B { 64 pinmux = <0x401f80c8 2 0x0 0 0x401f823c>; 65 }; 66 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_ewm_out_b: IOMUXC_GPIO_AD_B0_04_EWM_OUT_B { 67 pinmux = <0x401f80cc 7 0x0 0 0x401f8240>; 68 }; 69 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_gpio1_io04: IOMUXC_GPIO_AD_B0_04_GPIO1_IO04 { 70 pinmux = <0x401f80cc 5 0x0 0 0x401f8240>; 71 }; 72 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_jtag_tdo: IOMUXC_GPIO_AD_B0_04_JTAG_TDO { 73 pinmux = <0x401f80cc 0 0x0 0 0x401f8240>; 74 }; 75 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_usb_otg1_pwr: IOMUXC_GPIO_AD_B0_04_USB_OTG1_PWR { 76 pinmux = <0x401f80cc 6 0x0 0 0x401f8240>; 77 }; 78 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_arm_nmi: IOMUXC_GPIO_AD_B0_05_ARM_NMI { 79 pinmux = <0x401f80d0 7 0x401f840c 0 0x401f8244>; 80 }; 81 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_gpio1_io05: IOMUXC_GPIO_AD_B0_05_GPIO1_IO05 { 82 pinmux = <0x401f80d0 5 0x0 0 0x401f8244>; 83 }; 84 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_jtag_trstb: IOMUXC_GPIO_AD_B0_05_JTAG_TRSTB { 85 pinmux = <0x401f80d0 0 0x0 0 0x401f8244>; 86 }; 87 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_usb_otg1_id: IOMUXC_GPIO_AD_B0_05_USB_OTG1_ID { 88 pinmux = <0x401f80d0 6 0x401f82fc 0 0x401f8244>; 89 }; 90 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_gpio1_io06: IOMUXC_GPIO_AD_B0_06_GPIO1_IO06 { 91 pinmux = <0x401f80d4 5 0x0 0 0x401f8248>; 92 }; 93 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_lpuart1_tx: IOMUXC_GPIO_AD_B0_06_LPUART1_TX { 94 pinmux = <0x401f80d4 2 0x0 0 0x401f8248>; 95 }; 96 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_mqs_right: IOMUXC_GPIO_AD_B0_06_MQS_RIGHT { 97 pinmux = <0x401f80d4 1 0x0 0 0x401f8248>; 98 }; 99 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_pit_trigger0: IOMUXC_GPIO_AD_B0_06_PIT_TRIGGER0 { 100 pinmux = <0x401f80d4 0 0x0 0 0x401f8248>; 101 }; 102 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_ref_32k_out: IOMUXC_GPIO_AD_B0_06_REF_32K_OUT { 103 pinmux = <0x401f80d4 6 0x0 0 0x401f8248>; 104 }; 105 /omit-if-no-ref/ iomuxc_gpio_ad_b0_07_gpio1_io07: IOMUXC_GPIO_AD_B0_07_GPIO1_IO07 { 106 pinmux = <0x401f80d8 5 0x0 0 0x401f824c>; 107 }; 108 /omit-if-no-ref/ iomuxc_gpio_ad_b0_07_lpuart1_rx: IOMUXC_GPIO_AD_B0_07_LPUART1_RX { 109 pinmux = <0x401f80d8 2 0x0 0 0x401f824c>; 110 }; 111 /omit-if-no-ref/ iomuxc_gpio_ad_b0_07_mqs_left: IOMUXC_GPIO_AD_B0_07_MQS_LEFT { 112 pinmux = <0x401f80d8 1 0x0 0 0x401f824c>; 113 }; 114 /omit-if-no-ref/ iomuxc_gpio_ad_b0_07_pit_trigger1: IOMUXC_GPIO_AD_B0_07_PIT_TRIGGER1 { 115 pinmux = <0x401f80d8 0 0x0 0 0x401f824c>; 116 }; 117 /omit-if-no-ref/ iomuxc_gpio_ad_b0_07_ref_24m_out: IOMUXC_GPIO_AD_B0_07_REF_24M_OUT { 118 pinmux = <0x401f80d8 6 0x0 0 0x401f824c>; 119 }; 120 /omit-if-no-ref/ iomuxc_gpio_ad_b0_08_arm_cm7_txev: IOMUXC_GPIO_AD_B0_08_ARM_CM7_TXEV { 121 pinmux = <0x401f80dc 6 0x0 0 0x401f8250>; 122 }; 123 /omit-if-no-ref/ iomuxc_gpio_ad_b0_08_gpio1_io08: IOMUXC_GPIO_AD_B0_08_GPIO1_IO08 { 124 pinmux = <0x401f80dc 5 0x0 0 0x401f8250>; 125 }; 126 /omit-if-no-ref/ iomuxc_gpio_ad_b0_08_kpp_col0: IOMUXC_GPIO_AD_B0_08_KPP_COL0 { 127 pinmux = <0x401f80dc 3 0x0 0 0x401f8250>; 128 }; 129 /omit-if-no-ref/ iomuxc_gpio_ad_b0_08_lpuart1_cts_b: IOMUXC_GPIO_AD_B0_08_LPUART1_CTS_B { 130 pinmux = <0x401f80dc 2 0x0 0 0x401f8250>; 131 }; 132 /omit-if-no-ref/ iomuxc_gpio_ad_b0_09_arm_cm7_rxev: IOMUXC_GPIO_AD_B0_09_ARM_CM7_RXEV { 133 pinmux = <0x401f80e0 6 0x0 0 0x401f8254>; 134 }; 135 /omit-if-no-ref/ iomuxc_gpio_ad_b0_09_gpio1_io09: IOMUXC_GPIO_AD_B0_09_GPIO1_IO09 { 136 pinmux = <0x401f80e0 5 0x0 0 0x401f8254>; 137 }; 138 /omit-if-no-ref/ iomuxc_gpio_ad_b0_09_kpp_row0: IOMUXC_GPIO_AD_B0_09_KPP_ROW0 { 139 pinmux = <0x401f80e0 3 0x0 0 0x401f8254>; 140 }; 141 /omit-if-no-ref/ iomuxc_gpio_ad_b0_09_lpuart1_rts_b: IOMUXC_GPIO_AD_B0_09_LPUART1_RTS_B { 142 pinmux = <0x401f80e0 2 0x0 0 0x401f8254>; 143 }; 144 /omit-if-no-ref/ iomuxc_gpio_ad_b0_10_gpio1_io10: IOMUXC_GPIO_AD_B0_10_GPIO1_IO10 { 145 pinmux = <0x401f80e4 5 0x0 0 0x401f8258>; 146 }; 147 /omit-if-no-ref/ iomuxc_gpio_ad_b0_10_kpp_col1: IOMUXC_GPIO_AD_B0_10_KPP_COL1 { 148 pinmux = <0x401f80e4 3 0x0 0 0x401f8258>; 149 }; 150 /omit-if-no-ref/ iomuxc_gpio_ad_b0_10_lpspi1_sck: IOMUXC_GPIO_AD_B0_10_LPSPI1_SCK { 151 pinmux = <0x401f80e4 1 0x401f83a0 1 0x401f8258>; 152 }; 153 /omit-if-no-ref/ iomuxc_gpio_ad_b0_11_gpio1_io11: IOMUXC_GPIO_AD_B0_11_GPIO1_IO11 { 154 pinmux = <0x401f80e8 5 0x0 0 0x401f825c>; 155 }; 156 /omit-if-no-ref/ iomuxc_gpio_ad_b0_11_kpp_row1: IOMUXC_GPIO_AD_B0_11_KPP_ROW1 { 157 pinmux = <0x401f80e8 3 0x0 0 0x401f825c>; 158 }; 159 /omit-if-no-ref/ iomuxc_gpio_ad_b0_11_lpspi1_pcs0: IOMUXC_GPIO_AD_B0_11_LPSPI1_PCS0 { 160 pinmux = <0x401f80e8 1 0x401f839c 1 0x401f825c>; 161 }; 162 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_adc1_in0: IOMUXC_GPIO_AD_B0_12_ADC1_IN0 { 163 pinmux = <0x401f80ec 5 0x0 0 0x401f8260>; 164 }; 165 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_gpio1_io12: IOMUXC_GPIO_AD_B0_12_GPIO1_IO12 { 166 pinmux = <0x401f80ec 5 0x0 0 0x401f8260>; 167 }; 168 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_kpp_col2: IOMUXC_GPIO_AD_B0_12_KPP_COL2 { 169 pinmux = <0x401f80ec 3 0x0 0 0x401f8260>; 170 }; 171 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_lpspi1_sdo: IOMUXC_GPIO_AD_B0_12_LPSPI1_SDO { 172 pinmux = <0x401f80ec 1 0x401f83a8 1 0x401f8260>; 173 }; 174 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_lpuart3_cts_b: IOMUXC_GPIO_AD_B0_12_LPUART3_CTS_B { 175 pinmux = <0x401f80ec 2 0x0 0 0x401f8260>; 176 }; 177 /omit-if-no-ref/ iomuxc_gpio_ad_b0_12_snvs_vio_5_ctl: IOMUXC_GPIO_AD_B0_12_SNVS_VIO_5_CTL { 178 pinmux = <0x401f80ec 7 0x0 0 0x401f8260>; 179 }; 180 /omit-if-no-ref/ iomuxc_gpio_ad_b0_13_gpio1_io13: IOMUXC_GPIO_AD_B0_13_GPIO1_IO13 { 181 pinmux = <0x401f80f0 5 0x0 0 0x401f8264>; 182 }; 183 /omit-if-no-ref/ iomuxc_gpio_ad_b0_13_kpp_row2: IOMUXC_GPIO_AD_B0_13_KPP_ROW2 { 184 pinmux = <0x401f80f0 3 0x0 0 0x401f8264>; 185 }; 186 /omit-if-no-ref/ iomuxc_gpio_ad_b0_13_lpspi1_sdi: IOMUXC_GPIO_AD_B0_13_LPSPI1_SDI { 187 pinmux = <0x401f80f0 1 0x401f83a4 1 0x401f8264>; 188 }; 189 /omit-if-no-ref/ iomuxc_gpio_ad_b0_13_lpuart3_rts_b: IOMUXC_GPIO_AD_B0_13_LPUART3_RTS_B { 190 pinmux = <0x401f80f0 2 0x0 0 0x401f8264>; 191 }; 192 /omit-if-no-ref/ iomuxc_gpio_ad_b0_13_snvs_vio_5_b: IOMUXC_GPIO_AD_B0_13_SNVS_VIO_5_B { 193 pinmux = <0x401f80f0 7 0x0 0 0x401f8264>; 194 }; 195 /omit-if-no-ref/ iomuxc_gpio_ad_b0_14_adc1_in1: IOMUXC_GPIO_AD_B0_14_ADC1_IN1 { 196 pinmux = <0x401f80f4 5 0x0 0 0x401f8268>; 197 }; 198 /omit-if-no-ref/ iomuxc_gpio_ad_b0_14_gpio1_io14: IOMUXC_GPIO_AD_B0_14_GPIO1_IO14 { 199 pinmux = <0x401f80f4 5 0x0 0 0x401f8268>; 200 }; 201 /omit-if-no-ref/ iomuxc_gpio_ad_b0_14_kpp_col3: IOMUXC_GPIO_AD_B0_14_KPP_COL3 { 202 pinmux = <0x401f80f4 3 0x0 0 0x401f8268>; 203 }; 204 /omit-if-no-ref/ iomuxc_gpio_ad_b0_14_lpuart3_tx: IOMUXC_GPIO_AD_B0_14_LPUART3_TX { 205 pinmux = <0x401f80f4 2 0x401f83dc 1 0x401f8268>; 206 }; 207 /omit-if-no-ref/ iomuxc_gpio_ad_b0_14_wdog1_any: IOMUXC_GPIO_AD_B0_14_WDOG1_ANY { 208 pinmux = <0x401f80f4 7 0x0 0 0x401f8268>; 209 }; 210 /omit-if-no-ref/ iomuxc_gpio_ad_b0_15_adc1_in2: IOMUXC_GPIO_AD_B0_15_ADC1_IN2 { 211 pinmux = <0x401f80f8 5 0x0 0 0x401f826c>; 212 }; 213 /omit-if-no-ref/ iomuxc_gpio_ad_b0_15_gpio1_io15: IOMUXC_GPIO_AD_B0_15_GPIO1_IO15 { 214 pinmux = <0x401f80f8 5 0x0 0 0x401f826c>; 215 }; 216 /omit-if-no-ref/ iomuxc_gpio_ad_b0_15_kpp_row3: IOMUXC_GPIO_AD_B0_15_KPP_ROW3 { 217 pinmux = <0x401f80f8 3 0x0 0 0x401f826c>; 218 }; 219 /omit-if-no-ref/ iomuxc_gpio_ad_b0_15_lpuart3_rx: IOMUXC_GPIO_AD_B0_15_LPUART3_RX { 220 pinmux = <0x401f80f8 2 0x401f83d8 1 0x401f826c>; 221 }; 222 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_adc1_in10: IOMUXC_GPIO_AD_B1_10_ADC1_IN10 { 223 pinmux = <0x401f8124 5 0x0 0 0x401f8298>; 224 }; 225 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_flexio1_flexio05: IOMUXC_GPIO_AD_B1_10_FLEXIO1_FLEXIO05 { 226 pinmux = <0x401f8124 4 0x0 0 0x401f8298>; 227 }; 228 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_flexpwm1_pwma2: IOMUXC_GPIO_AD_B1_10_FLEXPWM1_PWMA2 { 229 pinmux = <0x401f8124 1 0x401f8330 0 0x401f8298>; 230 }; 231 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_gpio1_io26: IOMUXC_GPIO_AD_B1_10_GPIO1_IO26 { 232 pinmux = <0x401f8124 5 0x0 0 0x401f8298>; 233 }; 234 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_gpt2_capture1: IOMUXC_GPIO_AD_B1_10_GPT2_CAPTURE1 { 235 pinmux = <0x401f8124 6 0x0 0 0x401f8298>; 236 }; 237 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_lpuart4_tx: IOMUXC_GPIO_AD_B1_10_LPUART4_TX { 238 pinmux = <0x401f8124 2 0x401f83e8 1 0x401f8298>; 239 }; 240 /omit-if-no-ref/ iomuxc_gpio_ad_b1_10_usb_otg1_pwr: IOMUXC_GPIO_AD_B1_10_USB_OTG1_PWR { 241 pinmux = <0x401f8124 0 0x0 0 0x401f8298>; 242 }; 243 /omit-if-no-ref/ iomuxc_gpio_ad_b1_11_adc1_in11: IOMUXC_GPIO_AD_B1_11_ADC1_IN11 { 244 pinmux = <0x401f8128 5 0x0 0 0x401f829c>; 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