1/* 2 * Copyright 2025 NXP 3 * SPDX-License-Identifier: Apache-2.0 4 * 5 * Note: File generated by gen_soc_headers.py 6 * from configuration data for MIMX9131CVVXJ 7 */ 8 9/* 10 * SOC level pinctrl defintions 11 * These definitions define SOC level defaults for each pin, 12 * and select the pinmux for the pin. Pinmux entries are a tuple of: 13 * <mux_register mux_mode input_register input_daisy config_register> 14 * the mux_register and input_daisy reside in the IOMUXC peripheral, and 15 * the pinctrl driver will write the mux_mode and input_daisy values into 16 * each register, respectively. The config_register is used to configure 17 * the pin based on the devicetree properties set 18 */ 19 20&iomuxc { 21 /omit-if-no-ref/ iomuxc1_ccm_clko1_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko1: IOMUXC1_CCM_CLKO1_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO1 { 22 pinmux = <0x443c0088 0 0x0 0 0x443c0238>; 23 }; 24 /omit-if-no-ref/ iomuxc1_ccm_clko1_flexio_flexio_flexio1_flexio26: IOMUXC1_CCM_CLKO1_FLEXIO_FLEXIO_FLEXIO1_FLEXIO26 { 25 pinmux = <0x443c0088 4 0x0 0 0x443c0238>; 26 }; 27 /omit-if-no-ref/ iomuxc1_ccm_clko1_gpio_io_gpio3_io26: IOMUXC1_CCM_CLKO1_GPIO_IO_GPIO3_IO26 { 28 pinmux = <0x443c0088 5 0x0 0 0x443c0238>; 29 }; 30 /omit-if-no-ref/ iomuxc1_ccm_clko2_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko2: IOMUXC1_CCM_CLKO2_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO2 { 31 pinmux = <0x443c008c 0 0x0 0 0x443c023c>; 32 }; 33 /omit-if-no-ref/ iomuxc1_ccm_clko2_flexio_flexio_flexio1_flexio27: IOMUXC1_CCM_CLKO2_FLEXIO_FLEXIO_FLEXIO1_FLEXIO27 { 34 pinmux = <0x443c008c 4 0x443c03c8 1 0x443c023c>; 35 }; 36 /omit-if-no-ref/ iomuxc1_ccm_clko2_gpio_io_gpio3_io27: IOMUXC1_CCM_CLKO2_GPIO_IO_GPIO3_IO27 { 37 pinmux = <0x443c008c 5 0x0 0 0x443c023c>; 38 }; 39 /omit-if-no-ref/ iomuxc1_ccm_clko3_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko3: IOMUXC1_CCM_CLKO3_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO3 { 40 pinmux = <0x443c0090 0 0x0 0 0x443c0240>; 41 }; 42 /omit-if-no-ref/ iomuxc1_ccm_clko3_flexio_flexio_flexio2_flexio28: IOMUXC1_CCM_CLKO3_FLEXIO_FLEXIO_FLEXIO2_FLEXIO28 { 43 pinmux = <0x443c0090 4 0x0 0 0x443c0240>; 44 }; 45 /omit-if-no-ref/ iomuxc1_ccm_clko3_gpio_io_gpio4_io28: IOMUXC1_CCM_CLKO3_GPIO_IO_GPIO4_IO28 { 46 pinmux = <0x443c0090 5 0x0 0 0x443c0240>; 47 }; 48 /omit-if-no-ref/ iomuxc1_ccm_clko4_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko4: IOMUXC1_CCM_CLKO4_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO4 { 49 pinmux = <0x443c0094 0 0x0 0 0x443c0244>; 50 }; 51 /omit-if-no-ref/ iomuxc1_ccm_clko4_flexio_flexio_flexio2_flexio29: IOMUXC1_CCM_CLKO4_FLEXIO_FLEXIO_FLEXIO2_FLEXIO29 { 52 pinmux = <0x443c0094 4 0x0 0 0x443c0244>; 53 }; 54 /omit-if-no-ref/ iomuxc1_ccm_clko4_gpio_io_gpio4_io29: IOMUXC1_CCM_CLKO4_GPIO_IO_GPIO4_IO29 { 55 pinmux = <0x443c0094 5 0x0 0 0x443c0244>; 56 }; 57 /omit-if-no-ref/ iomuxc1_dap_tclk_swclk_flexio_flexio_flexio1_flexio30: IOMUXC1_DAP_TCLK_SWCLK_FLEXIO_FLEXIO_FLEXIO1_FLEXIO30 { 58 pinmux = <0x443c0008 4 0x0 0 0x443c01b8>; 59 }; 60 /omit-if-no-ref/ iomuxc1_dap_tclk_swclk_gpio_io_gpio3_io30: IOMUXC1_DAP_TCLK_SWCLK_GPIO_IO_GPIO3_IO30 { 61 pinmux = <0x443c0008 5 0x0 0 0x443c01b8>; 62 }; 63 /omit-if-no-ref/ iomuxc1_dap_tclk_swclk_jtag_mux_tck_jtag_mux_tck: IOMUXC1_DAP_TCLK_SWCLK_JTAG_MUX_TCK_JTAG_MUX_TCK { 64 pinmux = <0x443c0008 0 0x443c03d4 0 0x443c01b8>; 65 }; 66 /omit-if-no-ref/ iomuxc1_dap_tclk_swclk_lpuart_cts_b_lpuart5_cts_b: IOMUXC1_DAP_TCLK_SWCLK_LPUART_CTS_B_LPUART5_CTS_B { 67 pinmux = <0x443c0008 6 0x443c0484 0 0x443c01b8>; 68 }; 69 /omit-if-no-ref/ iomuxc1_dap_tdi_can_tx_can2_tx: IOMUXC1_DAP_TDI_CAN_TX_CAN2_TX { 70 pinmux = <0x443c0000 3 0x0 0 0x443c01b0>; 71 }; 72 /omit-if-no-ref/ iomuxc1_dap_tdi_flexio_flexio_flexio2_flexio30: IOMUXC1_DAP_TDI_FLEXIO_FLEXIO_FLEXIO2_FLEXIO30 { 73 pinmux = <0x443c0000 4 0x0 0 0x443c01b0>; 74 }; 75 /omit-if-no-ref/ iomuxc1_dap_tdi_gpio_io_gpio3_io28: IOMUXC1_DAP_TDI_GPIO_IO_GPIO3_IO28 { 76 pinmux = <0x443c0000 5 0x0 0 0x443c01b0>; 77 }; 78 /omit-if-no-ref/ iomuxc1_dap_tdi_jtag_mux_tdi_jtag_mux_tdi: IOMUXC1_DAP_TDI_JTAG_MUX_TDI_JTAG_MUX_TDI { 79 pinmux = <0x443c0000 0 0x443c03d8 0 0x443c01b0>; 80 }; 81 /omit-if-no-ref/ iomuxc1_dap_tdi_lpuart_rx_lpuart5_rx: IOMUXC1_DAP_TDI_LPUART_RX_LPUART5_RX { 82 pinmux = <0x443c0000 6 0x443c0488 0 0x443c01b0>; 83 }; 84 /omit-if-no-ref/ iomuxc1_dap_tdi_mqs_left_mqs2_left: IOMUXC1_DAP_TDI_MQS_LEFT_MQS2_LEFT { 85 pinmux = <0x443c0000 1 0x0 0 0x443c01b0>; 86 }; 87 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_can_rx_can2_rx: IOMUXC1_DAP_TDO_TRACESWO_CAN_RX_CAN2_RX { 88 pinmux = <0x443c000c 3 0x443c0364 0 0x443c01bc>; 89 }; 90 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_flexio_flexio_flexio1_flexio31: IOMUXC1_DAP_TDO_TRACESWO_FLEXIO_FLEXIO_FLEXIO1_FLEXIO31 { 91 pinmux = <0x443c000c 4 0x0 0 0x443c01bc>; 92 }; 93 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_gpio_io_gpio3_io31: IOMUXC1_DAP_TDO_TRACESWO_GPIO_IO_GPIO3_IO31 { 94 pinmux = <0x443c000c 5 0x0 0 0x443c01bc>; 95 }; 96 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_jtag_mux_tdo_jtag_mux_tdo: IOMUXC1_DAP_TDO_TRACESWO_JTAG_MUX_TDO_JTAG_MUX_TDO { 97 pinmux = <0x443c000c 0 0x0 0 0x443c01bc>; 98 }; 99 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_lpuart_tx_lpuart5_tx: IOMUXC1_DAP_TDO_TRACESWO_LPUART_TX_LPUART5_TX { 100 pinmux = <0x443c000c 6 0x443c048c 0 0x443c01bc>; 101 }; 102 /omit-if-no-ref/ iomuxc1_dap_tdo_traceswo_mqs_right_mqs2_right: IOMUXC1_DAP_TDO_TRACESWO_MQS_RIGHT_MQS2_RIGHT { 103 pinmux = <0x443c000c 1 0x0 0 0x443c01bc>; 104 }; 105 /omit-if-no-ref/ iomuxc1_dap_tms_swdio_flexio_flexio_flexio2_flexio31: IOMUXC1_DAP_TMS_SWDIO_FLEXIO_FLEXIO_FLEXIO2_FLEXIO31 { 106 pinmux = <0x443c0004 4 0x0 0 0x443c01b4>; 107 }; 108 /omit-if-no-ref/ iomuxc1_dap_tms_swdio_gpio_io_gpio3_io29: IOMUXC1_DAP_TMS_SWDIO_GPIO_IO_GPIO3_IO29 { 109 pinmux = <0x443c0004 5 0x0 0 0x443c01b4>; 110 }; 111 /omit-if-no-ref/ iomuxc1_dap_tms_swdio_jtag_mux_tms_jtag_mux_tms: IOMUXC1_DAP_TMS_SWDIO_JTAG_MUX_TMS_JTAG_MUX_TMS { 112 pinmux = <0x443c0004 0 0x443c03dc 0 0x443c01b4>; 113 }; 114 /omit-if-no-ref/ iomuxc1_dap_tms_swdio_lpuart_rts_b_lpuart5_rts_b: IOMUXC1_DAP_TMS_SWDIO_LPUART_RTS_B_LPUART5_RTS_B { 115 pinmux = <0x443c0004 6 0x0 0 0x443c01b4>; 116 }; 117 /omit-if-no-ref/ iomuxc1_enet1_mdc_enet_qos_mdc_enet_qos_mdc: IOMUXC1_ENET1_MDC_ENET_QOS_MDC_ENET_QOS_MDC { 118 pinmux = <0x443c0098 0 0x0 0 0x443c0248>; 119 }; 120 /omit-if-no-ref/ iomuxc1_enet1_mdc_flexio_flexio_flexio2_flexio0: IOMUXC1_ENET1_MDC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO0 { 121 pinmux = <0x443c0098 4 0x0 0 0x443c0248>; 122 }; 123 /omit-if-no-ref/ iomuxc1_enet1_mdc_gpio_io_gpio4_io0: IOMUXC1_ENET1_MDC_GPIO_IO_GPIO4_IO0 { 124 pinmux = <0x443c0098 5 0x0 0 0x443c0248>; 125 }; 126 /omit-if-no-ref/ iomuxc1_enet1_mdc_hsiomix_otg_id_hsiomix_otg_id1: IOMUXC1_ENET1_MDC_HSIOMIX_OTG_ID_HSIOMIX_OTG_ID1 { 127 pinmux = <0x443c0098 3 0x0 0 0x443c0248>; 128 }; 129 /omit-if-no-ref/ iomuxc1_enet1_mdc_i3c_scl_i3c2_scl: IOMUXC1_ENET1_MDC_I3C_SCL_I3C2_SCL { 130 pinmux = <0x443c0098 2 0x443c03cc 0 0x443c0248>; 131 }; 132 /omit-if-no-ref/ iomuxc1_enet1_mdc_lpi2c_scl_lpi2c1_scl: IOMUXC1_ENET1_MDC_LPI2C_SCL_LPI2C1_SCL { 133 pinmux = <0x443c0098 6 0x443c03e0 0 0x443c0248>; 134 }; 135 /omit-if-no-ref/ iomuxc1_enet1_mdc_lpuart_dcb_b_lpuart3_dcb_b: IOMUXC1_ENET1_MDC_LPUART_DCB_B_LPUART3_DCB_B { 136 pinmux = <0x443c0098 1 0x0 0 0x443c0248>; 137 }; 138 /omit-if-no-ref/ iomuxc1_enet1_mdio_enet_qos_mdio_enet_qos_mdio: IOMUXC1_ENET1_MDIO_ENET_QOS_MDIO_ENET_QOS_MDIO { 139 pinmux = <0x443c009c 0 0x0 0 0x443c024c>; 140 }; 141 /omit-if-no-ref/ iomuxc1_enet1_mdio_flexio_flexio_flexio2_flexio1: IOMUXC1_ENET1_MDIO_FLEXIO_FLEXIO_FLEXIO2_FLEXIO1 { 142 pinmux = <0x443c009c 4 0x0 0 0x443c024c>; 143 }; 144 /omit-if-no-ref/ iomuxc1_enet1_mdio_gpio_io_gpio4_io1: IOMUXC1_ENET1_MDIO_GPIO_IO_GPIO4_IO1 { 145 pinmux = <0x443c009c 5 0x0 0 0x443c024c>; 146 }; 147 /omit-if-no-ref/ iomuxc1_enet1_mdio_hsiomix_otg_pwr_hsiomix_otg_pwr1: IOMUXC1_ENET1_MDIO_HSIOMIX_OTG_PWR_HSIOMIX_OTG_PWR1 { 148 pinmux = <0x443c009c 3 0x0 0 0x443c024c>; 149 }; 150 /omit-if-no-ref/ iomuxc1_enet1_mdio_i3c_sda_i3c2_sda: IOMUXC1_ENET1_MDIO_I3C_SDA_I3C2_SDA { 151 pinmux = <0x443c009c 2 0x443c03d0 0 0x443c024c>; 152 }; 153 /omit-if-no-ref/ iomuxc1_enet1_mdio_lpi2c_sda_lpi2c1_sda: IOMUXC1_ENET1_MDIO_LPI2C_SDA_LPI2C1_SDA { 154 pinmux = <0x443c009c 6 0x443c03e4 0 0x443c024c>; 155 }; 156 /omit-if-no-ref/ iomuxc1_enet1_mdio_lpuart_rin_b_lpuart3_rin_b: IOMUXC1_ENET1_MDIO_LPUART_RIN_B_LPUART3_RIN_B { 157 pinmux = <0x443c009c 1 0x0 0 0x443c024c>; 158 }; 159 /omit-if-no-ref/ iomuxc1_enet1_rd0_enet_qos_rgmii_rd_enet_qos_rgmii_rd0: IOMUXC1_ENET1_RD0_ENET_QOS_RGMII_RD_ENET_QOS_RGMII_RD0 { 160 pinmux = <0x443c00c0 0 0x0 0 0x443c0270>; 161 }; 162 /omit-if-no-ref/ iomuxc1_enet1_rd0_flexio_flexio_flexio2_flexio10: IOMUXC1_ENET1_RD0_FLEXIO_FLEXIO_FLEXIO2_FLEXIO10 { 163 pinmux = <0x443c00c0 4 0x0 0 0x443c0270>; 164 }; 165 /omit-if-no-ref/ iomuxc1_enet1_rd0_gpio_io_gpio4_io10: IOMUXC1_ENET1_RD0_GPIO_IO_GPIO4_IO10 { 166 pinmux = <0x443c00c0 5 0x0 0 0x443c0270>; 167 }; 168 /omit-if-no-ref/ iomuxc1_enet1_rd0_lpuart_rx_lpuart3_rx: IOMUXC1_ENET1_RD0_LPUART_RX_LPUART3_RX { 169 pinmux = <0x443c00c0 1 0x443c0470 1 0x443c0270>; 170 }; 171 /omit-if-no-ref/ iomuxc1_enet1_rd1_enet_qos_rgmii_rd_enet_qos_rgmii_rd1: IOMUXC1_ENET1_RD1_ENET_QOS_RGMII_RD_ENET_QOS_RGMII_RD1 { 172 pinmux = <0x443c00c4 0 0x0 0 0x443c0274>; 173 }; 174 /omit-if-no-ref/ iomuxc1_enet1_rd1_flexio_flexio_flexio2_flexio11: IOMUXC1_ENET1_RD1_FLEXIO_FLEXIO_FLEXIO2_FLEXIO11 { 175 pinmux = <0x443c00c4 4 0x0 0 0x443c0274>; 176 }; 177 /omit-if-no-ref/ iomuxc1_enet1_rd1_gpio_io_gpio4_io11: IOMUXC1_ENET1_RD1_GPIO_IO_GPIO4_IO11 { 178 pinmux = <0x443c00c4 5 0x0 0 0x443c0274>; 179 }; 180 /omit-if-no-ref/ iomuxc1_enet1_rd1_lptmr_alt_lptmr2_alt1: IOMUXC1_ENET1_RD1_LPTMR_ALT_LPTMR2_ALT1 { 181 pinmux = <0x443c00c4 3 0x443c0448 0 0x443c0274>; 182 }; 183 /omit-if-no-ref/ iomuxc1_enet1_rd1_lpuart_cts_b_lpuart3_cts_b: IOMUXC1_ENET1_RD1_LPUART_CTS_B_LPUART3_CTS_B { 184 pinmux = <0x443c00c4 1 0x443c046c 1 0x443c0274>; 185 }; 186 /omit-if-no-ref/ iomuxc1_enet1_rd2_enet_qos_rgmii_rd_enet_qos_rgmii_rd2: IOMUXC1_ENET1_RD2_ENET_QOS_RGMII_RD_ENET_QOS_RGMII_RD2 { 187 pinmux = <0x443c00c8 0 0x0 0 0x443c0278>; 188 }; 189 /omit-if-no-ref/ iomuxc1_enet1_rd2_flexio_flexio_flexio2_flexio12: IOMUXC1_ENET1_RD2_FLEXIO_FLEXIO_FLEXIO2_FLEXIO12 { 190 pinmux = <0x443c00c8 4 0x0 0 0x443c0278>; 191 }; 192 /omit-if-no-ref/ iomuxc1_enet1_rd2_gpio_io_gpio4_io12: IOMUXC1_ENET1_RD2_GPIO_IO_GPIO4_IO12 { 193 pinmux = <0x443c00c8 5 0x0 0 0x443c0278>; 194 }; 195 /omit-if-no-ref/ iomuxc1_enet1_rd2_lptmr_alt_lptmr2_alt2: IOMUXC1_ENET1_RD2_LPTMR_ALT_LPTMR2_ALT2 { 196 pinmux = <0x443c00c8 3 0x443c044c 0 0x443c0278>; 197 }; 198 /omit-if-no-ref/ iomuxc1_enet1_rd3_enet_qos_rgmii_rd_enet_qos_rgmii_rd3: IOMUXC1_ENET1_RD3_ENET_QOS_RGMII_RD_ENET_QOS_RGMII_RD3 { 199 pinmux = <0x443c00cc 0 0x0 0 0x443c027c>; 200 }; 201 /omit-if-no-ref/ iomuxc1_enet1_rd3_flexio_flexio_flexio2_flexio13: IOMUXC1_ENET1_RD3_FLEXIO_FLEXIO_FLEXIO2_FLEXIO13 { 202 pinmux = <0x443c00cc 4 0x0 0 0x443c027c>; 203 }; 204 /omit-if-no-ref/ iomuxc1_enet1_rd3_gpio_io_gpio4_io13: IOMUXC1_ENET1_RD3_GPIO_IO_GPIO4_IO13 { 205 pinmux = <0x443c00cc 5 0x0 0 0x443c027c>; 206 }; 207 /omit-if-no-ref/ iomuxc1_enet1_rd3_lptmr_alt_lptmr2_alt3: IOMUXC1_ENET1_RD3_LPTMR_ALT_LPTMR2_ALT3 { 208 pinmux = <0x443c00cc 3 0x443c0450 0 0x443c027c>; 209 }; 210 /omit-if-no-ref/ iomuxc1_enet1_rxc_enet_qos_rgmii_rxc_enet_qos_rgmii_rxc: IOMUXC1_ENET1_RXC_ENET_QOS_RGMII_RXC_ENET_QOS_RGMII_RXC { 211 pinmux = <0x443c00bc 0 0x0 0 0x443c026c>; 212 }; 213 /omit-if-no-ref/ iomuxc1_enet1_rxc_enet_qos_rx_er_enet_qos_rx_er: IOMUXC1_ENET1_RXC_ENET_QOS_RX_ER_ENET_QOS_RX_ER { 214 pinmux = <0x443c00bc 1 0x0 0 0x443c026c>; 215 }; 216 /omit-if-no-ref/ iomuxc1_enet1_rxc_flexio_flexio_flexio2_flexio9: IOMUXC1_ENET1_RXC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO9 { 217 pinmux = <0x443c00bc 4 0x0 0 0x443c026c>; 218 }; 219 /omit-if-no-ref/ iomuxc1_enet1_rxc_gpio_io_gpio4_io9: IOMUXC1_ENET1_RXC_GPIO_IO_GPIO4_IO9 { 220 pinmux = <0x443c00bc 5 0x0 0 0x443c026c>; 221 }; 222 /omit-if-no-ref/ iomuxc1_enet1_rxc_lpspi_sout_lpspi2_sout: IOMUXC1_ENET1_RXC_LPSPI_SOUT_LPSPI2_SOUT { 223 pinmux = <0x443c00bc 2 0x443c0444 0 0x443c026c>; 224 }; 225 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_enet_qos_rgmii_rx_ctl_enet_qos_rgmii_rx_ctl: IOMUXC1_ENET1_RX_CTL_ENET_QOS_RGMII_RX_CTL_ENET_QOS_RGMII_RX_CTL { 226 pinmux = <0x443c00b8 0 0x0 0 0x443c0268>; 227 }; 228 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_flexio_flexio_flexio2_flexio8: IOMUXC1_ENET1_RX_CTL_FLEXIO_FLEXIO_FLEXIO2_FLEXIO8 { 229 pinmux = <0x443c00b8 4 0x0 0 0x443c0268>; 230 }; 231 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_gpio_io_gpio4_io8: IOMUXC1_ENET1_RX_CTL_GPIO_IO_GPIO4_IO8 { 232 pinmux = <0x443c00b8 5 0x0 0 0x443c0268>; 233 }; 234 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_hsiomix_otg_pwr_hsiomix_otg_pwr2: IOMUXC1_ENET1_RX_CTL_HSIOMIX_OTG_PWR_HSIOMIX_OTG_PWR2 { 235 pinmux = <0x443c00b8 3 0x0 0 0x443c0268>; 236 }; 237 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_lpspi_pcs_lpspi2_pcs0: IOMUXC1_ENET1_RX_CTL_LPSPI_PCS_LPSPI2_PCS0 { 238 pinmux = <0x443c00b8 2 0x443c0434 0 0x443c0268>; 239 }; 240 /omit-if-no-ref/ iomuxc1_enet1_rx_ctl_lpuart_dsr_b_lpuart3_dsr_b: IOMUXC1_ENET1_RX_CTL_LPUART_DSR_B_LPUART3_DSR_B { 241 pinmux = <0x443c00b8 1 0x0 0 0x443c0268>; 242 }; 243 /omit-if-no-ref/ iomuxc1_enet1_td0_enet_qos_rgmii_td_enet_qos_rgmii_td0: IOMUXC1_ENET1_TD0_ENET_QOS_RGMII_TD_ENET_QOS_RGMII_TD0 { 244 pinmux = <0x443c00ac 0 0x0 0 0x443c025c>; 245 }; 246 /omit-if-no-ref/ iomuxc1_enet1_td0_flexio_flexio_flexio2_flexio5: IOMUXC1_ENET1_TD0_FLEXIO_FLEXIO_FLEXIO2_FLEXIO5 { 247 pinmux = <0x443c00ac 4 0x0 0 0x443c025c>; 248 }; 249 /omit-if-no-ref/ iomuxc1_enet1_td0_gpio_io_gpio4_io5: IOMUXC1_ENET1_TD0_GPIO_IO_GPIO4_IO5 { 250 pinmux = <0x443c00ac 5 0x0 0 0x443c025c>; 251 }; 252 /omit-if-no-ref/ iomuxc1_enet1_td0_lpuart_tx_lpuart3_tx: IOMUXC1_ENET1_TD0_LPUART_TX_LPUART3_TX { 253 pinmux = <0x443c00ac 1 0x443c0474 1 0x443c025c>; 254 }; 255 /omit-if-no-ref/ iomuxc1_enet1_td1_enet_qos_rgmii_td_enet_qos_rgmii_td1: IOMUXC1_ENET1_TD1_ENET_QOS_RGMII_TD_ENET_QOS_RGMII_TD1 { 256 pinmux = <0x443c00a8 0 0x0 0 0x443c0258>; 257 }; 258 /omit-if-no-ref/ iomuxc1_enet1_td1_flexio_flexio_flexio2_flexio4: IOMUXC1_ENET1_TD1_FLEXIO_FLEXIO_FLEXIO2_FLEXIO4 { 259 pinmux = <0x443c00a8 4 0x0 0 0x443c0258>; 260 }; 261 /omit-if-no-ref/ iomuxc1_enet1_td1_gpio_io_gpio4_io4: IOMUXC1_ENET1_TD1_GPIO_IO_GPIO4_IO4 { 262 pinmux = <0x443c00a8 5 0x0 0 0x443c0258>; 263 }; 264 /omit-if-no-ref/ iomuxc1_enet1_td1_hsiomix_otg_oc_hsiomix_otg_oc1: IOMUXC1_ENET1_TD1_HSIOMIX_OTG_OC_HSIOMIX_OTG_OC1 { 265 pinmux = <0x443c00a8 3 0x0 0 0x443c0258>; 266 }; 267 /omit-if-no-ref/ iomuxc1_enet1_td1_i3c_pur_b_i3c2_pur_b: IOMUXC1_ENET1_TD1_I3C_PUR_B_I3C2_PUR_B { 268 pinmux = <0x443c00a8 6 0x0 0 0x443c0258>; 269 }; 270 /omit-if-no-ref/ iomuxc1_enet1_td1_i3c_pur_i3c2_pur: IOMUXC1_ENET1_TD1_I3C_PUR_I3C2_PUR { 271 pinmux = <0x443c00a8 2 0x0 0 0x443c0258>; 272 }; 273 /omit-if-no-ref/ iomuxc1_enet1_td1_lpuart_rts_b_lpuart3_rts_b: IOMUXC1_ENET1_TD1_LPUART_RTS_B_LPUART3_RTS_B { 274 pinmux = <0x443c00a8 1 0x0 0 0x443c0258>; 275 }; 276 /omit-if-no-ref/ iomuxc1_enet1_td2_can_rx_can2_rx: IOMUXC1_ENET1_TD2_CAN_RX_CAN2_RX { 277 pinmux = <0x443c00a4 2 0x443c0364 2 0x443c0254>; 278 }; 279 /omit-if-no-ref/ iomuxc1_enet1_td2_enet_qos_clock_generate_clk_enet_qos_clock_generate_clk: IOMUXC1_ENET1_TD2_ENET_QOS_CLOCK_GENERATE_CLK_ENET_QOS_CLOCK_GENERATE_CLK { 280 pinmux = <0x443c00a4 1 0x0 0 0x443c0254>; 281 }; 282 /omit-if-no-ref/ iomuxc1_enet1_td2_enet_qos_rgmii_td_enet_qos_rgmii_td2: IOMUXC1_ENET1_TD2_ENET_QOS_RGMII_TD_ENET_QOS_RGMII_TD2 { 283 pinmux = <0x443c00a4 0 0x0 0 0x443c0254>; 284 }; 285 /omit-if-no-ref/ iomuxc1_enet1_td2_flexio_flexio_flexio2_flexio3: IOMUXC1_ENET1_TD2_FLEXIO_FLEXIO_FLEXIO2_FLEXIO3 { 286 pinmux = <0x443c00a4 4 0x0 0 0x443c0254>; 287 }; 288 /omit-if-no-ref/ iomuxc1_enet1_td2_gpio_io_gpio4_io3: IOMUXC1_ENET1_TD2_GPIO_IO_GPIO4_IO3 { 289 pinmux = <0x443c00a4 5 0x0 0 0x443c0254>; 290 }; 291 /omit-if-no-ref/ iomuxc1_enet1_td2_hsiomix_otg_oc_hsiomix_otg_oc2: IOMUXC1_ENET1_TD2_HSIOMIX_OTG_OC_HSIOMIX_OTG_OC2 { 292 pinmux = <0x443c00a4 3 0x0 0 0x443c0254>; 293 }; 294 /omit-if-no-ref/ iomuxc1_enet1_td2_lpi2c_sda_lpi2c2_sda: IOMUXC1_ENET1_TD2_LPI2C_SDA_LPI2C2_SDA { 295 pinmux = <0x443c00a4 6 0x443c03ec 0 0x443c0254>; 296 }; 297 /omit-if-no-ref/ iomuxc1_enet1_td3_can_tx_can2_tx: IOMUXC1_ENET1_TD3_CAN_TX_CAN2_TX { 298 pinmux = <0x443c00a0 2 0x0 0 0x443c0250>; 299 }; 300 /omit-if-no-ref/ iomuxc1_enet1_td3_enet_qos_rgmii_td_enet_qos_rgmii_td3: IOMUXC1_ENET1_TD3_ENET_QOS_RGMII_TD_ENET_QOS_RGMII_TD3 { 301 pinmux = <0x443c00a0 0 0x0 0 0x443c0250>; 302 }; 303 /omit-if-no-ref/ iomuxc1_enet1_td3_flexio_flexio_flexio2_flexio2: IOMUXC1_ENET1_TD3_FLEXIO_FLEXIO_FLEXIO2_FLEXIO2 { 304 pinmux = <0x443c00a0 4 0x0 0 0x443c0250>; 305 }; 306 /omit-if-no-ref/ iomuxc1_enet1_td3_gpio_io_gpio4_io3: IOMUXC1_ENET1_TD3_GPIO_IO_GPIO4_IO3 { 307 pinmux = <0x443c00a0 5 0x0 0 0x443c0250>; 308 }; 309 /omit-if-no-ref/ iomuxc1_enet1_td3_hsiomix_otg_id_hsiomix_otg_id2: IOMUXC1_ENET1_TD3_HSIOMIX_OTG_ID_HSIOMIX_OTG_ID2 { 310 pinmux = <0x443c00a0 3 0x0 0 0x443c0250>; 311 }; 312 /omit-if-no-ref/ iomuxc1_enet1_td3_lpi2c_scl_lpi2c1_scl: IOMUXC1_ENET1_TD3_LPI2C_SCL_LPI2C1_SCL { 313 pinmux = <0x443c00a0 6 0x443c03e8 0 0x443c0250>; 314 }; 315 /omit-if-no-ref/ iomuxc1_enet1_txc_ccm_enet_qos_clock_generate_tx_clk_ccm_enet_qos_clock_generate_tx_clk: IOMUXC1_ENET1_TXC_CCM_ENET_QOS_CLOCK_GENERATE_TX_CLK_CCM_ENET_QOS_CLOCK_GENERATE_TX_CLK { 316 pinmux = <0x443c00b4 0 0x0 0 0x443c0264>; 317 }; 318 /omit-if-no-ref/ iomuxc1_enet1_txc_enet_qos_tx_er_enet_qos_tx_er: IOMUXC1_ENET1_TXC_ENET_QOS_TX_ER_ENET_QOS_TX_ER { 319 pinmux = <0x443c00b4 1 0x0 0 0x443c0264>; 320 }; 321 /omit-if-no-ref/ iomuxc1_enet1_txc_flexio_flexio_flexio2_flexio7: IOMUXC1_ENET1_TXC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO7 { 322 pinmux = <0x443c00b4 4 0x0 0 0x443c0264>; 323 }; 324 /omit-if-no-ref/ iomuxc1_enet1_txc_gpio_io_gpio4_io7: IOMUXC1_ENET1_TXC_GPIO_IO_GPIO4_IO7 { 325 pinmux = <0x443c00b4 5 0x0 0 0x443c0264>; 326 }; 327 /omit-if-no-ref/ iomuxc1_enet1_txc_lpspi_sin_lpspi2_sin: IOMUXC1_ENET1_TXC_LPSPI_SIN_LPSPI2_SIN { 328 pinmux = <0x443c00b4 2 0x443c0440 0 0x443c0264>; 329 }; 330 /omit-if-no-ref/ iomuxc1_enet1_tx_ctl_enet_qos_rgmii_tx_ctl_enet_qos_rgmii_tx_ctl: IOMUXC1_ENET1_TX_CTL_ENET_QOS_RGMII_TX_CTL_ENET_QOS_RGMII_TX_CTL { 331 pinmux = <0x443c00b0 0 0x0 0 0x443c0260>; 332 }; 333 /omit-if-no-ref/ iomuxc1_enet1_tx_ctl_flexio_flexio_flexio2_flexio6: IOMUXC1_ENET1_TX_CTL_FLEXIO_FLEXIO_FLEXIO2_FLEXIO6 { 334 pinmux = <0x443c00b0 4 0x0 0 0x443c0260>; 335 }; 336 /omit-if-no-ref/ iomuxc1_enet1_tx_ctl_gpio_io_gpio4_io6: IOMUXC1_ENET1_TX_CTL_GPIO_IO_GPIO4_IO6 { 337 pinmux = <0x443c00b0 5 0x0 0 0x443c0260>; 338 }; 339 /omit-if-no-ref/ iomuxc1_enet1_tx_ctl_lpspi_sck_lpspi2_sck: IOMUXC1_ENET1_TX_CTL_LPSPI_SCK_LPSPI2_SCK { 340 pinmux = <0x443c00b0 2 0x443c043c 0 0x443c0260>; 341 }; 342 /omit-if-no-ref/ iomuxc1_enet1_tx_ctl_lpuart_dtr_b_lpuart3_dtr_b: IOMUXC1_ENET1_TX_CTL_LPUART_DTR_B_LPUART3_DTR_B { 343 pinmux = <0x443c00b0 1 0x0 0 0x443c0260>; 344 }; 345 /omit-if-no-ref/ iomuxc1_enet2_mdc_enet_mdc_enet2_mdc: IOMUXC1_ENET2_MDC_ENET_MDC_ENET2_MDC { 346 pinmux = <0x443c00d0 0 0x0 0 0x443c0280>; 347 }; 348 /omit-if-no-ref/ iomuxc1_enet2_mdc_flexio_flexio_flexio2_flexio14: IOMUXC1_ENET2_MDC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO14 { 349 pinmux = <0x443c00d0 4 0x0 0 0x443c0280>; 350 }; 351 /omit-if-no-ref/ iomuxc1_enet2_mdc_gpio_io_gpio4_io14: IOMUXC1_ENET2_MDC_GPIO_IO_GPIO4_IO14 { 352 pinmux = <0x443c00d0 5 0x0 0 0x443c0280>; 353 }; 354 /omit-if-no-ref/ iomuxc1_enet2_mdc_lpuart_dcb_b_lpuart4_dcb_b: IOMUXC1_ENET2_MDC_LPUART_DCB_B_LPUART4_DCB_B { 355 pinmux = <0x443c00d0 1 0x0 0 0x443c0280>; 356 }; 357 /omit-if-no-ref/ iomuxc1_enet2_mdc_mediamix_cam_clk_mediamix_cam_clk: IOMUXC1_ENET2_MDC_MEDIAMIX_CAM_CLK_MEDIAMIX_CAM_CLK { 358 pinmux = <0x443c00d0 6 0x443c04bc 1 0x443c0280>; 359 }; 360 /omit-if-no-ref/ iomuxc1_enet2_mdc_sai_rx_sync_sai2_rx_sync: IOMUXC1_ENET2_MDC_SAI_RX_SYNC_SAI2_RX_SYNC { 361 pinmux = <0x443c00d0 2 0x0 0 0x443c0280>; 362 }; 363 /omit-if-no-ref/ iomuxc1_enet2_mdio_enet_mdio_enet2_mdio: IOMUXC1_ENET2_MDIO_ENET_MDIO_ENET2_MDIO { 364 pinmux = <0x443c00d4 0 0x0 0 0x443c0284>; 365 }; 366 /omit-if-no-ref/ iomuxc1_enet2_mdio_flexio_flexio_flexio2_flexio15: IOMUXC1_ENET2_MDIO_FLEXIO_FLEXIO_FLEXIO2_FLEXIO15 { 367 pinmux = <0x443c00d4 4 0x0 0 0x443c0284>; 368 }; 369 /omit-if-no-ref/ iomuxc1_enet2_mdio_gpio_io_gpio4_io15: IOMUXC1_ENET2_MDIO_GPIO_IO_GPIO4_IO15 { 370 pinmux = <0x443c00d4 5 0x0 0 0x443c0284>; 371 }; 372 /omit-if-no-ref/ iomuxc1_enet2_mdio_lpuart_rin_b_lpuart4_rin_b: IOMUXC1_ENET2_MDIO_LPUART_RIN_B_LPUART4_RIN_B { 373 pinmux = <0x443c00d4 1 0x0 0 0x443c0284>; 374 }; 375 /omit-if-no-ref/ iomuxc1_enet2_mdio_mediamix_cam_data_mediamix_cam_data0: IOMUXC1_ENET2_MDIO_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA0 { 376 pinmux = <0x443c00d4 6 0x443c0490 1 0x443c0284>; 377 }; 378 /omit-if-no-ref/ iomuxc1_enet2_mdio_sai_rx_bclk_sai2_rx_bclk: IOMUXC1_ENET2_MDIO_SAI_RX_BCLK_SAI2_RX_BCLK { 379 pinmux = <0x443c00d4 2 0x0 0 0x443c0284>; 380 }; 381 /omit-if-no-ref/ iomuxc1_enet2_rd0_enet_rgmii_rd_enet2_rgmii_rd0: IOMUXC1_ENET2_RD0_ENET_RGMII_RD_ENET2_RGMII_RD0 { 382 pinmux = <0x443c00f8 0 0x0 0 0x443c02a8>; 383 }; 384 /omit-if-no-ref/ iomuxc1_enet2_rd0_flexio_flexio_flexio2_flexio24: IOMUXC1_ENET2_RD0_FLEXIO_FLEXIO_FLEXIO2_FLEXIO24 { 385 pinmux = <0x443c00f8 4 0x0 0 0x443c02a8>; 386 }; 387 /omit-if-no-ref/ iomuxc1_enet2_rd0_gpio_io_gpio4_io24: IOMUXC1_ENET2_RD0_GPIO_IO_GPIO4_IO24 { 388 pinmux = <0x443c00f8 5 0x0 0 0x443c02a8>; 389 }; 390 /omit-if-no-ref/ iomuxc1_enet2_rd0_lpuart_rx_lpuart4_rx: IOMUXC1_ENET2_RD0_LPUART_RX_LPUART4_RX { 391 pinmux = <0x443c00f8 1 0x443c047c 1 0x443c02a8>; 392 }; 393 /omit-if-no-ref/ iomuxc1_enet2_rd0_mediamix_cam_data_mediamix_cam_data7: IOMUXC1_ENET2_RD0_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA7 { 394 pinmux = <0x443c00f8 6 0x443c04ac 1 0x443c02a8>; 395 }; 396 /omit-if-no-ref/ iomuxc1_enet2_rd1_enet_rgmii_rd_enet2_rgmii_rd1: IOMUXC1_ENET2_RD1_ENET_RGMII_RD_ENET2_RGMII_RD1 { 397 pinmux = <0x443c00fc 0 0x0 0 0x443c02ac>; 398 }; 399 /omit-if-no-ref/ iomuxc1_enet2_rd1_flexio_flexio_flexio2_flexio25: IOMUXC1_ENET2_RD1_FLEXIO_FLEXIO_FLEXIO2_FLEXIO25 { 400 pinmux = <0x443c00fc 4 0x0 0 0x443c02ac>; 401 }; 402 /omit-if-no-ref/ iomuxc1_enet2_rd1_gpio_io_gpio4_io25: IOMUXC1_ENET2_RD1_GPIO_IO_GPIO4_IO25 { 403 pinmux = <0x443c00fc 5 0x0 0 0x443c02ac>; 404 }; 405 /omit-if-no-ref/ iomuxc1_enet2_rd1_mediamix_cam_data_mediamix_cam_data8: IOMUXC1_ENET2_RD1_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA8 { 406 pinmux = <0x443c00fc 6 0x443c04b0 1 0x443c02ac>; 407 }; 408 /omit-if-no-ref/ iomuxc1_enet2_rd1_spdif_in_spdif_in: IOMUXC1_ENET2_RD1_SPDIF_IN_SPDIF_IN { 409 pinmux = <0x443c00fc 1 0x443c04e4 1 0x443c02ac>; 410 }; 411 /omit-if-no-ref/ iomuxc1_enet2_rd2_enet_rgmii_rd_enet2_rgmii_rd2: IOMUXC1_ENET2_RD2_ENET_RGMII_RD_ENET2_RGMII_RD2 { 412 pinmux = <0x443c0100 0 0x0 0 0x443c02b0>; 413 }; 414 /omit-if-no-ref/ iomuxc1_enet2_rd2_flexio_flexio_flexio2_flexio26: IOMUXC1_ENET2_RD2_FLEXIO_FLEXIO_FLEXIO2_FLEXIO26 { 415 pinmux = <0x443c0100 4 0x0 0 0x443c02b0>; 416 }; 417 /omit-if-no-ref/ iomuxc1_enet2_rd2_gpio_io_gpio4_io26: IOMUXC1_ENET2_RD2_GPIO_IO_GPIO4_IO26 { 418 pinmux = <0x443c0100 5 0x0 0 0x443c02b0>; 419 }; 420 /omit-if-no-ref/ iomuxc1_enet2_rd2_lpuart_cts_b_lpuart4_cts_b: IOMUXC1_ENET2_RD2_LPUART_CTS_B_LPUART4_CTS_B { 421 pinmux = <0x443c0100 1 0x443c0478 1 0x443c02b0>; 422 }; 423 /omit-if-no-ref/ iomuxc1_enet2_rd2_mediamix_cam_data_mediamix_cam_data9: IOMUXC1_ENET2_RD2_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA9 { 424 pinmux = <0x443c0100 6 0x443c04b4 1 0x443c02b0>; 425 }; 426 /omit-if-no-ref/ iomuxc1_enet2_rd2_mqs_right_mqs2_right: IOMUXC1_ENET2_RD2_MQS_RIGHT_MQS2_RIGHT { 427 pinmux = <0x443c0100 3 0x0 0 0x443c02b0>; 428 }; 429 /omit-if-no-ref/ iomuxc1_enet2_rd2_sai_mclk_sai2_mclk: IOMUXC1_ENET2_RD2_SAI_MCLK_SAI2_MCLK { 430 pinmux = <0x443c0100 2 0x0 0 0x443c02b0>; 431 }; 432 /omit-if-no-ref/ iomuxc1_enet2_rd3_enet_rgmii_rd_enet2_rgmii_rd3: IOMUXC1_ENET2_RD3_ENET_RGMII_RD_ENET2_RGMII_RD3 { 433 pinmux = <0x443c0104 0 0x0 0 0x443c02b4>; 434 }; 435 /omit-if-no-ref/ iomuxc1_enet2_rd3_flexio_flexio_flexio2_flexio27: IOMUXC1_ENET2_RD3_FLEXIO_FLEXIO_FLEXIO2_FLEXIO27 { 436 pinmux = <0x443c0104 4 0x0 0 0x443c02b4>; 437 }; 438 /omit-if-no-ref/ iomuxc1_enet2_rd3_gpio_io_gpio4_io27: IOMUXC1_ENET2_RD3_GPIO_IO_GPIO4_IO27 { 439 pinmux = <0x443c0104 5 0x0 0 0x443c02b4>; 440 }; 441 /omit-if-no-ref/ iomuxc1_enet2_rd3_mqs_left_mqs2_left: IOMUXC1_ENET2_RD3_MQS_LEFT_MQS2_LEFT { 442 pinmux = <0x443c0104 3 0x0 0 0x443c02b4>; 443 }; 444 /omit-if-no-ref/ iomuxc1_enet2_rd3_spdif_in_spdif_in: IOMUXC1_ENET2_RD3_SPDIF_IN_SPDIF_IN { 445 pinmux = <0x443c0104 2 0x443c04e4 2 0x443c02b4>; 446 }; 447 /omit-if-no-ref/ iomuxc1_enet2_rd3_spdif_out_spdif_out: IOMUXC1_ENET2_RD3_SPDIF_OUT_SPDIF_OUT { 448 pinmux = <0x443c0104 1 0x0 0 0x443c02b4>; 449 }; 450 /omit-if-no-ref/ iomuxc1_enet2_rxc_enet_rgmii_rxc_enet2_rgmii_rxc: IOMUXC1_ENET2_RXC_ENET_RGMII_RXC_ENET2_RGMII_RXC { 451 pinmux = <0x443c00f4 0 0x0 0 0x443c02a4>; 452 }; 453 /omit-if-no-ref/ iomuxc1_enet2_rxc_enet_rx_er_enet2_rx_er: IOMUXC1_ENET2_RXC_ENET_RX_ER_ENET2_RX_ER { 454 pinmux = <0x443c00f4 1 0x0 0 0x443c02a4>; 455 }; 456 /omit-if-no-ref/ iomuxc1_enet2_rxc_flexio_flexio_flexio2_flexio23: IOMUXC1_ENET2_RXC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO23 { 457 pinmux = <0x443c00f4 4 0x0 0 0x443c02a4>; 458 }; 459 /omit-if-no-ref/ iomuxc1_enet2_rxc_gpio_io_gpio4_io23: IOMUXC1_ENET2_RXC_GPIO_IO_GPIO4_IO23 { 460 pinmux = <0x443c00f4 5 0x0 0 0x443c02a4>; 461 }; 462 /omit-if-no-ref/ iomuxc1_enet2_rxc_mediamix_cam_data_mediamix_cam_data6: IOMUXC1_ENET2_RXC_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA6 { 463 pinmux = <0x443c00f4 6 0x443c04a8 1 0x443c02a4>; 464 }; 465 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_enet_rgmii_rx_ctl_enet2_rgmii_rx_ctl: IOMUXC1_ENET2_RX_CTL_ENET_RGMII_RX_CTL_ENET2_RGMII_RX_CTL { 466 pinmux = <0x443c00f0 0 0x0 0 0x443c02a0>; 467 }; 468 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_flexio_flexio_flexio2_flexio22: IOMUXC1_ENET2_RX_CTL_FLEXIO_FLEXIO_FLEXIO2_FLEXIO22 { 469 pinmux = <0x443c00f0 4 0x0 0 0x443c02a0>; 470 }; 471 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_gpio_io_gpio4_io22: IOMUXC1_ENET2_RX_CTL_GPIO_IO_GPIO4_IO22 { 472 pinmux = <0x443c00f0 5 0x0 0 0x443c02a0>; 473 }; 474 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_lpuart_dsr_b_lpuart4_dsr_b: IOMUXC1_ENET2_RX_CTL_LPUART_DSR_B_LPUART4_DSR_B { 475 pinmux = <0x443c00f0 1 0x0 0 0x443c02a0>; 476 }; 477 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_mediamix_cam_data_mediamix_cam_data5: IOMUXC1_ENET2_RX_CTL_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA5 { 478 pinmux = <0x443c00f0 6 0x443c04a4 1 0x443c02a0>; 479 }; 480 /omit-if-no-ref/ iomuxc1_enet2_rx_ctl_sai_tx_data_sai2_tx_data0: IOMUXC1_ENET2_RX_CTL_SAI_TX_DATA_SAI2_TX_DATA0 { 481 pinmux = <0x443c00f0 2 0x0 0 0x443c02a0>; 482 }; 483 /omit-if-no-ref/ iomuxc1_enet2_td0_enet_rgmii_td_enet2_rgmii_td0: IOMUXC1_ENET2_TD0_ENET_RGMII_TD_ENET2_RGMII_TD0 { 484 pinmux = <0x443c00e4 0 0x0 0 0x443c0294>; 485 }; 486 /omit-if-no-ref/ iomuxc1_enet2_td0_flexio_flexio_flexio2_flexio19: IOMUXC1_ENET2_TD0_FLEXIO_FLEXIO_FLEXIO2_FLEXIO19 { 487 pinmux = <0x443c00e4 4 0x0 0 0x443c0294>; 488 }; 489 /omit-if-no-ref/ iomuxc1_enet2_td0_gpio_io_gpio4_io19: IOMUXC1_ENET2_TD0_GPIO_IO_GPIO4_IO19 { 490 pinmux = <0x443c00e4 5 0x0 0 0x443c0294>; 491 }; 492 /omit-if-no-ref/ iomuxc1_enet2_td0_lpuart_tx_lpuart4_tx: IOMUXC1_ENET2_TD0_LPUART_TX_LPUART4_TX { 493 pinmux = <0x443c00e4 1 0x443c0480 1 0x443c0294>; 494 }; 495 /omit-if-no-ref/ iomuxc1_enet2_td0_mediamix_cam_data_mediamix_cam_data2: IOMUXC1_ENET2_TD0_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA2 { 496 pinmux = <0x443c00e4 6 0x443c0498 1 0x443c0294>; 497 }; 498 /omit-if-no-ref/ iomuxc1_enet2_td1_enet_rgmii_td_enet2_rgmii_td1: IOMUXC1_ENET2_TD1_ENET_RGMII_TD_ENET2_RGMII_TD1 { 499 pinmux = <0x443c00e0 0 0x0 0 0x443c0290>; 500 }; 501 /omit-if-no-ref/ iomuxc1_enet2_td1_flexio_flexio_flexio2_flexio18: IOMUXC1_ENET2_TD1_FLEXIO_FLEXIO_FLEXIO2_FLEXIO18 { 502 pinmux = <0x443c00e0 4 0x0 0 0x443c0290>; 503 }; 504 /omit-if-no-ref/ iomuxc1_enet2_td1_gpio_io_gpio4_io18: IOMUXC1_ENET2_TD1_GPIO_IO_GPIO4_IO18 { 505 pinmux = <0x443c00e0 5 0x0 0 0x443c0290>; 506 }; 507 /omit-if-no-ref/ iomuxc1_enet2_td1_lpuart_rts_b_lpuart4_rts_b: IOMUXC1_ENET2_TD1_LPUART_RTS_B_LPUART4_RTS_B { 508 pinmux = <0x443c00e0 1 0x0 0 0x443c0290>; 509 }; 510 /omit-if-no-ref/ iomuxc1_enet2_td1_mediamix_cam_data_mediamix_cam_data1: IOMUXC1_ENET2_TD1_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA1 { 511 pinmux = <0x443c00e0 6 0x443c0494 1 0x443c0290>; 512 }; 513 /omit-if-no-ref/ iomuxc1_enet2_td2_enet_rgmii_td_enet2_rgmii_td2: IOMUXC1_ENET2_TD2_ENET_RGMII_TD_ENET2_RGMII_TD2 { 514 pinmux = <0x443c00dc 0 0x0 0 0x443c028c>; 515 }; 516 /omit-if-no-ref/ iomuxc1_enet2_td2_enet_tx_clk_enet2_tx_clk2: IOMUXC1_ENET2_TD2_ENET_TX_CLK_ENET2_TX_CLK2 { 517 pinmux = <0x443c00dc 1 0x0 0 0x443c028c>; 518 }; 519 /omit-if-no-ref/ iomuxc1_enet2_td2_flexio_flexio_flexio2_flexio17: IOMUXC1_ENET2_TD2_FLEXIO_FLEXIO_FLEXIO2_FLEXIO17 { 520 pinmux = <0x443c00dc 4 0x0 0 0x443c028c>; 521 }; 522 /omit-if-no-ref/ iomuxc1_enet2_td2_gpio_io_gpio4_io17: IOMUXC1_ENET2_TD2_GPIO_IO_GPIO4_IO17 { 523 pinmux = <0x443c00dc 5 0x0 0 0x443c028c>; 524 }; 525 /omit-if-no-ref/ iomuxc1_enet2_td2_mediamix_cam_hsync_mediamix_cam_hsync: IOMUXC1_ENET2_TD2_MEDIAMIX_CAM_HSYNC_MEDIAMIX_CAM_HSYNC { 526 pinmux = <0x443c00dc 6 0x443c04b8 1 0x443c028c>; 527 }; 528 /omit-if-no-ref/ iomuxc1_enet2_td3_enet_rgmii_td_enet2_rgmii_td3: IOMUXC1_ENET2_TD3_ENET_RGMII_TD_ENET2_RGMII_TD3 { 529 pinmux = <0x443c00d8 0 0x0 0 0x443c0288>; 530 }; 531 /omit-if-no-ref/ iomuxc1_enet2_td3_flexio_flexio_flexio2_flexio16: IOMUXC1_ENET2_TD3_FLEXIO_FLEXIO_FLEXIO2_FLEXIO16 { 532 pinmux = <0x443c00d8 4 0x0 0 0x443c0288>; 533 }; 534 /omit-if-no-ref/ iomuxc1_enet2_td3_gpio_io_gpio4_io16: IOMUXC1_ENET2_TD3_GPIO_IO_GPIO4_IO16 { 535 pinmux = <0x443c00d8 5 0x0 0 0x443c0288>; 536 }; 537 /omit-if-no-ref/ iomuxc1_enet2_td3_mediamix_cam_vsync_mediamix_cam_vsync: IOMUXC1_ENET2_TD3_MEDIAMIX_CAM_VSYNC_MEDIAMIX_CAM_VSYNC { 538 pinmux = <0x443c00d8 6 0x443c04c0 1 0x443c0288>; 539 }; 540 /omit-if-no-ref/ iomuxc1_enet2_td3_sai_rx_data_sai2_rx_data0: IOMUXC1_ENET2_TD3_SAI_RX_DATA_SAI2_RX_DATA0 { 541 pinmux = <0x443c00d8 2 0x0 0 0x443c0288>; 542 }; 543 /omit-if-no-ref/ iomuxc1_enet2_txc_enet_rgmii_txc_enet2_rgmii_txc: IOMUXC1_ENET2_TXC_ENET_RGMII_TXC_ENET2_RGMII_TXC { 544 pinmux = <0x443c00ec 0 0x0 0 0x443c029c>; 545 }; 546 /omit-if-no-ref/ iomuxc1_enet2_txc_enet_tx_er_enet2_tx_er: IOMUXC1_ENET2_TXC_ENET_TX_ER_ENET2_TX_ER { 547 pinmux = <0x443c00ec 1 0x0 0 0x443c029c>; 548 }; 549 /omit-if-no-ref/ iomuxc1_enet2_txc_flexio_flexio_flexio2_flexio21: IOMUXC1_ENET2_TXC_FLEXIO_FLEXIO_FLEXIO2_FLEXIO21 { 550 pinmux = <0x443c00ec 4 0x0 0 0x443c029c>; 551 }; 552 /omit-if-no-ref/ iomuxc1_enet2_txc_gpio_io_gpio4_io21: IOMUXC1_ENET2_TXC_GPIO_IO_GPIO4_IO21 { 553 pinmux = <0x443c00ec 5 0x0 0 0x443c029c>; 554 }; 555 /omit-if-no-ref/ iomuxc1_enet2_txc_mediamix_cam_data_mediamix_cam_data4: IOMUXC1_ENET2_TXC_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA4 { 556 pinmux = <0x443c00ec 6 0x443c04a0 1 0x443c029c>; 557 }; 558 /omit-if-no-ref/ iomuxc1_enet2_txc_sai_tx_bclk_sai2_tx_bclk: IOMUXC1_ENET2_TXC_SAI_TX_BCLK_SAI2_TX_BCLK { 559 pinmux = <0x443c00ec 2 0x0 0 0x443c029c>; 560 }; 561 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_enet_rgmii_tx_ctl_enet2_rgmii_tx_ctl: IOMUXC1_ENET2_TX_CTL_ENET_RGMII_TX_CTL_ENET2_RGMII_TX_CTL { 562 pinmux = <0x443c00e8 0 0x0 0 0x443c0298>; 563 }; 564 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_flexio_flexio_flexio2_flexio20: IOMUXC1_ENET2_TX_CTL_FLEXIO_FLEXIO_FLEXIO2_FLEXIO20 { 565 pinmux = <0x443c00e8 4 0x0 0 0x443c0298>; 566 }; 567 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_gpio_io_gpio4_io20: IOMUXC1_ENET2_TX_CTL_GPIO_IO_GPIO4_IO20 { 568 pinmux = <0x443c00e8 5 0x0 0 0x443c0298>; 569 }; 570 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_lpuart_dtr_b_lpuart4_dtr_b: IOMUXC1_ENET2_TX_CTL_LPUART_DTR_B_LPUART4_DTR_B { 571 pinmux = <0x443c00e8 1 0x0 0 0x443c0298>; 572 }; 573 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_mediamix_cam_data_mediamix_cam_data3: IOMUXC1_ENET2_TX_CTL_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA3 { 574 pinmux = <0x443c00e8 6 0x443c049c 1 0x443c0298>; 575 }; 576 /omit-if-no-ref/ iomuxc1_enet2_tx_ctl_sai_tx_sync_sai2_tx_sync: IOMUXC1_ENET2_TX_CTL_SAI_TX_SYNC_SAI2_TX_SYNC { 577 pinmux = <0x443c00e8 2 0x0 0 0x443c0298>; 578 }; 579 /omit-if-no-ref/ iomuxc1_gpio_io00_flexio_flexio_flexio1_flexio0: IOMUXC1_GPIO_IO00_FLEXIO_FLEXIO_FLEXIO1_FLEXIO0 { 580 pinmux = <0x443c0010 7 0x443c036c 0 0x443c01c0>; 581 }; 582 /omit-if-no-ref/ iomuxc1_gpio_io00_gpio_io_gpio2_io0: IOMUXC1_GPIO_IO00_GPIO_IO_GPIO2_IO0 { 583 pinmux = <0x443c0010 0 0x0 0 0x443c01c0>; 584 }; 585 /omit-if-no-ref/ iomuxc1_gpio_io00_lpi2c_sda_lpi2c3_sda: IOMUXC1_GPIO_IO00_LPI2C_SDA_LPI2C3_SDA { 586 pinmux = <0x443c0010 1 0x443c03f4 0 0x443c01c0>; 587 }; 588 /omit-if-no-ref/ iomuxc1_gpio_io00_lpi2c_sda_lpi2c5_sda: IOMUXC1_GPIO_IO00_LPI2C_SDA_LPI2C5_SDA { 589 pinmux = <0x443c0010 6 0x443c0404 0 0x443c01c0>; 590 }; 591 /omit-if-no-ref/ iomuxc1_gpio_io00_lpspi_pcs_lpspi6_pcs0: IOMUXC1_GPIO_IO00_LPSPI_PCS_LPSPI6_PCS0 { 592 pinmux = <0x443c0010 4 0x0 0 0x443c01c0>; 593 }; 594 /omit-if-no-ref/ iomuxc1_gpio_io00_lpuart_tx_lpuart5_tx: IOMUXC1_GPIO_IO00_LPUART_TX_LPUART5_TX { 595 pinmux = <0x443c0010 5 0x443c048c 1 0x443c01c0>; 596 }; 597 /omit-if-no-ref/ iomuxc1_gpio_io00_mediamix_cam_clk_mediamix_cam_clk: IOMUXC1_GPIO_IO00_MEDIAMIX_CAM_CLK_MEDIAMIX_CAM_CLK { 598 pinmux = <0x443c0010 2 0x443c04bc 0 0x443c01c0>; 599 }; 600 /omit-if-no-ref/ iomuxc1_gpio_io00_mediamix_disp_clk_mediamix_disp_clk: IOMUXC1_GPIO_IO00_MEDIAMIX_DISP_CLK_MEDIAMIX_DISP_CLK { 601 pinmux = <0x443c0010 3 0x0 0 0x443c01c0>; 602 }; 603 /omit-if-no-ref/ iomuxc1_gpio_io01_flexio_flexio_flexio1_flexio1: IOMUXC1_GPIO_IO01_FLEXIO_FLEXIO_FLEXIO1_FLEXIO1 { 604 pinmux = <0x443c0014 7 0x443c0370 0 0x443c01c4>; 605 }; 606 /omit-if-no-ref/ iomuxc1_gpio_io01_gpio_io_gpio2_io1: IOMUXC1_GPIO_IO01_GPIO_IO_GPIO2_IO1 { 607 pinmux = <0x443c0014 0 0x0 0 0x443c01c4>; 608 }; 609 /omit-if-no-ref/ iomuxc1_gpio_io01_lpi2c_scl_lpi2c3_scl: IOMUXC1_GPIO_IO01_LPI2C_SCL_LPI2C3_SCL { 610 pinmux = <0x443c0014 1 0x443c03f0 0 0x443c01c4>; 611 }; 612 /omit-if-no-ref/ iomuxc1_gpio_io01_lpi2c_scl_lpi2c5_scl: IOMUXC1_GPIO_IO01_LPI2C_SCL_LPI2C5_SCL { 613 pinmux = <0x443c0014 6 0x443c0400 0 0x443c01c4>; 614 }; 615 /omit-if-no-ref/ iomuxc1_gpio_io01_lpspi_sin_lpspi6_sin: IOMUXC1_GPIO_IO01_LPSPI_SIN_LPSPI6_SIN { 616 pinmux = <0x443c0014 4 0x0 0 0x443c01c4>; 617 }; 618 /omit-if-no-ref/ iomuxc1_gpio_io01_lpuart_rx_lpuart5_rx: IOMUXC1_GPIO_IO01_LPUART_RX_LPUART5_RX { 619 pinmux = <0x443c0014 5 0x443c0488 1 0x443c01c4>; 620 }; 621 /omit-if-no-ref/ iomuxc1_gpio_io01_mediamix_cam_data_mediamix_cam_data0: IOMUXC1_GPIO_IO01_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA0 { 622 pinmux = <0x443c0014 2 0x443c0490 0 0x443c01c4>; 623 }; 624 /omit-if-no-ref/ iomuxc1_gpio_io01_mediamix_disp_de_mediamix_disp_de: IOMUXC1_GPIO_IO01_MEDIAMIX_DISP_DE_MEDIAMIX_DISP_DE { 625 pinmux = <0x443c0014 3 0x0 0 0x443c01c4>; 626 }; 627 /omit-if-no-ref/ iomuxc1_gpio_io02_flexio_flexio_flexio1_flexio3: IOMUXC1_GPIO_IO02_FLEXIO_FLEXIO_FLEXIO1_FLEXIO3 { 628 pinmux = <0x443c0018 7 0x443c0374 0 0x443c01c8>; 629 }; 630 /omit-if-no-ref/ iomuxc1_gpio_io02_gpio_io_gpio2_io2: IOMUXC1_GPIO_IO02_GPIO_IO_GPIO2_IO2 { 631 pinmux = <0x443c0018 0 0x0 0 0x443c01c8>; 632 }; 633 /omit-if-no-ref/ iomuxc1_gpio_io02_lpi2c_sda_lpi2c4_sda: IOMUXC1_GPIO_IO02_LPI2C_SDA_LPI2C4_SDA { 634 pinmux = <0x443c0018 1 0x443c03fc 0 0x443c01c8>; 635 }; 636 /omit-if-no-ref/ iomuxc1_gpio_io02_lpi2c_sda_lpi2c6_sda: IOMUXC1_GPIO_IO02_LPI2C_SDA_LPI2C6_SDA { 637 pinmux = <0x443c0018 6 0x443c040c 0 0x443c01c8>; 638 }; 639 /omit-if-no-ref/ iomuxc1_gpio_io02_lpspi_sout_lpspi6_sout: IOMUXC1_GPIO_IO02_LPSPI_SOUT_LPSPI6_SOUT { 640 pinmux = <0x443c0018 4 0x0 0 0x443c01c8>; 641 }; 642 /omit-if-no-ref/ iomuxc1_gpio_io02_lpuart_cts_b_lpuart5_cts_b: IOMUXC1_GPIO_IO02_LPUART_CTS_B_LPUART5_CTS_B { 643 pinmux = <0x443c0018 5 0x443c0484 1 0x443c01c8>; 644 }; 645 /omit-if-no-ref/ iomuxc1_gpio_io02_mediamix_cam_vsync_mediamix_cam_vsync: IOMUXC1_GPIO_IO02_MEDIAMIX_CAM_VSYNC_MEDIAMIX_CAM_VSYNC { 646 pinmux = <0x443c0018 2 0x443c04c0 0 0x443c01c8>; 647 }; 648 /omit-if-no-ref/ iomuxc1_gpio_io02_mediamix_disp_vsync_mediamix_disp_vsync: IOMUXC1_GPIO_IO02_MEDIAMIX_DISP_VSYNC_MEDIAMIX_DISP_VSYNC { 649 pinmux = <0x443c0018 3 0x0 0 0x443c01c8>; 650 }; 651 /omit-if-no-ref/ iomuxc1_gpio_io03_flexio_flexio_flexio1_flexio3: IOMUXC1_GPIO_IO03_FLEXIO_FLEXIO_FLEXIO1_FLEXIO3 { 652 pinmux = <0x443c001c 7 0x443c0378 0 0x443c01cc>; 653 }; 654 /omit-if-no-ref/ iomuxc1_gpio_io03_gpio_io_gpio2_io3: IOMUXC1_GPIO_IO03_GPIO_IO_GPIO2_IO3 { 655 pinmux = <0x443c001c 0 0x0 0 0x443c01cc>; 656 }; 657 /omit-if-no-ref/ iomuxc1_gpio_io03_lpi2c_scl_lpi2c4_scl: IOMUXC1_GPIO_IO03_LPI2C_SCL_LPI2C4_SCL { 658 pinmux = <0x443c001c 1 0x443c03f8 0 0x443c01cc>; 659 }; 660 /omit-if-no-ref/ iomuxc1_gpio_io03_lpi2c_scl_lpi2c6_scl: IOMUXC1_GPIO_IO03_LPI2C_SCL_LPI2C6_SCL { 661 pinmux = <0x443c001c 6 0x443c0408 0 0x443c01cc>; 662 }; 663 /omit-if-no-ref/ iomuxc1_gpio_io03_lpspi_sck_lpspi6_sck: IOMUXC1_GPIO_IO03_LPSPI_SCK_LPSPI6_SCK { 664 pinmux = <0x443c001c 4 0x0 0 0x443c01cc>; 665 }; 666 /omit-if-no-ref/ iomuxc1_gpio_io03_lpuart_rts_b_lpuart5_rts_b: IOMUXC1_GPIO_IO03_LPUART_RTS_B_LPUART5_RTS_B { 667 pinmux = <0x443c001c 5 0x0 0 0x443c01cc>; 668 }; 669 /omit-if-no-ref/ iomuxc1_gpio_io03_mediamix_cam_hsync_mediamix_cam_hsync: IOMUXC1_GPIO_IO03_MEDIAMIX_CAM_HSYNC_MEDIAMIX_CAM_HSYNC { 670 pinmux = <0x443c001c 2 0x443c04b8 0 0x443c01cc>; 671 }; 672 /omit-if-no-ref/ iomuxc1_gpio_io03_mediamix_disp_hsync_mediamix_disp_hsync: IOMUXC1_GPIO_IO03_MEDIAMIX_DISP_HSYNC_MEDIAMIX_DISP_HSYNC { 673 pinmux = <0x443c001c 3 0x0 0 0x443c01cc>; 674 }; 675 /omit-if-no-ref/ iomuxc1_gpio_io04_flexio_flexio_flexio1_flexio4: IOMUXC1_GPIO_IO04_FLEXIO_FLEXIO_FLEXIO1_FLEXIO4 { 676 pinmux = <0x443c0020 7 0x443c037c 0 0x443c01d0>; 677 }; 678 /omit-if-no-ref/ iomuxc1_gpio_io04_gpio_io_gpio2_io4: IOMUXC1_GPIO_IO04_GPIO_IO_GPIO2_IO4 { 679 pinmux = <0x443c0020 0 0x0 0 0x443c01d0>; 680 }; 681 /omit-if-no-ref/ iomuxc1_gpio_io04_lpi2c_sda_lpi2c6_sda: IOMUXC1_GPIO_IO04_LPI2C_SDA_LPI2C6_SDA { 682 pinmux = <0x443c0020 6 0x443c040c 1 0x443c01d0>; 683 }; 684 /omit-if-no-ref/ iomuxc1_gpio_io04_lpspi_pcs_lpspi7_pcs0: IOMUXC1_GPIO_IO04_LPSPI_PCS_LPSPI7_PCS0 { 685 pinmux = <0x443c0020 4 0x0 0 0x443c01d0>; 686 }; 687 /omit-if-no-ref/ iomuxc1_gpio_io04_lpuart_tx_lpuart6_tx: IOMUXC1_GPIO_IO04_LPUART_TX_LPUART6_TX { 688 pinmux = <0x443c0020 5 0x0 0 0x443c01d0>; 689 }; 690 /omit-if-no-ref/ iomuxc1_gpio_io04_mediamix_disp_data_mediamix_disp_data0: IOMUXC1_GPIO_IO04_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA0 { 691 pinmux = <0x443c0020 3 0x0 0 0x443c01d0>; 692 }; 693 /omit-if-no-ref/ iomuxc1_gpio_io04_pdm_clk_pdm_clk: IOMUXC1_GPIO_IO04_PDM_CLK_PDM_CLK { 694 pinmux = <0x443c0020 2 0x0 0 0x443c01d0>; 695 }; 696 /omit-if-no-ref/ iomuxc1_gpio_io04_tpm_ch_tpm3_ch0: IOMUXC1_GPIO_IO04_TPM_CH_TPM3_CH0 { 697 pinmux = <0x443c0020 1 0x0 0 0x443c01d0>; 698 }; 699 /omit-if-no-ref/ iomuxc1_gpio_io05_flexio_flexio_flexio1_flexio5: IOMUXC1_GPIO_IO05_FLEXIO_FLEXIO_FLEXIO1_FLEXIO5 { 700 pinmux = <0x443c0024 7 0x443c0380 0 0x443c01d4>; 701 }; 702 /omit-if-no-ref/ iomuxc1_gpio_io05_gpio_io_gpio2_io5: IOMUXC1_GPIO_IO05_GPIO_IO_GPIO2_IO5 { 703 pinmux = <0x443c0024 0 0x0 0 0x443c01d4>; 704 }; 705 /omit-if-no-ref/ iomuxc1_gpio_io05_lpi2c_scl_lpi2c6_scl: IOMUXC1_GPIO_IO05_LPI2C_SCL_LPI2C6_SCL { 706 pinmux = <0x443c0024 6 0x443c0408 1 0x443c01d4>; 707 }; 708 /omit-if-no-ref/ iomuxc1_gpio_io05_lpspi_sin_lpspi7_sin: IOMUXC1_GPIO_IO05_LPSPI_SIN_LPSPI7_SIN { 709 pinmux = <0x443c0024 4 0x0 0 0x443c01d4>; 710 }; 711 /omit-if-no-ref/ iomuxc1_gpio_io05_lpuart_rx_lpuart6_rx: IOMUXC1_GPIO_IO05_LPUART_RX_LPUART6_RX { 712 pinmux = <0x443c0024 5 0x0 0 0x443c01d4>; 713 }; 714 /omit-if-no-ref/ iomuxc1_gpio_io05_mediamix_disp_data_mediamix_disp_data1: IOMUXC1_GPIO_IO05_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA1 { 715 pinmux = <0x443c0024 3 0x0 0 0x443c01d4>; 716 }; 717 /omit-if-no-ref/ iomuxc1_gpio_io05_pdm_bit_stream_pdm_bit_stream0: IOMUXC1_GPIO_IO05_PDM_BIT_STREAM_PDM_BIT_STREAM0 { 718 pinmux = <0x443c0024 2 0x443c04c4 0 0x443c01d4>; 719 }; 720 /omit-if-no-ref/ iomuxc1_gpio_io05_tpm_ch_tpm4_ch0: IOMUXC1_GPIO_IO05_TPM_CH_TPM4_CH0 { 721 pinmux = <0x443c0024 1 0x0 0 0x443c01d4>; 722 }; 723 /omit-if-no-ref/ iomuxc1_gpio_io06_flexio_flexio_flexio1_flexio6: IOMUXC1_GPIO_IO06_FLEXIO_FLEXIO_FLEXIO1_FLEXIO6 { 724 pinmux = <0x443c0028 7 0x443c0384 0 0x443c01d8>; 725 }; 726 /omit-if-no-ref/ iomuxc1_gpio_io06_gpio_io_gpio2_io6: IOMUXC1_GPIO_IO06_GPIO_IO_GPIO2_IO6 { 727 pinmux = <0x443c0028 0 0x0 0 0x443c01d8>; 728 }; 729 /omit-if-no-ref/ iomuxc1_gpio_io06_lpi2c_sda_lpi2c7_sda: IOMUXC1_GPIO_IO06_LPI2C_SDA_LPI2C7_SDA { 730 pinmux = <0x443c0028 6 0x443c0414 0 0x443c01d8>; 731 }; 732 /omit-if-no-ref/ iomuxc1_gpio_io06_lpspi_sout_lpspi7_sout: IOMUXC1_GPIO_IO06_LPSPI_SOUT_LPSPI7_SOUT { 733 pinmux = <0x443c0028 4 0x0 0 0x443c01d8>; 734 }; 735 /omit-if-no-ref/ iomuxc1_gpio_io06_lpuart_cts_b_lpuart6_cts_b: IOMUXC1_GPIO_IO06_LPUART_CTS_B_LPUART6_CTS_B { 736 pinmux = <0x443c0028 5 0x0 0 0x443c01d8>; 737 }; 738 /omit-if-no-ref/ iomuxc1_gpio_io06_mediamix_disp_data_mediamix_disp_data2: IOMUXC1_GPIO_IO06_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA2 { 739 pinmux = <0x443c0028 3 0x0 0 0x443c01d8>; 740 }; 741 /omit-if-no-ref/ iomuxc1_gpio_io06_pdm_bit_stream_pdm_bit_stream1: IOMUXC1_GPIO_IO06_PDM_BIT_STREAM_PDM_BIT_STREAM1 { 742 pinmux = <0x443c0028 2 0x443c04c8 0 0x443c01d8>; 743 }; 744 /omit-if-no-ref/ iomuxc1_gpio_io06_tpm_ch_tpm5_ch0: IOMUXC1_GPIO_IO06_TPM_CH_TPM5_CH0 { 745 pinmux = <0x443c0028 1 0x0 0 0x443c01d8>; 746 }; 747 /omit-if-no-ref/ iomuxc1_gpio_io07_flexio_flexio_flexio1_flexio7: IOMUXC1_GPIO_IO07_FLEXIO_FLEXIO_FLEXIO1_FLEXIO7 { 748 pinmux = <0x443c002c 7 0x443c0388 0 0x443c01dc>; 749 }; 750 /omit-if-no-ref/ iomuxc1_gpio_io07_gpio_io_gpio2_io7: IOMUXC1_GPIO_IO07_GPIO_IO_GPIO2_IO7 { 751 pinmux = <0x443c002c 0 0x0 0 0x443c01dc>; 752 }; 753 /omit-if-no-ref/ iomuxc1_gpio_io07_lpi2c_scl_lpi2c7_scl: IOMUXC1_GPIO_IO07_LPI2C_SCL_LPI2C7_SCL { 754 pinmux = <0x443c002c 6 0x443c0410 0 0x443c01dc>; 755 }; 756 /omit-if-no-ref/ iomuxc1_gpio_io07_lpspi_pcs_lpspi3_pcs1: IOMUXC1_GPIO_IO07_LPSPI_PCS_LPSPI3_PCS1 { 757 pinmux = <0x443c002c 1 0x0 0 0x443c01dc>; 758 }; 759 /omit-if-no-ref/ iomuxc1_gpio_io07_lpspi_sck_lpspi7_sck: IOMUXC1_GPIO_IO07_LPSPI_SCK_LPSPI7_SCK { 760 pinmux = <0x443c002c 4 0x0 0 0x443c01dc>; 761 }; 762 /omit-if-no-ref/ iomuxc1_gpio_io07_lpuart_rts_b_lpuart6_rts_b: IOMUXC1_GPIO_IO07_LPUART_RTS_B_LPUART6_RTS_B { 763 pinmux = <0x443c002c 5 0x0 0 0x443c01dc>; 764 }; 765 /omit-if-no-ref/ iomuxc1_gpio_io07_mediamix_cam_data_mediamix_cam_data1: IOMUXC1_GPIO_IO07_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA1 { 766 pinmux = <0x443c002c 2 0x443c0494 0 0x443c01dc>; 767 }; 768 /omit-if-no-ref/ iomuxc1_gpio_io07_mediamix_disp_data_mediamix_disp_data3: IOMUXC1_GPIO_IO07_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA3 { 769 pinmux = <0x443c002c 3 0x0 0 0x443c01dc>; 770 }; 771 /omit-if-no-ref/ iomuxc1_gpio_io08_flexio_flexio_flexio1_flexio8: IOMUXC1_GPIO_IO08_FLEXIO_FLEXIO_FLEXIO1_FLEXIO8 { 772 pinmux = <0x443c0030 7 0x443c038c 0 0x443c01e0>; 773 }; 774 /omit-if-no-ref/ iomuxc1_gpio_io08_gpio_io_gpio2_io8: IOMUXC1_GPIO_IO08_GPIO_IO_GPIO2_IO8 { 775 pinmux = <0x443c0030 0 0x0 0 0x443c01e0>; 776 }; 777 /omit-if-no-ref/ iomuxc1_gpio_io08_lpi2c_sda_lpi2c7_sda: IOMUXC1_GPIO_IO08_LPI2C_SDA_LPI2C7_SDA { 778 pinmux = <0x443c0030 6 0x443c0414 1 0x443c01e0>; 779 }; 780 /omit-if-no-ref/ iomuxc1_gpio_io08_lpspi_pcs_lpspi3_pcs0: IOMUXC1_GPIO_IO08_LPSPI_PCS_LPSPI3_PCS0 { 781 pinmux = <0x443c0030 1 0x0 0 0x443c01e0>; 782 }; 783 /omit-if-no-ref/ iomuxc1_gpio_io08_lpuart_tx_lpuart7_tx: IOMUXC1_GPIO_IO08_LPUART_TX_LPUART7_TX { 784 pinmux = <0x443c0030 5 0x0 0 0x443c01e0>; 785 }; 786 /omit-if-no-ref/ iomuxc1_gpio_io08_mediamix_cam_data_mediamix_cam_data2: IOMUXC1_GPIO_IO08_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA2 { 787 pinmux = <0x443c0030 2 0x443c0498 0 0x443c01e0>; 788 }; 789 /omit-if-no-ref/ iomuxc1_gpio_io08_mediamix_disp_data_mediamix_disp_data4: IOMUXC1_GPIO_IO08_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA4 { 790 pinmux = <0x443c0030 3 0x0 0 0x443c01e0>; 791 }; 792 /omit-if-no-ref/ iomuxc1_gpio_io08_tpm_ch_tpm6_ch0: IOMUXC1_GPIO_IO08_TPM_CH_TPM6_CH0 { 793 pinmux = <0x443c0030 4 0x0 0 0x443c01e0>; 794 }; 795 /omit-if-no-ref/ iomuxc1_gpio_io09_flexio_flexio_flexio1_flexio9: IOMUXC1_GPIO_IO09_FLEXIO_FLEXIO_FLEXIO1_FLEXIO9 { 796 pinmux = <0x443c0034 7 0x443c0390 0 0x443c01e4>; 797 }; 798 /omit-if-no-ref/ iomuxc1_gpio_io09_gpio_io_gpio2_io9: IOMUXC1_GPIO_IO09_GPIO_IO_GPIO2_IO9 { 799 pinmux = <0x443c0034 0 0x0 0 0x443c01e4>; 800 }; 801 /omit-if-no-ref/ iomuxc1_gpio_io09_lpi2c_scl_lpi2c7_scl: IOMUXC1_GPIO_IO09_LPI2C_SCL_LPI2C7_SCL { 802 pinmux = <0x443c0034 6 0x443c0410 1 0x443c01e4>; 803 }; 804 /omit-if-no-ref/ iomuxc1_gpio_io09_lpspi_sin_lpspi3_sin: IOMUXC1_GPIO_IO09_LPSPI_SIN_LPSPI3_SIN { 805 pinmux = <0x443c0034 1 0x0 0 0x443c01e4>; 806 }; 807 /omit-if-no-ref/ iomuxc1_gpio_io09_lpuart_rx_lpuart7_rx: IOMUXC1_GPIO_IO09_LPUART_RX_LPUART7_RX { 808 pinmux = <0x443c0034 5 0x0 0 0x443c01e4>; 809 }; 810 /omit-if-no-ref/ iomuxc1_gpio_io09_mediamix_cam_data_mediamix_cam_data3: IOMUXC1_GPIO_IO09_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA3 { 811 pinmux = <0x443c0034 2 0x443c049c 0 0x443c01e4>; 812 }; 813 /omit-if-no-ref/ iomuxc1_gpio_io09_mediamix_disp_data_mediamix_disp_data5: IOMUXC1_GPIO_IO09_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA5 { 814 pinmux = <0x443c0034 3 0x0 0 0x443c01e4>; 815 }; 816 /omit-if-no-ref/ iomuxc1_gpio_io09_tpm_extclk_tpm3_extclk: IOMUXC1_GPIO_IO09_TPM_EXTCLK_TPM3_EXTCLK { 817 pinmux = <0x443c0034 4 0x0 0 0x443c01e4>; 818 }; 819 /omit-if-no-ref/ iomuxc1_gpio_io10_flexio_flexio_flexio1_flexio10: IOMUXC1_GPIO_IO10_FLEXIO_FLEXIO_FLEXIO1_FLEXIO10 { 820 pinmux = <0x443c0038 7 0x443c0394 0 0x443c01e8>; 821 }; 822 /omit-if-no-ref/ iomuxc1_gpio_io10_gpio_io_gpio2_io10: IOMUXC1_GPIO_IO10_GPIO_IO_GPIO2_IO10 { 823 pinmux = <0x443c0038 0 0x0 0 0x443c01e8>; 824 }; 825 /omit-if-no-ref/ iomuxc1_gpio_io10_lpi2c_sda_lpi2c8_sda: IOMUXC1_GPIO_IO10_LPI2C_SDA_LPI2C8_SDA { 826 pinmux = <0x443c0038 6 0x443c041c 0 0x443c01e8>; 827 }; 828 /omit-if-no-ref/ iomuxc1_gpio_io10_lpspi_sout_lpspi3_sout: IOMUXC1_GPIO_IO10_LPSPI_SOUT_LPSPI3_SOUT { 829 pinmux = <0x443c0038 1 0x0 0 0x443c01e8>; 830 }; 831 /omit-if-no-ref/ iomuxc1_gpio_io10_lpuart_cts_b_lpuart7_cts_b: IOMUXC1_GPIO_IO10_LPUART_CTS_B_LPUART7_CTS_B { 832 pinmux = <0x443c0038 5 0x0 0 0x443c01e8>; 833 }; 834 /omit-if-no-ref/ iomuxc1_gpio_io10_mediamix_cam_data_mediamix_cam_data4: IOMUXC1_GPIO_IO10_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA4 { 835 pinmux = <0x443c0038 2 0x443c04a0 0 0x443c01e8>; 836 }; 837 /omit-if-no-ref/ iomuxc1_gpio_io10_mediamix_disp_data_mediamix_disp_data6: IOMUXC1_GPIO_IO10_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA6 { 838 pinmux = <0x443c0038 3 0x0 0 0x443c01e8>; 839 }; 840 /omit-if-no-ref/ iomuxc1_gpio_io10_tpm_extclk_tpm4_extclk: IOMUXC1_GPIO_IO10_TPM_EXTCLK_TPM4_EXTCLK { 841 pinmux = <0x443c0038 4 0x0 0 0x443c01e8>; 842 }; 843 /omit-if-no-ref/ iomuxc1_gpio_io11_flexio_flexio_flexio1_flexio11: IOMUXC1_GPIO_IO11_FLEXIO_FLEXIO_FLEXIO1_FLEXIO11 { 844 pinmux = <0x443c003c 7 0x443c0398 0 0x443c01ec>; 845 }; 846 /omit-if-no-ref/ iomuxc1_gpio_io11_gpio_io_gpio2_io11: IOMUXC1_GPIO_IO11_GPIO_IO_GPIO2_IO11 { 847 pinmux = <0x443c003c 0 0x0 0 0x443c01ec>; 848 }; 849 /omit-if-no-ref/ iomuxc1_gpio_io11_lpi2c_scl_lpi2c8_scl: IOMUXC1_GPIO_IO11_LPI2C_SCL_LPI2C8_SCL { 850 pinmux = <0x443c003c 6 0x443c0418 0 0x443c01ec>; 851 }; 852 /omit-if-no-ref/ iomuxc1_gpio_io11_lpspi_sck_lpspi3_sck: IOMUXC1_GPIO_IO11_LPSPI_SCK_LPSPI3_SCK { 853 pinmux = <0x443c003c 1 0x0 0 0x443c01ec>; 854 }; 855 /omit-if-no-ref/ iomuxc1_gpio_io11_lpuart_rts_b_lpuart7_rts_b: IOMUXC1_GPIO_IO11_LPUART_RTS_B_LPUART7_RTS_B { 856 pinmux = <0x443c003c 5 0x0 0 0x443c01ec>; 857 }; 858 /omit-if-no-ref/ iomuxc1_gpio_io11_mediamix_cam_data_mediamix_cam_data5: IOMUXC1_GPIO_IO11_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA5 { 859 pinmux = <0x443c003c 2 0x443c04a4 0 0x443c01ec>; 860 }; 861 /omit-if-no-ref/ iomuxc1_gpio_io11_mediamix_disp_data_mediamix_disp_data7: IOMUXC1_GPIO_IO11_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA7 { 862 pinmux = <0x443c003c 3 0x0 0 0x443c01ec>; 863 }; 864 /omit-if-no-ref/ iomuxc1_gpio_io11_tpm_extclk_tpm5_extclk: IOMUXC1_GPIO_IO11_TPM_EXTCLK_TPM5_EXTCLK { 865 pinmux = <0x443c003c 4 0x0 0 0x443c01ec>; 866 }; 867 /omit-if-no-ref/ iomuxc1_gpio_io12_gpio_io_gpio2_io12: IOMUXC1_GPIO_IO12_GPIO_IO_GPIO2_IO12 { 868 pinmux = <0x443c0040 0 0x0 0 0x443c01f0>; 869 }; 870 /omit-if-no-ref/ iomuxc1_gpio_io12_lpi2c_sda_lpi2c8_sda: IOMUXC1_GPIO_IO12_LPI2C_SDA_LPI2C8_SDA { 871 pinmux = <0x443c0040 6 0x443c041c 1 0x443c01f0>; 872 }; 873 /omit-if-no-ref/ iomuxc1_gpio_io12_lpspi_pcs_lpspi8_pcs0: IOMUXC1_GPIO_IO12_LPSPI_PCS_LPSPI8_PCS0 { 874 pinmux = <0x443c0040 4 0x0 0 0x443c01f0>; 875 }; 876 /omit-if-no-ref/ iomuxc1_gpio_io12_lpuart_tx_lpuart8_tx: IOMUXC1_GPIO_IO12_LPUART_TX_LPUART8_TX { 877 pinmux = <0x443c0040 5 0x0 0 0x443c01f0>; 878 }; 879 /omit-if-no-ref/ iomuxc1_gpio_io12_mediamix_disp_data_mediamix_disp_data8: IOMUXC1_GPIO_IO12_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA8 { 880 pinmux = <0x443c0040 3 0x0 0 0x443c01f0>; 881 }; 882 /omit-if-no-ref/ iomuxc1_gpio_io12_pdm_bit_stream_pdm_bit_stream2: IOMUXC1_GPIO_IO12_PDM_BIT_STREAM_PDM_BIT_STREAM2 { 883 pinmux = <0x443c0040 2 0x443c04cc 0 0x443c01f0>; 884 }; 885 /omit-if-no-ref/ iomuxc1_gpio_io12_sai_rx_sync_sai3_rx_sync: IOMUXC1_GPIO_IO12_SAI_RX_SYNC_SAI3_RX_SYNC { 886 pinmux = <0x443c0040 7 0x443c04dc 0 0x443c01f0>; 887 }; 888 /omit-if-no-ref/ iomuxc1_gpio_io12_tpm_ch_tpm3_ch2: IOMUXC1_GPIO_IO12_TPM_CH_TPM3_CH2 { 889 pinmux = <0x443c0040 1 0x0 0 0x443c01f0>; 890 }; 891 /omit-if-no-ref/ iomuxc1_gpio_io13_flexio_flexio_flexio1_flexio13: IOMUXC1_GPIO_IO13_FLEXIO_FLEXIO_FLEXIO1_FLEXIO13 { 892 pinmux = <0x443c0044 7 0x443c039c 0 0x443c01f4>; 893 }; 894 /omit-if-no-ref/ iomuxc1_gpio_io13_gpio_io_gpio2_io13: IOMUXC1_GPIO_IO13_GPIO_IO_GPIO2_IO13 { 895 pinmux = <0x443c0044 0 0x0 0 0x443c01f4>; 896 }; 897 /omit-if-no-ref/ iomuxc1_gpio_io13_lpi2c_scl_lpi2c8_scl: IOMUXC1_GPIO_IO13_LPI2C_SCL_LPI2C8_SCL { 898 pinmux = <0x443c0044 6 0x443c0418 1 0x443c01f4>; 899 }; 900 /omit-if-no-ref/ iomuxc1_gpio_io13_lpspi_sin_lpspi8_sin: IOMUXC1_GPIO_IO13_LPSPI_SIN_LPSPI8_SIN { 901 pinmux = <0x443c0044 4 0x0 0 0x443c01f4>; 902 }; 903 /omit-if-no-ref/ iomuxc1_gpio_io13_lpuart_rx_lpuart8_rx: IOMUXC1_GPIO_IO13_LPUART_RX_LPUART8_RX { 904 pinmux = <0x443c0044 5 0x0 0 0x443c01f4>; 905 }; 906 /omit-if-no-ref/ iomuxc1_gpio_io13_mediamix_disp_data_mediamix_disp_data9: IOMUXC1_GPIO_IO13_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA9 { 907 pinmux = <0x443c0044 3 0x0 0 0x443c01f4>; 908 }; 909 /omit-if-no-ref/ iomuxc1_gpio_io13_pdm_bit_stream_pdm_bit_stream3: IOMUXC1_GPIO_IO13_PDM_BIT_STREAM_PDM_BIT_STREAM3 { 910 pinmux = <0x443c0044 2 0x443c04d0 0 0x443c01f4>; 911 }; 912 /omit-if-no-ref/ iomuxc1_gpio_io13_tpm_ch_tpm4_ch2: IOMUXC1_GPIO_IO13_TPM_CH_TPM4_CH2 { 913 pinmux = <0x443c0044 1 0x0 0 0x443c01f4>; 914 }; 915 /omit-if-no-ref/ iomuxc1_gpio_io14_flexio_flexio_flexio1_flexio14: IOMUXC1_GPIO_IO14_FLEXIO_FLEXIO_FLEXIO1_FLEXIO14 { 916 pinmux = <0x443c0048 7 0x443c03a0 0 0x443c01f8>; 917 }; 918 /omit-if-no-ref/ iomuxc1_gpio_io14_gpio_io_gpio2_io14: IOMUXC1_GPIO_IO14_GPIO_IO_GPIO2_IO14 { 919 pinmux = <0x443c0048 0 0x0 0 0x443c01f8>; 920 }; 921 /omit-if-no-ref/ iomuxc1_gpio_io14_lpspi_sout_lpspi8_sout: IOMUXC1_GPIO_IO14_LPSPI_SOUT_LPSPI8_SOUT { 922 pinmux = <0x443c0048 4 0x0 0 0x443c01f8>; 923 }; 924 /omit-if-no-ref/ iomuxc1_gpio_io14_lpuart_cts_b_lpuart8_cts_b: IOMUXC1_GPIO_IO14_LPUART_CTS_B_LPUART8_CTS_B { 925 pinmux = <0x443c0048 5 0x0 0 0x443c01f8>; 926 }; 927 /omit-if-no-ref/ iomuxc1_gpio_io14_lpuart_tx_lpuart3_tx: IOMUXC1_GPIO_IO14_LPUART_TX_LPUART3_TX { 928 pinmux = <0x443c0048 1 0x443c0474 0 0x443c01f8>; 929 }; 930 /omit-if-no-ref/ iomuxc1_gpio_io14_lpuart_tx_lpuart4_tx: IOMUXC1_GPIO_IO14_LPUART_TX_LPUART4_TX { 931 pinmux = <0x443c0048 6 0x443c0480 0 0x443c01f8>; 932 }; 933 /omit-if-no-ref/ iomuxc1_gpio_io14_mediamix_cam_data_mediamix_cam_data6: IOMUXC1_GPIO_IO14_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA6 { 934 pinmux = <0x443c0048 2 0x443c04a8 0 0x443c01f8>; 935 }; 936 /omit-if-no-ref/ iomuxc1_gpio_io14_mediamix_disp_data_mediamix_disp_data10: IOMUXC1_GPIO_IO14_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA10 { 937 pinmux = <0x443c0048 3 0x0 0 0x443c01f8>; 938 }; 939 /omit-if-no-ref/ iomuxc1_gpio_io15_flexio_flexio_flexio1_flexio15: IOMUXC1_GPIO_IO15_FLEXIO_FLEXIO_FLEXIO1_FLEXIO15 { 940 pinmux = <0x443c004c 7 0x443c03a4 0 0x443c01fc>; 941 }; 942 /omit-if-no-ref/ iomuxc1_gpio_io15_gpio_io_gpio2_io15: IOMUXC1_GPIO_IO15_GPIO_IO_GPIO2_IO15 { 943 pinmux = <0x443c004c 0 0x0 0 0x443c01fc>; 944 }; 945 /omit-if-no-ref/ iomuxc1_gpio_io15_lpspi_sck_lpspi8_sck: IOMUXC1_GPIO_IO15_LPSPI_SCK_LPSPI8_SCK { 946 pinmux = <0x443c004c 4 0x0 0 0x443c01fc>; 947 }; 948 /omit-if-no-ref/ iomuxc1_gpio_io15_lpuart_rts_b_lpuart8_rts_b: IOMUXC1_GPIO_IO15_LPUART_RTS_B_LPUART8_RTS_B { 949 pinmux = <0x443c004c 5 0x0 0 0x443c01fc>; 950 }; 951 /omit-if-no-ref/ iomuxc1_gpio_io15_lpuart_rx_lpuart3_rx: IOMUXC1_GPIO_IO15_LPUART_RX_LPUART3_RX { 952 pinmux = <0x443c004c 1 0x443c0470 0 0x443c01fc>; 953 }; 954 /omit-if-no-ref/ iomuxc1_gpio_io15_lpuart_rx_lpuart4_rx: IOMUXC1_GPIO_IO15_LPUART_RX_LPUART4_RX { 955 pinmux = <0x443c004c 6 0x443c047c 0 0x443c01fc>; 956 }; 957 /omit-if-no-ref/ iomuxc1_gpio_io15_mediamix_cam_data_mediamix_cam_data7: IOMUXC1_GPIO_IO15_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA7 { 958 pinmux = <0x443c004c 2 0x443c04ac 0 0x443c01fc>; 959 }; 960 /omit-if-no-ref/ iomuxc1_gpio_io15_mediamix_disp_data_mediamix_disp_data11: IOMUXC1_GPIO_IO15_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA11 { 961 pinmux = <0x443c004c 3 0x0 0 0x443c01fc>; 962 }; 963 /omit-if-no-ref/ iomuxc1_gpio_io16_flexio_flexio_flexio1_flexio16: IOMUXC1_GPIO_IO16_FLEXIO_FLEXIO_FLEXIO1_FLEXIO16 { 964 pinmux = <0x443c0050 7 0x443c03a8 0 0x443c0200>; 965 }; 966 /omit-if-no-ref/ iomuxc1_gpio_io16_gpio_io_gpio2_io16: IOMUXC1_GPIO_IO16_GPIO_IO_GPIO2_IO16 { 967 pinmux = <0x443c0050 0 0x0 0 0x443c0200>; 968 }; 969 /omit-if-no-ref/ iomuxc1_gpio_io16_lpspi_pcs_lpspi4_pcs2: IOMUXC1_GPIO_IO16_LPSPI_PCS_LPSPI4_PCS2 { 970 pinmux = <0x443c0050 5 0x0 0 0x443c0200>; 971 }; 972 /omit-if-no-ref/ iomuxc1_gpio_io16_lpuart_cts_b_lpuart3_cts_b: IOMUXC1_GPIO_IO16_LPUART_CTS_B_LPUART3_CTS_B { 973 pinmux = <0x443c0050 4 0x443c046c 0 0x443c0200>; 974 }; 975 /omit-if-no-ref/ iomuxc1_gpio_io16_lpuart_cts_b_lpuart4_cts_b: IOMUXC1_GPIO_IO16_LPUART_CTS_B_LPUART4_CTS_B { 976 pinmux = <0x443c0050 6 0x443c0478 0 0x443c0200>; 977 }; 978 /omit-if-no-ref/ iomuxc1_gpio_io16_mediamix_disp_data_mediamix_disp_data12: IOMUXC1_GPIO_IO16_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA12 { 979 pinmux = <0x443c0050 3 0x0 0 0x443c0200>; 980 }; 981 /omit-if-no-ref/ iomuxc1_gpio_io16_pdm_bit_stream_pdm_bit_stream2: IOMUXC1_GPIO_IO16_PDM_BIT_STREAM_PDM_BIT_STREAM2 { 982 pinmux = <0x443c0050 2 0x443c04cc 1 0x443c0200>; 983 }; 984 /omit-if-no-ref/ iomuxc1_gpio_io16_sai_tx_bclk_sai3_tx_bclk: IOMUXC1_GPIO_IO16_SAI_TX_BCLK_SAI3_TX_BCLK { 985 pinmux = <0x443c0050 1 0x0 0 0x443c0200>; 986 }; 987 /omit-if-no-ref/ iomuxc1_gpio_io17_flexio_flexio_flexio1_flexio17: IOMUXC1_GPIO_IO17_FLEXIO_FLEXIO_FLEXIO1_FLEXIO17 { 988 pinmux = <0x443c0054 7 0x443c03ac 0 0x443c0204>; 989 }; 990 /omit-if-no-ref/ iomuxc1_gpio_io17_gpio_io_gpio2_io17: IOMUXC1_GPIO_IO17_GPIO_IO_GPIO2_IO17 { 991 pinmux = <0x443c0054 0 0x0 0 0x443c0204>; 992 }; 993 /omit-if-no-ref/ iomuxc1_gpio_io17_lpspi_pcs_lpspi4_pcs1: IOMUXC1_GPIO_IO17_LPSPI_PCS_LPSPI4_PCS1 { 994 pinmux = <0x443c0054 5 0x0 0 0x443c0204>; 995 }; 996 /omit-if-no-ref/ iomuxc1_gpio_io17_lpuart_rts_b_lpuart3_rts_b: IOMUXC1_GPIO_IO17_LPUART_RTS_B_LPUART3_RTS_B { 997 pinmux = <0x443c0054 4 0x0 0 0x443c0204>; 998 }; 999 /omit-if-no-ref/ iomuxc1_gpio_io17_lpuart_rts_b_lpuart4_rts_b: IOMUXC1_GPIO_IO17_LPUART_RTS_B_LPUART4_RTS_B { 1000 pinmux = <0x443c0054 6 0x0 0 0x443c0204>; 1001 }; 1002 /omit-if-no-ref/ iomuxc1_gpio_io17_mediamix_cam_data_mediamix_cam_data8: IOMUXC1_GPIO_IO17_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA8 { 1003 pinmux = <0x443c0054 2 0x443c04b0 0 0x443c0204>; 1004 }; 1005 /omit-if-no-ref/ iomuxc1_gpio_io17_mediamix_disp_data_mediamix_disp_data13: IOMUXC1_GPIO_IO17_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA13 { 1006 pinmux = <0x443c0054 3 0x0 0 0x443c0204>; 1007 }; 1008 /omit-if-no-ref/ iomuxc1_gpio_io17_sai_mclk_sai3_mclk: IOMUXC1_GPIO_IO17_SAI_MCLK_SAI3_MCLK { 1009 pinmux = <0x443c0054 1 0x0 0 0x443c0204>; 1010 }; 1011 /omit-if-no-ref/ iomuxc1_gpio_io18_flexio_flexio_flexio1_flexio18: IOMUXC1_GPIO_IO18_FLEXIO_FLEXIO_FLEXIO1_FLEXIO18 { 1012 pinmux = <0x443c0058 7 0x443c03b0 0 0x443c0208>; 1013 }; 1014 /omit-if-no-ref/ iomuxc1_gpio_io18_gpio_io_gpio2_io18: IOMUXC1_GPIO_IO18_GPIO_IO_GPIO2_IO18 { 1015 pinmux = <0x443c0058 0 0x0 0 0x443c0208>; 1016 }; 1017 /omit-if-no-ref/ iomuxc1_gpio_io18_lpspi_pcs_lpspi4_pcs0: IOMUXC1_GPIO_IO18_LPSPI_PCS_LPSPI4_PCS0 { 1018 pinmux = <0x443c0058 5 0x0 0 0x443c0208>; 1019 }; 1020 /omit-if-no-ref/ iomuxc1_gpio_io18_lpspi_pcs_lpspi5_pcs0: IOMUXC1_GPIO_IO18_LPSPI_PCS_LPSPI5_PCS0 { 1021 pinmux = <0x443c0058 4 0x0 0 0x443c0208>; 1022 }; 1023 /omit-if-no-ref/ iomuxc1_gpio_io18_mediamix_cam_data_mediamix_cam_data9: IOMUXC1_GPIO_IO18_MEDIAMIX_CAM_DATA_MEDIAMIX_CAM_DATA9 { 1024 pinmux = <0x443c0058 2 0x443c04b4 0 0x443c0208>; 1025 }; 1026 /omit-if-no-ref/ iomuxc1_gpio_io18_mediamix_disp_data_mediamix_disp_data14: IOMUXC1_GPIO_IO18_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA14 { 1027 pinmux = <0x443c0058 3 0x0 0 0x443c0208>; 1028 }; 1029 /omit-if-no-ref/ iomuxc1_gpio_io18_sai_rx_bclk_sai3_rx_bclk: IOMUXC1_GPIO_IO18_SAI_RX_BCLK_SAI3_RX_BCLK { 1030 pinmux = <0x443c0058 1 0x443c04d8 0 0x443c0208>; 1031 }; 1032 /omit-if-no-ref/ iomuxc1_gpio_io18_tpm_ch_tpm5_ch2: IOMUXC1_GPIO_IO18_TPM_CH_TPM5_CH2 { 1033 pinmux = <0x443c0058 6 0x0 0 0x443c0208>; 1034 }; 1035 /omit-if-no-ref/ iomuxc1_gpio_io19_gpio_io_gpio2_io19: IOMUXC1_GPIO_IO19_GPIO_IO_GPIO2_IO19 { 1036 pinmux = <0x443c005c 0 0x0 0 0x443c020c>; 1037 }; 1038 /omit-if-no-ref/ iomuxc1_gpio_io19_lpspi_sin_lpspi4_sin: IOMUXC1_GPIO_IO19_LPSPI_SIN_LPSPI4_SIN { 1039 pinmux = <0x443c005c 5 0x0 0 0x443c020c>; 1040 }; 1041 /omit-if-no-ref/ iomuxc1_gpio_io19_lpspi_sin_lpspi5_sin: IOMUXC1_GPIO_IO19_LPSPI_SIN_LPSPI5_SIN { 1042 pinmux = <0x443c005c 4 0x0 0 0x443c020c>; 1043 }; 1044 /omit-if-no-ref/ iomuxc1_gpio_io19_mediamix_disp_data_mediamix_disp_data15: IOMUXC1_GPIO_IO19_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA15 { 1045 pinmux = <0x443c005c 3 0x0 0 0x443c020c>; 1046 }; 1047 /omit-if-no-ref/ iomuxc1_gpio_io19_pdm_bit_stream_pdm_bit_stream3: IOMUXC1_GPIO_IO19_PDM_BIT_STREAM_PDM_BIT_STREAM3 { 1048 pinmux = <0x443c005c 2 0x443c04d0 1 0x443c020c>; 1049 }; 1050 /omit-if-no-ref/ iomuxc1_gpio_io19_sai_rx_sync_sai3_rx_sync: IOMUXC1_GPIO_IO19_SAI_RX_SYNC_SAI3_RX_SYNC { 1051 pinmux = <0x443c005c 1 0x443c04dc 1 0x443c020c>; 1052 }; 1053 /omit-if-no-ref/ iomuxc1_gpio_io19_sai_tx_data_sai3_tx_data0: IOMUXC1_GPIO_IO19_SAI_TX_DATA_SAI3_TX_DATA0 { 1054 pinmux = <0x443c005c 7 0x0 0 0x443c020c>; 1055 }; 1056 /omit-if-no-ref/ iomuxc1_gpio_io19_tpm_ch_tpm6_ch2: IOMUXC1_GPIO_IO19_TPM_CH_TPM6_CH2 { 1057 pinmux = <0x443c005c 6 0x0 0 0x443c020c>; 1058 }; 1059 /omit-if-no-ref/ iomuxc1_gpio_io20_flexio_flexio_flexio1_flexio20: IOMUXC1_GPIO_IO20_FLEXIO_FLEXIO_FLEXIO1_FLEXIO20 { 1060 pinmux = <0x443c0060 7 0x443c03b4 0 0x443c0210>; 1061 }; 1062 /omit-if-no-ref/ iomuxc1_gpio_io20_gpio_io_gpio2_io20: IOMUXC1_GPIO_IO20_GPIO_IO_GPIO2_IO20 { 1063 pinmux = <0x443c0060 0 0x0 0 0x443c0210>; 1064 }; 1065 /omit-if-no-ref/ iomuxc1_gpio_io20_lpspi_sout_lpspi4_sout: IOMUXC1_GPIO_IO20_LPSPI_SOUT_LPSPI4_SOUT { 1066 pinmux = <0x443c0060 5 0x0 0 0x443c0210>; 1067 }; 1068 /omit-if-no-ref/ iomuxc1_gpio_io20_lpspi_sout_lpspi5_sout: IOMUXC1_GPIO_IO20_LPSPI_SOUT_LPSPI5_SOUT { 1069 pinmux = <0x443c0060 4 0x0 0 0x443c0210>; 1070 }; 1071 /omit-if-no-ref/ iomuxc1_gpio_io20_mediamix_disp_data_mediamix_disp_data16: IOMUXC1_GPIO_IO20_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA16 { 1072 pinmux = <0x443c0060 3 0x0 0 0x443c0210>; 1073 }; 1074 /omit-if-no-ref/ iomuxc1_gpio_io20_pdm_bit_stream_pdm_bit_stream0: IOMUXC1_GPIO_IO20_PDM_BIT_STREAM_PDM_BIT_STREAM0 { 1075 pinmux = <0x443c0060 2 0x443c04c4 1 0x443c0210>; 1076 }; 1077 /omit-if-no-ref/ iomuxc1_gpio_io20_sai_rx_data_sai3_rx_data0: IOMUXC1_GPIO_IO20_SAI_RX_DATA_SAI3_RX_DATA0 { 1078 pinmux = <0x443c0060 1 0x0 0 0x443c0210>; 1079 }; 1080 /omit-if-no-ref/ iomuxc1_gpio_io20_tpm_ch_tpm3_ch1: IOMUXC1_GPIO_IO20_TPM_CH_TPM3_CH1 { 1081 pinmux = <0x443c0060 6 0x0 0 0x443c0210>; 1082 }; 1083 /omit-if-no-ref/ iomuxc1_gpio_io21_gpio_io_gpio2_io21: IOMUXC1_GPIO_IO21_GPIO_IO_GPIO2_IO21 { 1084 pinmux = <0x443c0064 0 0x0 0 0x443c0214>; 1085 }; 1086 /omit-if-no-ref/ iomuxc1_gpio_io21_lpspi_sck_lpspi4_sck: IOMUXC1_GPIO_IO21_LPSPI_SCK_LPSPI4_SCK { 1087 pinmux = <0x443c0064 5 0x0 0 0x443c0214>; 1088 }; 1089 /omit-if-no-ref/ iomuxc1_gpio_io21_lpspi_sck_lpspi5_sck: IOMUXC1_GPIO_IO21_LPSPI_SCK_LPSPI5_SCK { 1090 pinmux = <0x443c0064 4 0x0 0 0x443c0214>; 1091 }; 1092 /omit-if-no-ref/ iomuxc1_gpio_io21_mediamix_disp_data_mediamix_disp_data17: IOMUXC1_GPIO_IO21_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA17 { 1093 pinmux = <0x443c0064 3 0x0 0 0x443c0214>; 1094 }; 1095 /omit-if-no-ref/ iomuxc1_gpio_io21_pdm_clk_pdm_clk: IOMUXC1_GPIO_IO21_PDM_CLK_PDM_CLK { 1096 pinmux = <0x443c0064 2 0x0 0 0x443c0214>; 1097 }; 1098 /omit-if-no-ref/ iomuxc1_gpio_io21_sai_rx_bclk_sai3_rx_bclk: IOMUXC1_GPIO_IO21_SAI_RX_BCLK_SAI3_RX_BCLK { 1099 pinmux = <0x443c0064 7 0x443c04d8 1 0x443c0214>; 1100 }; 1101 /omit-if-no-ref/ iomuxc1_gpio_io21_sai_tx_data_sai3_tx_data0: IOMUXC1_GPIO_IO21_SAI_TX_DATA_SAI3_TX_DATA0 { 1102 pinmux = <0x443c0064 1 0x0 0 0x443c0214>; 1103 }; 1104 /omit-if-no-ref/ iomuxc1_gpio_io21_tpm_ch_tpm4_ch1: IOMUXC1_GPIO_IO21_TPM_CH_TPM4_CH1 { 1105 pinmux = <0x443c0064 6 0x0 0 0x443c0214>; 1106 }; 1107 /omit-if-no-ref/ iomuxc1_gpio_io22_flexio_flexio_flexio1_flexio22: IOMUXC1_GPIO_IO22_FLEXIO_FLEXIO_FLEXIO1_FLEXIO22 { 1108 pinmux = <0x443c0068 7 0x443c03b8 0 0x443c0218>; 1109 }; 1110 /omit-if-no-ref/ iomuxc1_gpio_io22_gpio_io_gpio2_io22: IOMUXC1_GPIO_IO22_GPIO_IO_GPIO2_IO22 { 1111 pinmux = <0x443c0068 0 0x0 0 0x443c0218>; 1112 }; 1113 /omit-if-no-ref/ iomuxc1_gpio_io22_lpi2c_sda_lpi2c5_sda: IOMUXC1_GPIO_IO22_LPI2C_SDA_LPI2C5_SDA { 1114 pinmux = <0x443c0068 6 0x443c0404 1 0x443c0218>; 1115 }; 1116 /omit-if-no-ref/ iomuxc1_gpio_io22_mediamix_disp_data_mediamix_disp_data18: IOMUXC1_GPIO_IO22_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA18 { 1117 pinmux = <0x443c0068 3 0x0 0 0x443c0218>; 1118 }; 1119 /omit-if-no-ref/ iomuxc1_gpio_io22_spdif_in_spdif_in: IOMUXC1_GPIO_IO22_SPDIF_IN_SPDIF_IN { 1120 pinmux = <0x443c0068 2 0x443c04e4 0 0x443c0218>; 1121 }; 1122 /omit-if-no-ref/ iomuxc1_gpio_io22_tpm_ch_tpm5_ch1: IOMUXC1_GPIO_IO22_TPM_CH_TPM5_CH1 { 1123 pinmux = <0x443c0068 4 0x0 0 0x443c0218>; 1124 }; 1125 /omit-if-no-ref/ iomuxc1_gpio_io22_tpm_extclk_tpm6_extclk: IOMUXC1_GPIO_IO22_TPM_EXTCLK_TPM6_EXTCLK { 1126 pinmux = <0x443c0068 5 0x0 0 0x443c0218>; 1127 }; 1128 /omit-if-no-ref/ iomuxc1_gpio_io22_usdhc_clk_usdhc3_clk: IOMUXC1_GPIO_IO22_USDHC_CLK_USDHC3_CLK { 1129 pinmux = <0x443c0068 1 0x443c04e8 0 0x443c0218>; 1130 }; 1131 /omit-if-no-ref/ iomuxc1_gpio_io23_flexio_flexio_flexio1_flexio23: IOMUXC1_GPIO_IO23_FLEXIO_FLEXIO_FLEXIO1_FLEXIO23 { 1132 pinmux = <0x443c006c 7 0x443c03bc 0 0x443c021c>; 1133 }; 1134 /omit-if-no-ref/ iomuxc1_gpio_io23_gpio_io_gpio2_io23: IOMUXC1_GPIO_IO23_GPIO_IO_GPIO2_IO23 { 1135 pinmux = <0x443c006c 0 0x0 0 0x443c021c>; 1136 }; 1137 /omit-if-no-ref/ iomuxc1_gpio_io23_lpi2c_scl_lpi2c5_scl: IOMUXC1_GPIO_IO23_LPI2C_SCL_LPI2C5_SCL { 1138 pinmux = <0x443c006c 6 0x443c0400 1 0x443c021c>; 1139 }; 1140 /omit-if-no-ref/ iomuxc1_gpio_io23_mediamix_disp_data_mediamix_disp_data19: IOMUXC1_GPIO_IO23_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA19 { 1141 pinmux = <0x443c006c 3 0x0 0 0x443c021c>; 1142 }; 1143 /omit-if-no-ref/ iomuxc1_gpio_io23_spdif_out_spdif_out: IOMUXC1_GPIO_IO23_SPDIF_OUT_SPDIF_OUT { 1144 pinmux = <0x443c006c 2 0x0 0 0x443c021c>; 1145 }; 1146 /omit-if-no-ref/ iomuxc1_gpio_io23_tpm_ch_tpm6_ch1: IOMUXC1_GPIO_IO23_TPM_CH_TPM6_CH1 { 1147 pinmux = <0x443c006c 4 0x0 0 0x443c021c>; 1148 }; 1149 /omit-if-no-ref/ iomuxc1_gpio_io23_usdhc_cmd_usdhc3_cmd: IOMUXC1_GPIO_IO23_USDHC_CMD_USDHC3_CMD { 1150 pinmux = <0x443c006c 1 0x443c04ec 0 0x443c021c>; 1151 }; 1152 /omit-if-no-ref/ iomuxc1_gpio_io24_flexio_flexio_flexio1_flexio24: IOMUXC1_GPIO_IO24_FLEXIO_FLEXIO_FLEXIO1_FLEXIO24 { 1153 pinmux = <0x443c0070 7 0x443c03c0 0 0x443c0220>; 1154 }; 1155 /omit-if-no-ref/ iomuxc1_gpio_io24_gpio_io_gpio2_io24: IOMUXC1_GPIO_IO24_GPIO_IO_GPIO2_IO24 { 1156 pinmux = <0x443c0070 0 0x0 0 0x443c0220>; 1157 }; 1158 /omit-if-no-ref/ iomuxc1_gpio_io24_jtag_mux_tdo_jtag_mux_tdo: IOMUXC1_GPIO_IO24_JTAG_MUX_TDO_JTAG_MUX_TDO { 1159 pinmux = <0x443c0070 5 0x0 0 0x443c0220>; 1160 }; 1161 /omit-if-no-ref/ iomuxc1_gpio_io24_lpspi_pcs_lpspi6_pcs1: IOMUXC1_GPIO_IO24_LPSPI_PCS_LPSPI6_PCS1 { 1162 pinmux = <0x443c0070 6 0x0 0 0x443c0220>; 1163 }; 1164 /omit-if-no-ref/ iomuxc1_gpio_io24_mediamix_disp_data_mediamix_disp_data20: IOMUXC1_GPIO_IO24_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA20 { 1165 pinmux = <0x443c0070 3 0x0 0 0x443c0220>; 1166 }; 1167 /omit-if-no-ref/ iomuxc1_gpio_io24_tpm_ch_tpm3_ch3: IOMUXC1_GPIO_IO24_TPM_CH_TPM3_CH3 { 1168 pinmux = <0x443c0070 4 0x0 0 0x443c0220>; 1169 }; 1170 /omit-if-no-ref/ iomuxc1_gpio_io24_usdhc_data_usdhc3_data0: IOMUXC1_GPIO_IO24_USDHC_DATA_USDHC3_DATA0 { 1171 pinmux = <0x443c0070 1 0x443c04f0 0 0x443c0220>; 1172 }; 1173 /omit-if-no-ref/ iomuxc1_gpio_io25_can_tx_can2_tx: IOMUXC1_GPIO_IO25_CAN_TX_CAN2_TX { 1174 pinmux = <0x443c0074 2 0x0 0 0x443c0224>; 1175 }; 1176 /omit-if-no-ref/ iomuxc1_gpio_io25_flexio_flexio_flexio1_flexio25: IOMUXC1_GPIO_IO25_FLEXIO_FLEXIO_FLEXIO1_FLEXIO25 { 1177 pinmux = <0x443c0074 7 0x443c03c4 0 0x443c0224>; 1178 }; 1179 /omit-if-no-ref/ iomuxc1_gpio_io25_gpio_io_gpio2_io25: IOMUXC1_GPIO_IO25_GPIO_IO_GPIO2_IO25 { 1180 pinmux = <0x443c0074 0 0x0 0 0x443c0224>; 1181 }; 1182 /omit-if-no-ref/ iomuxc1_gpio_io25_jtag_mux_tck_jtag_mux_tck: IOMUXC1_GPIO_IO25_JTAG_MUX_TCK_JTAG_MUX_TCK { 1183 pinmux = <0x443c0074 5 0x443c03d4 1 0x443c0224>; 1184 }; 1185 /omit-if-no-ref/ iomuxc1_gpio_io25_lpspi_pcs_lpspi7_pcs1: IOMUXC1_GPIO_IO25_LPSPI_PCS_LPSPI7_PCS1 { 1186 pinmux = <0x443c0074 6 0x0 0 0x443c0224>; 1187 }; 1188 /omit-if-no-ref/ iomuxc1_gpio_io25_mediamix_disp_data_mediamix_disp_data21: IOMUXC1_GPIO_IO25_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA21 { 1189 pinmux = <0x443c0074 3 0x0 0 0x443c0224>; 1190 }; 1191 /omit-if-no-ref/ iomuxc1_gpio_io25_tpm_ch_tpm4_ch3: IOMUXC1_GPIO_IO25_TPM_CH_TPM4_CH3 { 1192 pinmux = <0x443c0074 4 0x0 0 0x443c0224>; 1193 }; 1194 /omit-if-no-ref/ iomuxc1_gpio_io25_usdhc_data_usdhc3_data1: IOMUXC1_GPIO_IO25_USDHC_DATA_USDHC3_DATA1 { 1195 pinmux = <0x443c0074 1 0x443c04f4 0 0x443c0224>; 1196 }; 1197 /omit-if-no-ref/ iomuxc1_gpio_io26_gpio_io_gpio2_io26: IOMUXC1_GPIO_IO26_GPIO_IO_GPIO2_IO26 { 1198 pinmux = <0x443c0078 0 0x0 0 0x443c0228>; 1199 }; 1200 /omit-if-no-ref/ iomuxc1_gpio_io26_jtag_mux_tdi_jtag_mux_tdi: IOMUXC1_GPIO_IO26_JTAG_MUX_TDI_JTAG_MUX_TDI { 1201 pinmux = <0x443c0078 5 0x443c03d8 1 0x443c0228>; 1202 }; 1203 /omit-if-no-ref/ iomuxc1_gpio_io26_lpspi_pcs_lpspi8_pcs1: IOMUXC1_GPIO_IO26_LPSPI_PCS_LPSPI8_PCS1 { 1204 pinmux = <0x443c0078 6 0x0 0 0x443c0228>; 1205 }; 1206 /omit-if-no-ref/ iomuxc1_gpio_io26_mediamix_disp_data_mediamix_disp_data22: IOMUXC1_GPIO_IO26_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA22 { 1207 pinmux = <0x443c0078 3 0x0 0 0x443c0228>; 1208 }; 1209 /omit-if-no-ref/ iomuxc1_gpio_io26_pdm_bit_stream_pdm_bit_stream1: IOMUXC1_GPIO_IO26_PDM_BIT_STREAM_PDM_BIT_STREAM1 { 1210 pinmux = <0x443c0078 2 0x443c04c8 1 0x443c0228>; 1211 }; 1212 /omit-if-no-ref/ iomuxc1_gpio_io26_sai_tx_sync_sai3_tx_sync: IOMUXC1_GPIO_IO26_SAI_TX_SYNC_SAI3_TX_SYNC { 1213 pinmux = <0x443c0078 7 0x443c04e0 0 0x443c0228>; 1214 }; 1215 /omit-if-no-ref/ iomuxc1_gpio_io26_tpm_ch_tpm5_ch3: IOMUXC1_GPIO_IO26_TPM_CH_TPM5_CH3 { 1216 pinmux = <0x443c0078 4 0x0 0 0x443c0228>; 1217 }; 1218 /omit-if-no-ref/ iomuxc1_gpio_io26_usdhc_data_usdhc3_data2: IOMUXC1_GPIO_IO26_USDHC_DATA_USDHC3_DATA2 { 1219 pinmux = <0x443c0078 1 0x443c04f8 0 0x443c0228>; 1220 }; 1221 /omit-if-no-ref/ iomuxc1_gpio_io27_can_rx_can2_rx: IOMUXC1_GPIO_IO27_CAN_RX_CAN2_RX { 1222 pinmux = <0x443c007c 2 0x443c0364 1 0x443c022c>; 1223 }; 1224 /omit-if-no-ref/ iomuxc1_gpio_io27_flexio_flexio_flexio1_flexio27: IOMUXC1_GPIO_IO27_FLEXIO_FLEXIO_FLEXIO1_FLEXIO27 { 1225 pinmux = <0x443c007c 7 0x443c03c8 0 0x443c022c>; 1226 }; 1227 /omit-if-no-ref/ iomuxc1_gpio_io27_gpio_io_gpio2_io27: IOMUXC1_GPIO_IO27_GPIO_IO_GPIO2_IO27 { 1228 pinmux = <0x443c007c 0 0x0 0 0x443c022c>; 1229 }; 1230 /omit-if-no-ref/ iomuxc1_gpio_io27_jtag_mux_tms_jtag_mux_tms: IOMUXC1_GPIO_IO27_JTAG_MUX_TMS_JTAG_MUX_TMS { 1231 pinmux = <0x443c007c 5 0x443c03dc 1 0x443c022c>; 1232 }; 1233 /omit-if-no-ref/ iomuxc1_gpio_io27_lpspi_pcs_lpspi5_pcs1: IOMUXC1_GPIO_IO27_LPSPI_PCS_LPSPI5_PCS1 { 1234 pinmux = <0x443c007c 6 0x0 0 0x443c022c>; 1235 }; 1236 /omit-if-no-ref/ iomuxc1_gpio_io27_mediamix_disp_data_mediamix_disp_data23: IOMUXC1_GPIO_IO27_MEDIAMIX_DISP_DATA_MEDIAMIX_DISP_DATA23 { 1237 pinmux = <0x443c007c 3 0x0 0 0x443c022c>; 1238 }; 1239 /omit-if-no-ref/ iomuxc1_gpio_io27_tpm_ch_tpm6_ch3: IOMUXC1_GPIO_IO27_TPM_CH_TPM6_CH3 { 1240 pinmux = <0x443c007c 4 0x0 0 0x443c022c>; 1241 }; 1242 /omit-if-no-ref/ iomuxc1_gpio_io27_usdhc_data_usdhc3_data3: IOMUXC1_GPIO_IO27_USDHC_DATA_USDHC3_DATA3 { 1243 pinmux = <0x443c007c 1 0x443c04fc 0 0x443c022c>; 1244 }; 1245 /omit-if-no-ref/ iomuxc1_gpio_io28_can_tx_can1_tx: IOMUXC1_GPIO_IO28_CAN_TX_CAN1_TX { 1246 pinmux = <0x443c0080 2 0x0 0 0x443c0230>; 1247 }; 1248 /omit-if-no-ref/ iomuxc1_gpio_io28_flexio_flexio_flexio1_flexio28: IOMUXC1_GPIO_IO28_FLEXIO_FLEXIO_FLEXIO1_FLEXIO28 { 1249 pinmux = <0x443c0080 7 0x0 0 0x443c0230>; 1250 }; 1251 /omit-if-no-ref/ iomuxc1_gpio_io28_gpio_io_gpio2_io28: IOMUXC1_GPIO_IO28_GPIO_IO_GPIO2_IO28 { 1252 pinmux = <0x443c0080 0 0x0 0 0x443c0230>; 1253 }; 1254 /omit-if-no-ref/ iomuxc1_gpio_io28_lpi2c_sda_lpi2c3_sda: IOMUXC1_GPIO_IO28_LPI2C_SDA_LPI2C3_SDA { 1255 pinmux = <0x443c0080 1 0x443c03f4 1 0x443c0230>; 1256 }; 1257 /omit-if-no-ref/ iomuxc1_gpio_io29_can_rx_can1_rx: IOMUXC1_GPIO_IO29_CAN_RX_CAN1_RX { 1258 pinmux = <0x443c0084 2 0x443c0360 0 0x443c0234>; 1259 }; 1260 /omit-if-no-ref/ iomuxc1_gpio_io29_flexio_flexio_flexio1_flexio29: IOMUXC1_GPIO_IO29_FLEXIO_FLEXIO_FLEXIO1_FLEXIO29 { 1261 pinmux = <0x443c0084 7 0x0 0 0x443c0234>; 1262 }; 1263 /omit-if-no-ref/ iomuxc1_gpio_io29_gpio_io_gpio2_io29: IOMUXC1_GPIO_IO29_GPIO_IO_GPIO2_IO29 { 1264 pinmux = <0x443c0084 0 0x0 0 0x443c0234>; 1265 }; 1266 /omit-if-no-ref/ iomuxc1_gpio_io29_lpi2c_scl_lpi2c3_scl: IOMUXC1_GPIO_IO29_LPI2C_SCL_LPI2C3_SCL { 1267 pinmux = <0x443c0084 1 0x443c03f0 1 0x443c0234>; 1268 }; 1269 /omit-if-no-ref/ iomuxc1_i2c1_scl_gpio_io_gpio1_io0: IOMUXC1_I2C1_SCL_GPIO_IO_GPIO1_IO0 { 1270 pinmux = <0x443c0170 5 0x0 0 0x443c0320>; 1271 }; 1272 /omit-if-no-ref/ iomuxc1_i2c1_scl_i3c_scl_i3c1_scl: IOMUXC1_I2C1_SCL_I3C_SCL_I3C1_SCL { 1273 pinmux = <0x443c0170 1 0x0 0 0x443c0320>; 1274 }; 1275 /omit-if-no-ref/ iomuxc1_i2c1_scl_lpi2c_scl_lpi2c1_scl: IOMUXC1_I2C1_SCL_LPI2C_SCL_LPI2C1_SCL { 1276 pinmux = <0x443c0170 0 0x443c03e0 2 0x443c0320>; 1277 }; 1278 /omit-if-no-ref/ iomuxc1_i2c1_scl_lpuart_dcb_b_lpuart1_dcb_b: IOMUXC1_I2C1_SCL_LPUART_DCB_B_LPUART1_DCB_B { 1279 pinmux = <0x443c0170 2 0x0 0 0x443c0320>; 1280 }; 1281 /omit-if-no-ref/ iomuxc1_i2c1_scl_tpm_ch_tpm2_ch0: IOMUXC1_I2C1_SCL_TPM_CH_TPM2_CH0 { 1282 pinmux = <0x443c0170 3 0x0 0 0x443c0320>; 1283 }; 1284 /omit-if-no-ref/ iomuxc1_i2c1_sda_gpio_io_gpio1_io1: IOMUXC1_I2C1_SDA_GPIO_IO_GPIO1_IO1 { 1285 pinmux = <0x443c0174 5 0x0 0 0x443c0324>; 1286 }; 1287 /omit-if-no-ref/ iomuxc1_i2c1_sda_i3c_sda_i3c1_sda: IOMUXC1_I2C1_SDA_I3C_SDA_I3C1_SDA { 1288 pinmux = <0x443c0174 1 0x0 0 0x443c0324>; 1289 }; 1290 /omit-if-no-ref/ iomuxc1_i2c1_sda_lpi2c_sda_lpi2c1_sda: IOMUXC1_I2C1_SDA_LPI2C_SDA_LPI2C1_SDA { 1291 pinmux = <0x443c0174 0 0x443c03e4 2 0x443c0324>; 1292 }; 1293 /omit-if-no-ref/ iomuxc1_i2c1_sda_lpuart_rin_b_lpuart1_rin_b: IOMUXC1_I2C1_SDA_LPUART_RIN_B_LPUART1_RIN_B { 1294 pinmux = <0x443c0174 2 0x0 0 0x443c0324>; 1295 }; 1296 /omit-if-no-ref/ iomuxc1_i2c1_sda_tpm_ch_tpm2_ch1: IOMUXC1_I2C1_SDA_TPM_CH_TPM2_CH1 { 1297 pinmux = <0x443c0174 3 0x0 0 0x443c0324>; 1298 }; 1299 /omit-if-no-ref/ iomuxc1_i2c2_scl_gpio_io_gpio1_io3: IOMUXC1_I2C2_SCL_GPIO_IO_GPIO1_IO3 { 1300 pinmux = <0x443c0178 5 0x0 0 0x443c0328>; 1301 }; 1302 /omit-if-no-ref/ iomuxc1_i2c2_scl_i3c_pur_b_i3c1_pur_b: IOMUXC1_I2C2_SCL_I3C_PUR_B_I3C1_PUR_B { 1303 pinmux = <0x443c0178 6 0x0 0 0x443c0328>; 1304 }; 1305 /omit-if-no-ref/ iomuxc1_i2c2_scl_i3c_pur_i3c1_pur: IOMUXC1_I2C2_SCL_I3C_PUR_I3C1_PUR { 1306 pinmux = <0x443c0178 1 0x0 0 0x443c0328>; 1307 }; 1308 /omit-if-no-ref/ iomuxc1_i2c2_scl_lpi2c_scl_lpi2c2_scl: IOMUXC1_I2C2_SCL_LPI2C_SCL_LPI2C2_SCL { 1309 pinmux = <0x443c0178 0 0x443c03e8 1 0x443c0328>; 1310 }; 1311 /omit-if-no-ref/ iomuxc1_i2c2_scl_lpuart_dcb_b_lpuart2_dcb_b: IOMUXC1_I2C2_SCL_LPUART_DCB_B_LPUART2_DCB_B { 1312 pinmux = <0x443c0178 2 0x0 0 0x443c0328>; 1313 }; 1314 /omit-if-no-ref/ iomuxc1_i2c2_scl_sai_rx_sync_sai1_rx_sync: IOMUXC1_I2C2_SCL_SAI_RX_SYNC_SAI1_RX_SYNC { 1315 pinmux = <0x443c0178 4 0x0 0 0x443c0328>; 1316 }; 1317 /omit-if-no-ref/ iomuxc1_i2c2_scl_tpm_ch_tpm2_ch2: IOMUXC1_I2C2_SCL_TPM_CH_TPM2_CH2 { 1318 pinmux = <0x443c0178 3 0x0 0 0x443c0328>; 1319 }; 1320 /omit-if-no-ref/ iomuxc1_i2c2_sda_gpio_io_gpio1_io3: IOMUXC1_I2C2_SDA_GPIO_IO_GPIO1_IO3 { 1321 pinmux = <0x443c017c 5 0x0 0 0x443c032c>; 1322 }; 1323 /omit-if-no-ref/ iomuxc1_i2c2_sda_lpi2c_sda_lpi2c2_sda: IOMUXC1_I2C2_SDA_LPI2C_SDA_LPI2C2_SDA { 1324 pinmux = <0x443c017c 0 0x443c03ec 1 0x443c032c>; 1325 }; 1326 /omit-if-no-ref/ iomuxc1_i2c2_sda_lpuart_rin_b_lpuart2_rin_b: IOMUXC1_I2C2_SDA_LPUART_RIN_B_LPUART2_RIN_B { 1327 pinmux = <0x443c017c 2 0x0 0 0x443c032c>; 1328 }; 1329 /omit-if-no-ref/ iomuxc1_i2c2_sda_sai_rx_bclk_sai1_rx_bclk: IOMUXC1_I2C2_SDA_SAI_RX_BCLK_SAI1_RX_BCLK { 1330 pinmux = <0x443c017c 4 0x0 0 0x443c032c>; 1331 }; 1332 /omit-if-no-ref/ iomuxc1_i2c2_sda_tpm_ch_tpm2_ch3: IOMUXC1_I2C2_SDA_TPM_CH_TPM2_CH3 { 1333 pinmux = <0x443c017c 3 0x0 0 0x443c032c>; 1334 }; 1335 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_can_rx_can1_rx: IOMUXC1_PDM_BIT_STREAM0_CAN_RX_CAN1_RX { 1336 pinmux = <0x443c0194 6 0x443c0360 1 0x443c0344>; 1337 }; 1338 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_gpio_io_gpio1_io9: IOMUXC1_PDM_BIT_STREAM0_GPIO_IO_GPIO1_IO9 { 1339 pinmux = <0x443c0194 5 0x0 0 0x443c0344>; 1340 }; 1341 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_lpspi_pcs_lpspi1_pcs1: IOMUXC1_PDM_BIT_STREAM0_LPSPI_PCS_LPSPI1_PCS1 { 1342 pinmux = <0x443c0194 2 0x443c0424 1 0x443c0344>; 1343 }; 1344 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_lptmr_alt_lptmr1_alt2: IOMUXC1_PDM_BIT_STREAM0_LPTMR_ALT_LPTMR1_ALT2 { 1345 pinmux = <0x443c0194 4 0x0 0 0x443c0344>; 1346 }; 1347 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_mqs_right_mqs1_right: IOMUXC1_PDM_BIT_STREAM0_MQS_RIGHT_MQS1_RIGHT { 1348 pinmux = <0x443c0194 1 0x0 0 0x443c0344>; 1349 }; 1350 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_pdm_bit_stream_pdm_bit_stream0: IOMUXC1_PDM_BIT_STREAM0_PDM_BIT_STREAM_PDM_BIT_STREAM0 { 1351 pinmux = <0x443c0194 0 0x443c04c4 2 0x443c0344>; 1352 }; 1353 /omit-if-no-ref/ iomuxc1_pdm_bit_stream0_tpm_extclk_tpm1_extclk: IOMUXC1_PDM_BIT_STREAM0_TPM_EXTCLK_TPM1_EXTCLK { 1354 pinmux = <0x443c0194 3 0x0 0 0x443c0344>; 1355 }; 1356 /omit-if-no-ref/ iomuxc1_pdm_bit_stream1_gpio_io_gpio1_io10: IOMUXC1_PDM_BIT_STREAM1_GPIO_IO_GPIO1_IO10 { 1357 pinmux = <0x443c0198 5 0x0 0 0x443c0348>; 1358 }; 1359 /omit-if-no-ref/ iomuxc1_pdm_bit_stream1_lpspi_pcs_lpspi2_pcs1: IOMUXC1_PDM_BIT_STREAM1_LPSPI_PCS_LPSPI2_PCS1 { 1360 pinmux = <0x443c0198 2 0x443c0438 1 0x443c0348>; 1361 }; 1362 /omit-if-no-ref/ iomuxc1_pdm_bit_stream1_lptmr_alt_lptmr1_alt3: IOMUXC1_PDM_BIT_STREAM1_LPTMR_ALT_LPTMR1_ALT3 { 1363 pinmux = <0x443c0198 4 0x0 0 0x443c0348>; 1364 }; 1365 /omit-if-no-ref/ iomuxc1_pdm_bit_stream1_pdm_bit_stream_pdm_bit_stream1: IOMUXC1_PDM_BIT_STREAM1_PDM_BIT_STREAM_PDM_BIT_STREAM1 { 1366 pinmux = <0x443c0198 0 0x443c04c8 2 0x443c0348>; 1367 }; 1368 /omit-if-no-ref/ iomuxc1_pdm_bit_stream1_tpm_extclk_tpm2_extclk: IOMUXC1_PDM_BIT_STREAM1_TPM_EXTCLK_TPM2_EXTCLK { 1369 pinmux = <0x443c0198 3 0x0 0 0x443c0348>; 1370 }; 1371 /omit-if-no-ref/ iomuxc1_pdm_clk_can_tx_can1_tx: IOMUXC1_PDM_CLK_CAN_TX_CAN1_TX { 1372 pinmux = <0x443c0190 6 0x0 0 0x443c0340>; 1373 }; 1374 /omit-if-no-ref/ iomuxc1_pdm_clk_gpio_io_gpio1_io8: IOMUXC1_PDM_CLK_GPIO_IO_GPIO1_IO8 { 1375 pinmux = <0x443c0190 5 0x0 0 0x443c0340>; 1376 }; 1377 /omit-if-no-ref/ iomuxc1_pdm_clk_lptmr_alt_lptmr1_alt1: IOMUXC1_PDM_CLK_LPTMR_ALT_LPTMR1_ALT1 { 1378 pinmux = <0x443c0190 4 0x0 0 0x443c0340>; 1379 }; 1380 /omit-if-no-ref/ iomuxc1_pdm_clk_mqs_left_mqs1_left: IOMUXC1_PDM_CLK_MQS_LEFT_MQS1_LEFT { 1381 pinmux = <0x443c0190 1 0x0 0 0x443c0340>; 1382 }; 1383 /omit-if-no-ref/ iomuxc1_pdm_clk_pdm_clk_pdm_clk: IOMUXC1_PDM_CLK_PDM_CLK_PDM_CLK { 1384 pinmux = <0x443c0190 0 0x0 0 0x443c0340>; 1385 }; 1386 /omit-if-no-ref/ iomuxc1_sai1_rxd0_gpio_io_gpio1_io14: IOMUXC1_SAI1_RXD0_GPIO_IO_GPIO1_IO14 { 1387 pinmux = <0x443c01a8 5 0x0 0 0x443c0358>; 1388 }; 1389 /omit-if-no-ref/ iomuxc1_sai1_rxd0_lpspi_sout_lpspi1_sout: IOMUXC1_SAI1_RXD0_LPSPI_SOUT_LPSPI1_SOUT { 1390 pinmux = <0x443c01a8 2 0x443c0430 1 0x443c0358>; 1391 }; 1392 /omit-if-no-ref/ iomuxc1_sai1_rxd0_lpuart_dsr_b_lpuart2_dsr_b: IOMUXC1_SAI1_RXD0_LPUART_DSR_B_LPUART2_DSR_B { 1393 pinmux = <0x443c01a8 3 0x0 0 0x443c0358>; 1394 }; 1395 /omit-if-no-ref/ iomuxc1_sai1_rxd0_mqs_right_mqs1_right: IOMUXC1_SAI1_RXD0_MQS_RIGHT_MQS1_RIGHT { 1396 pinmux = <0x443c01a8 4 0x0 0 0x443c0358>; 1397 }; 1398 /omit-if-no-ref/ iomuxc1_sai1_rxd0_sai_mclk_sai1_mclk: IOMUXC1_SAI1_RXD0_SAI_MCLK_SAI1_MCLK { 1399 pinmux = <0x443c01a8 1 0x443c04d4 2 0x443c0358>; 1400 }; 1401 /omit-if-no-ref/ iomuxc1_sai1_rxd0_sai_rx_data_sai1_rx_data0: IOMUXC1_SAI1_RXD0_SAI_RX_DATA_SAI1_RX_DATA0 { 1402 pinmux = <0x443c01a8 0 0x0 0 0x443c0358>; 1403 }; 1404 /omit-if-no-ref/ iomuxc1_sai1_txc_can_rx_can1_rx: IOMUXC1_SAI1_TXC_CAN_RX_CAN1_RX { 1405 pinmux = <0x443c01a0 4 0x443c0360 2 0x443c0350>; 1406 }; 1407 /omit-if-no-ref/ iomuxc1_sai1_txc_gpio_io_gpio1_io12: IOMUXC1_SAI1_TXC_GPIO_IO_GPIO1_IO12 { 1408 pinmux = <0x443c01a0 5 0x0 0 0x443c0350>; 1409 }; 1410 /omit-if-no-ref/ iomuxc1_sai1_txc_lpspi_sin_lpspi1_sin: IOMUXC1_SAI1_TXC_LPSPI_SIN_LPSPI1_SIN { 1411 pinmux = <0x443c01a0 2 0x443c042c 1 0x443c0350>; 1412 }; 1413 /omit-if-no-ref/ iomuxc1_sai1_txc_lpuart_cts_b_lpuart2_cts_b: IOMUXC1_SAI1_TXC_LPUART_CTS_B_LPUART2_CTS_B { 1414 pinmux = <0x443c01a0 1 0x443c0460 1 0x443c0350>; 1415 }; 1416 /omit-if-no-ref/ iomuxc1_sai1_txc_lpuart_dsr_b_lpuart1_dsr_b: IOMUXC1_SAI1_TXC_LPUART_DSR_B_LPUART1_DSR_B { 1417 pinmux = <0x443c01a0 3 0x0 0 0x443c0350>; 1418 }; 1419 /omit-if-no-ref/ iomuxc1_sai1_txc_sai_tx_bclk_sai1_tx_bclk: IOMUXC1_SAI1_TXC_SAI_TX_BCLK_SAI1_TX_BCLK { 1420 pinmux = <0x443c01a0 0 0x0 0 0x443c0350>; 1421 }; 1422 /omit-if-no-ref/ iomuxc1_sai1_txd0_can_tx_can1_tx: IOMUXC1_SAI1_TXD0_CAN_TX_CAN1_TX { 1423 pinmux = <0x443c01a4 4 0x0 0 0x443c0354>; 1424 }; 1425 /omit-if-no-ref/ iomuxc1_sai1_txd0_gpio_io_gpio1_io13: IOMUXC1_SAI1_TXD0_GPIO_IO_GPIO1_IO13 { 1426 pinmux = <0x443c01a4 5 0x0 0 0x443c0354>; 1427 }; 1428 /omit-if-no-ref/ iomuxc1_sai1_txd0_lpspi_sck_lpspi1_sck: IOMUXC1_SAI1_TXD0_LPSPI_SCK_LPSPI1_SCK { 1429 pinmux = <0x443c01a4 2 0x443c0428 1 0x443c0354>; 1430 }; 1431 /omit-if-no-ref/ iomuxc1_sai1_txd0_lpuart_dtr_b_lpuart1_dtr_b: IOMUXC1_SAI1_TXD0_LPUART_DTR_B_LPUART1_DTR_B { 1432 pinmux = <0x443c01a4 3 0x0 0 0x443c0354>; 1433 }; 1434 /omit-if-no-ref/ iomuxc1_sai1_txd0_lpuart_rts_b_lpuart2_rts_b: IOMUXC1_SAI1_TXD0_LPUART_RTS_B_LPUART2_RTS_B { 1435 pinmux = <0x443c01a4 1 0x0 0 0x443c0354>; 1436 }; 1437 /omit-if-no-ref/ iomuxc1_sai1_txd0_sai_mclk_sai1_mclk: IOMUXC1_SAI1_TXD0_SAI_MCLK_SAI1_MCLK { 1438 pinmux = <0x443c01a4 6 0x443c04d4 1 0x443c0354>; 1439 }; 1440 /omit-if-no-ref/ iomuxc1_sai1_txd0_sai_tx_data_sai1_tx_data0: IOMUXC1_SAI1_TXD0_SAI_TX_DATA_SAI1_TX_DATA0 { 1441 pinmux = <0x443c01a4 0 0x0 0 0x443c0354>; 1442 }; 1443 /omit-if-no-ref/ iomuxc1_sai1_txfs_gpio_io_gpio1_io11: IOMUXC1_SAI1_TXFS_GPIO_IO_GPIO1_IO11 { 1444 pinmux = <0x443c019c 5 0x0 0 0x443c034c>; 1445 }; 1446 /omit-if-no-ref/ iomuxc1_sai1_txfs_lpspi_pcs_lpspi1_pcs0: IOMUXC1_SAI1_TXFS_LPSPI_PCS_LPSPI1_PCS0 { 1447 pinmux = <0x443c019c 2 0x443c0420 1 0x443c034c>; 1448 }; 1449 /omit-if-no-ref/ iomuxc1_sai1_txfs_lpuart_dtr_b_lpuart2_dtr_b: IOMUXC1_SAI1_TXFS_LPUART_DTR_B_LPUART2_DTR_B { 1450 pinmux = <0x443c019c 3 0x0 0 0x443c034c>; 1451 }; 1452 /omit-if-no-ref/ iomuxc1_sai1_txfs_mqs_left_mqs1_left: IOMUXC1_SAI1_TXFS_MQS_LEFT_MQS1_LEFT { 1453 pinmux = <0x443c019c 4 0x0 0 0x443c034c>; 1454 }; 1455 /omit-if-no-ref/ iomuxc1_sai1_txfs_sai_tx_data_sai1_tx_data1: IOMUXC1_SAI1_TXFS_SAI_TX_DATA_SAI1_TX_DATA1 { 1456 pinmux = <0x443c019c 1 0x0 0 0x443c034c>; 1457 }; 1458 /omit-if-no-ref/ iomuxc1_sai1_txfs_sai_tx_sync_sai1_tx_sync: IOMUXC1_SAI1_TXFS_SAI_TX_SYNC_SAI1_TX_SYNC { 1459 pinmux = <0x443c019c 0 0x0 0 0x443c034c>; 1460 }; 1461 /omit-if-no-ref/ iomuxc1_sd1_clk_flexio_flexio_flexio1_flexio8: IOMUXC1_SD1_CLK_FLEXIO_FLEXIO_FLEXIO1_FLEXIO8 { 1462 pinmux = <0x443c0108 4 0x443c038c 1 0x443c02b8>; 1463 }; 1464 /omit-if-no-ref/ iomuxc1_sd1_clk_gpio_io_gpio3_io8: IOMUXC1_SD1_CLK_GPIO_IO_GPIO3_IO8 { 1465 pinmux = <0x443c0108 5 0x0 0 0x443c02b8>; 1466 }; 1467 /omit-if-no-ref/ iomuxc1_sd1_clk_lpspi_sck_lpspi2_sck: IOMUXC1_SD1_CLK_LPSPI_SCK_LPSPI2_SCK { 1468 pinmux = <0x443c0108 3 0x443c043c 1 0x443c02b8>; 1469 }; 1470 /omit-if-no-ref/ iomuxc1_sd1_clk_usdhc_clk_usdhc1_clk: IOMUXC1_SD1_CLK_USDHC_CLK_USDHC1_CLK { 1471 pinmux = <0x443c0108 0 0x0 0 0x443c02b8>; 1472 }; 1473 /omit-if-no-ref/ iomuxc1_sd1_cmd_flexio_flexio_flexio1_flexio9: IOMUXC1_SD1_CMD_FLEXIO_FLEXIO_FLEXIO1_FLEXIO9 { 1474 pinmux = <0x443c010c 4 0x443c0390 1 0x443c02bc>; 1475 }; 1476 /omit-if-no-ref/ iomuxc1_sd1_cmd_gpio_io_gpio3_io9: IOMUXC1_SD1_CMD_GPIO_IO_GPIO3_IO9 { 1477 pinmux = <0x443c010c 5 0x0 0 0x443c02bc>; 1478 }; 1479 /omit-if-no-ref/ iomuxc1_sd1_cmd_lpspi_sin_lpspi2_sin: IOMUXC1_SD1_CMD_LPSPI_SIN_LPSPI2_SIN { 1480 pinmux = <0x443c010c 3 0x443c0440 1 0x443c02bc>; 1481 }; 1482 /omit-if-no-ref/ iomuxc1_sd1_cmd_usdhc_cmd_usdhc1_cmd: IOMUXC1_SD1_CMD_USDHC_CMD_USDHC1_CMD { 1483 pinmux = <0x443c010c 0 0x0 0 0x443c02bc>; 1484 }; 1485 /omit-if-no-ref/ iomuxc1_sd1_data0_flexio_flexio_flexio1_flexio10: IOMUXC1_SD1_DATA0_FLEXIO_FLEXIO_FLEXIO1_FLEXIO10 { 1486 pinmux = <0x443c0110 4 0x443c0394 1 0x443c02c0>; 1487 }; 1488 /omit-if-no-ref/ iomuxc1_sd1_data0_gpio_io_gpio3_io10: IOMUXC1_SD1_DATA0_GPIO_IO_GPIO3_IO10 { 1489 pinmux = <0x443c0110 5 0x0 0 0x443c02c0>; 1490 }; 1491 /omit-if-no-ref/ iomuxc1_sd1_data0_lpspi_pcs_lpspi2_pcs0: IOMUXC1_SD1_DATA0_LPSPI_PCS_LPSPI2_PCS0 { 1492 pinmux = <0x443c0110 3 0x443c0434 1 0x443c02c0>; 1493 }; 1494 /omit-if-no-ref/ iomuxc1_sd1_data0_usdhc_data_usdhc1_data0: IOMUXC1_SD1_DATA0_USDHC_DATA_USDHC1_DATA0 { 1495 pinmux = <0x443c0110 0 0x0 0 0x443c02c0>; 1496 }; 1497 /omit-if-no-ref/ iomuxc1_sd1_data1_flexio_flexio_flexio1_flexio11: IOMUXC1_SD1_DATA1_FLEXIO_FLEXIO_FLEXIO1_FLEXIO11 { 1498 pinmux = <0x443c0114 4 0x443c0398 1 0x443c02c4>; 1499 }; 1500 /omit-if-no-ref/ iomuxc1_sd1_data1_gpio_io_gpio3_io11: IOMUXC1_SD1_DATA1_GPIO_IO_GPIO3_IO11 { 1501 pinmux = <0x443c0114 5 0x0 0 0x443c02c4>; 1502 }; 1503 /omit-if-no-ref/ iomuxc1_sd1_data1_lpspi_sout_lpspi2_sout: IOMUXC1_SD1_DATA1_LPSPI_SOUT_LPSPI2_SOUT { 1504 pinmux = <0x443c0114 3 0x443c0444 1 0x443c02c4>; 1505 }; 1506 /omit-if-no-ref/ iomuxc1_sd1_data1_usdhc_data_usdhc1_data1: IOMUXC1_SD1_DATA1_USDHC_DATA_USDHC1_DATA1 { 1507 pinmux = <0x443c0114 0 0x0 0 0x443c02c4>; 1508 }; 1509 /omit-if-no-ref/ iomuxc1_sd1_data2_flexio_flexio_flexio1_flexio12: IOMUXC1_SD1_DATA2_FLEXIO_FLEXIO_FLEXIO1_FLEXIO12 { 1510 pinmux = <0x443c0118 4 0x0 0 0x443c02c8>; 1511 }; 1512 /omit-if-no-ref/ iomuxc1_sd1_data2_gpio_io_gpio3_io12: IOMUXC1_SD1_DATA2_GPIO_IO_GPIO3_IO12 { 1513 pinmux = <0x443c0118 5 0x0 0 0x443c02c8>; 1514 }; 1515 /omit-if-no-ref/ iomuxc1_sd1_data2_lpspi_pcs_lpspi2_pcs1: IOMUXC1_SD1_DATA2_LPSPI_PCS_LPSPI2_PCS1 { 1516 pinmux = <0x443c0118 3 0x443c0438 0 0x443c02c8>; 1517 }; 1518 /omit-if-no-ref/ iomuxc1_sd1_data2_usdhc_data_usdhc1_data2: IOMUXC1_SD1_DATA2_USDHC_DATA_USDHC1_DATA2 { 1519 pinmux = <0x443c0118 0 0x0 0 0x443c02c8>; 1520 }; 1521 /omit-if-no-ref/ iomuxc1_sd1_data3_flexio_flexio_flexio1_flexio13: IOMUXC1_SD1_DATA3_FLEXIO_FLEXIO_FLEXIO1_FLEXIO13 { 1522 pinmux = <0x443c011c 4 0x443c039c 1 0x443c02cc>; 1523 }; 1524 /omit-if-no-ref/ iomuxc1_sd1_data3_flexspi_a_ss_b_flexspi1_a_ss1_b: IOMUXC1_SD1_DATA3_FLEXSPI_A_SS_B_FLEXSPI1_A_SS1_B { 1525 pinmux = <0x443c011c 1 0x0 0 0x443c02cc>; 1526 }; 1527 /omit-if-no-ref/ iomuxc1_sd1_data3_gpio_io_gpio3_io13: IOMUXC1_SD1_DATA3_GPIO_IO_GPIO3_IO13 { 1528 pinmux = <0x443c011c 5 0x0 0 0x443c02cc>; 1529 }; 1530 /omit-if-no-ref/ iomuxc1_sd1_data3_lpspi_pcs_lpspi1_pcs1: IOMUXC1_SD1_DATA3_LPSPI_PCS_LPSPI1_PCS1 { 1531 pinmux = <0x443c011c 3 0x443c0424 0 0x443c02cc>; 1532 }; 1533 /omit-if-no-ref/ iomuxc1_sd1_data3_usdhc_data_usdhc1_data3: IOMUXC1_SD1_DATA3_USDHC_DATA_USDHC1_DATA3 { 1534 pinmux = <0x443c011c 0 0x0 0 0x443c02cc>; 1535 }; 1536 /omit-if-no-ref/ iomuxc1_sd1_data4_flexio_flexio_flexio1_flexio14: IOMUXC1_SD1_DATA4_FLEXIO_FLEXIO_FLEXIO1_FLEXIO14 { 1537 pinmux = <0x443c0120 4 0x443c03a0 1 0x443c02d0>; 1538 }; 1539 /omit-if-no-ref/ iomuxc1_sd1_data4_flexspi_a_data_flexspi1_a_data4: IOMUXC1_SD1_DATA4_FLEXSPI_A_DATA_FLEXSPI1_A_DATA4 { 1540 pinmux = <0x443c0120 1 0x0 0 0x443c02d0>; 1541 }; 1542 /omit-if-no-ref/ iomuxc1_sd1_data4_gpio_io_gpio3_io14: IOMUXC1_SD1_DATA4_GPIO_IO_GPIO3_IO14 { 1543 pinmux = <0x443c0120 5 0x0 0 0x443c02d0>; 1544 }; 1545 /omit-if-no-ref/ iomuxc1_sd1_data4_lpspi_pcs_lpspi1_pcs0: IOMUXC1_SD1_DATA4_LPSPI_PCS_LPSPI1_PCS0 { 1546 pinmux = <0x443c0120 3 0x443c0420 0 0x443c02d0>; 1547 }; 1548 /omit-if-no-ref/ iomuxc1_sd1_data4_usdhc_data_usdhc1_data4: IOMUXC1_SD1_DATA4_USDHC_DATA_USDHC1_DATA4 { 1549 pinmux = <0x443c0120 0 0x0 0 0x443c02d0>; 1550 }; 1551 /omit-if-no-ref/ iomuxc1_sd1_data5_flexio_flexio_flexio1_flexio15: IOMUXC1_SD1_DATA5_FLEXIO_FLEXIO_FLEXIO1_FLEXIO15 { 1552 pinmux = <0x443c0124 4 0x443c03a4 1 0x443c02d4>; 1553 }; 1554 /omit-if-no-ref/ iomuxc1_sd1_data5_flexspi_a_data_flexspi1_a_data5: IOMUXC1_SD1_DATA5_FLEXSPI_A_DATA_FLEXSPI1_A_DATA5 { 1555 pinmux = <0x443c0124 1 0x0 0 0x443c02d4>; 1556 }; 1557 /omit-if-no-ref/ iomuxc1_sd1_data5_gpio_io_gpio3_io15: IOMUXC1_SD1_DATA5_GPIO_IO_GPIO3_IO15 { 1558 pinmux = <0x443c0124 5 0x0 0 0x443c02d4>; 1559 }; 1560 /omit-if-no-ref/ iomuxc1_sd1_data5_lpspi_sin_lpspi1_sin: IOMUXC1_SD1_DATA5_LPSPI_SIN_LPSPI1_SIN { 1561 pinmux = <0x443c0124 3 0x443c042c 0 0x443c02d4>; 1562 }; 1563 /omit-if-no-ref/ iomuxc1_sd1_data5_usdhc_data_usdhc1_data5: IOMUXC1_SD1_DATA5_USDHC_DATA_USDHC1_DATA5 { 1564 pinmux = <0x443c0124 0 0x0 0 0x443c02d4>; 1565 }; 1566 /omit-if-no-ref/ iomuxc1_sd1_data5_usdhc_reset_b_usdhc1_reset_b: IOMUXC1_SD1_DATA5_USDHC_RESET_B_USDHC1_RESET_B { 1567 pinmux = <0x443c0124 2 0x0 0 0x443c02d4>; 1568 }; 1569 /omit-if-no-ref/ iomuxc1_sd1_data6_flexio_flexio_flexio1_flexio16: IOMUXC1_SD1_DATA6_FLEXIO_FLEXIO_FLEXIO1_FLEXIO16 { 1570 pinmux = <0x443c0128 4 0x443c03a8 1 0x443c02d8>; 1571 }; 1572 /omit-if-no-ref/ iomuxc1_sd1_data6_flexspi_a_data_flexspi1_a_data6: IOMUXC1_SD1_DATA6_FLEXSPI_A_DATA_FLEXSPI1_A_DATA6 { 1573 pinmux = <0x443c0128 1 0x0 0 0x443c02d8>; 1574 }; 1575 /omit-if-no-ref/ iomuxc1_sd1_data6_gpio_io_gpio3_io16: IOMUXC1_SD1_DATA6_GPIO_IO_GPIO3_IO16 { 1576 pinmux = <0x443c0128 5 0x0 0 0x443c02d8>; 1577 }; 1578 /omit-if-no-ref/ iomuxc1_sd1_data6_lpspi_sck_lpspi1_sck: IOMUXC1_SD1_DATA6_LPSPI_SCK_LPSPI1_SCK { 1579 pinmux = <0x443c0128 3 0x443c0428 0 0x443c02d8>; 1580 }; 1581 /omit-if-no-ref/ iomuxc1_sd1_data6_usdhc_cd_b_usdhc1_cd_b: IOMUXC1_SD1_DATA6_USDHC_CD_B_USDHC1_CD_B { 1582 pinmux = <0x443c0128 2 0x0 0 0x443c02d8>; 1583 }; 1584 /omit-if-no-ref/ iomuxc1_sd1_data6_usdhc_data_usdhc1_data6: IOMUXC1_SD1_DATA6_USDHC_DATA_USDHC1_DATA6 { 1585 pinmux = <0x443c0128 0 0x0 0 0x443c02d8>; 1586 }; 1587 /omit-if-no-ref/ iomuxc1_sd1_data7_flexio_flexio_flexio1_flexio17: IOMUXC1_SD1_DATA7_FLEXIO_FLEXIO_FLEXIO1_FLEXIO17 { 1588 pinmux = <0x443c012c 4 0x443c03ac 1 0x443c02dc>; 1589 }; 1590 /omit-if-no-ref/ iomuxc1_sd1_data7_flexspi_a_data_flexspi1_a_data7: IOMUXC1_SD1_DATA7_FLEXSPI_A_DATA_FLEXSPI1_A_DATA7 { 1591 pinmux = <0x443c012c 1 0x0 0 0x443c02dc>; 1592 }; 1593 /omit-if-no-ref/ iomuxc1_sd1_data7_gpio_io_gpio3_io17: IOMUXC1_SD1_DATA7_GPIO_IO_GPIO3_IO17 { 1594 pinmux = <0x443c012c 5 0x0 0 0x443c02dc>; 1595 }; 1596 /omit-if-no-ref/ iomuxc1_sd1_data7_lpspi_sout_lpspi1_sout: IOMUXC1_SD1_DATA7_LPSPI_SOUT_LPSPI1_SOUT { 1597 pinmux = <0x443c012c 3 0x443c0430 0 0x443c02dc>; 1598 }; 1599 /omit-if-no-ref/ iomuxc1_sd1_data7_usdhc_data_usdhc1_data7: IOMUXC1_SD1_DATA7_USDHC_DATA_USDHC1_DATA7 { 1600 pinmux = <0x443c012c 0 0x0 0 0x443c02dc>; 1601 }; 1602 /omit-if-no-ref/ iomuxc1_sd1_data7_usdhc_wp_usdhc1_wp: IOMUXC1_SD1_DATA7_USDHC_WP_USDHC1_WP { 1603 pinmux = <0x443c012c 2 0x0 0 0x443c02dc>; 1604 }; 1605 /omit-if-no-ref/ iomuxc1_sd1_strobe_flexio_flexio_flexio1_flexio18: IOMUXC1_SD1_STROBE_FLEXIO_FLEXIO_FLEXIO1_FLEXIO18 { 1606 pinmux = <0x443c0130 4 0x443c03b0 1 0x443c02e0>; 1607 }; 1608 /omit-if-no-ref/ iomuxc1_sd1_strobe_flexspi_a_dqs_flexspi1_a_dqs: IOMUXC1_SD1_STROBE_FLEXSPI_A_DQS_FLEXSPI1_A_DQS { 1609 pinmux = <0x443c0130 1 0x0 0 0x443c02e0>; 1610 }; 1611 /omit-if-no-ref/ iomuxc1_sd1_strobe_gpio_io_gpio3_io18: IOMUXC1_SD1_STROBE_GPIO_IO_GPIO3_IO18 { 1612 pinmux = <0x443c0130 5 0x0 0 0x443c02e0>; 1613 }; 1614 /omit-if-no-ref/ iomuxc1_sd1_strobe_usdhc_strobe_usdhc1_strobe: IOMUXC1_SD1_STROBE_USDHC_STROBE_USDHC1_STROBE { 1615 pinmux = <0x443c0130 0 0x0 0 0x443c02e0>; 1616 }; 1617 /omit-if-no-ref/ iomuxc1_sd2_cd_b_enet_qos_1588_event0_in_enet_qos_1588_event0_in: IOMUXC1_SD2_CD_B_ENET_QOS_1588_EVENT0_IN_ENET_QOS_1588_EVENT0_IN { 1618 pinmux = <0x443c0150 1 0x0 0 0x443c0300>; 1619 }; 1620 /omit-if-no-ref/ iomuxc1_sd2_cd_b_flexio_flexio_flexio1_flexio0: IOMUXC1_SD2_CD_B_FLEXIO_FLEXIO_FLEXIO1_FLEXIO0 { 1621 pinmux = <0x443c0150 4 0x443c036c 1 0x443c0300>; 1622 }; 1623 /omit-if-no-ref/ iomuxc1_sd2_cd_b_gpio_io_gpio3_io0: IOMUXC1_SD2_CD_B_GPIO_IO_GPIO3_IO0 { 1624 pinmux = <0x443c0150 5 0x0 0 0x443c0300>; 1625 }; 1626 /omit-if-no-ref/ iomuxc1_sd2_cd_b_i3c_scl_i3c2_scl: IOMUXC1_SD2_CD_B_I3C_SCL_I3C2_SCL { 1627 pinmux = <0x443c0150 2 0x443c03cc 1 0x443c0300>; 1628 }; 1629 /omit-if-no-ref/ iomuxc1_sd2_cd_b_lpi2c_scl_lpi2c1_scl: IOMUXC1_SD2_CD_B_LPI2C_SCL_LPI2C1_SCL { 1630 pinmux = <0x443c0150 3 0x0 0 0x443c0300>; 1631 }; 1632 /omit-if-no-ref/ iomuxc1_sd2_cd_b_usdhc_cd_b_usdhc2_cd_b: IOMUXC1_SD2_CD_B_USDHC_CD_B_USDHC2_CD_B { 1633 pinmux = <0x443c0150 0 0x0 0 0x443c0300>; 1634 }; 1635 /omit-if-no-ref/ iomuxc1_sd2_clk_enet_qos_1588_event0_out_enet_qos_1588_event0_out: IOMUXC1_SD2_CLK_ENET_QOS_1588_EVENT0_OUT_ENET_QOS_1588_EVENT0_OUT { 1636 pinmux = <0x443c0154 1 0x0 0 0x443c0304>; 1637 }; 1638 /omit-if-no-ref/ iomuxc1_sd2_clk_flexio_flexio_flexio1_flexio1: IOMUXC1_SD2_CLK_FLEXIO_FLEXIO_FLEXIO1_FLEXIO1 { 1639 pinmux = <0x443c0154 4 0x443c0370 1 0x443c0304>; 1640 }; 1641 /omit-if-no-ref/ iomuxc1_sd2_clk_gpio_io_gpio3_io1: IOMUXC1_SD2_CLK_GPIO_IO_GPIO3_IO1 { 1642 pinmux = <0x443c0154 5 0x0 0 0x443c0304>; 1643 }; 1644 /omit-if-no-ref/ iomuxc1_sd2_clk_i3c_sda_i3c2_sda: IOMUXC1_SD2_CLK_I3C_SDA_I3C2_SDA { 1645 pinmux = <0x443c0154 2 0x443c03d0 1 0x443c0304>; 1646 }; 1647 /omit-if-no-ref/ iomuxc1_sd2_clk_lpi2c_sda_lpi2c1_sda: IOMUXC1_SD2_CLK_LPI2C_SDA_LPI2C1_SDA { 1648 pinmux = <0x443c0154 3 0x443c03e4 1 0x443c0304>; 1649 }; 1650 /omit-if-no-ref/ iomuxc1_sd2_clk_usdhc_clk_usdhc2_clk: IOMUXC1_SD2_CLK_USDHC_CLK_USDHC2_CLK { 1651 pinmux = <0x443c0154 0 0x0 0 0x443c0304>; 1652 }; 1653 /omit-if-no-ref/ iomuxc1_sd2_cmd_enet2_1588_event0_in_enet2_1588_event0_in: IOMUXC1_SD2_CMD_ENET2_1588_EVENT0_IN_ENET2_1588_EVENT0_IN { 1654 pinmux = <0x443c0158 1 0x0 0 0x443c0308>; 1655 }; 1656 /omit-if-no-ref/ iomuxc1_sd2_cmd_flexio_flexio_flexio1_flexio2: IOMUXC1_SD2_CMD_FLEXIO_FLEXIO_FLEXIO1_FLEXIO2 { 1657 pinmux = <0x443c0158 4 0x443c0374 1 0x443c0308>; 1658 }; 1659 /omit-if-no-ref/ iomuxc1_sd2_cmd_gpio_io_gpio3_io2: IOMUXC1_SD2_CMD_GPIO_IO_GPIO3_IO2 { 1660 pinmux = <0x443c0158 5 0x0 0 0x443c0308>; 1661 }; 1662 /omit-if-no-ref/ iomuxc1_sd2_cmd_i3c_pur_b_i3c2_pur_b: IOMUXC1_SD2_CMD_I3C_PUR_B_I3C2_PUR_B { 1663 pinmux = <0x443c0158 3 0x0 0 0x443c0308>; 1664 }; 1665 /omit-if-no-ref/ iomuxc1_sd2_cmd_i3c_pur_i3c2_pur: IOMUXC1_SD2_CMD_I3C_PUR_I3C2_PUR { 1666 pinmux = <0x443c0158 2 0x0 0 0x443c0308>; 1667 }; 1668 /omit-if-no-ref/ iomuxc1_sd2_cmd_usdhc_cmd_usdhc2_cmd: IOMUXC1_SD2_CMD_USDHC_CMD_USDHC2_CMD { 1669 pinmux = <0x443c0158 0 0x0 0 0x443c0308>; 1670 }; 1671 /omit-if-no-ref/ iomuxc1_sd2_data0_can_tx_can2_tx: IOMUXC1_SD2_DATA0_CAN_TX_CAN2_TX { 1672 pinmux = <0x443c015c 2 0x0 0 0x443c030c>; 1673 }; 1674 /omit-if-no-ref/ iomuxc1_sd2_data0_enet2_1588_event0_out_enet2_1588_event0_out: IOMUXC1_SD2_DATA0_ENET2_1588_EVENT0_OUT_ENET2_1588_EVENT0_OUT { 1675 pinmux = <0x443c015c 1 0x0 0 0x443c030c>; 1676 }; 1677 /omit-if-no-ref/ iomuxc1_sd2_data0_flexio_flexio_flexio1_flexio3: IOMUXC1_SD2_DATA0_FLEXIO_FLEXIO_FLEXIO1_FLEXIO3 { 1678 pinmux = <0x443c015c 4 0x443c0378 1 0x443c030c>; 1679 }; 1680 /omit-if-no-ref/ iomuxc1_sd2_data0_gpio_io_gpio3_io3: IOMUXC1_SD2_DATA0_GPIO_IO_GPIO3_IO3 { 1681 pinmux = <0x443c015c 5 0x0 0 0x443c030c>; 1682 }; 1683 /omit-if-no-ref/ iomuxc1_sd2_data0_lpuart_tx_lpuart1_tx: IOMUXC1_SD2_DATA0_LPUART_TX_LPUART1_TX { 1684 pinmux = <0x443c015c 3 0x443c045c 0 0x443c030c>; 1685 }; 1686 /omit-if-no-ref/ iomuxc1_sd2_data0_usdhc_data_usdhc2_data0: IOMUXC1_SD2_DATA0_USDHC_DATA_USDHC2_DATA0 { 1687 pinmux = <0x443c015c 0 0x0 0 0x443c030c>; 1688 }; 1689 /omit-if-no-ref/ iomuxc1_sd2_data1_can_rx_can2_rx: IOMUXC1_SD2_DATA1_CAN_RX_CAN2_RX { 1690 pinmux = <0x443c0160 2 0x443c0364 3 0x443c0310>; 1691 }; 1692 /omit-if-no-ref/ iomuxc1_sd2_data1_enet2_1588_event1_in_enet2_1588_event1_in: IOMUXC1_SD2_DATA1_ENET2_1588_EVENT1_IN_ENET2_1588_EVENT1_IN { 1693 pinmux = <0x443c0160 1 0x0 0 0x443c0310>; 1694 }; 1695 /omit-if-no-ref/ iomuxc1_sd2_data1_flexio_flexio_flexio1_flexio4: IOMUXC1_SD2_DATA1_FLEXIO_FLEXIO_FLEXIO1_FLEXIO4 { 1696 pinmux = <0x443c0160 4 0x443c037c 1 0x443c0310>; 1697 }; 1698 /omit-if-no-ref/ iomuxc1_sd2_data1_gpio_io_gpio3_io4: IOMUXC1_SD2_DATA1_GPIO_IO_GPIO3_IO4 { 1699 pinmux = <0x443c0160 5 0x0 0 0x443c0310>; 1700 }; 1701 /omit-if-no-ref/ iomuxc1_sd2_data1_lpuart_rx_lpuart1_rx: IOMUXC1_SD2_DATA1_LPUART_RX_LPUART1_RX { 1702 pinmux = <0x443c0160 3 0x443c0458 0 0x443c0310>; 1703 }; 1704 /omit-if-no-ref/ iomuxc1_sd2_data1_usdhc_data_usdhc2_data1: IOMUXC1_SD2_DATA1_USDHC_DATA_USDHC2_DATA1 { 1705 pinmux = <0x443c0160 0 0x0 0 0x443c0310>; 1706 }; 1707 /omit-if-no-ref/ iomuxc1_sd2_data2_enet2_1588_event1_out_enet2_1588_event1_out: IOMUXC1_SD2_DATA2_ENET2_1588_EVENT1_OUT_ENET2_1588_EVENT1_OUT { 1708 pinmux = <0x443c0164 1 0x0 0 0x443c0314>; 1709 }; 1710 /omit-if-no-ref/ iomuxc1_sd2_data2_flexio_flexio_flexio1_flexio5: IOMUXC1_SD2_DATA2_FLEXIO_FLEXIO_FLEXIO1_FLEXIO5 { 1711 pinmux = <0x443c0164 4 0x443c0380 1 0x443c0314>; 1712 }; 1713 /omit-if-no-ref/ iomuxc1_sd2_data2_gpio_io_gpio3_io5: IOMUXC1_SD2_DATA2_GPIO_IO_GPIO3_IO5 { 1714 pinmux = <0x443c0164 5 0x0 0 0x443c0314>; 1715 }; 1716 /omit-if-no-ref/ iomuxc1_sd2_data2_lpuart_tx_lpuart2_tx: IOMUXC1_SD2_DATA2_LPUART_TX_LPUART2_TX { 1717 pinmux = <0x443c0164 3 0x443c0468 0 0x443c0314>; 1718 }; 1719 /omit-if-no-ref/ iomuxc1_sd2_data2_mqs_right_mqs2_right: IOMUXC1_SD2_DATA2_MQS_RIGHT_MQS2_RIGHT { 1720 pinmux = <0x443c0164 2 0x0 0 0x443c0314>; 1721 }; 1722 /omit-if-no-ref/ iomuxc1_sd2_data2_usdhc_data_usdhc2_data2: IOMUXC1_SD2_DATA2_USDHC_DATA_USDHC2_DATA2 { 1723 pinmux = <0x443c0164 0 0x0 0 0x443c0314>; 1724 }; 1725 /omit-if-no-ref/ iomuxc1_sd2_data3_flexio_flexio_flexio1_flexio6: IOMUXC1_SD2_DATA3_FLEXIO_FLEXIO_FLEXIO1_FLEXIO6 { 1726 pinmux = <0x443c0168 4 0x443c0384 1 0x443c0318>; 1727 }; 1728 /omit-if-no-ref/ iomuxc1_sd2_data3_gpio_io_gpio3_io6: IOMUXC1_SD2_DATA3_GPIO_IO_GPIO3_IO6 { 1729 pinmux = <0x443c0168 5 0x0 0 0x443c0318>; 1730 }; 1731 /omit-if-no-ref/ iomuxc1_sd2_data3_lptmr_alt_lptmr2_alt1: IOMUXC1_SD2_DATA3_LPTMR_ALT_LPTMR2_ALT1 { 1732 pinmux = <0x443c0168 1 0x443c0448 1 0x443c0318>; 1733 }; 1734 /omit-if-no-ref/ iomuxc1_sd2_data3_lpuart_rx_lpuart2_rx: IOMUXC1_SD2_DATA3_LPUART_RX_LPUART2_RX { 1735 pinmux = <0x443c0168 3 0x443c0464 0 0x443c0318>; 1736 }; 1737 /omit-if-no-ref/ iomuxc1_sd2_data3_mqs_left_mqs2_left: IOMUXC1_SD2_DATA3_MQS_LEFT_MQS2_LEFT { 1738 pinmux = <0x443c0168 2 0x0 0 0x443c0318>; 1739 }; 1740 /omit-if-no-ref/ iomuxc1_sd2_data3_usdhc_data_usdhc2_data3: IOMUXC1_SD2_DATA3_USDHC_DATA_USDHC2_DATA3 { 1741 pinmux = <0x443c0168 0 0x0 0 0x443c0318>; 1742 }; 1743 /omit-if-no-ref/ iomuxc1_sd2_reset_b_ccmsrcgpcmix_system_reset_ccmsrcgpcmix_system_reset: IOMUXC1_SD2_RESET_B_CCMSRCGPCMIX_SYSTEM_RESET_CCMSRCGPCMIX_SYSTEM_RESET { 1744 pinmux = <0x443c016c 6 0x0 0 0x443c031c>; 1745 }; 1746 /omit-if-no-ref/ iomuxc1_sd2_reset_b_flexio_flexio_flexio1_flexio7: IOMUXC1_SD2_RESET_B_FLEXIO_FLEXIO_FLEXIO1_FLEXIO7 { 1747 pinmux = <0x443c016c 4 0x443c0388 1 0x443c031c>; 1748 }; 1749 /omit-if-no-ref/ iomuxc1_sd2_reset_b_gpio_io_gpio3_io7: IOMUXC1_SD2_RESET_B_GPIO_IO_GPIO3_IO7 { 1750 pinmux = <0x443c016c 5 0x0 0 0x443c031c>; 1751 }; 1752 /omit-if-no-ref/ iomuxc1_sd2_reset_b_lptmr_alt_lptmr2_alt2: IOMUXC1_SD2_RESET_B_LPTMR_ALT_LPTMR2_ALT2 { 1753 pinmux = <0x443c016c 1 0x443c044c 1 0x443c031c>; 1754 }; 1755 /omit-if-no-ref/ iomuxc1_sd2_reset_b_usdhc_reset_b_usdhc2_reset_b: IOMUXC1_SD2_RESET_B_USDHC_RESET_B_USDHC2_RESET_B { 1756 pinmux = <0x443c016c 0 0x0 0 0x443c031c>; 1757 }; 1758 /omit-if-no-ref/ iomuxc1_sd2_vselect_flexio_flexio_flexio1_flexio19: IOMUXC1_SD2_VSELECT_FLEXIO_FLEXIO_FLEXIO1_FLEXIO19 { 1759 pinmux = <0x443c0134 4 0x0 0 0x443c02e4>; 1760 }; 1761 /omit-if-no-ref/ iomuxc1_sd2_vselect_gpio_io_gpio3_io19: IOMUXC1_SD2_VSELECT_GPIO_IO_GPIO3_IO19 { 1762 pinmux = <0x443c0134 5 0x0 0 0x443c02e4>; 1763 }; 1764 /omit-if-no-ref/ iomuxc1_sd2_vselect_lptmr_alt_lptmr2_alt3: IOMUXC1_SD2_VSELECT_LPTMR_ALT_LPTMR2_ALT3 { 1765 pinmux = <0x443c0134 2 0x443c0450 1 0x443c02e4>; 1766 }; 1767 /omit-if-no-ref/ iomuxc1_sd2_vselect_usdhc_vselect_usdhc2_vselect: IOMUXC1_SD2_VSELECT_USDHC_VSELECT_USDHC2_VSELECT { 1768 pinmux = <0x443c0134 0 0x0 0 0x443c02e4>; 1769 }; 1770 /omit-if-no-ref/ iomuxc1_sd2_vselect_usdhc_wp_usdhc2_wp: IOMUXC1_SD2_VSELECT_USDHC_WP_USDHC2_WP { 1771 pinmux = <0x443c0134 1 0x0 0 0x443c02e4>; 1772 }; 1773 /omit-if-no-ref/ iomuxc1_sd3_clk_flexio_flexio_flexio1_flexio20: IOMUXC1_SD3_CLK_FLEXIO_FLEXIO_FLEXIO1_FLEXIO20 { 1774 pinmux = <0x443c0138 4 0x443c03b4 1 0x443c02e8>; 1775 }; 1776 /omit-if-no-ref/ iomuxc1_sd3_clk_flexspi_a_sclk_flexspi1_a_sclk: IOMUXC1_SD3_CLK_FLEXSPI_A_SCLK_FLEXSPI1_A_SCLK { 1777 pinmux = <0x443c0138 1 0x0 0 0x443c02e8>; 1778 }; 1779 /omit-if-no-ref/ iomuxc1_sd3_clk_gpio_io_gpio3_io20: IOMUXC1_SD3_CLK_GPIO_IO_GPIO3_IO20 { 1780 pinmux = <0x443c0138 5 0x0 0 0x443c02e8>; 1781 }; 1782 /omit-if-no-ref/ iomuxc1_sd3_clk_lpuart_cts_b_lpuart1_cts_b: IOMUXC1_SD3_CLK_LPUART_CTS_B_LPUART1_CTS_B { 1783 pinmux = <0x443c0138 2 0x443c0454 0 0x443c02e8>; 1784 }; 1785 /omit-if-no-ref/ iomuxc1_sd3_clk_usdhc_clk_usdhc3_clk: IOMUXC1_SD3_CLK_USDHC_CLK_USDHC3_CLK { 1786 pinmux = <0x443c0138 0 0x443c04e8 1 0x443c02e8>; 1787 }; 1788 /omit-if-no-ref/ iomuxc1_sd3_cmd_flexio_flexio_flexio1_flexio21: IOMUXC1_SD3_CMD_FLEXIO_FLEXIO_FLEXIO1_FLEXIO21 { 1789 pinmux = <0x443c013c 4 0x0 0 0x443c02ec>; 1790 }; 1791 /omit-if-no-ref/ iomuxc1_sd3_cmd_flexspi_a_ss_b_flexspi1_a_ss0_b: IOMUXC1_SD3_CMD_FLEXSPI_A_SS_B_FLEXSPI1_A_SS0_B { 1792 pinmux = <0x443c013c 1 0x0 0 0x443c02ec>; 1793 }; 1794 /omit-if-no-ref/ iomuxc1_sd3_cmd_gpio_io_gpio3_io21: IOMUXC1_SD3_CMD_GPIO_IO_GPIO3_IO21 { 1795 pinmux = <0x443c013c 5 0x0 0 0x443c02ec>; 1796 }; 1797 /omit-if-no-ref/ iomuxc1_sd3_cmd_lpuart_rts_b_lpuart1_rts_b: IOMUXC1_SD3_CMD_LPUART_RTS_B_LPUART1_RTS_B { 1798 pinmux = <0x443c013c 2 0x0 0 0x443c02ec>; 1799 }; 1800 /omit-if-no-ref/ iomuxc1_sd3_cmd_usdhc_cmd_usdhc3_cmd: IOMUXC1_SD3_CMD_USDHC_CMD_USDHC3_CMD { 1801 pinmux = <0x443c013c 0 0x443c04ec 1 0x443c02ec>; 1802 }; 1803 /omit-if-no-ref/ iomuxc1_sd3_data0_flexio_flexio_flexio1_flexio22: IOMUXC1_SD3_DATA0_FLEXIO_FLEXIO_FLEXIO1_FLEXIO22 { 1804 pinmux = <0x443c0140 4 0x443c03b8 1 0x443c02f0>; 1805 }; 1806 /omit-if-no-ref/ iomuxc1_sd3_data0_flexspi_a_data_flexspi1_a_data0: IOMUXC1_SD3_DATA0_FLEXSPI_A_DATA_FLEXSPI1_A_DATA0 { 1807 pinmux = <0x443c0140 1 0x0 0 0x443c02f0>; 1808 }; 1809 /omit-if-no-ref/ iomuxc1_sd3_data0_gpio_io_gpio3_io22: IOMUXC1_SD3_DATA0_GPIO_IO_GPIO3_IO22 { 1810 pinmux = <0x443c0140 5 0x0 0 0x443c02f0>; 1811 }; 1812 /omit-if-no-ref/ iomuxc1_sd3_data0_lpuart_cts_b_lpuart2_cts_b: IOMUXC1_SD3_DATA0_LPUART_CTS_B_LPUART2_CTS_B { 1813 pinmux = <0x443c0140 2 0x443c0460 0 0x443c02f0>; 1814 }; 1815 /omit-if-no-ref/ iomuxc1_sd3_data0_usdhc_data_usdhc3_data0: IOMUXC1_SD3_DATA0_USDHC_DATA_USDHC3_DATA0 { 1816 pinmux = <0x443c0140 0 0x443c04f0 1 0x443c02f0>; 1817 }; 1818 /omit-if-no-ref/ iomuxc1_sd3_data1_flexio_flexio_flexio1_flexio23: IOMUXC1_SD3_DATA1_FLEXIO_FLEXIO_FLEXIO1_FLEXIO23 { 1819 pinmux = <0x443c0144 4 0x443c03bc 1 0x443c02f4>; 1820 }; 1821 /omit-if-no-ref/ iomuxc1_sd3_data1_flexspi_a_data_flexspi1_a_data1: IOMUXC1_SD3_DATA1_FLEXSPI_A_DATA_FLEXSPI1_A_DATA1 { 1822 pinmux = <0x443c0144 1 0x0 0 0x443c02f4>; 1823 }; 1824 /omit-if-no-ref/ iomuxc1_sd3_data1_gpio_io_gpio3_io23: IOMUXC1_SD3_DATA1_GPIO_IO_GPIO3_IO23 { 1825 pinmux = <0x443c0144 5 0x0 0 0x443c02f4>; 1826 }; 1827 /omit-if-no-ref/ iomuxc1_sd3_data1_lpuart_rts_b_lpuart2_rts_b: IOMUXC1_SD3_DATA1_LPUART_RTS_B_LPUART2_RTS_B { 1828 pinmux = <0x443c0144 2 0x0 0 0x443c02f4>; 1829 }; 1830 /omit-if-no-ref/ iomuxc1_sd3_data1_usdhc_data_usdhc3_data1: IOMUXC1_SD3_DATA1_USDHC_DATA_USDHC3_DATA1 { 1831 pinmux = <0x443c0144 0 0x443c04f4 1 0x443c02f4>; 1832 }; 1833 /omit-if-no-ref/ iomuxc1_sd3_data2_flexio_flexio_flexio1_flexio24: IOMUXC1_SD3_DATA2_FLEXIO_FLEXIO_FLEXIO1_FLEXIO24 { 1834 pinmux = <0x443c0148 4 0x443c03c0 1 0x443c02f8>; 1835 }; 1836 /omit-if-no-ref/ iomuxc1_sd3_data2_flexspi_a_data_flexspi1_a_data2: IOMUXC1_SD3_DATA2_FLEXSPI_A_DATA_FLEXSPI1_A_DATA2 { 1837 pinmux = <0x443c0148 1 0x0 0 0x443c02f8>; 1838 }; 1839 /omit-if-no-ref/ iomuxc1_sd3_data2_gpio_io_gpio3_io24: IOMUXC1_SD3_DATA2_GPIO_IO_GPIO3_IO24 { 1840 pinmux = <0x443c0148 5 0x0 0 0x443c02f8>; 1841 }; 1842 /omit-if-no-ref/ iomuxc1_sd3_data2_lpi2c_sda_lpi2c4_sda: IOMUXC1_SD3_DATA2_LPI2C_SDA_LPI2C4_SDA { 1843 pinmux = <0x443c0148 2 0x443c03fc 1 0x443c02f8>; 1844 }; 1845 /omit-if-no-ref/ iomuxc1_sd3_data2_usdhc_data_usdhc3_data2: IOMUXC1_SD3_DATA2_USDHC_DATA_USDHC3_DATA2 { 1846 pinmux = <0x443c0148 0 0x443c04f8 1 0x443c02f8>; 1847 }; 1848 /omit-if-no-ref/ iomuxc1_sd3_data3_flexio_flexio_flexio1_flexio25: IOMUXC1_SD3_DATA3_FLEXIO_FLEXIO_FLEXIO1_FLEXIO25 { 1849 pinmux = <0x443c014c 4 0x443c03c4 1 0x443c02fc>; 1850 }; 1851 /omit-if-no-ref/ iomuxc1_sd3_data3_flexspi_a_data_flexspi1_a_data3: IOMUXC1_SD3_DATA3_FLEXSPI_A_DATA_FLEXSPI1_A_DATA3 { 1852 pinmux = <0x443c014c 1 0x0 0 0x443c02fc>; 1853 }; 1854 /omit-if-no-ref/ iomuxc1_sd3_data3_gpio_io_gpio3_io25: IOMUXC1_SD3_DATA3_GPIO_IO_GPIO3_IO25 { 1855 pinmux = <0x443c014c 5 0x0 0 0x443c02fc>; 1856 }; 1857 /omit-if-no-ref/ iomuxc1_sd3_data3_lpi2c_scl_lpi2c4_scl: IOMUXC1_SD3_DATA3_LPI2C_SCL_LPI2C4_SCL { 1858 pinmux = <0x443c014c 2 0x443c03f8 1 0x443c02fc>; 1859 }; 1860 /omit-if-no-ref/ iomuxc1_sd3_data3_usdhc_data_usdhc3_data3: IOMUXC1_SD3_DATA3_USDHC_DATA_USDHC3_DATA3 { 1861 pinmux = <0x443c014c 0 0x443c04fc 1 0x443c02fc>; 1862 }; 1863 /omit-if-no-ref/ iomuxc1_uart1_rxd_ele_uart_rx_ele_uart_rx: IOMUXC1_UART1_RXD_ELE_UART_RX_ELE_UART_RX { 1864 pinmux = <0x443c0180 1 0x0 0 0x443c0330>; 1865 }; 1866 /omit-if-no-ref/ iomuxc1_uart1_rxd_gpio_io_gpio1_io4: IOMUXC1_UART1_RXD_GPIO_IO_GPIO1_IO4 { 1867 pinmux = <0x443c0180 5 0x0 0 0x443c0330>; 1868 }; 1869 /omit-if-no-ref/ iomuxc1_uart1_rxd_lpspi_sin_lpspi2_sin: IOMUXC1_UART1_RXD_LPSPI_SIN_LPSPI2_SIN { 1870 pinmux = <0x443c0180 2 0x443c0440 2 0x443c0330>; 1871 }; 1872 /omit-if-no-ref/ iomuxc1_uart1_rxd_lpuart_rx_lpuart1_rx: IOMUXC1_UART1_RXD_LPUART_RX_LPUART1_RX { 1873 pinmux = <0x443c0180 0 0x443c0458 1 0x443c0330>; 1874 }; 1875 /omit-if-no-ref/ iomuxc1_uart1_rxd_tpm_ch_tpm1_ch0: IOMUXC1_UART1_RXD_TPM_CH_TPM1_CH0 { 1876 pinmux = <0x443c0180 3 0x0 0 0x443c0330>; 1877 }; 1878 /omit-if-no-ref/ iomuxc1_uart1_txd_ele_uart_tx_ele_uart_tx: IOMUXC1_UART1_TXD_ELE_UART_TX_ELE_UART_TX { 1879 pinmux = <0x443c0184 1 0x0 0 0x443c0334>; 1880 }; 1881 /omit-if-no-ref/ iomuxc1_uart1_txd_gpio_io_gpio1_io5: IOMUXC1_UART1_TXD_GPIO_IO_GPIO1_IO5 { 1882 pinmux = <0x443c0184 5 0x0 0 0x443c0334>; 1883 }; 1884 /omit-if-no-ref/ iomuxc1_uart1_txd_lpspi_pcs_lpspi2_pcs0: IOMUXC1_UART1_TXD_LPSPI_PCS_LPSPI2_PCS0 { 1885 pinmux = <0x443c0184 2 0x443c0434 2 0x443c0334>; 1886 }; 1887 /omit-if-no-ref/ iomuxc1_uart1_txd_lpuart_tx_lpuart1_tx: IOMUXC1_UART1_TXD_LPUART_TX_LPUART1_TX { 1888 pinmux = <0x443c0184 0 0x443c045c 1 0x443c0334>; 1889 }; 1890 /omit-if-no-ref/ iomuxc1_uart1_txd_tpm_ch_tpm1_ch1: IOMUXC1_UART1_TXD_TPM_CH_TPM1_CH1 { 1891 pinmux = <0x443c0184 3 0x0 0 0x443c0334>; 1892 }; 1893 /omit-if-no-ref/ iomuxc1_uart2_rxd_gpio_io_gpio1_io6: IOMUXC1_UART2_RXD_GPIO_IO_GPIO1_IO6 { 1894 pinmux = <0x443c0188 5 0x0 0 0x443c0338>; 1895 }; 1896 /omit-if-no-ref/ iomuxc1_uart2_rxd_lpspi_sout_lpspi2_sout: IOMUXC1_UART2_RXD_LPSPI_SOUT_LPSPI2_SOUT { 1897 pinmux = <0x443c0188 2 0x443c0444 2 0x443c0338>; 1898 }; 1899 /omit-if-no-ref/ iomuxc1_uart2_rxd_lpuart_cts_b_lpuart1_cts_b: IOMUXC1_UART2_RXD_LPUART_CTS_B_LPUART1_CTS_B { 1900 pinmux = <0x443c0188 1 0x443c0454 1 0x443c0338>; 1901 }; 1902 /omit-if-no-ref/ iomuxc1_uart2_rxd_lpuart_rx_lpuart2_rx: IOMUXC1_UART2_RXD_LPUART_RX_LPUART2_RX { 1903 pinmux = <0x443c0188 0 0x443c0464 1 0x443c0338>; 1904 }; 1905 /omit-if-no-ref/ iomuxc1_uart2_rxd_sai_mclk_sai1_mclk: IOMUXC1_UART2_RXD_SAI_MCLK_SAI1_MCLK { 1906 pinmux = <0x443c0188 4 0x443c04d4 0 0x443c0338>; 1907 }; 1908 /omit-if-no-ref/ iomuxc1_uart2_rxd_tpm_ch_tpm1_ch2: IOMUXC1_UART2_RXD_TPM_CH_TPM1_CH2 { 1909 pinmux = <0x443c0188 3 0x0 0 0x443c0338>; 1910 }; 1911 /omit-if-no-ref/ iomuxc1_uart2_txd_gpio_io_gpio1_io7: IOMUXC1_UART2_TXD_GPIO_IO_GPIO1_IO7 { 1912 pinmux = <0x443c018c 5 0x0 0 0x443c033c>; 1913 }; 1914 /omit-if-no-ref/ iomuxc1_uart2_txd_lpspi_sck_lpspi2_sck: IOMUXC1_UART2_TXD_LPSPI_SCK_LPSPI2_SCK { 1915 pinmux = <0x443c018c 2 0x443c043c 2 0x443c033c>; 1916 }; 1917 /omit-if-no-ref/ iomuxc1_uart2_txd_lpuart_rts_b_lpuart1_rts_b: IOMUXC1_UART2_TXD_LPUART_RTS_B_LPUART1_RTS_B { 1918 pinmux = <0x443c018c 1 0x0 0 0x443c033c>; 1919 }; 1920 /omit-if-no-ref/ iomuxc1_uart2_txd_lpuart_tx_lpuart2_tx: IOMUXC1_UART2_TXD_LPUART_TX_LPUART2_TX { 1921 pinmux = <0x443c018c 0 0x443c0468 1 0x443c033c>; 1922 }; 1923 /omit-if-no-ref/ iomuxc1_uart2_txd_sai_tx_sync_sai3_tx_sync: IOMUXC1_UART2_TXD_SAI_TX_SYNC_SAI3_TX_SYNC { 1924 pinmux = <0x443c018c 7 0x443c04e0 2 0x443c033c>; 1925 }; 1926 /omit-if-no-ref/ iomuxc1_uart2_txd_tpm_ch_tpm1_ch3: IOMUXC1_UART2_TXD_TPM_CH_TPM1_CH3 { 1927 pinmux = <0x443c018c 3 0x0 0 0x443c033c>; 1928 }; 1929 /omit-if-no-ref/ iomuxc1_wdog_any_gpio_io_gpio1_io15: IOMUXC1_WDOG_ANY_GPIO_IO_GPIO1_IO15 { 1930 pinmux = <0x443c01ac 5 0x0 0 0x443c035c>; 1931 }; 1932 /omit-if-no-ref/ iomuxc1_wdog_any_wdog_wdog_any_wdog1_wdog_any: IOMUXC1_WDOG_ANY_WDOG_WDOG_ANY_WDOG1_WDOG_ANY { 1933 pinmux = <0x443c01ac 0 0x0 0 0x443c035c>; 1934 }; 1935}; 1936 1937
