1 /* 2 * NOTE: Autogenerated file by gen_soc_headers.py 3 * for MCXN236VNL/signal_configuration.xml 4 * 5 * Copyright 2024 NXP 6 * SPDX-License-Identifier: Apache-2.0 7 */ 8 9 #ifndef _ZEPHYR_DTS_BINDING_MCXN236VNL_ 10 #define _ZEPHYR_DTS_BINDING_MCXN236VNL_ 11 12 #define N9X_MUX(port, pin, mux) \ 13 (((((port) - '0') & 0xF) << 28) | \ 14 (((pin) & 0x3F) << 22) | \ 15 (((mux) & 0xF) << 8)) 16 17 #define PIO0_0 N9X_MUX('0',0,0) /* PT0_0 */ 18 #define TMS_PIO0_0 N9X_MUX('0',0,1) /* PT0_0 */ 19 #define SWDIO_PIO0_0 N9X_MUX('0',0,1) /* PT0_0 */ 20 #define FC1_P0_PIO0_0 N9X_MUX('0',0,2) /* PT0_0 */ 21 #define CT_INP0_PIO0_0 N9X_MUX('0',0,4) /* PT0_0 */ 22 #define PIO0_1 N9X_MUX('0',1,0) /* PT0_1 */ 23 #define TCLK_PIO0_1 N9X_MUX('0',1,1) /* PT0_1 */ 24 #define SWCLK_PIO0_1 N9X_MUX('0',1,1) /* PT0_1 */ 25 #define FC1_P1_PIO0_1 N9X_MUX('0',1,2) /* PT0_1 */ 26 #define CT_INP1_PIO0_1 N9X_MUX('0',1,4) /* PT0_1 */ 27 #define PIO0_2 N9X_MUX('0',2,0) /* PT0_2 */ 28 #define TDO_PIO0_2 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566 #define PIO5_1 N9X_MUX('5',1,0) /* PT5_1 */ 567 #define TRIG_OUT6_PIO5_1 N9X_MUX('5',1,1) /* PT5_1 */ 568 #define LPTMR1_ALT2_PIO5_1 N9X_MUX('5',1,2) /* PT5_1 */ 569 #define PIO5_2 N9X_MUX('5',2,0) /* PT5_2 */ 570 #define ADC1_B10_PIO5_2 N9X_MUX('5',2,0) /* PT5_2 */ 571 #define VBAT_WAKEUP_b_PIO5_2 N9X_MUX('5',2,1) /* PT5_2 */ 572 #define SPC_LPREQ_PIO5_2 N9X_MUX('5',2,2) /* PT5_2 */ 573 #define TAMPER0_PIO5_2 N9X_MUX('5',2,3) /* PT5_2 */ 574 #define ADC1_B11_PIO5_3 N9X_MUX('5',3,0) /* PT5_3 */ 575 #define PIO5_3 N9X_MUX('5',3,0) /* PT5_3 */ 576 #define TRIG_IN11_PIO5_3 N9X_MUX('5',3,1) /* PT5_3 */ 577 #define RTC_CLKOUT_PIO5_3 N9X_MUX('5',3,2) /* PT5_3 */ 578 #define TAMPER1_PIO5_3 N9X_MUX('5',3,3) /* PT5_3 */ 579 #endif 580
