1 /* 2 * NOTE: File generated by lpc_cfg_utils.py 3 * from MIMXRT685SFVKB/signal_configuration.xml 4 * 5 * Copyright (c) 2022, NXP 6 * SPDX-License-Identifier: Apache-2.0 7 */ 8 9 #ifndef _ZEPHYR_DTS_BINDING_MIMXRT685SFVKB_ 10 #define _ZEPHYR_DTS_BINDING_MIMXRT685SFVKB_ 11 12 #define IOPCTL_MUX(offset, mux) \ 13 ((((offset) & 0xFFF) << 20) | \ 14 (((mux) & 0xF) << 0)) 15 16 #define CTIMER0_MATCH0_PIO0_0 IOPCTL_MUX(0, 4) /* PIO0_0 */ 17 #define DMA0_TRIG0_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 18 #define DMA0_TRIG10_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 19 #define DMA0_TRIG11_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 20 #define DMA0_TRIG12_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 21 #define DMA0_TRIG13_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 22 #define DMA0_TRIG14_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 23 #define DMA0_TRIG15_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 24 #define DMA0_TRIG16_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 25 #define DMA0_TRIG17_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 26 #define DMA0_TRIG18_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 27 #define DMA0_TRIG19_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 28 #define DMA0_TRIG1_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 29 #define DMA0_TRIG20_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 30 #define DMA0_TRIG21_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 31 #define DMA0_TRIG22_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 32 #define DMA0_TRIG23_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 33 #define DMA0_TRIG24_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 34 #define DMA0_TRIG25_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 35 #define DMA0_TRIG26_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 36 #define DMA0_TRIG27_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 37 #define DMA0_TRIG28_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 38 #define DMA0_TRIG29_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 39 #define DMA0_TRIG2_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 40 #define DMA0_TRIG30_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 41 #define DMA0_TRIG31_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 42 #define DMA0_TRIG32_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 43 #define DMA0_TRIG3_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 44 #define DMA0_TRIG4_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 45 #define DMA0_TRIG5_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 46 #define DMA0_TRIG6_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 47 #define DMA0_TRIG7_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 48 #define DMA0_TRIG8_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 49 #define DMA0_TRIG9_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 50 #define DMA1_TRIG0_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 51 #define DMA1_TRIG10_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 52 #define DMA1_TRIG11_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 53 #define DMA1_TRIG12_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 54 #define DMA1_TRIG13_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 55 #define DMA1_TRIG14_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 56 #define DMA1_TRIG15_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 57 #define DMA1_TRIG16_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 58 #define DMA1_TRIG17_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 59 #define DMA1_TRIG18_PIO0_0 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93 #define PINT_PINT6_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 94 #define PINT_PINT7_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ 95 #define SECGPIO_SECPIO00_PIO0_0 IOPCTL_MUX(0, 8) /* PIO0_0 */ 96 #define PMIC_I2C_SCL IOPCTL_MUX(256, 0) /* PIO0_0 */ 97 #define PMIC_I2C_SDA IOPCTL_MUX(257, 0) /* PIO0_0 */ 98 #define CTIMER0_MATCH1_PIO0_1 IOPCTL_MUX(1, 4) /* PIO0_1 */ 99 #define DMA0_TRIG0_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 100 #define DMA0_TRIG10_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 101 #define DMA0_TRIG11_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 102 #define DMA0_TRIG12_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 103 #define DMA0_TRIG13_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 104 #define DMA0_TRIG14_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 105 #define DMA0_TRIG15_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 106 #define DMA0_TRIG16_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 107 #define DMA0_TRIG17_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 108 #define DMA0_TRIG18_PIO0_1 IOPCTL_MUX(1, 0) /* PIO0_1 */ 109 #define DMA0_TRIG19_PIO0_1 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PIO0_20 */ 1856 #define CTIMER4_CAPTURE3_PIO0_20 IOPCTL_MUX(20, 5) /* PIO0_20 */ 1857 #define DMA0_TRIG0_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1858 #define DMA0_TRIG10_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1859 #define DMA0_TRIG11_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1860 #define DMA0_TRIG12_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1861 #define DMA0_TRIG13_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1862 #define DMA0_TRIG14_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1863 #define DMA0_TRIG15_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1864 #define DMA0_TRIG16_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1865 #define DMA0_TRIG17_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1866 #define DMA0_TRIG18_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1867 #define DMA0_TRIG19_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1868 #define DMA0_TRIG1_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1869 #define DMA0_TRIG20_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1870 #define DMA0_TRIG21_PIO0_20 IOPCTL_MUX(20, 0) /* PIO0_20 */ 1871 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1979 #define DMA1_TRIG12_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1980 #define DMA1_TRIG13_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1981 #define DMA1_TRIG14_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1982 #define DMA1_TRIG15_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1983 #define DMA1_TRIG16_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1984 #define DMA1_TRIG17_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1985 #define DMA1_TRIG18_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1986 #define DMA1_TRIG19_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1987 #define DMA1_TRIG1_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1988 #define DMA1_TRIG20_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1989 #define DMA1_TRIG21_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1990 #define DMA1_TRIG22_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1991 #define DMA1_TRIG23_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1992 #define DMA1_TRIG24_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1993 #define DMA1_TRIG25_PIO0_21 IOPCTL_MUX(21, 0) /* PIO0_21 */ 1994 #define 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SCT0_IN4_PIO1_8 IOPCTL_MUX(40, 2) /* PIO1_8 */ 3676 #define SCT0_IN5_PIO1_8 IOPCTL_MUX(40, 2) /* PIO1_8 */ 3677 #define SCT0_IN6_PIO1_8 IOPCTL_MUX(40, 2) /* PIO1_8 */ 3678 #define ADC0_CH12_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3679 #define CTIMER1_MATCH3_PIO1_9 IOPCTL_MUX(41, 4) /* PIO1_9 */ 3680 #define DMA0_TRIG0_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3681 #define DMA0_TRIG10_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3682 #define DMA0_TRIG11_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3683 #define DMA0_TRIG12_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3684 #define DMA0_TRIG13_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3685 #define DMA0_TRIG14_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3686 #define DMA0_TRIG15_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3687 #define DMA0_TRIG16_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3688 #define DMA0_TRIG17_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3689 #define DMA0_TRIG18_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3690 #define DMA0_TRIG19_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3691 #define 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3739 #define DMA1_TRIG3_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3740 #define DMA1_TRIG4_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3741 #define DMA1_TRIG5_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3742 #define DMA1_TRIG6_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3743 #define DMA1_TRIG7_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3744 #define DMA1_TRIG8_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3745 #define DMA1_TRIG9_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3746 #define FC5_SSEL3_PIO1_9 IOPCTL_MUX(41, 1) /* PIO1_9 */ 3747 #define GPIO_PIO19_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3748 #define PINT_PINT0_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3749 #define PINT_PINT1_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3750 #define PINT_PINT2_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3751 #define PINT_PINT3_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3752 #define PINT_PINT4_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3753 #define PINT_PINT5_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3754 #define PINT_PINT6_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3755 #define PINT_PINT7_PIO1_9 IOPCTL_MUX(41, 0) /* PIO1_9 */ 3756 #define SCT0_IN0_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3757 #define SCT0_IN1_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3758 #define SCT0_IN2_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3759 #define SCT0_IN3_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3760 #define SCT0_IN4_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3761 #define SCT0_IN5_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3762 #define SCT0_IN6_PIO1_9 IOPCTL_MUX(41, 2) /* PIO1_9 */ 3763 #define UTICK0_CAPTURE1_PIO1_9 IOPCTL_MUX(41, 3) /* PIO1_9 */ 3764 #define CLKOUT_PIO1_10 IOPCTL_MUX(42, 7) /* PIO1_10 */ 3765 #define CTIMER0_CAPTURE0_PIO1_10 IOPCTL_MUX(42, 4) /* PIO1_10 */ 3766 #define CTIMER0_CAPTURE1_PIO1_10 IOPCTL_MUX(42, 4) /* PIO1_10 */ 3767 #define CTIMER0_CAPTURE2_PIO1_10 IOPCTL_MUX(42, 4) /* PIO1_10 */ 3768 #define CTIMER0_CAPTURE3_PIO1_10 IOPCTL_MUX(42, 4) /* PIO1_10 */ 3769 #define CTIMER1_CAPTURE0_PIO1_10 IOPCTL_MUX(42, 4) /* PIO1_10 */ 3770 #define CTIMER1_CAPTURE1_PIO1_10 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PIO1_10 */ 3785 #define DMA0_TRIG0_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3786 #define DMA0_TRIG10_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3787 #define DMA0_TRIG11_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3788 #define DMA0_TRIG12_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3789 #define DMA0_TRIG13_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3790 #define DMA0_TRIG14_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3791 #define DMA0_TRIG15_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3792 #define DMA0_TRIG16_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3793 #define DMA0_TRIG17_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3794 #define DMA0_TRIG18_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3795 #define DMA0_TRIG19_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3796 #define DMA0_TRIG1_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3797 #define DMA0_TRIG20_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3798 #define DMA0_TRIG21_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3799 #define DMA0_TRIG22_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3800 #define DMA0_TRIG23_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3801 #define DMA0_TRIG24_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3802 #define DMA0_TRIG25_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3803 #define DMA0_TRIG26_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3804 #define DMA0_TRIG27_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3805 #define DMA0_TRIG28_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3806 #define DMA0_TRIG29_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3807 #define DMA0_TRIG2_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3808 #define DMA0_TRIG30_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3809 #define DMA0_TRIG31_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3810 #define DMA0_TRIG32_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3811 #define DMA0_TRIG3_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3812 #define DMA0_TRIG4_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3813 #define DMA0_TRIG5_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3814 #define DMA0_TRIG6_PIO1_10 IOPCTL_MUX(42, 0) /* PIO1_10 */ 3815 #define DMA0_TRIG7_PIO1_10 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4031 #define DMA0_TRIG13_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4032 #define DMA0_TRIG14_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4033 #define DMA0_TRIG15_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4034 #define DMA0_TRIG16_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4035 #define DMA0_TRIG17_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4036 #define DMA0_TRIG18_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4037 #define DMA0_TRIG19_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4038 #define DMA0_TRIG1_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4039 #define DMA0_TRIG20_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4040 #define DMA0_TRIG21_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4041 #define DMA0_TRIG22_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4042 #define DMA0_TRIG23_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4043 #define DMA0_TRIG24_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4044 #define DMA0_TRIG25_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4045 #define DMA0_TRIG26_PIO1_13 IOPCTL_MUX(45, 0) /* PIO1_13 */ 4046 #define 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PIO1_15 */ 4231 #define DMA1_TRIG23_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4232 #define DMA1_TRIG24_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4233 #define DMA1_TRIG25_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4234 #define DMA1_TRIG26_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4235 #define DMA1_TRIG27_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4236 #define DMA1_TRIG28_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4237 #define DMA1_TRIG29_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4238 #define DMA1_TRIG2_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4239 #define DMA1_TRIG30_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4240 #define DMA1_TRIG31_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4241 #define DMA1_TRIG32_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4242 #define DMA1_TRIG3_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4243 #define DMA1_TRIG4_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4244 #define DMA1_TRIG5_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4245 #define DMA1_TRIG6_PIO1_15 IOPCTL_MUX(47, 0) /* PIO1_15 */ 4246 #define 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PINT_PINT4_PIO1_26 IOPCTL_MUX(58, 0) /* PIO1_26 */ 5153 #define PINT_PINT5_PIO1_26 IOPCTL_MUX(58, 0) /* PIO1_26 */ 5154 #define PINT_PINT6_PIO1_26 IOPCTL_MUX(58, 0) /* PIO1_26 */ 5155 #define PINT_PINT7_PIO1_26 IOPCTL_MUX(58, 0) /* PIO1_26 */ 5156 #define SCT0_IN0_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5157 #define SCT0_IN1_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5158 #define SCT0_IN2_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5159 #define SCT0_IN3_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5160 #define SCT0_IN4_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5161 #define SCT0_IN5_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5162 #define SCT0_IN6_PIO1_26 IOPCTL_MUX(58, 2) /* PIO1_26 */ 5163 #define DMA0_TRIG0_PIO1_27 IOPCTL_MUX(59, 0) /* PIO1_27 */ 5164 #define DMA0_TRIG10_PIO1_27 IOPCTL_MUX(59, 0) /* PIO1_27 */ 5165 #define DMA0_TRIG11_PIO1_27 IOPCTL_MUX(59, 0) /* PIO1_27 */ 5166 #define DMA0_TRIG12_PIO1_27 IOPCTL_MUX(59, 0) /* PIO1_27 */ 5167 #define DMA0_TRIG13_PIO1_27 IOPCTL_MUX(59, 0) /* PIO1_27 */ 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SCT0_IN6_PIO1_28 IOPCTL_MUX(60, 2) /* PIO1_28 */ 5323 #define CTIMER0_CAPTURE0_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5324 #define CTIMER0_CAPTURE1_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5325 #define CTIMER0_CAPTURE2_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5326 #define CTIMER0_CAPTURE3_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5327 #define CTIMER1_CAPTURE0_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5328 #define CTIMER1_CAPTURE1_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5329 #define CTIMER1_CAPTURE2_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5330 #define CTIMER1_CAPTURE3_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5331 #define CTIMER2_CAPTURE0_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5332 #define CTIMER2_CAPTURE1_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5333 #define CTIMER2_CAPTURE2_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5334 #define CTIMER2_CAPTURE3_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5335 #define CTIMER3_CAPTURE0_PIO1_29 IOPCTL_MUX(61, 4) /* PIO1_29 */ 5336 #define CTIMER3_CAPTURE1_PIO1_29 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*/ 5662 #define SCT0_IN3_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ 5663 #define SCT0_IN4_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ 5664 #define SCT0_IN5_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ 5665 #define SCT0_IN6_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ 5666 #define SD0_VOLT_PIO2_11 IOPCTL_MUX(75, 1) /* PIO2_11 */ 5667 #define CTIMER2_MATCH2_PIO2_12 IOPCTL_MUX(76, 4) /* PIO2_12 */ 5668 #define GPIO_PIO212_PIO2_12 IOPCTL_MUX(76, 0) /* PIO2_12 */ 5669 #define SCT0_OUT6_PIO2_12 IOPCTL_MUX(76, 2) /* PIO2_12 */ 5670 #define CMP0_OUT_PIO2_13 IOPCTL_MUX(77, 7) /* PIO2_13 */ 5671 #define CTIMER2_MATCH3_PIO2_13 IOPCTL_MUX(77, 4) /* PIO2_13 */ 5672 #define GPIO_PIO213_PIO2_13 IOPCTL_MUX(77, 0) /* PIO2_13 */ 5673 #define SCT0_OUT7_PIO2_13 IOPCTL_MUX(77, 2) /* PIO2_13 */ 5674 #define CMP_IN1_PIO2_14 IOPCTL_MUX(78, 0) /* PIO2_14 */ 5675 #define CTIMER0_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5676 #define CTIMER0_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5677 #define CTIMER0_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5678 #define CTIMER0_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5679 #define CTIMER1_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5680 #define CTIMER1_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5681 #define CTIMER1_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5682 #define CTIMER1_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5683 #define CTIMER2_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5684 #define CTIMER2_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5685 #define CTIMER2_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5686 #define CTIMER2_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5687 #define CTIMER3_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5688 #define CTIMER3_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5689 #define CTIMER3_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5690 #define CTIMER3_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5691 #define CTIMER4_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5692 #define CTIMER4_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5693 #define CTIMER4_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5694 #define CTIMER4_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ 5695 #define GPIO_PIO214_PIO2_14 IOPCTL_MUX(78, 0) /* PIO2_14 */ 5696 #define SCT0_OUT8_PIO2_14 IOPCTL_MUX(78, 2) /* PIO2_14 */ 5697 #define CLKIN_PIO2_15 IOPCTL_MUX(79, 7) /* PIO2_15 */ 5698 #define CMP_IN4_PIO2_15 IOPCTL_MUX(79, 0) /* PIO2_15 */ 5699 #define GPIO_PIO215_PIO2_15 IOPCTL_MUX(79, 0) /* PIO2_15 */ 5700 #define SCT0_OUT9_PIO2_15 IOPCTL_MUX(79, 2) /* PIO2_15 */ 5701 #define DMIC0_CLK0_1_PIO2_16 IOPCTL_MUX(80, 1) /* PIO2_16 */ 5702 #define GPIO_PIO216_PIO2_16 IOPCTL_MUX(80, 0) /* PIO2_16 */ 5703 #define DMIC0_CLK2_3_PIO2_17 IOPCTL_MUX(81, 1) /* PIO2_17 */ 5704 #define FLEXSPI0B_DATA4_PIO2_17 IOPCTL_MUX(81, 6) /* PIO2_17 */ 5705 #define GPIO_PIO217_PIO2_17 IOPCTL_MUX(81, 0) /* PIO2_17 */ 5706 #define DMIC0_CLK4_5_PIO2_18 IOPCTL_MUX(82, 1) /* PIO2_18 */ 5707 #define FLEXSPI0B_DATA5_PIO2_18 IOPCTL_MUX(82, 6) /* PIO2_18 */ 5708 #define GPIO_PIO218_PIO2_18 IOPCTL_MUX(82, 0) /* PIO2_18 */ 5709 #define DMIC0_CLK6_7_PIO2_19 IOPCTL_MUX(83, 1) /* PIO2_19 */ 5710 #define FLEXSPI0B_SS0_N_PIO2_19 IOPCTL_MUX(83, 6) /* PIO2_19 */ 5711 #define GPIO_PIO219_PIO2_19 IOPCTL_MUX(83, 0) /* PIO2_19 */ 5712 #define DMIC0_DATA0_1_PIO2_20 IOPCTL_MUX(84, 1) /* PIO2_20 */ 5713 #define GPIO_PIO220_PIO2_20 IOPCTL_MUX(84, 0) /* PIO2_20 */ 5714 #define CTIMER0_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5715 #define CTIMER0_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5716 #define CTIMER0_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5717 #define CTIMER0_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5718 #define CTIMER1_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5719 #define CTIMER1_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5720 #define CTIMER1_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5721 #define CTIMER1_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5722 #define CTIMER2_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5723 #define CTIMER2_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5724 #define CTIMER2_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5725 #define CTIMER2_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5726 #define CTIMER3_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5727 #define CTIMER3_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5728 #define CTIMER3_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5729 #define CTIMER3_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5730 #define CTIMER4_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5731 #define CTIMER4_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5732 #define CTIMER4_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5733 #define CTIMER4_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ 5734 #define DMIC0_DATA2_3_PIO2_21 IOPCTL_MUX(85, 1) /* PIO2_21 */ 5735 #define FLEXSPI0B_SS1_N_PIO2_21 IOPCTL_MUX(85, 6) /* PIO2_21 */ 5736 #define GPIO_PIO221_PIO2_21 IOPCTL_MUX(85, 0) /* PIO2_21 */ 5737 #define DMIC0_DATA4_5_PIO2_22 IOPCTL_MUX(86, 1) /* PIO2_22 */ 5738 #define FLEXSPI0B_DATA6_PIO2_22 IOPCTL_MUX(86, 6) /* PIO2_22 */ 5739 #define GPIO_PIO222_PIO2_22 IOPCTL_MUX(86, 0) /* PIO2_22 */ 5740 #define DMIC0_DATA6_7_PIO2_23 IOPCTL_MUX(87, 1) /* PIO2_23 */ 5741 #define FLEXSPI0B_DATA7_PIO2_23 IOPCTL_MUX(87, 6) /* PIO2_23 */ 5742 #define GPIO_PIO223_PIO2_23 IOPCTL_MUX(87, 0) /* PIO2_23 */ 5743 #define GPIO_INT_BMAT_PIO2_24 IOPCTL_MUX(88, 6) /* PIO2_24 */ 5744 #define GPIO_PIO224_PIO2_24 IOPCTL_MUX(88, 0) /* PIO2_24 */ 5745 #define SWO_PIO2_24 IOPCTL_MUX(88, 1) /* PIO2_24 */ 5746 #define GPIO_PIO225_PIO2_25 IOPCTL_MUX(89, 0) /* PIO2_25 */ 5747 #define SWCLK_PIO2_25 IOPCTL_MUX(89, 1) /* PIO2_25 */ 5748 #define GPIO_PIO226_PIO2_26 IOPCTL_MUX(90, 0) /* PIO2_26 */ 5749 #define SWDIO_PIO2_26 IOPCTL_MUX(90, 1) /* PIO2_26 */ 5750 #define GPIO_PIO227_PIO2_27 IOPCTL_MUX(91, 0) /* PIO2_27 */ 5751 #define USB1_OVERCURRENTN_PIO2_27 IOPCTL_MUX(91, 1) /* PIO2_27 */ 5752 #define GPIO_PIO228_PIO2_28 IOPCTL_MUX(92, 0) /* PIO2_28 */ 5753 #define USB1_PORTPWRN_PIO2_28 IOPCTL_MUX(92, 1) /* PIO2_28 */ 5754 #define CLKOUT_PIO2_29 IOPCTL_MUX(93, 5) /* PIO2_29 */ 5755 #define GPIO_PIO229_PIO2_29 IOPCTL_MUX(93, 0) /* PIO2_29 */ 5756 #define I3C0_SCL_PIO2_29 IOPCTL_MUX(93, 1) /* PIO2_29 */ 5757 #define SCT0_OUT0_PIO2_29 IOPCTL_MUX(93, 2) /* PIO2_29 */ 5758 #define CLKIN_PIO2_30 IOPCTL_MUX(94, 5) /* PIO2_30 */ 5759 #define CMP0_OUT_PIO2_30 IOPCTL_MUX(94, 7) /* PIO2_30 */ 5760 #define GPIO_PIO230_PIO2_30 IOPCTL_MUX(94, 0) /* PIO2_30 */ 5761 #define I3C0_SDA_PIO2_30 IOPCTL_MUX(94, 1) /* PIO2_30 */ 5762 #define SCT0_OUT3_PIO2_30 IOPCTL_MUX(94, 2) /* PIO2_30 */ 5763 #define CMP_IN2_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ 5764 #define CTIMER0_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5765 #define CTIMER0_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5766 #define CTIMER0_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5767 #define CTIMER0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5768 #define CTIMER1_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5769 #define CTIMER1_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5770 #define CTIMER1_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5771 #define CTIMER1_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5772 #define CTIMER2_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5773 #define CTIMER2_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5774 #define CTIMER2_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5775 #define CTIMER2_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5776 #define CTIMER3_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5777 #define CTIMER3_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5778 #define CTIMER3_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5779 #define CTIMER3_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5780 #define CTIMER4_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5781 #define CTIMER4_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5782 #define CTIMER4_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5783 #define CTIMER4_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ 5784 #define GPIO_PIO231_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ 5785 #define I3C0_PUR_PIO2_31 IOPCTL_MUX(95, 1) /* PIO2_31 */ 5786 #define SCT0_OUT7_PIO2_31 IOPCTL_MUX(95, 2) /* PIO2_31 */ 5787 #define SWO_PIO2_31 IOPCTL_MUX(95, 5) /* PIO2_31 */ 5788 #define UTICK0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 3) /* PIO2_31 */ 5789 5790 #endif 5791
