1/* 2 * Copyright (c) 2022, NXP 3 * SPDX-License-Identifier: Apache-2.0 4 * 5 * Note: File generated by rt_cfg_utils.py 6 * from configuration data for MIMXRT1011CAE4A 7 */ 8 9/* 10 * SOC level pinctrl defintions 11 * These definitions define SOC level defaults for each pin, 12 * and select the pinmux for the pin. Pinmux entries are a tuple of: 13 * <mux_register mux_mode input_register input_daisy config_register> 14 * the mux_register and input_daisy reside in the IOMUXC peripheral, and 15 * the pinctrl driver will write the mux_mode and input_daisy values into 16 * each register, respectively. The config_register is used to configure 17 * the pin based on the devicetree properties set 18 */ 19 20&iomuxc { 21 /omit-if-no-ref/ iomuxc_gpio_00_flexspi_b_dqs: IOMUXC_GPIO_00_FLEXSPI_B_DQS { 22 pinmux = <0x401f80bc 0 0x401f8198 1 0x401f816c>; 23 }; 24 /omit-if-no-ref/ iomuxc_gpio_00_gpiomux_io00: IOMUXC_GPIO_00_GPIOMUX_IO00 { 25 pinmux = <0x401f80bc 5 0x0 0 0x401f816c>; 26 }; 27 /omit-if-no-ref/ iomuxc_gpio_00_lpspi1_pcs3: IOMUXC_GPIO_00_LPSPI1_PCS3 { 28 pinmux = <0x401f80bc 3 0x0 0 0x401f816c>; 29 }; 30 /omit-if-no-ref/ iomuxc_gpio_00_lpspi2_pcs3: IOMUXC_GPIO_00_LPSPI2_PCS3 { 31 pinmux = <0x401f80bc 2 0x0 0 0x401f816c>; 32 }; 33 /omit-if-no-ref/ iomuxc_gpio_00_pit_trigger0: IOMUXC_GPIO_00_PIT_TRIGGER0 { 34 pinmux = <0x401f80bc 4 0x0 0 0x401f816c>; 35 }; 36 /omit-if-no-ref/ iomuxc_gpio_00_sai3_mclk: IOMUXC_GPIO_00_SAI3_MCLK { 37 pinmux = <0x401f80bc 1 0x0 0 0x401f816c>; 38 }; 39 /omit-if-no-ref/ iomuxc_gpio_01_flexpwm1_pwm0_b: IOMUXC_GPIO_01_FLEXPWM1_PWM0_B { 40 pinmux = <0x401f80b8 2 0x401f8184 1 0x401f8168>; 41 }; 42 /omit-if-no-ref/ iomuxc_gpio_01_gpiomux_io01: IOMUXC_GPIO_01_GPIOMUX_IO01 { 43 pinmux = <0x401f80b8 5 0x0 0 0x401f8168>; 44 }; 45 /omit-if-no-ref/ iomuxc_gpio_01_kpp_row3: IOMUXC_GPIO_01_KPP_ROW3 { 46 pinmux = <0x401f80b8 4 0x401f81b8 1 0x401f8168>; 47 }; 48 /omit-if-no-ref/ iomuxc_gpio_01_lpi2c1_sda: IOMUXC_GPIO_01_LPI2C1_SDA { 49 pinmux = <0x401f80b8 3 0x401f81c4 3 0x401f8168>; 50 }; 51 /omit-if-no-ref/ iomuxc_gpio_01_sai1_rx_bclk: IOMUXC_GPIO_01_SAI1_RX_BCLK { 52 pinmux = <0x401f80b8 0 0x0 0 0x401f8168>; 53 }; 54 /omit-if-no-ref/ iomuxc_gpio_01_wdog1_any: IOMUXC_GPIO_01_WDOG1_ANY { 55 pinmux = <0x401f80b8 1 0x0 0 0x401f8168>; 56 }; 57 /omit-if-no-ref/ iomuxc_gpio_02_flexpwm1_pwm0_a: IOMUXC_GPIO_02_FLEXPWM1_PWM0_A { 58 pinmux = <0x401f80b4 2 0x401f8174 1 0x401f8164>; 59 }; 60 /omit-if-no-ref/ iomuxc_gpio_02_gpiomux_io02: IOMUXC_GPIO_02_GPIOMUX_IO02 { 61 pinmux = <0x401f80b4 5 0x0 0 0x401f8164>; 62 }; 63 /omit-if-no-ref/ iomuxc_gpio_02_kpp_col3: IOMUXC_GPIO_02_KPP_COL3 { 64 pinmux = <0x401f80b4 4 0x401f81a8 1 0x401f8164>; 65 }; 66 /omit-if-no-ref/ iomuxc_gpio_02_lpi2c1_scl: IOMUXC_GPIO_02_LPI2C1_SCL { 67 pinmux = <0x401f80b4 3 0x401f81c0 3 0x401f8164>; 68 }; 69 /omit-if-no-ref/ iomuxc_gpio_02_sai1_rx_sync: IOMUXC_GPIO_02_SAI1_RX_SYNC { 70 pinmux = <0x401f80b4 0 0x0 0 0x401f8164>; 71 }; 72 /omit-if-no-ref/ iomuxc_gpio_02_wdog2_b: IOMUXC_GPIO_02_WDOG2_B { 73 pinmux = <0x401f80b4 1 0x0 0 0x401f8164>; 74 }; 75 /omit-if-no-ref/ iomuxc_gpio_03_flexpwm1_pwm1_b: IOMUXC_GPIO_03_FLEXPWM1_PWM1_B { 76 pinmux = <0x401f80b0 2 0x401f8188 1 0x401f8160>; 77 }; 78 /omit-if-no-ref/ iomuxc_gpio_03_gpiomux_io03: IOMUXC_GPIO_03_GPIOMUX_IO03 { 79 pinmux = <0x401f80b0 5 0x0 0 0x401f8160>; 80 }; 81 /omit-if-no-ref/ iomuxc_gpio_03_gpt1_compare3: IOMUXC_GPIO_03_GPT1_COMPARE3 { 82 pinmux = <0x401f80b0 1 0x0 0 0x401f8160>; 83 }; 84 /omit-if-no-ref/ iomuxc_gpio_03_sai1_rx_data0: IOMUXC_GPIO_03_SAI1_RX_DATA0 { 85 pinmux = <0x401f80b0 0 0x0 0 0x401f8160>; 86 }; 87 /omit-if-no-ref/ iomuxc_gpio_03_spdif_sr_clk: IOMUXC_GPIO_03_SPDIF_SR_CLK { 88 pinmux = <0x401f80b0 4 0x0 0 0x401f8160>; 89 }; 90 /omit-if-no-ref/ iomuxc_gpio_04_flexpwm1_pwm1_a: IOMUXC_GPIO_04_FLEXPWM1_PWM1_A { 91 pinmux = <0x401f80ac 2 0x401f8178 1 0x401f815c>; 92 }; 93 /omit-if-no-ref/ iomuxc_gpio_04_gpiomux_io04: IOMUXC_GPIO_04_GPIOMUX_IO04 { 94 pinmux = <0x401f80ac 5 0x0 0 0x401f815c>; 95 }; 96 /omit-if-no-ref/ iomuxc_gpio_04_gpt1_capture2: IOMUXC_GPIO_04_GPT1_CAPTURE2 { 97 pinmux = <0x401f80ac 1 0x0 0 0x401f815c>; 98 }; 99 /omit-if-no-ref/ iomuxc_gpio_04_sai1_tx_data0: IOMUXC_GPIO_04_SAI1_TX_DATA0 { 100 pinmux = <0x401f80ac 0 0x0 0 0x401f815c>; 101 }; 102 /omit-if-no-ref/ iomuxc_gpio_04_spdif_in: IOMUXC_GPIO_04_SPDIF_IN { 103 pinmux = <0x401f80ac 4 0x401f8214 1 0x401f815c>; 104 }; 105 /omit-if-no-ref/ iomuxc_gpio_05_flexpwm1_pwm2_b: IOMUXC_GPIO_05_FLEXPWM1_PWM2_B { 106 pinmux = <0x401f80a8 2 0x401f818c 1 0x401f8158>; 107 }; 108 /omit-if-no-ref/ iomuxc_gpio_05_gpiomux_io05: IOMUXC_GPIO_05_GPIOMUX_IO05 { 109 pinmux = <0x401f80a8 5 0x0 0 0x401f8158>; 110 }; 111 /omit-if-no-ref/ iomuxc_gpio_05_gpt1_compare2: IOMUXC_GPIO_05_GPT1_COMPARE2 { 112 pinmux = <0x401f80a8 1 0x0 0 0x401f8158>; 113 }; 114 /omit-if-no-ref/ iomuxc_gpio_05_lpuart4_rxd: IOMUXC_GPIO_05_LPUART4_RXD { 115 pinmux = <0x401f80a8 3 0x401f8208 1 0x401f8158>; 116 }; 117 /omit-if-no-ref/ iomuxc_gpio_05_sai1_tx_data1: IOMUXC_GPIO_05_SAI1_TX_DATA1 { 118 pinmux = <0x401f80a8 0 0x0 0 0x401f8158>; 119 }; 120 /omit-if-no-ref/ iomuxc_gpio_05_spdif_out: IOMUXC_GPIO_05_SPDIF_OUT { 121 pinmux = <0x401f80a8 4 0x0 0 0x401f8158>; 122 }; 123 /omit-if-no-ref/ iomuxc_gpio_06_flexpwm1_pwm2_a: IOMUXC_GPIO_06_FLEXPWM1_PWM2_A { 124 pinmux = <0x401f80a4 2 0x401f817c 1 0x401f8154>; 125 }; 126 /omit-if-no-ref/ iomuxc_gpio_06_gpiomux_io06: IOMUXC_GPIO_06_GPIOMUX_IO06 { 127 pinmux = <0x401f80a4 5 0x0 0 0x401f8154>; 128 }; 129 /omit-if-no-ref/ iomuxc_gpio_06_gpt1_capture1: IOMUXC_GPIO_06_GPT1_CAPTURE1 { 130 pinmux = <0x401f80a4 1 0x0 0 0x401f8154>; 131 }; 132 /omit-if-no-ref/ iomuxc_gpio_06_lpuart4_txd: IOMUXC_GPIO_06_LPUART4_TXD { 133 pinmux = <0x401f80a4 3 0x401f820c 1 0x401f8154>; 134 }; 135 /omit-if-no-ref/ iomuxc_gpio_06_sai1_tx_bclk: IOMUXC_GPIO_06_SAI1_TX_BCLK { 136 pinmux = <0x401f80a4 0 0x0 0 0x401f8154>; 137 }; 138 /omit-if-no-ref/ iomuxc_gpio_06_spdif_ext_clk: IOMUXC_GPIO_06_SPDIF_EXT_CLK { 139 pinmux = <0x401f80a4 4 0x401f8218 1 0x401f8154>; 140 }; 141 /omit-if-no-ref/ iomuxc_gpio_07_flexpwm1_pwm3_b: IOMUXC_GPIO_07_FLEXPWM1_PWM3_B { 142 pinmux = <0x401f80a0 2 0x401f8190 1 0x401f8150>; 143 }; 144 /omit-if-no-ref/ iomuxc_gpio_07_gpiomux_io07: IOMUXC_GPIO_07_GPIOMUX_IO07 { 145 pinmux = <0x401f80a0 5 0x0 0 0x401f8150>; 146 }; 147 /omit-if-no-ref/ iomuxc_gpio_07_gpt1_compare1: IOMUXC_GPIO_07_GPT1_COMPARE1 { 148 pinmux = <0x401f80a0 1 0x0 0 0x401f8150>; 149 }; 150 /omit-if-no-ref/ iomuxc_gpio_07_lpuart1_rts_b: IOMUXC_GPIO_07_LPUART1_RTS_B { 151 pinmux = <0x401f80a0 6 0x0 0 0x401f8150>; 152 }; 153 /omit-if-no-ref/ iomuxc_gpio_07_lpuart3_rxd: IOMUXC_GPIO_07_LPUART3_RXD { 154 pinmux = <0x401f80a0 3 0x401f8200 2 0x401f8150>; 155 }; 156 /omit-if-no-ref/ iomuxc_gpio_07_sai1_tx_sync: IOMUXC_GPIO_07_SAI1_TX_SYNC { 157 pinmux = <0x401f80a0 0 0x0 0 0x401f8150>; 158 }; 159 /omit-if-no-ref/ iomuxc_gpio_07_spdif_lock: IOMUXC_GPIO_07_SPDIF_LOCK { 160 pinmux = <0x401f80a0 4 0x0 0 0x401f8150>; 161 }; 162 /omit-if-no-ref/ iomuxc_gpio_08_flexio1_io00: IOMUXC_GPIO_08_FLEXIO1_IO00 { 163 pinmux = <0x401f809c 4 0x0 0 0x401f814c>; 164 }; 165 /omit-if-no-ref/ iomuxc_gpio_08_flexpwm1_pwm3_a: IOMUXC_GPIO_08_FLEXPWM1_PWM3_A { 166 pinmux = <0x401f809c 2 0x401f8180 1 0x401f814c>; 167 }; 168 /omit-if-no-ref/ iomuxc_gpio_08_gpiomux_io08: IOMUXC_GPIO_08_GPIOMUX_IO08 { 169 pinmux = <0x401f809c 5 0x0 0 0x401f814c>; 170 }; 171 /omit-if-no-ref/ iomuxc_gpio_08_gpt1_clk: IOMUXC_GPIO_08_GPT1_CLK { 172 pinmux = <0x401f809c 1 0x0 0 0x401f814c>; 173 }; 174 /omit-if-no-ref/ iomuxc_gpio_08_lpuart1_cts_b: IOMUXC_GPIO_08_LPUART1_CTS_B { 175 pinmux = <0x401f809c 6 0x0 0 0x401f814c>; 176 }; 177 /omit-if-no-ref/ iomuxc_gpio_08_lpuart3_txd: IOMUXC_GPIO_08_LPUART3_TXD { 178 pinmux = <0x401f809c 3 0x401f8204 2 0x401f814c>; 179 }; 180 /omit-if-no-ref/ iomuxc_gpio_08_sai1_mclk: IOMUXC_GPIO_08_SAI1_MCLK { 181 pinmux = <0x401f809c 0 0x0 0 0x401f814c>; 182 }; 183 /omit-if-no-ref/ iomuxc_gpio_09_flexio1_io01: IOMUXC_GPIO_09_FLEXIO1_IO01 { 184 pinmux = <0x401f8098 4 0x0 0 0x401f8148>; 185 }; 186 /omit-if-no-ref/ iomuxc_gpio_09_flexspi_a_ss1_b: IOMUXC_GPIO_09_FLEXSPI_A_SS1_B { 187 pinmux = <0x401f8098 2 0x0 0 0x401f8148>; 188 }; 189 /omit-if-no-ref/ iomuxc_gpio_09_gpiomux_io09: IOMUXC_GPIO_09_GPIOMUX_IO09 { 190 pinmux = <0x401f8098 5 0x0 0 0x401f8148>; 191 }; 192 /omit-if-no-ref/ iomuxc_gpio_09_lpi2c2_sda: IOMUXC_GPIO_09_LPI2C2_SDA { 193 pinmux = <0x401f8098 3 0x401f81cc 3 0x401f8148>; 194 }; 195 /omit-if-no-ref/ iomuxc_gpio_09_lpuart1_rxd: IOMUXC_GPIO_09_LPUART1_RXD { 196 pinmux = <0x401f8098 0 0x401f81f0 1 0x401f8148>; 197 }; 198 /omit-if-no-ref/ iomuxc_gpio_09_spdif_sr_clk: IOMUXC_GPIO_09_SPDIF_SR_CLK { 199 pinmux = <0x401f8098 6 0x0 0 0x401f8148>; 200 }; 201 /omit-if-no-ref/ iomuxc_gpio_09_wdog1_b: IOMUXC_GPIO_09_WDOG1_B { 202 pinmux = <0x401f8098 1 0x0 0 0x401f8148>; 203 }; 204 /omit-if-no-ref/ iomuxc_gpio_10_ewm_out_b: IOMUXC_GPIO_10_EWM_OUT_B { 205 pinmux = <0x401f8094 2 0x0 0 0x401f8144>; 206 }; 207 /omit-if-no-ref/ iomuxc_gpio_10_flexio1_io02: IOMUXC_GPIO_10_FLEXIO1_IO02 { 208 pinmux = <0x401f8094 4 0x0 0 0x401f8144>; 209 }; 210 /omit-if-no-ref/ iomuxc_gpio_10_gpiomux_io10: IOMUXC_GPIO_10_GPIOMUX_IO10 { 211 pinmux = <0x401f8094 5 0x0 0 0x401f8144>; 212 }; 213 /omit-if-no-ref/ iomuxc_gpio_10_lpi2c1_hreq: IOMUXC_GPIO_10_LPI2C1_HREQ { 214 pinmux = <0x401f8094 1 0x401f81bc 1 0x401f8144>; 215 }; 216 /omit-if-no-ref/ iomuxc_gpio_10_lpi2c2_scl: IOMUXC_GPIO_10_LPI2C2_SCL { 217 pinmux = <0x401f8094 3 0x401f81c8 3 0x401f8144>; 218 }; 219 /omit-if-no-ref/ iomuxc_gpio_10_lpuart1_txd: IOMUXC_GPIO_10_LPUART1_TXD { 220 pinmux = <0x401f8094 0 0x401f81f4 1 0x401f8144>; 221 }; 222 /omit-if-no-ref/ iomuxc_gpio_10_spdif_in: IOMUXC_GPIO_10_SPDIF_IN { 223 pinmux = <0x401f8094 6 0x401f8214 0 0x401f8144>; 224 }; 225 /omit-if-no-ref/ iomuxc_gpio_11_arm_trace3: IOMUXC_GPIO_11_ARM_TRACE3 { 226 pinmux = <0x401f8090 7 0x0 0 0x401f8140>; 227 }; 228 /omit-if-no-ref/ iomuxc_gpio_11_flexio1_io03: IOMUXC_GPIO_11_FLEXIO1_IO03 { 229 pinmux = <0x401f8090 4 0x0 0 0x401f8140>; 230 }; 231 /omit-if-no-ref/ iomuxc_gpio_11_flexspi_b_ss1_b: IOMUXC_GPIO_11_FLEXSPI_B_SS1_B { 232 pinmux = <0x401f8090 3 0x0 0 0x401f8140>; 233 }; 234 /omit-if-no-ref/ iomuxc_gpio_11_gpiomux_io11: IOMUXC_GPIO_11_GPIOMUX_IO11 { 235 pinmux = <0x401f8090 5 0x0 0 0x401f8140>; 236 }; 237 /omit-if-no-ref/ iomuxc_gpio_11_kpp_row0: IOMUXC_GPIO_11_KPP_ROW0 { 238 pinmux = <0x401f8090 2 0x401f81ac 1 0x401f8140>; 239 }; 240 /omit-if-no-ref/ iomuxc_gpio_11_lpi2c1_sda: IOMUXC_GPIO_11_LPI2C1_SDA { 241 pinmux = <0x401f8090 1 0x401f81c4 2 0x401f8140>; 242 }; 243 /omit-if-no-ref/ iomuxc_gpio_11_lpuart3_rxd: IOMUXC_GPIO_11_LPUART3_RXD { 244 pinmux = <0x401f8090 0 0x401f8200 1 0x401f8140>; 245 }; 246 /omit-if-no-ref/ iomuxc_gpio_11_spdif_out: IOMUXC_GPIO_11_SPDIF_OUT { 247 pinmux = <0x401f8090 6 0x0 0 0x401f8140>; 248 }; 249 /omit-if-no-ref/ iomuxc_gpio_12_arm_trace2: IOMUXC_GPIO_12_ARM_TRACE2 { 250 pinmux = <0x401f808c 7 0x0 0 0x401f813c>; 251 }; 252 /omit-if-no-ref/ iomuxc_gpio_12_flexio1_io04: IOMUXC_GPIO_12_FLEXIO1_IO04 { 253 pinmux = <0x401f808c 4 0x0 0 0x401f813c>; 254 }; 255 /omit-if-no-ref/ iomuxc_gpio_12_gpiomux_io12: IOMUXC_GPIO_12_GPIOMUX_IO12 { 256 pinmux = <0x401f808c 5 0x0 0 0x401f813c>; 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