1/* 2 * Copyright (c) 2022, NXP 3 * SPDX-License-Identifier: Apache-2.0 4 * 5 * Note: File generated by imx_cfg_utils.py 6 * from configuration data for MIMX8MQ6DVAJZ 7 */ 8 9/* 10 * SOC level pinctrl defintions 11 * These definitions define SOC level defaults for each pin, 12 * and select the pinmux for the pin. Pinmux entries are a tuple of: 13 * <mux_register mux_mode input_register input_daisy config_register> 14 * the mux_register and input_daisy reside in the IOMUXC peripheral, and 15 * the pinctrl driver will write the mux_mode and input_daisy values into 16 * each register, respectively. The config_register is used to configure 17 * the pin based on the devicetree properties set 18 */ 19 20&iomuxc { 21 /omit-if-no-ref/ iomuxc_boot_mode0_src_boot_mode_src_boot_mode0: IOMUXC_BOOT_MODE0_SRC_BOOT_MODE_SRC_BOOT_MODE0 { 22 pinmux = <0x0 0 0x0 0 0x30330258>; 23 }; 24 /omit-if-no-ref/ iomuxc_boot_mode1_src_boot_mode_src_boot_mode1: IOMUXC_BOOT_MODE1_SRC_BOOT_MODE_SRC_BOOT_MODE1 { 25 pinmux = <0x0 0 0x0 0 0x3033025c>; 26 }; 27 /omit-if-no-ref/ iomuxc_ecspi1_miso_ecspi_miso_ecspi1_miso: IOMUXC_ECSPI1_MISO_ECSPI_MISO_ECSPI1_MISO { 28 pinmux = <0x303301fc 0 0x0 0 0x30330464>; 29 }; 30 /omit-if-no-ref/ iomuxc_ecspi1_miso_gpio_io_gpio5_io08: IOMUXC_ECSPI1_MISO_GPIO_IO_GPIO5_IO08 { 31 pinmux = <0x303301fc 5 0x0 0 0x30330464>; 32 }; 33 /omit-if-no-ref/ iomuxc_ecspi1_miso_uart_cts_b_uart3_cts_b: IOMUXC_ECSPI1_MISO_UART_CTS_B_UART3_CTS_B { 34 pinmux = <0x303301fc 1 0x0 0 0x30330464>; 35 }; 36 /omit-if-no-ref/ iomuxc_ecspi1_miso_uart_rts_b_uart3_cts_b: IOMUXC_ECSPI1_MISO_UART_RTS_B_UART3_CTS_B { 37 pinmux = <0x303301fc 1 0x30330500 0 0x30330464>; 38 }; 39 /omit-if-no-ref/ iomuxc_ecspi1_mosi_ecspi_mosi_ecspi1_mosi: IOMUXC_ECSPI1_MOSI_ECSPI_MOSI_ECSPI1_MOSI { 40 pinmux = <0x303301f8 0 0x0 0 0x30330460>; 41 }; 42 /omit-if-no-ref/ iomuxc_ecspi1_mosi_gpio_io_gpio5_io07: IOMUXC_ECSPI1_MOSI_GPIO_IO_GPIO5_IO07 { 43 pinmux = <0x303301f8 5 0x0 0 0x30330460>; 44 }; 45 /omit-if-no-ref/ iomuxc_ecspi1_mosi_uart_rx_uart3_tx: IOMUXC_ECSPI1_MOSI_UART_RX_UART3_TX { 46 pinmux = <0x303301f8 1 0x30330504 1 0x30330460>; 47 }; 48 /omit-if-no-ref/ iomuxc_ecspi1_mosi_uart_tx_uart3_tx: IOMUXC_ECSPI1_MOSI_UART_TX_UART3_TX { 49 pinmux = <0x303301f8 1 0x0 0 0x30330460>; 50 }; 51 /omit-if-no-ref/ iomuxc_ecspi1_sclk_ecspi_sclk_ecspi1_sclk: IOMUXC_ECSPI1_SCLK_ECSPI_SCLK_ECSPI1_SCLK { 52 pinmux = <0x303301f4 0 0x0 0 0x3033045c>; 53 }; 54 /omit-if-no-ref/ iomuxc_ecspi1_sclk_gpio_io_gpio5_io06: IOMUXC_ECSPI1_SCLK_GPIO_IO_GPIO5_IO06 { 55 pinmux = <0x303301f4 5 0x0 0 0x3033045c>; 56 }; 57 /omit-if-no-ref/ iomuxc_ecspi1_sclk_uart_rx_uart3_rx: IOMUXC_ECSPI1_SCLK_UART_RX_UART3_RX { 58 pinmux = <0x303301f4 1 0x30330504 0 0x3033045c>; 59 }; 60 /omit-if-no-ref/ iomuxc_ecspi1_sclk_uart_tx_uart3_rx: IOMUXC_ECSPI1_SCLK_UART_TX_UART3_RX { 61 pinmux = <0x303301f4 1 0x0 0 0x3033045c>; 62 }; 63 /omit-if-no-ref/ iomuxc_ecspi1_ss0_ecspi_ss_ecspi1_ss0: IOMUXC_ECSPI1_SS0_ECSPI_SS_ECSPI1_SS0 { 64 pinmux = <0x30330200 0 0x0 0 0x30330468>; 65 }; 66 /omit-if-no-ref/ iomuxc_ecspi1_ss0_gpio_io_gpio5_io09: IOMUXC_ECSPI1_SS0_GPIO_IO_GPIO5_IO09 { 67 pinmux = <0x30330200 5 0x0 0 0x30330468>; 68 }; 69 /omit-if-no-ref/ iomuxc_ecspi1_ss0_uart_cts_b_uart3_rts_b: IOMUXC_ECSPI1_SS0_UART_CTS_B_UART3_RTS_B { 70 pinmux = <0x30330200 1 0x0 0 0x30330468>; 71 }; 72 /omit-if-no-ref/ iomuxc_ecspi1_ss0_uart_rts_b_uart3_rts_b: IOMUXC_ECSPI1_SS0_UART_RTS_B_UART3_RTS_B { 73 pinmux = <0x30330200 1 0x30330500 1 0x30330468>; 74 }; 75 /omit-if-no-ref/ iomuxc_ecspi2_miso_ecspi_miso_ecspi2_miso: IOMUXC_ECSPI2_MISO_ECSPI_MISO_ECSPI2_MISO { 76 pinmux = <0x3033020c 0 0x0 0 0x30330474>; 77 }; 78 /omit-if-no-ref/ iomuxc_ecspi2_miso_gpio_io_gpio5_io12: IOMUXC_ECSPI2_MISO_GPIO_IO_GPIO5_IO12 { 79 pinmux = <0x3033020c 5 0x0 0 0x30330474>; 80 }; 81 /omit-if-no-ref/ iomuxc_ecspi2_miso_uart_cts_b_uart4_cts_b: IOMUXC_ECSPI2_MISO_UART_CTS_B_UART4_CTS_B { 82 pinmux = <0x3033020c 1 0x0 0 0x30330474>; 83 }; 84 /omit-if-no-ref/ iomuxc_ecspi2_miso_uart_rts_b_uart4_cts_b: IOMUXC_ECSPI2_MISO_UART_RTS_B_UART4_CTS_B { 85 pinmux = <0x3033020c 1 0x30330508 0 0x30330474>; 86 }; 87 /omit-if-no-ref/ iomuxc_ecspi2_mosi_ecspi_mosi_ecspi2_mosi: IOMUXC_ECSPI2_MOSI_ECSPI_MOSI_ECSPI2_MOSI { 88 pinmux = <0x30330208 0 0x0 0 0x30330470>; 89 }; 90 /omit-if-no-ref/ iomuxc_ecspi2_mosi_gpio_io_gpio5_io11: IOMUXC_ECSPI2_MOSI_GPIO_IO_GPIO5_IO11 { 91 pinmux = <0x30330208 5 0x0 0 0x30330470>; 92 }; 93 /omit-if-no-ref/ iomuxc_ecspi2_mosi_uart_rx_uart4_tx: IOMUXC_ECSPI2_MOSI_UART_RX_UART4_TX { 94 pinmux = <0x30330208 1 0x3033050c 1 0x30330470>; 95 }; 96 /omit-if-no-ref/ iomuxc_ecspi2_mosi_uart_tx_uart4_tx: IOMUXC_ECSPI2_MOSI_UART_TX_UART4_TX { 97 pinmux = <0x30330208 1 0x0 0 0x30330470>; 98 }; 99 /omit-if-no-ref/ iomuxc_ecspi2_sclk_ecspi_sclk_ecspi2_sclk: IOMUXC_ECSPI2_SCLK_ECSPI_SCLK_ECSPI2_SCLK { 100 pinmux = <0x30330204 0 0x0 0 0x3033046c>; 101 }; 102 /omit-if-no-ref/ iomuxc_ecspi2_sclk_gpio_io_gpio5_io10: IOMUXC_ECSPI2_SCLK_GPIO_IO_GPIO5_IO10 { 103 pinmux = <0x30330204 5 0x0 0 0x3033046c>; 104 }; 105 /omit-if-no-ref/ iomuxc_ecspi2_sclk_uart_rx_uart4_rx: IOMUXC_ECSPI2_SCLK_UART_RX_UART4_RX { 106 pinmux = <0x30330204 1 0x3033050c 0 0x3033046c>; 107 }; 108 /omit-if-no-ref/ iomuxc_ecspi2_sclk_uart_tx_uart4_rx: IOMUXC_ECSPI2_SCLK_UART_TX_UART4_RX { 109 pinmux = <0x30330204 1 0x0 0 0x3033046c>; 110 }; 111 /omit-if-no-ref/ iomuxc_ecspi2_ss0_ecspi_ss_ecspi2_ss0: IOMUXC_ECSPI2_SS0_ECSPI_SS_ECSPI2_SS0 { 112 pinmux = <0x30330210 0 0x0 0 0x30330478>; 113 }; 114 /omit-if-no-ref/ iomuxc_ecspi2_ss0_gpio_io_gpio5_io13: IOMUXC_ECSPI2_SS0_GPIO_IO_GPIO5_IO13 { 115 pinmux = <0x30330210 5 0x0 0 0x30330478>; 116 }; 117 /omit-if-no-ref/ iomuxc_ecspi2_ss0_uart_cts_b_uart4_rts_b: IOMUXC_ECSPI2_SS0_UART_CTS_B_UART4_RTS_B { 118 pinmux = <0x30330210 1 0x0 0 0x30330478>; 119 }; 120 /omit-if-no-ref/ iomuxc_ecspi2_ss0_uart_rts_b_uart4_rts_b: IOMUXC_ECSPI2_SS0_UART_RTS_B_UART4_RTS_B { 121 pinmux = <0x30330210 1 0x30330508 1 0x30330478>; 122 }; 123 /omit-if-no-ref/ iomuxc_enet_mdc_enet_mdc_enet1_mdc: IOMUXC_ENET_MDC_ENET_MDC_ENET1_MDC { 124 pinmux = <0x30330068 0 0x0 0 0x303302d0>; 125 }; 126 /omit-if-no-ref/ iomuxc_enet_mdc_gpio_io_gpio1_io16: IOMUXC_ENET_MDC_GPIO_IO_GPIO1_IO16 { 127 pinmux = <0x30330068 5 0x0 0 0x303302d0>; 128 }; 129 /omit-if-no-ref/ iomuxc_enet_mdio_enet_mdio_enet1_mdio: IOMUXC_ENET_MDIO_ENET_MDIO_ENET1_MDIO { 130 pinmux = <0x3033006c 0 0x303304c0 1 0x303302d4>; 131 }; 132 /omit-if-no-ref/ iomuxc_enet_mdio_gpio_io_gpio1_io17: IOMUXC_ENET_MDIO_GPIO_IO_GPIO1_IO17 { 133 pinmux = <0x3033006c 5 0x0 0 0x303302d4>; 134 }; 135 /omit-if-no-ref/ iomuxc_enet_rd0_enet_rgmii_rd_enet1_rgmii_rd0: IOMUXC_ENET_RD0_ENET_RGMII_RD_ENET1_RGMII_RD0 { 136 pinmux = <0x30330090 0 0x0 0 0x303302f8>; 137 }; 138 /omit-if-no-ref/ iomuxc_enet_rd0_gpio_io_gpio1_io26: IOMUXC_ENET_RD0_GPIO_IO_GPIO1_IO26 { 139 pinmux = <0x30330090 5 0x0 0 0x303302f8>; 140 }; 141 /omit-if-no-ref/ iomuxc_enet_rd1_enet_rgmii_rd_enet1_rgmii_rd1: IOMUXC_ENET_RD1_ENET_RGMII_RD_ENET1_RGMII_RD1 { 142 pinmux = <0x30330094 0 0x0 0 0x303302fc>; 143 }; 144 /omit-if-no-ref/ iomuxc_enet_rd1_gpio_io_gpio1_io27: IOMUXC_ENET_RD1_GPIO_IO_GPIO1_IO27 { 145 pinmux = <0x30330094 5 0x0 0 0x303302fc>; 146 }; 147 /omit-if-no-ref/ iomuxc_enet_rd2_enet_rgmii_rd_enet1_rgmii_rd2: IOMUXC_ENET_RD2_ENET_RGMII_RD_ENET1_RGMII_RD2 { 148 pinmux = <0x30330098 0 0x0 0 0x30330300>; 149 }; 150 /omit-if-no-ref/ iomuxc_enet_rd2_gpio_io_gpio1_io28: IOMUXC_ENET_RD2_GPIO_IO_GPIO1_IO28 { 151 pinmux = <0x30330098 5 0x0 0 0x30330300>; 152 }; 153 /omit-if-no-ref/ iomuxc_enet_rd3_enet_rgmii_rd_enet1_rgmii_rd3: IOMUXC_ENET_RD3_ENET_RGMII_RD_ENET1_RGMII_RD3 { 154 pinmux = <0x3033009c 0 0x0 0 0x30330304>; 155 }; 156 /omit-if-no-ref/ iomuxc_enet_rd3_gpio_io_gpio1_io29: IOMUXC_ENET_RD3_GPIO_IO_GPIO1_IO29 { 157 pinmux = <0x3033009c 5 0x0 0 0x30330304>; 158 }; 159 /omit-if-no-ref/ iomuxc_enet_rxc_enet_rgmii_rxc_enet1_rgmii_rxc: IOMUXC_ENET_RXC_ENET_RGMII_RXC_ENET1_RGMII_RXC { 160 pinmux = <0x3033008c 0 0x0 0 0x303302f4>; 161 }; 162 /omit-if-no-ref/ iomuxc_enet_rxc_enet_rx_er_enet1_rx_er: IOMUXC_ENET_RXC_ENET_RX_ER_ENET1_RX_ER { 163 pinmux = <0x3033008c 1 0x0 0 0x303302f4>; 164 }; 165 /omit-if-no-ref/ iomuxc_enet_rxc_gpio_io_gpio1_io25: IOMUXC_ENET_RXC_GPIO_IO_GPIO1_IO25 { 166 pinmux = <0x3033008c 5 0x0 0 0x303302f4>; 167 }; 168 /omit-if-no-ref/ iomuxc_enet_rx_ctl_enet_rgmii_rx_ctl_enet1_rgmii_rx_ctl: IOMUXC_ENET_RX_CTL_ENET_RGMII_RX_CTL_ENET1_RGMII_RX_CTL { 169 pinmux = <0x30330088 0 0x0 0 0x303302f0>; 170 }; 171 /omit-if-no-ref/ iomuxc_enet_rx_ctl_gpio_io_gpio1_io24: IOMUXC_ENET_RX_CTL_GPIO_IO_GPIO1_IO24 { 172 pinmux = <0x30330088 5 0x0 0 0x303302f0>; 173 }; 174 /omit-if-no-ref/ iomuxc_enet_td0_enet_rgmii_td_enet1_rgmii_td0: IOMUXC_ENET_TD0_ENET_RGMII_TD_ENET1_RGMII_TD0 { 175 pinmux = <0x3033007c 0 0x0 0 0x303302e4>; 176 }; 177 /omit-if-no-ref/ iomuxc_enet_td0_gpio_io_gpio1_io21: IOMUXC_ENET_TD0_GPIO_IO_GPIO1_IO21 { 178 pinmux = <0x3033007c 5 0x0 0 0x303302e4>; 179 }; 180 /omit-if-no-ref/ iomuxc_enet_td1_enet_rgmii_td_enet1_rgmii_td1: IOMUXC_ENET_TD1_ENET_RGMII_TD_ENET1_RGMII_TD1 { 181 pinmux = <0x30330078 0 0x0 0 0x303302e0>; 182 }; 183 /omit-if-no-ref/ iomuxc_enet_td1_gpio_io_gpio1_io20: IOMUXC_ENET_TD1_GPIO_IO_GPIO1_IO20 { 184 pinmux = <0x30330078 5 0x0 0 0x303302e0>; 185 }; 186 /omit-if-no-ref/ iomuxc_enet_td2_ccm_enet_ref_clk_root_ccm_enet_ref_clk_root: IOMUXC_ENET_TD2_CCM_ENET_REF_CLK_ROOT_CCM_ENET_REF_CLK_ROOT { 187 pinmux = <0x30330074 1 0x0 0 0x303302dc>; 188 }; 189 /omit-if-no-ref/ iomuxc_enet_td2_enet_rgmii_td_enet1_rgmii_td2: IOMUXC_ENET_TD2_ENET_RGMII_TD_ENET1_RGMII_TD2 { 190 pinmux = <0x30330074 0 0x0 0 0x303302dc>; 191 }; 192 /omit-if-no-ref/ iomuxc_enet_td2_enet_tx_clk_enet1_tx_clk: IOMUXC_ENET_TD2_ENET_TX_CLK_ENET1_TX_CLK { 193 pinmux = <0x30330074 1 0x0 0 0x303302dc>; 194 }; 195 /omit-if-no-ref/ iomuxc_enet_td2_gpio_io_gpio1_io19: IOMUXC_ENET_TD2_GPIO_IO_GPIO1_IO19 { 196 pinmux = <0x30330074 5 0x0 0 0x303302dc>; 197 }; 198 /omit-if-no-ref/ iomuxc_enet_td3_enet_rgmii_td_enet1_rgmii_td3: IOMUXC_ENET_TD3_ENET_RGMII_TD_ENET1_RGMII_TD3 { 199 pinmux = <0x30330070 0 0x0 0 0x303302d8>; 200 }; 201 /omit-if-no-ref/ iomuxc_enet_td3_gpio_io_gpio1_io18: IOMUXC_ENET_TD3_GPIO_IO_GPIO1_IO18 { 202 pinmux = <0x30330070 5 0x0 0 0x303302d8>; 203 }; 204 /omit-if-no-ref/ iomuxc_enet_txc_enet_rgmii_txc_enet1_rgmii_txc: IOMUXC_ENET_TXC_ENET_RGMII_TXC_ENET1_RGMII_TXC { 205 pinmux = <0x30330084 0 0x0 0 0x303302ec>; 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224 }; 225 /omit-if-no-ref/ iomuxc_gpio1_io00_gpio_io_gpio1_io00: IOMUXC_GPIO1_IO00_GPIO_IO_GPIO1_IO00 { 226 pinmux = <0x30330028 0 0x0 0 0x30330290>; 227 }; 228 /omit-if-no-ref/ iomuxc_gpio1_io00_xtalosc_ref_clk_32k_xtalosc_ref_clk_32k: IOMUXC_GPIO1_IO00_XTALOSC_REF_CLK_32K_XTALOSC_REF_CLK_32K { 229 pinmux = <0x30330028 5 0x0 0 0x30330290>; 230 }; 231 /omit-if-no-ref/ iomuxc_gpio1_io01_ccm_ext_clk_ccm_ext_clk2: IOMUXC_GPIO1_IO01_CCM_EXT_CLK_CCM_EXT_CLK2 { 232 pinmux = <0x3033002c 6 0x0 0 0x30330294>; 233 }; 234 /omit-if-no-ref/ iomuxc_gpio1_io01_gpio_io_gpio1_io01: IOMUXC_GPIO1_IO01_GPIO_IO_GPIO1_IO01 { 235 pinmux = <0x3033002c 0 0x0 0 0x30330294>; 236 }; 237 /omit-if-no-ref/ iomuxc_gpio1_io01_pwm_out_pwm1_out: IOMUXC_GPIO1_IO01_PWM_OUT_PWM1_OUT { 238 pinmux = <0x3033002c 1 0x0 0 0x30330294>; 239 }; 240 /omit-if-no-ref/ iomuxc_gpio1_io01_xtalosc_ref_clk_24m_xtalosc_ref_clk_24m: IOMUXC_GPIO1_IO01_XTALOSC_REF_CLK_24M_XTALOSC_REF_CLK_24M { 241 pinmux = <0x3033002c 5 0x0 0 0x30330294>; 242 }; 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