1/*
2 * Copyright (c) 2019, Linaro
3 *
4 * SPDX-License-Identifier: Apache-2.0
5 */
6
7#include <nxp/nxp_rt10xx.dtsi>
8
9&flexram {
10	/* FlexRAM OCRAM is at a different address on RT1060 */
11	/delete-node/ ocram@20200000;
12	ocram: ocram@20280000 {
13		compatible = "zephyr,memory-region", "mmio-sram";
14		reg = <0x20280000 DT_SIZE_K(256)>;
15		zephyr,memory-region = "OCRAM";
16	};
17
18	flexram,num-ram-banks = <16>;
19};
20
21&ccm {
22	arm-podf {
23		clock-div = <2>;
24	};
25
26	ipg-podf {
27		clock-div = <4>;
28	};
29};
30
31/ {
32	soc {
33		/* i.MX rt1060 has a second Ethernet controller. */
34		enet2: ethernet@402d4000 {
35			compatible = "nxp,enet";
36			reg = <0x402d4000 0x628>;
37			clocks = <&ccm IMX_CCM_ENET_CLK 0 0>;
38			enet2_mac: ethernet {
39				compatible = "nxp,enet-mac";
40				interrupts = <152 0>;
41				interrupt-names = "COMMON";
42				nxp,mdio = <&enet2_mdio>;
43				nxp,ptp-clock = <&enet2_ptp_clock>;
44				status = "disabled";
45			};
46			enet2_mdio: mdio {
47				compatible = "nxp,enet-mdio";
48				status = "disabled";
49				#address-cells = <1>;
50				#size-cells = <0>;
51			};
52			enet2_ptp_clock: ptp_clock {
53				compatible = "nxp,enet-ptp-clock";
54				status = "disabled";
55				interrupts = <153 0>;
56				interrupt-names = "IEEE1588_TMR";
57				clocks = <&ccm IMX_CCM_ENET_PLL 0 0>;
58			};
59		};
60
61		/* RT1060 has a dedicated OCRAM region */
62		ocram2: ocram@20200000 {
63			compatible = "zephyr,memory-region", "mmio-sram";
64			reg = <0x20200000 DT_SIZE_K(512)>;
65			zephyr,memory-region = "OCRAM2";
66		};
67
68		flexio2: flexio@401b0000 {
69			compatible = "nxp,flexio";
70			reg = <0x401b0000 0x4000>;
71			status = "disabled";
72			interrupts = <91 0>;
73			clocks = <&ccm IMX_CCM_FLEXIO2_3_CLK 0 0>;
74		};
75
76		flexio3: flexio@42020000 {
77			compatible = "nxp,flexio";
78			reg = <0x42020000 0x4000>;
79			status = "disabled";
80			interrupts = <156 0>;
81			clocks = <&ccm IMX_CCM_FLEXIO2_3_CLK 0 0>;
82		};
83	};
84};
85
86/*
87 * GPIO pinmux options. These options define the pinmux settings
88 * for GPIO ports on the package, so that the GPIO driver can
89 * select GPIO mux options during GPIO configuration.
90 */
91
92&gpio1{
93	pinmux = <&iomuxc_gpio_ad_b0_00_gpio1_io00>,
94		<&iomuxc_gpio_ad_b0_01_gpio1_io01>,
95		<&iomuxc_gpio_ad_b0_02_gpio1_io02>,
96		<&iomuxc_gpio_ad_b0_03_gpio1_io03>,
97		<&iomuxc_gpio_ad_b0_04_gpio1_io04>,
98		<&iomuxc_gpio_ad_b0_05_gpio1_io05>,
99		<&iomuxc_gpio_ad_b0_06_gpio1_io06>,
100		<&iomuxc_gpio_ad_b0_07_gpio1_io07>,
101		<&iomuxc_gpio_ad_b0_08_gpio1_io08>,
102		<&iomuxc_gpio_ad_b0_09_gpio1_io09>,
103		<&iomuxc_gpio_ad_b0_10_gpio1_io10>,
104		<&iomuxc_gpio_ad_b0_11_gpio1_io11>,
105		<&iomuxc_gpio_ad_b0_12_gpio1_io12>,
106		<&iomuxc_gpio_ad_b0_13_gpio1_io13>,
107		<&iomuxc_gpio_ad_b0_14_gpio1_io14>,
108		<&iomuxc_gpio_ad_b0_15_gpio1_io15>,
109		<&iomuxc_gpio_ad_b1_00_gpio1_io16>,
110		<&iomuxc_gpio_ad_b1_01_gpio1_io17>,
111		<&iomuxc_gpio_ad_b1_02_gpio1_io18>,
112		<&iomuxc_gpio_ad_b1_03_gpio1_io19>,
113		<&iomuxc_gpio_ad_b1_04_gpio1_io20>,
114		<&iomuxc_gpio_ad_b1_05_gpio1_io21>,
115		<&iomuxc_gpio_ad_b1_06_gpio1_io22>,
116		<&iomuxc_gpio_ad_b1_07_gpio1_io23>,
117		<&iomuxc_gpio_ad_b1_08_gpio1_io24>,
118		<&iomuxc_gpio_ad_b1_09_gpio1_io25>,
119		<&iomuxc_gpio_ad_b1_10_gpio1_io26>,
120		<&iomuxc_gpio_ad_b1_11_gpio1_io27>,
121		<&iomuxc_gpio_ad_b1_12_gpio1_io28>,
122		<&iomuxc_gpio_ad_b1_13_gpio1_io29>,
123		<&iomuxc_gpio_ad_b1_14_gpio1_io30>,
124		<&iomuxc_gpio_ad_b1_15_gpio1_io31>;
125};
126
127&gpio2{
128	pinmux = <&iomuxc_gpio_b0_00_gpio2_io00>,
129		<&iomuxc_gpio_b0_01_gpio2_io01>,
130		<&iomuxc_gpio_b0_02_gpio2_io02>,
131		<&iomuxc_gpio_b0_03_gpio2_io03>,
132		<&iomuxc_gpio_b0_04_gpio2_io04>,
133		<&iomuxc_gpio_b0_05_gpio2_io05>,
134		<&iomuxc_gpio_b0_06_gpio2_io06>,
135		<&iomuxc_gpio_b0_07_gpio2_io07>,
136		<&iomuxc_gpio_b0_08_gpio2_io08>,
137		<&iomuxc_gpio_b0_09_gpio2_io09>,
138		<&iomuxc_gpio_b0_10_gpio2_io10>,
139		<&iomuxc_gpio_b0_11_gpio2_io11>,
140		<&iomuxc_gpio_b0_12_gpio2_io12>,
141		<&iomuxc_gpio_b0_13_gpio2_io13>,
142		<&iomuxc_gpio_b0_14_gpio2_io14>,
143		<&iomuxc_gpio_b0_15_gpio2_io15>,
144		<&iomuxc_gpio_b1_00_gpio2_io16>,
145		<&iomuxc_gpio_b1_01_gpio2_io17>,
146		<&iomuxc_gpio_b1_02_gpio2_io18>,
147		<&iomuxc_gpio_b1_03_gpio2_io19>,
148		<&iomuxc_gpio_b1_04_gpio2_io20>,
149		<&iomuxc_gpio_b1_05_gpio2_io21>,
150		<&iomuxc_gpio_b1_06_gpio2_io22>,
151		<&iomuxc_gpio_b1_07_gpio2_io23>,
152		<&iomuxc_gpio_b1_08_gpio2_io24>,
153		<&iomuxc_gpio_b1_09_gpio2_io25>,
154		<&iomuxc_gpio_b1_10_gpio2_io26>,
155		<&iomuxc_gpio_b1_11_gpio2_io27>,
156		<&iomuxc_gpio_b1_12_gpio2_io28>,
157		<&iomuxc_gpio_b1_13_gpio2_io29>,
158		<&iomuxc_gpio_b1_14_gpio2_io30>,
159		<&iomuxc_gpio_b1_15_gpio2_io31>;
160};
161
162&gpio3{
163	pinmux = <&iomuxc_gpio_sd_b1_00_gpio3_io00>,
164		<&iomuxc_gpio_sd_b1_01_gpio3_io01>,
165		<&iomuxc_gpio_sd_b1_02_gpio3_io02>,
166		<&iomuxc_gpio_sd_b1_03_gpio3_io03>,
167		<&iomuxc_gpio_sd_b1_04_gpio3_io04>,
168		<&iomuxc_gpio_sd_b1_05_gpio3_io05>,
169		<&iomuxc_gpio_sd_b1_06_gpio3_io06>,
170		<&iomuxc_gpio_sd_b1_07_gpio3_io07>,
171		<&iomuxc_gpio_sd_b1_08_gpio3_io08>,
172		<&iomuxc_gpio_sd_b1_09_gpio3_io09>,
173		<&iomuxc_gpio_sd_b1_10_gpio3_io10>,
174		<&iomuxc_gpio_sd_b1_11_gpio3_io11>,
175		<&iomuxc_gpio_sd_b0_00_gpio3_io12>,
176		<&iomuxc_gpio_sd_b0_01_gpio3_io13>,
177		<&iomuxc_gpio_sd_b0_02_gpio3_io14>,
178		<&iomuxc_gpio_sd_b0_03_gpio3_io15>,
179		<&iomuxc_gpio_sd_b0_04_gpio3_io16>,
180		<&iomuxc_gpio_sd_b0_05_gpio3_io17>,
181		<&iomuxc_gpio_emc_32_gpio3_io18>,
182		<&iomuxc_gpio_emc_33_gpio3_io19>,
183		<&iomuxc_gpio_emc_34_gpio3_io20>,
184		<&iomuxc_gpio_emc_35_gpio3_io21>,
185		<&iomuxc_gpio_emc_36_gpio3_io22>,
186		<&iomuxc_gpio_emc_37_gpio3_io23>,
187		<&iomuxc_gpio_emc_38_gpio3_io24>,
188		<&iomuxc_gpio_emc_39_gpio3_io25>,
189		<&iomuxc_gpio_emc_40_gpio3_io26>,
190		<&iomuxc_gpio_emc_41_gpio3_io27>;
191};
192
193&gpio4{
194	pinmux = <&iomuxc_gpio_emc_00_gpio4_io00>,
195		<&iomuxc_gpio_emc_01_gpio4_io01>,
196		<&iomuxc_gpio_emc_02_gpio4_io02>,
197		<&iomuxc_gpio_emc_03_gpio4_io03>,
198		<&iomuxc_gpio_emc_04_gpio4_io04>,
199		<&iomuxc_gpio_emc_05_gpio4_io05>,
200		<&iomuxc_gpio_emc_06_gpio4_io06>,
201		<&iomuxc_gpio_emc_07_gpio4_io07>,
202		<&iomuxc_gpio_emc_08_gpio4_io08>,
203		<&iomuxc_gpio_emc_09_gpio4_io09>,
204		<&iomuxc_gpio_emc_10_gpio4_io10>,
205		<&iomuxc_gpio_emc_11_gpio4_io11>,
206		<&iomuxc_gpio_emc_12_gpio4_io12>,
207		<&iomuxc_gpio_emc_13_gpio4_io13>,
208		<&iomuxc_gpio_emc_14_gpio4_io14>,
209		<&iomuxc_gpio_emc_15_gpio4_io15>,
210		<&iomuxc_gpio_emc_16_gpio4_io16>,
211		<&iomuxc_gpio_emc_17_gpio4_io17>,
212		<&iomuxc_gpio_emc_18_gpio4_io18>,
213		<&iomuxc_gpio_emc_19_gpio4_io19>,
214		<&iomuxc_gpio_emc_20_gpio4_io20>,
215		<&iomuxc_gpio_emc_21_gpio4_io21>,
216		<&iomuxc_gpio_emc_22_gpio4_io22>,
217		<&iomuxc_gpio_emc_23_gpio4_io23>,
218		<&iomuxc_gpio_emc_24_gpio4_io24>,
219		<&iomuxc_gpio_emc_25_gpio4_io25>,
220		<&iomuxc_gpio_emc_26_gpio4_io26>,
221		<&iomuxc_gpio_emc_27_gpio4_io27>,
222		<&iomuxc_gpio_emc_28_gpio4_io28>,
223		<&iomuxc_gpio_emc_29_gpio4_io29>,
224		<&iomuxc_gpio_emc_30_gpio4_io30>,
225		<&iomuxc_gpio_emc_31_gpio4_io31>;
226};
227
228&gpio5{
229	pinmux = <&iomuxc_snvs_wakeup_gpio5_io00>,
230		<&iomuxc_snvs_pmic_on_req_gpio5_io01>,
231		<&iomuxc_snvs_pmic_stby_req_gpio5_io02>;
232};
233
234&gpio6{
235	pinmux = <&iomuxc_gpio_ad_b0_00_gpio6_io00>,
236		<&iomuxc_gpio_ad_b0_01_gpio6_io01>,
237		<&iomuxc_gpio_ad_b0_02_gpio6_io02>,
238		<&iomuxc_gpio_ad_b0_03_gpio6_io03>,
239		<&iomuxc_gpio_ad_b0_04_gpio6_io04>,
240		<&iomuxc_gpio_ad_b0_05_gpio6_io05>,
241		<&iomuxc_gpio_ad_b0_06_gpio6_io06>,
242		<&iomuxc_gpio_ad_b0_07_gpio6_io07>,
243		<&iomuxc_gpio_ad_b0_08_gpio6_io08>,
244		<&iomuxc_gpio_ad_b0_09_gpio6_io09>,
245		<&iomuxc_gpio_ad_b0_10_gpio6_io10>,
246		<&iomuxc_gpio_ad_b0_11_gpio6_io11>,
247		<&iomuxc_gpio_ad_b0_12_gpio6_io12>,
248		<&iomuxc_gpio_ad_b0_13_gpio6_io13>,
249		<&iomuxc_gpio_ad_b0_14_gpio6_io14>,
250		<&iomuxc_gpio_ad_b0_15_gpio6_io15>,
251		<&iomuxc_gpio_ad_b1_00_gpio6_io16>,
252		<&iomuxc_gpio_ad_b1_01_gpio6_io17>,
253		<&iomuxc_gpio_ad_b1_02_gpio6_io18>,
254		<&iomuxc_gpio_ad_b1_03_gpio6_io19>,
255		<&iomuxc_gpio_ad_b1_04_gpio6_io20>,
256		<&iomuxc_gpio_ad_b1_05_gpio6_io21>,
257		<&iomuxc_gpio_ad_b1_06_gpio6_io22>,
258		<&iomuxc_gpio_ad_b1_07_gpio6_io23>,
259		<&iomuxc_gpio_ad_b1_08_gpio6_io24>,
260		<&iomuxc_gpio_ad_b1_09_gpio6_io25>,
261		<&iomuxc_gpio_ad_b1_10_gpio6_io26>,
262		<&iomuxc_gpio_ad_b1_11_gpio6_io27>,
263		<&iomuxc_gpio_ad_b1_12_gpio6_io28>,
264		<&iomuxc_gpio_ad_b1_13_gpio6_io29>,
265		<&iomuxc_gpio_ad_b1_14_gpio6_io30>,
266		<&iomuxc_gpio_ad_b1_15_gpio6_io31>;
267};
268
269&gpio7{
270	pinmux = <&iomuxc_gpio_b0_00_gpio7_io00>,
271		<&iomuxc_gpio_b0_01_gpio7_io01>,
272		<&iomuxc_gpio_b0_02_gpio7_io02>,
273		<&iomuxc_gpio_b0_03_gpio7_io03>,
274		<&iomuxc_gpio_b0_04_gpio7_io04>,
275		<&iomuxc_gpio_b0_05_gpio7_io05>,
276		<&iomuxc_gpio_b0_06_gpio7_io06>,
277		<&iomuxc_gpio_b0_07_gpio7_io07>,
278		<&iomuxc_gpio_b0_08_gpio7_io08>,
279		<&iomuxc_gpio_b0_09_gpio7_io09>,
280		<&iomuxc_gpio_b0_10_gpio7_io10>,
281		<&iomuxc_gpio_b0_11_gpio7_io11>,
282		<&iomuxc_gpio_b0_12_gpio7_io12>,
283		<&iomuxc_gpio_b0_13_gpio7_io13>,
284		<&iomuxc_gpio_b0_14_gpio7_io14>,
285		<&iomuxc_gpio_b0_15_gpio7_io15>,
286		<&iomuxc_gpio_b1_00_gpio7_io16>,
287		<&iomuxc_gpio_b1_01_gpio7_io17>,
288		<&iomuxc_gpio_b1_02_gpio7_io18>,
289		<&iomuxc_gpio_b1_03_gpio7_io19>,
290		<&iomuxc_gpio_b1_04_gpio7_io20>,
291		<&iomuxc_gpio_b1_05_gpio7_io21>,
292		<&iomuxc_gpio_b1_06_gpio7_io22>,
293		<&iomuxc_gpio_b1_07_gpio7_io23>,
294		<&iomuxc_gpio_b1_08_gpio7_io24>,
295		<&iomuxc_gpio_b1_09_gpio7_io25>,
296		<&iomuxc_gpio_b1_10_gpio7_io26>,
297		<&iomuxc_gpio_b1_11_gpio7_io27>,
298		<&iomuxc_gpio_b1_12_gpio7_io28>,
299		<&iomuxc_gpio_b1_13_gpio7_io29>,
300		<&iomuxc_gpio_b1_14_gpio7_io30>,
301		<&iomuxc_gpio_b1_15_gpio7_io31>;
302};
303
304&gpio8{
305	pinmux = <&iomuxc_gpio_sd_b1_00_gpio8_io00>,
306		<&iomuxc_gpio_sd_b1_01_gpio8_io01>,
307		<&iomuxc_gpio_sd_b1_02_gpio8_io02>,
308		<&iomuxc_gpio_sd_b1_03_gpio8_io03>,
309		<&iomuxc_gpio_sd_b1_04_gpio8_io04>,
310		<&iomuxc_gpio_sd_b1_05_gpio8_io05>,
311		<&iomuxc_gpio_sd_b1_06_gpio8_io06>,
312		<&iomuxc_gpio_sd_b1_07_gpio8_io07>,
313		<&iomuxc_gpio_sd_b1_08_gpio8_io08>,
314		<&iomuxc_gpio_sd_b1_09_gpio8_io09>,
315		<&iomuxc_gpio_sd_b1_10_gpio8_io10>,
316		<&iomuxc_gpio_sd_b1_11_gpio8_io11>,
317		<&iomuxc_gpio_sd_b0_00_gpio8_io12>,
318		<&iomuxc_gpio_sd_b0_01_gpio8_io13>,
319		<&iomuxc_gpio_sd_b0_02_gpio8_io14>,
320		<&iomuxc_gpio_sd_b0_03_gpio8_io15>,
321		<&iomuxc_gpio_sd_b0_04_gpio8_io16>,
322		<&iomuxc_gpio_sd_b0_05_gpio8_io17>,
323		<&iomuxc_gpio_emc_32_gpio8_io18>,
324		<&iomuxc_gpio_emc_33_gpio8_io19>,
325		<&iomuxc_gpio_emc_34_gpio8_io20>,
326		<&iomuxc_gpio_emc_35_gpio8_io21>,
327		<&iomuxc_gpio_emc_36_gpio8_io22>,
328		<&iomuxc_gpio_emc_37_gpio8_io23>,
329		<&iomuxc_gpio_emc_38_gpio8_io24>,
330		<&iomuxc_gpio_emc_39_gpio8_io25>,
331		<&iomuxc_gpio_emc_40_gpio8_io26>,
332		<&iomuxc_gpio_emc_41_gpio8_io27>;
333};
334
335&gpio9{
336	pinmux = <&iomuxc_gpio_emc_00_gpio9_io00>,
337		<&iomuxc_gpio_emc_01_gpio9_io01>,
338		<&iomuxc_gpio_emc_02_gpio9_io02>,
339		<&iomuxc_gpio_emc_03_gpio9_io03>,
340		<&iomuxc_gpio_emc_04_gpio9_io04>,
341		<&iomuxc_gpio_emc_05_gpio9_io05>,
342		<&iomuxc_gpio_emc_06_gpio9_io06>,
343		<&iomuxc_gpio_emc_07_gpio9_io07>,
344		<&iomuxc_gpio_emc_08_gpio9_io08>,
345		<&iomuxc_gpio_emc_09_gpio9_io09>,
346		<&iomuxc_gpio_emc_10_gpio9_io10>,
347		<&iomuxc_gpio_emc_11_gpio9_io11>,
348		<&iomuxc_gpio_emc_12_gpio9_io12>,
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369