Home
last modified time | relevance | path

Searched refs:DIGTMP_PDR_TPD5_MASK (Results 1 – 10 of 10) sorted by relevance

/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN236/
DMCXN236.h11785 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
11791 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN235/
DMCXN235.h11755 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
11761 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN546/
DMCXN546_cm33_core0.h14069 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14075 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
DMCXN546_cm33_core1.h14069 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14075 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN547/
DMCXN547_cm33_core0.h14069 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14075 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
DMCXN547_cm33_core1.h14069 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14075 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN947/
DMCXN947_cm33_core1.h14115 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14121 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
DMCXN947_cm33_core0.h14115 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14121 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MCXN946/
DMCXN946_cm33_core0.h14115 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14121 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)
DMCXN946_cm33_core1.h14115 #define DIGTMP_PDR_TPD5_MASK (0x20U) macro
14121 … (((uint32_t)(((uint32_t)(x)) << DIGTMP_PDR_TPD5_SHIFT)) & DIGTMP_PDR_TPD5_MASK)