Home
last modified time | relevance | path

Searched refs:CLK_GATE_REG_OFFSET_MASK (Results 1 – 25 of 93) sorted by relevance

1234

/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKE02Z4/drivers/
Dfsl_clock.h203 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
208 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
211 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKE04Z4/drivers/
Dfsl_clock.h212 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
217 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
220 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKE06Z4/drivers/
Dfsl_clock.h218 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
223 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
226 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKE04Z1284/drivers/
Dfsl_clock.h218 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
223 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
226 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKL17Z644/drivers/
Dfsl_clock.h246 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
251 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
254 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/K32L2B31A/drivers/
Dfsl_clock.h264 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
269 ((((uint32_t)(reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
272 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/K32L2B21A/drivers/
Dfsl_clock.h264 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
269 ((((uint32_t)(reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
272 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/K32L2B11A/drivers/
Dfsl_clock.h264 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
269 ((((uint32_t)(reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
272 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKL27Z644/drivers/
Dfsl_clock.h252 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
257 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
260 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKW41Z4/drivers/
Dfsl_clock.h318 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
323 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
326 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV10Z1287/drivers/
Dfsl_clock.h246 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
251 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
254 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV30F12810/drivers/
Dfsl_clock.h276 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
281 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
284 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MK02F12810/drivers/
Dfsl_clock.h277 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
282 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
285 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV11Z7/drivers/
Dfsl_clock.h246 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
251 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
254 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV10Z7/drivers/
Dfsl_clock.h249 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
254 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
257 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV31F12810/drivers/
Dfsl_clock.h280 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
285 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
288 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MK22F12810/drivers/
Dfsl_clock.h302 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
307 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
310 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKL25Z4/drivers/
Dfsl_clock.h283 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
288 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
291 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKW22D5/drivers/
Dfsl_clock.h303 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
308 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
311 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKW24D5/drivers/
Dfsl_clock.h303 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
308 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
311 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MK22F25612/drivers/
Dfsl_clock.h308 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
313 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
316 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV31F51212/drivers/
Dfsl_clock.h293 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
298 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
301 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV31F25612/drivers/
Dfsl_clock.h286 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
291 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
294 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKM34ZA5/drivers/
Dfsl_clock.h298 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
303 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
306 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…
/hal_nxp-3.7.0/mcux/mcux-sdk/devices/MKV58F24/drivers/
Dfsl_clock.h341 #define CLK_GATE_REG_OFFSET_MASK 0xFFFF0000U macro
346 ((((reg_offset) << CLK_GATE_REG_OFFSET_SHIFT) & CLK_GATE_REG_OFFSET_MASK) | \
349 #define CLK_GATE_ABSTRACT_REG_OFFSET(x) (((x)&CLK_GATE_REG_OFFSET_MASK) >> CLK_GATE_REG_OFFSET_SHIF…

1234