1/* 2 * Copyright (c) 2022, NXP 3 * SPDX-License-Identifier: Apache-2.0 4 * 5 * Note: File generated by rt_cfg_utils.py 6 * from configuration data for MIMXRT1064CVJ5A 7 */ 8 9/* 10 * SOC level pinctrl defintions 11 * These definitions define SOC level defaults for each pin, 12 * and select the pinmux for the pin. Pinmux entries are a tuple of: 13 * <mux_register mux_mode input_register input_daisy config_register> 14 * the mux_register and input_daisy reside in the IOMUXC peripheral, and 15 * the pinctrl driver will write the mux_mode and input_daisy values into 16 * each register, respectively. The config_register is used to configure 17 * the pin based on the devicetree properties set 18 */ 19 20/* 21 * NOTE: file fixup performed by rt_fixup_pinmux.py 22 * to correct missing daisy register values 23 */ 24 25&iomuxc { 26 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_acmp1_in4: IOMUXC_GPIO_AD_B0_00_ACMP1_IN4 { 27 pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; 28 }; 29 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_flexpwm2_pwma3: IOMUXC_GPIO_AD_B0_00_FLEXPWM2_PWMA3 { 30 pinmux = <0x401f80bc 0 0x401f8474 2 0x401f82ac>; 31 }; 32 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpio1_io00: IOMUXC_GPIO_AD_B0_00_GPIO1_IO00 { 33 pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; 34 gpr = <0x400ac068 0x0 0x0>; 35 }; 36 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpio6_io00: IOMUXC_GPIO_AD_B0_00_GPIO6_IO00 { 37 pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; 38 gpr = <0x400ac068 0x0 0x1>; 39 }; 40 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_lpi2c1_scls: IOMUXC_GPIO_AD_B0_00_LPI2C1_SCLS { 41 pinmux = <0x401f80bc 4 0x0 0 0x401f82ac>; 42 }; 43 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_lpspi3_sck: IOMUXC_GPIO_AD_B0_00_LPSPI3_SCK { 44 pinmux = <0x401f80bc 7 0x401f8510 0 0x401f82ac>; 45 }; 46 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_ref_32k_out: IOMUXC_GPIO_AD_B0_00_REF_32K_OUT { 47 pinmux = <0x401f80bc 2 0x0 0 0x401f82ac>; 48 }; 49 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_usb_otg2_id: IOMUXC_GPIO_AD_B0_00_USB_OTG2_ID { 50 pinmux = <0x401f80bc 3 0x401f83f8 0 0x401f82ac>; 51 }; 52 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_usdhc1_reset_b: IOMUXC_GPIO_AD_B0_00_USDHC1_RESET_B { 53 pinmux = <0x401f80bc 6 0x0 0 0x401f82ac>; 54 }; 55 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_xbar1_xbar_in14: IOMUXC_GPIO_AD_B0_00_XBAR1_XBAR_IN14 { 56 pinmux = <0x401f80bc 1 0x401f8644 0 0x401f82ac>; 57 gpr = <0x400ac018 0x1a 0x0>; 58 }; 59 /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_xbar1_xbar_inout14: IOMUXC_GPIO_AD_B0_00_XBAR1_XBAR_INOUT14 { 60 pinmux = <0x401f80bc 1 0x401f8644 0 0x401f82ac>; 61 gpr = <0x400ac018 0x1a 0x0>; 62 }; 63 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_acmp2_in4: IOMUXC_GPIO_AD_B0_01_ACMP2_IN4 { 64 pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; 65 }; 66 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_ewm_out_b: IOMUXC_GPIO_AD_B0_01_EWM_OUT_B { 67 pinmux = <0x401f80c0 6 0x0 0 0x401f82b0>; 68 }; 69 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_flexpwm2_pwmb3: IOMUXC_GPIO_AD_B0_01_FLEXPWM2_PWMB3 { 70 pinmux = <0x401f80c0 0 0x401f8484 2 0x401f82b0>; 71 }; 72 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpio1_io01: IOMUXC_GPIO_AD_B0_01_GPIO1_IO01 { 73 pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; 74 gpr = <0x400ac068 0x1 0x0>; 75 }; 76 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpio6_io01: IOMUXC_GPIO_AD_B0_01_GPIO6_IO01 { 77 pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; 78 gpr = <0x400ac068 0x1 0x1>; 79 }; 80 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_lpi2c1_sdas: IOMUXC_GPIO_AD_B0_01_LPI2C1_SDAS { 81 pinmux = <0x401f80c0 4 0x0 0 0x401f82b0>; 82 }; 83 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_lpspi3_sdo: IOMUXC_GPIO_AD_B0_01_LPSPI3_SDO { 84 pinmux = <0x401f80c0 7 0x401f8518 0 0x401f82b0>; 85 }; 86 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_ref_24m_out: IOMUXC_GPIO_AD_B0_01_REF_24M_OUT { 87 pinmux = <0x401f80c0 2 0x0 0 0x401f82b0>; 88 }; 89 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_usb_otg1_id: IOMUXC_GPIO_AD_B0_01_USB_OTG1_ID { 90 pinmux = <0x401f80c0 3 0x401f83f4 0 0x401f82b0>; 91 }; 92 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_xbar1_xbar_in15: IOMUXC_GPIO_AD_B0_01_XBAR1_XBAR_IN15 { 93 pinmux = <0x401f80c0 1 0x401f8648 0 0x401f82b0>; 94 gpr = <0x400ac018 0x1b 0x0>; 95 }; 96 /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_xbar1_xbar_inout15: IOMUXC_GPIO_AD_B0_01_XBAR1_XBAR_INOUT15 { 97 pinmux = <0x401f80c0 1 0x401f8648 0 0x401f82b0>; 98 gpr = <0x400ac018 0x1b 0x0>; 99 }; 100 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_acmp3_in4: IOMUXC_GPIO_AD_B0_02_ACMP3_IN4 { 101 pinmux = <0x401f80c4 5 0x0 0 0x401f82b4>; 102 }; 103 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_flexcan2_tx: IOMUXC_GPIO_AD_B0_02_FLEXCAN2_TX { 104 pinmux = <0x401f80c4 0 0x0 0 0x401f82b4>; 105 }; 106 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_flexpwm1_pwmx0: IOMUXC_GPIO_AD_B0_02_FLEXPWM1_PWMX0 { 107 pinmux = <0x401f80c4 4 0x0 0 0x401f82b4>; 108 }; 109 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_gpio1_io02: IOMUXC_GPIO_AD_B0_02_GPIO1_IO02 { 110 pinmux = <0x401f80c4 5 0x0 0 0x401f82b4>; 111 gpr = <0x400ac068 0x2 0x0>; 112 }; 113 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_gpio6_io02: IOMUXC_GPIO_AD_B0_02_GPIO6_IO02 { 114 pinmux = <0x401f80c4 5 0x0 0 0x401f82b4>; 115 gpr = <0x400ac068 0x2 0x1>; 116 }; 117 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_lpi2c1_hreq: IOMUXC_GPIO_AD_B0_02_LPI2C1_HREQ { 118 pinmux = <0x401f80c4 6 0x0 0 0x401f82b4>; 119 }; 120 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_lpspi3_sdi: IOMUXC_GPIO_AD_B0_02_LPSPI3_SDI { 121 pinmux = <0x401f80c4 7 0x401f8514 0 0x401f82b4>; 122 }; 123 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_lpuart6_tx: IOMUXC_GPIO_AD_B0_02_LPUART6_TX { 124 pinmux = <0x401f80c4 2 0x401f8554 1 0x401f82b4>; 125 }; 126 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_usb_otg1_pwr: IOMUXC_GPIO_AD_B0_02_USB_OTG1_PWR { 127 pinmux = <0x401f80c4 3 0x0 0 0x401f82b4>; 128 }; 129 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_xbar1_xbar_in16: IOMUXC_GPIO_AD_B0_02_XBAR1_XBAR_IN16 { 130 pinmux = <0x401f80c4 1 0x401f864c 0 0x401f82b4>; 131 gpr = <0x400ac018 0x1c 0x0>; 132 }; 133 /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_xbar1_xbar_inout16: IOMUXC_GPIO_AD_B0_02_XBAR1_XBAR_INOUT16 { 134 pinmux = <0x401f80c4 1 0x401f864c 0 0x401f82b4>; 135 gpr = <0x400ac018 0x1c 0x0>; 136 }; 137 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_acmp4_in4: IOMUXC_GPIO_AD_B0_03_ACMP4_IN4 { 138 pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; 139 }; 140 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_flexcan2_rx: IOMUXC_GPIO_AD_B0_03_FLEXCAN2_RX { 141 pinmux = <0x401f80c8 0 0x401f8450 1 0x401f82b8>; 142 }; 143 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_flexpwm1_pwmx1: IOMUXC_GPIO_AD_B0_03_FLEXPWM1_PWMX1 { 144 pinmux = <0x401f80c8 4 0x0 0 0x401f82b8>; 145 }; 146 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_gpio1_io03: IOMUXC_GPIO_AD_B0_03_GPIO1_IO03 { 147 pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; 148 gpr = <0x400ac068 0x3 0x0>; 149 }; 150 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_gpio6_io03: IOMUXC_GPIO_AD_B0_03_GPIO6_IO03 { 151 pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; 152 gpr = <0x400ac068 0x3 0x1>; 153 }; 154 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_lpspi3_pcs0: IOMUXC_GPIO_AD_B0_03_LPSPI3_PCS0 { 155 pinmux = <0x401f80c8 7 0x401f850c 0 0x401f82b8>; 156 }; 157 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_lpuart6_rx: IOMUXC_GPIO_AD_B0_03_LPUART6_RX { 158 pinmux = <0x401f80c8 2 0x401f8550 1 0x401f82b8>; 159 }; 160 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_ref_24m_out: IOMUXC_GPIO_AD_B0_03_REF_24M_OUT { 161 pinmux = <0x401f80c8 6 0x0 0 0x401f82b8>; 162 }; 163 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_usb_otg1_oc: IOMUXC_GPIO_AD_B0_03_USB_OTG1_OC { 164 pinmux = <0x401f80c8 3 0x401f85d0 0 0x401f82b8>; 165 }; 166 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_xbar1_xbar_in17: IOMUXC_GPIO_AD_B0_03_XBAR1_XBAR_IN17 { 167 pinmux = <0x401f80c8 1 0x401f862c 1 0x401f82b8>; 168 gpr = <0x400ac018 0x1d 0x0>; 169 }; 170 /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_xbar1_xbar_inout17: IOMUXC_GPIO_AD_B0_03_XBAR1_XBAR_INOUT17 { 171 pinmux = <0x401f80c8 1 0x401f862c 1 0x401f82b8>; 172 gpr = <0x400ac018 0x1d 0x0>; 173 }; 174 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_csi_data09: IOMUXC_GPIO_AD_B0_04_CSI_DATA09 { 175 pinmux = <0x401f80cc 4 0x401f841c 1 0x401f82bc>; 176 }; 177 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_enet_tx_data3: IOMUXC_GPIO_AD_B0_04_ENET_TX_DATA3 { 178 pinmux = <0x401f80cc 2 0x0 0 0x401f82bc>; 179 }; 180 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_gpio1_io04: IOMUXC_GPIO_AD_B0_04_GPIO1_IO04 { 181 pinmux = <0x401f80cc 5 0x0 0 0x401f82bc>; 182 gpr = <0x400ac068 0x4 0x0>; 183 }; 184 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_gpio6_io04: IOMUXC_GPIO_AD_B0_04_GPIO6_IO04 { 185 pinmux = <0x401f80cc 5 0x0 0 0x401f82bc>; 186 gpr = <0x400ac068 0x4 0x1>; 187 }; 188 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_lpspi3_pcs1: IOMUXC_GPIO_AD_B0_04_LPSPI3_PCS1 { 189 pinmux = <0x401f80cc 7 0x0 0 0x401f82bc>; 190 }; 191 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_mqs_right: IOMUXC_GPIO_AD_B0_04_MQS_RIGHT { 192 pinmux = <0x401f80cc 1 0x0 0 0x401f82bc>; 193 }; 194 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_pit_trigger0: IOMUXC_GPIO_AD_B0_04_PIT_TRIGGER0 { 195 pinmux = <0x401f80cc 6 0x0 0 0x401f82bc>; 196 }; 197 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_sai2_tx_sync: IOMUXC_GPIO_AD_B0_04_SAI2_TX_SYNC { 198 pinmux = <0x401f80cc 3 0x401f85c4 1 0x401f82bc>; 199 }; 200 /omit-if-no-ref/ iomuxc_gpio_ad_b0_04_src_boot_mode0: IOMUXC_GPIO_AD_B0_04_SRC_BOOT_MODE0 { 201 pinmux = <0x401f80cc 0 0x0 0 0x401f82bc>; 202 }; 203 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_csi_data08: IOMUXC_GPIO_AD_B0_05_CSI_DATA08 { 204 pinmux = <0x401f80d0 4 0x401f8418 1 0x401f82c0>; 205 }; 206 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_enet_tx_data2: IOMUXC_GPIO_AD_B0_05_ENET_TX_DATA2 { 207 pinmux = <0x401f80d0 2 0x0 0 0x401f82c0>; 208 }; 209 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_gpio1_io05: IOMUXC_GPIO_AD_B0_05_GPIO1_IO05 { 210 pinmux = <0x401f80d0 5 0x0 0 0x401f82c0>; 211 gpr = <0x400ac068 0x5 0x0>; 212 }; 213 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_gpio6_io05: IOMUXC_GPIO_AD_B0_05_GPIO6_IO05 { 214 pinmux = <0x401f80d0 5 0x0 0 0x401f82c0>; 215 gpr = <0x400ac068 0x5 0x1>; 216 }; 217 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_lpspi3_pcs2: IOMUXC_GPIO_AD_B0_05_LPSPI3_PCS2 { 218 pinmux = <0x401f80d0 7 0x0 0 0x401f82c0>; 219 }; 220 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_mqs_left: IOMUXC_GPIO_AD_B0_05_MQS_LEFT { 221 pinmux = <0x401f80d0 1 0x0 0 0x401f82c0>; 222 }; 223 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_sai2_tx_bclk: IOMUXC_GPIO_AD_B0_05_SAI2_TX_BCLK { 224 pinmux = <0x401f80d0 3 0x401f85c0 1 0x401f82c0>; 225 }; 226 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_src_boot_mode1: IOMUXC_GPIO_AD_B0_05_SRC_BOOT_MODE1 { 227 pinmux = <0x401f80d0 0 0x0 0 0x401f82c0>; 228 }; 229 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_xbar1_xbar_in17: IOMUXC_GPIO_AD_B0_05_XBAR1_XBAR_IN17 { 230 pinmux = <0x401f80d0 6 0x401f862c 2 0x401f82c0>; 231 gpr = <0x400ac018 0x1d 0x0>; 232 }; 233 /omit-if-no-ref/ iomuxc_gpio_ad_b0_05_xbar1_xbar_inout17: IOMUXC_GPIO_AD_B0_05_XBAR1_XBAR_INOUT17 { 234 pinmux = <0x401f80d0 6 0x401f862c 2 0x401f82c0>; 235 gpr = <0x400ac018 0x1d 0x0>; 236 }; 237 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_csi_data07: IOMUXC_GPIO_AD_B0_06_CSI_DATA07 { 238 pinmux = <0x401f80d4 4 0x401f8414 1 0x401f82c4>; 239 }; 240 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_enet_rx_clk: IOMUXC_GPIO_AD_B0_06_ENET_RX_CLK { 241 pinmux = <0x401f80d4 2 0x0 0 0x401f82c4>; 242 }; 243 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_gpio1_io06: IOMUXC_GPIO_AD_B0_06_GPIO1_IO06 { 244 pinmux = <0x401f80d4 5 0x0 0 0x401f82c4>; 245 gpr = <0x400ac068 0x6 0x0>; 246 }; 247 /omit-if-no-ref/ iomuxc_gpio_ad_b0_06_gpio6_io06: IOMUXC_GPIO_AD_B0_06_GPIO6_IO06 { 248 pinmux = <0x401f80d4 5 0x0 0 0x401f82c4>; 249 gpr = <0x400ac068 0x6 0x1>; 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