1/* 2 * Copyright (c) 2019, Linaro 3 * Copyright (c) 2022, NXP 4 * 5 * SPDX-License-Identifier: Apache-2.0 6 */ 7 8#include <nxp/nxp_rt1060.dtsi> 9 10&flexspi2 { 11 status = "okay"; 12 reg = <0x402a4000 0x4000>, <0x70000000 DT_SIZE_M(4)>; 13 /* WINBOND */ 14 w25q32jvwj0: w25q32jvwj@0 { 15 compatible = "nxp,imx-flexspi-nor"; 16 size = <33554432>; 17 reg = <0>; 18 spi-max-frequency = <133000000>; 19 status = "okay"; 20 jedec-id = [ef 40 16]; 21 erase-block-size = <4096>; 22 write-block-size = <1>; 23 }; 24}; 25 26/* 27 * GPIO pinmux options. These options define the pinmux settings 28 * for GPIO ports on the package, so that the GPIO driver can 29 * select GPIO mux options during GPIO configuration. 30 */ 31 32&gpio1{ 33 pinmux = <&iomuxc_gpio_ad_b0_00_gpio1_io00>, 34 <&iomuxc_gpio_ad_b0_01_gpio1_io01>, 35 <&iomuxc_gpio_ad_b0_02_gpio1_io02>, 36 <&iomuxc_gpio_ad_b0_03_gpio1_io03>, 37 <&iomuxc_gpio_ad_b0_04_gpio1_io04>, 38 <&iomuxc_gpio_ad_b0_05_gpio1_io05>, 39 <&iomuxc_gpio_ad_b0_06_gpio1_io06>, 40 <&iomuxc_gpio_ad_b0_07_gpio1_io07>, 41 <&iomuxc_gpio_ad_b0_08_gpio1_io08>, 42 <&iomuxc_gpio_ad_b0_09_gpio1_io09>, 43 <&iomuxc_gpio_ad_b0_10_gpio1_io10>, 44 <&iomuxc_gpio_ad_b0_11_gpio1_io11>, 45 <&iomuxc_gpio_ad_b0_12_gpio1_io12>, 46 <&iomuxc_gpio_ad_b0_13_gpio1_io13>, 47 <&iomuxc_gpio_ad_b0_14_gpio1_io14>, 48 <&iomuxc_gpio_ad_b0_15_gpio1_io15>, 49 <&iomuxc_gpio_ad_b1_00_gpio1_io16>, 50 <&iomuxc_gpio_ad_b1_01_gpio1_io17>, 51 <&iomuxc_gpio_ad_b1_02_gpio1_io18>, 52 <&iomuxc_gpio_ad_b1_03_gpio1_io19>, 53 <&iomuxc_gpio_ad_b1_04_gpio1_io20>, 54 <&iomuxc_gpio_ad_b1_05_gpio1_io21>, 55 <&iomuxc_gpio_ad_b1_06_gpio1_io22>, 56 <&iomuxc_gpio_ad_b1_07_gpio1_io23>, 57 <&iomuxc_gpio_ad_b1_08_gpio1_io24>, 58 <&iomuxc_gpio_ad_b1_09_gpio1_io25>, 59 <&iomuxc_gpio_ad_b1_10_gpio1_io26>, 60 <&iomuxc_gpio_ad_b1_11_gpio1_io27>, 61 <&iomuxc_gpio_ad_b1_12_gpio1_io28>, 62 <&iomuxc_gpio_ad_b1_13_gpio1_io29>, 63 <&iomuxc_gpio_ad_b1_14_gpio1_io30>, 64 <&iomuxc_gpio_ad_b1_15_gpio1_io31>; 65}; 66 67&gpio2{ 68 pinmux = <&iomuxc_gpio_b0_00_gpio2_io00>, 69 <&iomuxc_gpio_b0_01_gpio2_io01>, 70 <&iomuxc_gpio_b0_02_gpio2_io02>, 71 <&iomuxc_gpio_b0_03_gpio2_io03>, 72 <&iomuxc_gpio_b0_04_gpio2_io04>, 73 <&iomuxc_gpio_b0_05_gpio2_io05>, 74 <&iomuxc_gpio_b0_06_gpio2_io06>, 75 <&iomuxc_gpio_b0_07_gpio2_io07>, 76 <&iomuxc_gpio_b0_08_gpio2_io08>, 77 <&iomuxc_gpio_b0_09_gpio2_io09>, 78 <&iomuxc_gpio_b0_10_gpio2_io10>, 79 <&iomuxc_gpio_b0_11_gpio2_io11>, 80 <&iomuxc_gpio_b0_12_gpio2_io12>, 81 <&iomuxc_gpio_b0_13_gpio2_io13>, 82 <&iomuxc_gpio_b0_14_gpio2_io14>, 83 <&iomuxc_gpio_b0_15_gpio2_io15>, 84 <&iomuxc_gpio_b1_00_gpio2_io16>, 85 <&iomuxc_gpio_b1_01_gpio2_io17>, 86 <&iomuxc_gpio_b1_02_gpio2_io18>, 87 <&iomuxc_gpio_b1_03_gpio2_io19>, 88 <&iomuxc_gpio_b1_04_gpio2_io20>, 89 <&iomuxc_gpio_b1_05_gpio2_io21>, 90 <&iomuxc_gpio_b1_06_gpio2_io22>, 91 <&iomuxc_gpio_b1_07_gpio2_io23>, 92 <&iomuxc_gpio_b1_08_gpio2_io24>, 93 <&iomuxc_gpio_b1_09_gpio2_io25>, 94 <&iomuxc_gpio_b1_10_gpio2_io26>, 95 <&iomuxc_gpio_b1_11_gpio2_io27>, 96 <&iomuxc_gpio_b1_12_gpio2_io28>, 97 <&iomuxc_gpio_b1_13_gpio2_io29>, 98 <&iomuxc_gpio_b1_14_gpio2_io30>, 99 <&iomuxc_gpio_b1_15_gpio2_io31>; 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308}; 309