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Searched refs:DR_REG_PARL_IO_BASE (Results 1 – 4 of 4) sorted by relevance

/hal_espressif-latest/components/soc/esp32h2/include/soc/
Dparl_io_reg.h17 #define PARL_IO_RX_MODE_CFG_REG (DR_REG_PARL_IO_BASE + 0x0)
70 #define PARL_IO_RX_DATA_CFG_REG (DR_REG_PARL_IO_BASE + 0x4)
100 #define PARL_IO_RX_GENRL_CFG_REG (DR_REG_PARL_IO_BASE + 0x8)
134 #define PARL_IO_RX_START_CFG_REG (DR_REG_PARL_IO_BASE + 0xc)
146 #define PARL_IO_TX_DATA_CFG_REG (DR_REG_PARL_IO_BASE + 0x10)
176 #define PARL_IO_TX_START_CFG_REG (DR_REG_PARL_IO_BASE + 0x14)
188 #define PARL_IO_TX_GENRL_CFG_REG (DR_REG_PARL_IO_BASE + 0x18)
214 #define PARL_IO_FIFO_CFG_REG (DR_REG_PARL_IO_BASE + 0x1c)
233 #define PARL_IO_REG_UPDATE_REG (DR_REG_PARL_IO_BASE + 0x20)
245 #define PARL_IO_ST_REG (DR_REG_PARL_IO_BASE + 0x24)
[all …]
Dreg_base.h27 #define DR_REG_PARL_IO_BASE 0x60015000 macro
/hal_espressif-latest/components/soc/esp32c6/include/soc/
Dparl_io_reg.h17 #define PARL_IO_RX_CFG0_REG (DR_REG_PARL_IO_BASE + 0x0)
131 #define PARL_IO_RX_CFG1_REG (DR_REG_PARL_IO_BASE + 0x4)
164 #define PARL_IO_TX_CFG0_REG (DR_REG_PARL_IO_BASE + 0x8)
232 #define PARL_IO_TX_CFG1_REG (DR_REG_PARL_IO_BASE + 0xc)
244 #define PARL_IO_ST_REG (DR_REG_PARL_IO_BASE + 0x10)
256 #define PARL_IO_INT_ENA_REG (DR_REG_PARL_IO_BASE + 0x14)
282 #define PARL_IO_INT_RAW_REG (DR_REG_PARL_IO_BASE + 0x18)
308 #define PARL_IO_INT_ST_REG (DR_REG_PARL_IO_BASE + 0x1c)
334 #define PARL_IO_INT_CLR_REG (DR_REG_PARL_IO_BASE + 0x20)
360 #define PARL_IO_CLK_REG (DR_REG_PARL_IO_BASE + 0x120)
[all …]
Dreg_base.h33 #define DR_REG_PARL_IO_BASE 0x60015000 macro