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Searched refs:DR_REG_SHA_BASE (Results 1 – 10 of 10) sorted by relevance

/hal_espressif-3.6.0/components/soc/esp32/include/soc/
Dhwcrypto_reg.h44 #define SHA_TEXT_BASE ((DR_REG_SHA_BASE) + 0x00)
46 #define SHA_1_START_REG ((DR_REG_SHA_BASE) + 0x80)
47 #define SHA_1_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x84)
48 #define SHA_1_LOAD_REG ((DR_REG_SHA_BASE) + 0x88)
49 #define SHA_1_BUSY_REG ((DR_REG_SHA_BASE) + 0x8c)
51 #define SHA_256_START_REG ((DR_REG_SHA_BASE) + 0x90)
52 #define SHA_256_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x94)
53 #define SHA_256_LOAD_REG ((DR_REG_SHA_BASE) + 0x98)
54 #define SHA_256_BUSY_REG ((DR_REG_SHA_BASE) + 0x9c)
56 #define SHA_384_START_REG ((DR_REG_SHA_BASE) + 0xa0)
[all …]
Dsoc.h34 #define DR_REG_SHA_BASE 0x3ff03000 macro
/hal_espressif-3.6.0/components/soc/esp32s3/include/soc/
Dhwcrypto_reg.h40 #define SHA_MODE_REG ((DR_REG_SHA_BASE) + 0x00)
41 #define SHA_T_STRING_REG ((DR_REG_SHA_BASE) + 0x04)
42 #define SHA_T_LENGTH_REG ((DR_REG_SHA_BASE) + 0x08)
43 #define SHA_BLOCK_NUM_REG ((DR_REG_SHA_BASE) + 0x0C)
44 #define SHA_START_REG ((DR_REG_SHA_BASE) + 0x10)
45 #define SHA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x14)
46 #define SHA_BUSY_REG ((DR_REG_SHA_BASE) + 0x18)
47 #define SHA_DMA_START_REG ((DR_REG_SHA_BASE) + 0x1C)
48 #define SHA_DMA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x20)
49 #define SHA_CLEAR_IRQ_REG ((DR_REG_SHA_BASE) + 0x24)
[all …]
Dsoc.h90 #define DR_REG_SHA_BASE 0x6003B000 macro
/hal_espressif-3.6.0/components/soc/esp32c3/include/soc/
Dhwcrypto_reg.h53 #define SHA_MODE_REG ((DR_REG_SHA_BASE) + 0x00)
54 #define SHA_BLOCK_NUM_REG ((DR_REG_SHA_BASE) + 0x0C)
55 #define SHA_START_REG ((DR_REG_SHA_BASE) + 0x10)
56 #define SHA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x14)
57 #define SHA_BUSY_REG ((DR_REG_SHA_BASE) + 0x18)
58 #define SHA_DMA_START_REG ((DR_REG_SHA_BASE) + 0x1C)
59 #define SHA_DMA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x20)
60 #define SHA_CLEAR_IRQ_REG ((DR_REG_SHA_BASE) + 0x24)
61 #define SHA_INT_ENA_REG ((DR_REG_SHA_BASE) + 0x28)
62 #define SHA_DATE_REG ((DR_REG_SHA_BASE) + 0x2C)
[all …]
Dsoc.h33 #define DR_REG_SHA_BASE 0x6003b000 macro
/hal_espressif-3.6.0/components/soc/esp32h2/include/soc/
Dhwcrypto_reg.h53 #define SHA_MODE_REG ((DR_REG_SHA_BASE) + 0x00)
54 #define SHA_BLOCK_NUM_REG ((DR_REG_SHA_BASE) + 0x0C)
55 #define SHA_START_REG ((DR_REG_SHA_BASE) + 0x10)
56 #define SHA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x14)
57 #define SHA_BUSY_REG ((DR_REG_SHA_BASE) + 0x18)
58 #define SHA_DMA_START_REG ((DR_REG_SHA_BASE) + 0x1C)
59 #define SHA_DMA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x20)
60 #define SHA_CLEAR_IRQ_REG ((DR_REG_SHA_BASE) + 0x24)
61 #define SHA_INT_ENA_REG ((DR_REG_SHA_BASE) + 0x28)
62 #define SHA_DATE_REG ((DR_REG_SHA_BASE) + 0x2C)
[all …]
Dsoc.h37 #define DR_REG_SHA_BASE 0x6003b000 macro
/hal_espressif-3.6.0/components/soc/esp32s2/include/soc/
Dhwcrypto_reg.h57 #define SHA_MODE_REG ((DR_REG_SHA_BASE) + 0x00)
58 #define SHA_T_STRING_REG ((DR_REG_SHA_BASE) + 0x04)
59 #define SHA_T_LENGTH_REG ((DR_REG_SHA_BASE) + 0x08)
60 #define SHA_BLOCK_NUM_REG ((DR_REG_SHA_BASE) + 0x0C)
61 #define SHA_START_REG ((DR_REG_SHA_BASE) + 0x10)
62 #define SHA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x14)
63 #define SHA_BUSY_REG ((DR_REG_SHA_BASE) + 0x18)
64 #define SHA_DMA_START_REG ((DR_REG_SHA_BASE) + 0x1C)
65 #define SHA_DMA_CONTINUE_REG ((DR_REG_SHA_BASE) + 0x20)
66 #define SHA_CLEAR_IRQ_REG ((DR_REG_SHA_BASE) + 0x24)
[all …]
Dsoc.h36 #define DR_REG_SHA_BASE 0x6003b000 macro