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/hal_gigadevice-latest/gd32f403/standard_peripheral/include/
Dgd32f403_spi.h48 #define SPI_CTL0(spix) REG32((spix) + 0x00U) /*!< SPI control re… argument
49 #define SPI_CTL1(spix) REG32((spix) + 0x04U) /*!< SPI control re… argument
50 #define SPI_STAT(spix) REG32((spix) + 0x08U) /*!< SPI status reg… argument
51 #define SPI_DATA(spix) REG32((spix) + 0x0CU) /*!< SPI data regis… argument
52 #define SPI_CRCPOLY(spix) REG32((spix) + 0x10U) /*!< SPI CRC polyno… argument
53 #define SPI_RCRC(spix) REG32((spix) + 0x14U) /*!< SPI receive CR… argument
54 #define SPI_TCRC(spix) REG32((spix) + 0x18U) /*!< SPI transmit C… argument
55 #define SPI_I2SCTL(spix) REG32((spix) + 0x1CU) /*!< SPI I2S contro… argument
56 #define SPI_I2SPSC(spix) REG32((spix) + 0x20U) /*!< SPI I2S clock … argument
57 #define SPI_QCTL(spix) REG32((spix) + 0x80U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32f3x0/standard_peripheral/include/
Dgd32f3x0_spi.h47 #define SPI_CTL0(spix) REG32((spix) + 0x00000000U) /*!< SPI control re… argument
48 #define SPI_CTL1(spix) REG32((spix) + 0x00000004U) /*!< SPI control re… argument
49 #define SPI_STAT(spix) REG32((spix) + 0x00000008U) /*!< SPI status reg… argument
50 #define SPI_DATA(spix) REG32((spix) + 0x0000000CU) /*!< SPI data regis… argument
51 #define SPI_CRCPOLY(spix) REG32((spix) + 0x00000010U) /*!< SPI CRC polyno… argument
52 #define SPI_RCRC(spix) REG32((spix) + 0x00000014U) /*!< SPI receive CR… argument
53 #define SPI_TCRC(spix) REG32((spix) + 0x00000018U) /*!< SPI transmit C… argument
54 #define SPI_I2SCTL(spix) REG32((spix) + 0x0000001CU) /*!< SPI I2S contro… argument
55 #define SPI_I2SPSC(spix) REG32((spix) + 0x00000020U) /*!< SPI I2S clock … argument
56 #define SPI_QCTL(spix) REG32((spix) + 0x00000080U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32e10x/standard_peripheral/include/
Dgd32e10x_spi.h51 #define SPI_CTL0(spix) REG32((spix) + 0x00U) /*!< SPI control re… argument
52 #define SPI_CTL1(spix) REG32((spix) + 0x04U) /*!< SPI control re… argument
53 #define SPI_STAT(spix) REG32((spix) + 0x08U) /*!< SPI status reg… argument
54 #define SPI_DATA(spix) REG32((spix) + 0x0CU) /*!< SPI data regis… argument
55 #define SPI_CRCPOLY(spix) REG32((spix) + 0x10U) /*!< SPI CRC polyno… argument
56 #define SPI_RCRC(spix) REG32((spix) + 0x14U) /*!< SPI receive CR… argument
57 #define SPI_TCRC(spix) REG32((spix) + 0x18U) /*!< SPI transmit C… argument
58 #define SPI_I2SCTL(spix) REG32((spix) + 0x1CU) /*!< SPI I2S contro… argument
59 #define SPI_I2SPSC(spix) REG32((spix) + 0x20U) /*!< SPI I2S clock … argument
60 #define SPI_QCTL(spix) REG32((spix) + 0x80U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32f4xx/standard_peripheral/include/
Dgd32f4xx_spi.h57 #define SPI_CTL0(spix) REG32((spix) + 0x00U) /*!< SPI control re… argument
58 #define SPI_CTL1(spix) REG32((spix) + 0x04U) /*!< SPI control re… argument
59 #define SPI_STAT(spix) REG32((spix) + 0x08U) /*!< SPI status reg… argument
60 #define SPI_DATA(spix) REG32((spix) + 0x0CU) /*!< SPI data regis… argument
61 #define SPI_CRCPOLY(spix) REG32((spix) + 0x10U) /*!< SPI CRC polyno… argument
62 #define SPI_RCRC(spix) REG32((spix) + 0x14U) /*!< SPI receive CR… argument
63 #define SPI_TCRC(spix) REG32((spix) + 0x18U) /*!< SPI transmit C… argument
64 #define SPI_I2SCTL(spix) REG32((spix) + 0x1CU) /*!< SPI I2S contro… argument
65 #define SPI_I2SPSC(spix) REG32((spix) + 0x20U) /*!< SPI I2S clock … argument
66 #define SPI_QCTL(spix) REG32((spix) + 0x80U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32e50x/standard_peripheral/include/
Dgd32e50x_spi.h52 #define SPI_CTL0(spix) REG32((spix) + 0x00000000U) /*!< SPI control re… argument
53 #define SPI_CTL1(spix) REG32((spix) + 0x00000004U) /*!< SPI control re… argument
54 #define SPI_STAT(spix) REG32((spix) + 0x00000008U) /*!< SPI status reg… argument
55 #define SPI_DATA(spix) REG32((spix) + 0x0000000CU) /*!< SPI data regis… argument
56 #define SPI_CRCPOLY(spix) REG32((spix) + 0x00000010U) /*!< SPI CRC polyno… argument
57 #define SPI_RCRC(spix) REG32((spix) + 0x00000014U) /*!< SPI receive CR… argument
58 #define SPI_TCRC(spix) REG32((spix) + 0x00000018U) /*!< SPI transmit C… argument
59 #define SPI_I2SCTL(spix) REG32((spix) + 0x0000001CU) /*!< SPI I2S contro… argument
60 #define SPI_I2SPSC(spix) REG32((spix) + 0x00000020U) /*!< SPI I2S clock … argument
61 #define SPI_QCTL(spix) REG32((spix) + 0x00000080U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32a50x/standard_peripheral/include/
Dgd32a50x_spi.h45 #define SPI_CTL0(spix) REG32((spix) + 0x00000000U) /*!< SPI control re… argument
46 #define SPI_CTL1(spix) REG32((spix) + 0x00000004U) /*!< SPI control re… argument
47 #define SPI_STAT(spix) REG32((spix) + 0x00000008U) /*!< SPI status reg… argument
48 #define SPI_DATA(spix) REG32((spix) + 0x0000000CU) /*!< SPI data regis… argument
49 #define SPI_CRCPOLY(spix) REG32((spix) + 0x00000010U) /*!< SPI CRC polyno… argument
50 #define SPI_RCRC(spix) REG32((spix) + 0x00000014U) /*!< SPI receive CR… argument
51 #define SPI_TCRC(spix) REG32((spix) + 0x00000018U) /*!< SPI transmit C… argument
52 #define SPI_I2SCTL(spix) REG32((spix) + 0x0000001CU) /*!< SPI I2S contro… argument
53 #define SPI_I2SPSC(spix) REG32((spix) + 0x00000020U) /*!< SPI I2S clock … argument
54 #define SPI_QCTL(spix) REG32((spix) + 0x00000080U) /*!< SPI quad mode … argument
/hal_gigadevice-latest/gd32vf103/standard_peripheral/include/
Dgd32vf103_spi.h47 #define SPI_CTL0(spix) REG32((spix) + 0x00U) /*!< SPI control re… argument
48 #define SPI_CTL1(spix) REG32((spix) + 0x04U) /*!< SPI control re… argument
49 #define SPI_STAT(spix) REG32((spix) + 0x08U) /*!< SPI status reg… argument
50 #define SPI_DATA(spix) REG32((spix) + 0x0CU) /*!< SPI data regis… argument
51 #define SPI_CRCPOLY(spix) REG32((spix) + 0x10U) /*!< SPI CRC polyno… argument
52 #define SPI_RCRC(spix) REG32((spix) + 0x14U) /*!< SPI receive CR… argument
53 #define SPI_TCRC(spix) REG32((spix) + 0x18U) /*!< SPI transmit C… argument
54 #define SPI_I2SCTL(spix) REG32((spix) + 0x1CU) /*!< SPI I2S contro… argument
55 #define SPI_I2SPSC(spix) REG32((spix) + 0x20U) /*!< SPI I2S clock … argument
/hal_gigadevice-latest/gd32l23x/standard_peripheral/include/
Dgd32l23x_spi.h45 #define SPI_CTL0(spix) REG32((spix) + 0x00000000U) /*!< SPI control re… argument
46 #define SPI_CTL1(spix) REG32((spix) + 0x00000004U) /*!< SPI control re… argument
47 #define SPI_STAT(spix) REG32((spix) + 0x00000008U) /*!< SPI status reg… argument
48 #define SPI_DATA(spix) REG32((spix) + 0x0000000CU) /*!< SPI data regis… argument
49 #define SPI_CRCPOLY(spix) REG32((spix) + 0x00000010U) /*!< SPI CRC polyno… argument
50 #define SPI_RCRC(spix) REG32((spix) + 0x00000014U) /*!< SPI receive CR… argument
51 #define SPI_TCRC(spix) REG32((spix) + 0x00000018U) /*!< SPI transmit C… argument
52 #define SPI_I2SCTL(spix) REG32((spix) + 0x0000001CU) /*!< SPI I2S contro… argument
53 #define SPI_I2SPSC(spix) REG32((spix) + 0x00000020U) /*!< SPI I2S clock … argument
54 #define SPI_QCTL(spix) REG32((spix) + 0x00000080U) /*!< SPI quad mode … argument