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2081 …32_t)(pll2vco / ((float)(((RCC->PLL2CFGR2 & RCC_PLL2CFGR2_DIVP) >> RCC_PLL2CFGR2_DIVP_Pos) + 1U))); in HAL_RCC_GetPLL2ClockFreq()
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4398 MODIFY_REG(RCC->PLL2CFGR2, RCC_PLL2CFGR2_DIVP, (DIVP - 1U) << RCC_PLL2CFGR2_DIVP_Pos); in LL_RCC_PLL2_SetP()
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26189 #define RCC_PLL2CFGR2_DIVP_2 (0x4UL << RCC_PLL2CFGR2_DIVP_Pos) …
26190 #define RCC_PLL2CFGR2_DIVP_3 (0x8UL << RCC_PLL2CFGR2_DIVP_Pos) …
26191 #define RCC_PLL2CFGR2_DIVP_4 (0x10UL << RCC_PLL2CFGR2_DIVP_Pos) …
26192 #define RCC_PLL2CFGR2_DIVP_5 (0x20UL << RCC_PLL2CFGR2_DIVP_Pos) …
26193 #define RCC_PLL2CFGR2_DIVP_6 (0x40UL << RCC_PLL2CFGR2_DIVP_Pos) …
Dstm32mp157dxx_cm4.h26150 #define RCC_PLL2CFGR2_DIVP_Pos (0U) macro
26151 #define RCC_PLL2CFGR2_DIVP_Msk (0x7FUL << RCC_PLL2CFGR2_DIVP_Pos) …
26153 #define RCC_PLL2CFGR2_DIVP_0 (0x1UL << RCC_PLL2CFGR2_DIVP_Pos) …
26154 #define RCC_PLL2CFGR2_DIVP_1 (0x2UL << RCC_PLL2CFGR2_DIVP_Pos) …
26155 #define RCC_PLL2CFGR2_DIVP_2 (0x4UL << RCC_PLL2CFGR2_DIVP_Pos) …
26156 #define RCC_PLL2CFGR2_DIVP_3 (0x8UL << RCC_PLL2CFGR2_DIVP_Pos) …
26157 #define RCC_PLL2CFGR2_DIVP_4 (0x10UL << RCC_PLL2CFGR2_DIVP_Pos) …
26158 #define RCC_PLL2CFGR2_DIVP_5 (0x20UL << RCC_PLL2CFGR2_DIVP_Pos) …
26159 #define RCC_PLL2CFGR2_DIVP_6 (0x40UL << RCC_PLL2CFGR2_DIVP_Pos) …
Dstm32mp157fxx_ca7.h26381 #define RCC_PLL2CFGR2_DIVP_Pos (0U) macro
26382 #define RCC_PLL2CFGR2_DIVP_Msk (0x7FUL << RCC_PLL2CFGR2_DIVP_Pos) …
26384 #define RCC_PLL2CFGR2_DIVP_0 (0x1UL << RCC_PLL2CFGR2_DIVP_Pos) …
26385 #define RCC_PLL2CFGR2_DIVP_1 (0x2UL << RCC_PLL2CFGR2_DIVP_Pos) …
26386 #define RCC_PLL2CFGR2_DIVP_2 (0x4UL << RCC_PLL2CFGR2_DIVP_Pos) …
26387 #define RCC_PLL2CFGR2_DIVP_3 (0x8UL << RCC_PLL2CFGR2_DIVP_Pos) …
26388 #define RCC_PLL2CFGR2_DIVP_4 (0x10UL << RCC_PLL2CFGR2_DIVP_Pos) …
26389 #define RCC_PLL2CFGR2_DIVP_5 (0x20UL << RCC_PLL2CFGR2_DIVP_Pos) …
26390 #define RCC_PLL2CFGR2_DIVP_6 (0x40UL << RCC_PLL2CFGR2_DIVP_Pos) …

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