/hal_silabs-3.5.0/gecko/Device/SiliconLabs/EFM32HG/Include/ |
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D | efm32hg321f32.h | 1093 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1094 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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D | efm32hg321f64.h | 1093 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1094 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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D | efm32hg108f32.h | 1139 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1140 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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D | efm32hg108f64.h | 1139 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1140 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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D | efm32hg308f32.h | 1151 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1152 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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D | efm32hg308f64.h | 1151 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode D… macro 1152 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shifte…
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/hal_silabs-3.5.0/gecko/Device/SiliconLabs/EFM32WG/Include/ |
D | efm32wg_dma.h | 1221 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1222 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg360f128.h | 1658 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1659 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg360f64.h | 1658 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1659 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg842f128.h | 1738 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1739 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg840f256.h | 1738 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1739 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg840f64.h | 1738 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1739 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg330f256.h | 1746 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1747 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg330f64.h | 1746 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1747 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg332f128.h | 1746 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1747 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg332f64.h | 1746 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1747 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg840f128.h | 1738 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1739 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg940f128.h | 1751 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1752 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg940f256.h | 1751 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1752 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg942f128.h | 1751 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1752 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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D | efm32wg942f256.h | 1751 #define _DMA_IFC_CH1DONE_DEFAULT 0x00000000UL /**< Mode… macro 1752 #define DMA_IFC_CH1DONE_DEFAULT (_DMA_IFC_CH1DONE_DEFAULT << 1) /**< Shif…
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