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Searched refs:SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (Results 1 – 7 of 7) sorted by relevance

/hal_nxp-latest/mcux/mcux-sdk/devices/MIMXRT685S/
DMIMXRT685S_dsp.h25489 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
25495 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
DMIMXRT685S_cm33.h35102 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
35108 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMXRT633S/
DMIMXRT633S.h35102 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
35108 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMXRT595S/
DMIMXRT595S_dsp.h39842 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
39848 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
DMIMXRT595S_cm33.h49641 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
49647 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMXRT533S/
DMIMXRT533S.h48014 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
48020 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMXRT555S/
DMIMXRT555S.h49640 #define SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK (0x400U) macro
49646 …2_t)(x)) << SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_SHIFT)) & SYSCTL0_PDRUNCFG3_CLR_SRAM_IF10_PPD_MASK)