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Searched refs:IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (Results 1 – 13 of 13) sorted by relevance

/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8QM6/
DMIMX8QM6_cm4_core1.h67597 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
67601 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
DMIMX8QM6_cm4_core0.h67597 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
67601 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8QX3/
DMIMX8QX3_cm4.h91345 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91349 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8DX4/
DMIMX8DX4_cm4.h91345 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91349 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8DX3/
DMIMX8DX3_cm4.h91345 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91349 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8QX6/
DMIMX8QX6_dsp.h94507 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
94510 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
DMIMX8QX6_cm4.h91347 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91351 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8DX6/
DMIMX8DX6_cm4.h91347 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91351 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8QX5/
DMIMX8QX5_cm4.h91346 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91350 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8DX5/
DMIMX8DX5_cm4.h91347 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91351 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8UX6/
DMIMX8UX6_cm4.h91348 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91352 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8UX5/
DMIMX8UX5_cm4.h91348 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91352 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)
/hal_nxp-latest/mcux/mcux-sdk/devices/MIMX8QX4/
DMIMX8QX4_cm4.h91344 #define IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK (0x200U) macro
91348 …(x)) << IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_SHIFT)) & IRIS_MVPL_SIG0_EVALCONTROL0_AlphaInv0_MASK)