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/hal_nxp-3.5.0/s32/drivers/s32k3/Icu/src/
DEmios_Icu_Ip.c185 eMIOS_Type * const s_emiosBase[] = IP_eMIOS_BASE_PTRS; variable
349 s_emiosBase[instance]->CH.UC[hwChannel].C &= ~eMIOS_C_MODE_MASK; in Emios_Icu_Ip_UCSetMode()
351 s_emiosBase[instance]->CH.UC[hwChannel].C |= (u32Mode & eMIOS_C_MODE_MASK); in Emios_Icu_Ip_UCSetMode()
408 s_emiosBase[instance]->CH.UC[hwChannel].C &= ~eMIOS_C_UCPREN_MASK; in Emios_Icu_Ip_SetPrescaler()
410 s_emiosBase[instance]->CH.UC[hwChannel].C2 &= ~eMIOS_C2_UCEXTPRE_MASK; in Emios_Icu_Ip_SetPrescaler()
412 s_emiosBase[instance]->CH.UC[hwChannel].C2 |= eMIOS_C2_UCEXTPRE(u32ChannelPrescaler); in Emios_Icu_Ip_SetPrescaler()
414 s_emiosBase[instance]->CH.UC[hwChannel].C |= eMIOS_C_UCPREN_MASK; in Emios_Icu_Ip_SetPrescaler()
438s_emiosBase[instance]->CH.UC[hwChannel].S |= (eMIOS_S_OVR_MASK | eMIOS_S_OVFL_MASK | eMIOS_S_FLAG_… in Emios_Icu_Ip_EnableMasterBusInterrupt()
491 s_emiosBase[instance]->CH.UC[hwChannel].S |= eMIOS_S_FLAG_MASK; in Emios_Icu_Ip_EnableInterrupt()
495 s_emiosBase[instance]->CH.UC[hwChannel].C |= eMIOS_C_FEN_MASK; in Emios_Icu_Ip_EnableInterrupt()
[all …]
DEmios_Icu_Ip_Irq.c152 extern eMIOS_Type * const s_emiosBase[];
389 return s_emiosBase[instance]->CH.UC[hwChannel].B; in Emios_Icu_Ip_GetCaptureRegB()
405 return s_emiosBase[instance]->CH.UC[hwChannel].A; in Emios_Icu_Ip_GetCaptureRegA()
416s_emiosBase[instance]->CH.UC[hwChannel].S |= (u32BitMask & (eMIOS_S_OVR_MASK | eMIOS_S_OVFL_MASK |… in Emios_Icu_Ip_ClearStatusFlags()
427 return (s_emiosBase[instance]->CH.UC[hwChannel].C & eMIOS_C_MODE_MASK); in Emios_Icu_Ip_GetChannelClockMode()
934 return s_emiosBase[instance]->CH.UC[hwChannel].S ; in Emios_Icu_Ip_GetStatusFlags()
1044 uint32 u32RegCCR = s_emiosBase[instance]->CH.UC[channel].C; in Emios_Icu_Ip_IrqHandler()
1051 if (eMIOS_C_FEN_MASK == (s_emiosBase[instance]->CH.UC[channel].C & eMIOS_C_FEN_MASK)) in Emios_Icu_Ip_IrqHandler()
1080 … eMios_Icu_Ip_BufferPtr[u8ChIndex] = (eMios_Icu_ValueType)s_emiosBase[instance]->CH.UC[channel].A; in Emios_Icu_Ip_IrqHandler()