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/hal_espressif-latest/components/soc/esp32s3/include/soc/
Dio_mux_reg.h173 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
174 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
200 #define PERIPHS_IO_MUX_GPIO0_U (REG_IO_MUX_BASE +0x04)
204 #define PERIPHS_IO_MUX_GPIO1_U (REG_IO_MUX_BASE +0x08)
208 #define PERIPHS_IO_MUX_GPIO2_U (REG_IO_MUX_BASE +0x0c)
212 #define PERIPHS_IO_MUX_GPIO3_U (REG_IO_MUX_BASE +0x10)
216 #define PERIPHS_IO_MUX_GPIO4_U (REG_IO_MUX_BASE +0x14)
220 #define PERIPHS_IO_MUX_GPIO5_U (REG_IO_MUX_BASE +0x18)
224 #define PERIPHS_IO_MUX_GPIO6_U (REG_IO_MUX_BASE +0x1c)
228 #define PERIPHS_IO_MUX_GPIO7_U (REG_IO_MUX_BASE +0x20)
[all …]
/hal_espressif-latest/components/soc/esp32s2/include/soc/
Dio_mux_reg.h163 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
164 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
190 #define PERIPHS_IO_MUX_GPIO0_U (REG_IO_MUX_BASE +0x04)
194 #define PERIPHS_IO_MUX_GPIO1_U (REG_IO_MUX_BASE +0x08)
198 #define PERIPHS_IO_MUX_GPIO2_U (REG_IO_MUX_BASE +0x0c)
202 #define PERIPHS_IO_MUX_GPIO3_U (REG_IO_MUX_BASE +0x10)
206 #define PERIPHS_IO_MUX_GPIO4_U (REG_IO_MUX_BASE +0x14)
210 #define PERIPHS_IO_MUX_GPIO5_U (REG_IO_MUX_BASE +0x18)
214 #define PERIPHS_IO_MUX_GPIO6_U (REG_IO_MUX_BASE +0x1c)
218 #define PERIPHS_IO_MUX_GPIO7_U (REG_IO_MUX_BASE +0x20)
[all …]
/hal_espressif-latest/components/soc/esp32c6/include/soc/
Dio_mux_reg.h157 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
158 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
175 #define PERIPHS_IO_MUX_XTAL_32K_P_U (REG_IO_MUX_BASE + 0x4)
179 #define PERIPHS_IO_MUX_XTAL_32K_N_U (REG_IO_MUX_BASE + 0x8)
183 #define PERIPHS_IO_MUX_GPIO2_U (REG_IO_MUX_BASE + 0xC)
188 #define PERIPHS_IO_MUX_GPIO3_U (REG_IO_MUX_BASE + 0x10)
192 #define PERIPHS_IO_MUX_MTMS_U (REG_IO_MUX_BASE + 0x14)
197 #define PERIPHS_IO_MUX_MTDI_U (REG_IO_MUX_BASE + 0x18)
202 #define PERIPHS_IO_MUX_MTCK_U (REG_IO_MUX_BASE + 0x1C)
207 #define PERIPHS_IO_MUX_MTDO_U (REG_IO_MUX_BASE + 0x20)
[all …]
/hal_espressif-latest/components/soc/esp32h2/include/soc/
Dio_mux_reg.h169 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
170 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
187 #define PERIPHS_IO_MUX_GPIO0_U (REG_IO_MUX_BASE + 0x4)
192 #define PERIPHS_IO_MUX_GPIO1_U (REG_IO_MUX_BASE + 0x8)
197 #define PERIPHS_IO_MUX_MTMS_U (REG_IO_MUX_BASE + 0xC)
202 #define PERIPHS_IO_MUX_MTDO_U (REG_IO_MUX_BASE + 0x10)
207 #define PERIPHS_IO_MUX_MTCK_U (REG_IO_MUX_BASE + 0x14)
212 #define PERIPHS_IO_MUX_MTDI_U (REG_IO_MUX_BASE + 0x18)
217 #define PERIPHS_IO_MUX_GPIO6_U (REG_IO_MUX_BASE + 0x1C)
221 #define PERIPHS_IO_MUX_GPIO7_U (REG_IO_MUX_BASE + 0x20)
[all …]
/hal_espressif-latest/components/soc/esp32c3/include/soc/
Dio_mux_reg.h147 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
148 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
174 #define PERIPHS_IO_MUX_XTAL_32K_P_U (REG_IO_MUX_BASE +0x04)
178 #define PERIPHS_IO_MUX_XTAL_32K_N_U (REG_IO_MUX_BASE +0x08)
182 #define PERIPHS_IO_MUX_GPIO2_U (REG_IO_MUX_BASE +0x0c)
187 #define PERIPHS_IO_MUX_GPIO3_U (REG_IO_MUX_BASE +0x10)
191 #define PERIPHS_IO_MUX_MTMS_U (REG_IO_MUX_BASE +0x14)
196 #define PERIPHS_IO_MUX_MTDI_U (REG_IO_MUX_BASE +0x18)
201 #define PERIPHS_IO_MUX_MTCK_U (REG_IO_MUX_BASE +0x1c)
206 #define PERIPHS_IO_MUX_MTDO_U (REG_IO_MUX_BASE +0x20)
[all …]
/hal_espressif-latest/components/soc/esp32c2/include/soc/
Dio_mux_reg.h140 #define REG_IO_MUX_BASE DR_REG_IO_MUX_BASE macro
141 #define PIN_CTRL (REG_IO_MUX_BASE +0x00)
167 #define PERIPHS_IO_MUX_XTAL_32K_P_U (REG_IO_MUX_BASE + 0x4)
171 #define PERIPHS_IO_MUX_XTAL_32K_N_U (REG_IO_MUX_BASE + 0x8)
175 #define PERIPHS_IO_MUX_GPIO2_U (REG_IO_MUX_BASE + 0xC)
180 #define PERIPHS_IO_MUX_GPIO3_U (REG_IO_MUX_BASE + 0x10)
184 #define PERIPHS_IO_MUX_MTMS_U (REG_IO_MUX_BASE + 0x14)
189 #define PERIPHS_IO_MUX_MTDI_U (REG_IO_MUX_BASE + 0x18)
194 #define PERIPHS_IO_MUX_MTCK_U (REG_IO_MUX_BASE + 0x1C)
199 #define PERIPHS_IO_MUX_MTDO_U (REG_IO_MUX_BASE + 0x20)
[all …]
/hal_espressif-latest/components/esp_hw_support/
Dsleep_system_peripheral.c129 #define N_REGS_IOMUX_0() (((IO_MUX_GPIO30_REG - REG_IO_MUX_BASE) / 4) + 1) in sleep_sys_periph_iomux_retention_init()
134 #define N_REGS_IOMUX_0() (((IO_MUX_GPIO27_REG - REG_IO_MUX_BASE) / 4) + 1) in sleep_sys_periph_iomux_retention_init()
140 …= REGDMA_LINK_CONTINUOUS_INIT(REGDMA_IOMUX_LINK(0x00), REG_IO_MUX_BASE, REG_IO_MUX_BASE in sleep_sys_periph_iomux_retention_init()