/* * Copyright 2022 NXP * All rights reserved. * * SPDX-License-Identifier: BSD-3-Clause */ #ifndef _FSL_EDMA_SOC_H_ #define _FSL_EDMA_SOC_H_ #include "fsl_common.h" /*! * @addtogroup edma_soc * @{ */ /******************************************************************************* * Definitions ******************************************************************************/ /*! @name Driver version */ /*@{*/ /*! @brief Driver version 2.0.0. */ #define FSL_EDMA_SOC_DRIVER_VERSION (MAKE_VERSION(2, 0, 0)) /*@}*/ /*!@brief DMA IP version */ #define FSL_EDMA_SOC_IP_DMA3 (1) #define FSL_EDMA_SOC_IP_DMA4 (0) /*!@brief DMA base table */ #define EDMA_BASE_PTRS \ { \ DMA0 \ } #define EDMA_CHN_IRQS \ { \ { \ DMA_CH0_IRQn, DMA_CH1_IRQn, DMA_CH2_IRQn, DMA_CH3_IRQn \ } \ } /*!@brief EDMA base address convert macro */ #define EDMA_CHANNEL_OFFSET 0x1000U #define EDMA_CHANNEL_ARRAY_STEP(base) (0x1000U) /******************************************************************************* * API ******************************************************************************/ #ifdef __cplusplus extern "C" { #endif #ifdef __cplusplus } #endif /*! * @} */ #endif /* _FSL_EDMA_SOC_H_ */