/* * * * Note: File generated by imx_cfg_utils.py * from configuration data for MIMXRT1189CVM8B */ /* * SOC level pinctrl defintions * These definitions define SOC level defaults for each pin, * and select the pinmux for the pin. Pinmux entries are a tuple of: * * the mux_register and input_daisy reside in the IOMUXC peripheral, and * the pinctrl driver will write the mux_mode and input_daisy values into * each register, respectively. The config_register is used to configure * the pin based on the devicetree properties set */ /* * NOTE: file fixup performed by imx_fixup_pinmux.py * to correct missing daisy register values */ &iomuxc { /omit-if-no-ref/ iomuxc_gpio_ad_00_acmp1_in1: IOMUXC_GPIO_AD_00_ACMP1_IN1 { pinmux = <0x42a1010c 5 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexcan2_tx: IOMUXC_GPIO_AD_00_FLEXCAN2_TX { pinmux = <0x42a1010c 1 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexio2_d00: IOMUXC_GPIO_AD_00_FLEXIO2_D00 { pinmux = <0x42a1010c 8 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexpwm1_pwm0_a: IOMUXC_GPIO_AD_00_FLEXPWM1_PWM0_A { pinmux = <0x42a1010c 4 0x42a104f4 2 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpio4_io00: IOMUXC_GPIO_AD_00_GPIO4_IO00 { pinmux = <0x42a1010c 5 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpt2_capture1: IOMUXC_GPIO_AD_00_GPT2_CAPTURE1 { pinmux = <0x42a1010c 3 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_mic_clk: IOMUXC_GPIO_AD_00_MIC_CLK { pinmux = <0x42a1010c 2 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_qtimer4_timer0: IOMUXC_GPIO_AD_00_QTIMER4_TIMER0 { pinmux = <0x42a1010c 9 0x42a1087c 1 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_sinc1_mod_clk0: IOMUXC_GPIO_AD_00_SINC1_MOD_CLK0 { pinmux = <0x42a1010c 6 0x0 0 0x42a10354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_acmp1_in2: IOMUXC_GPIO_AD_01_ACMP1_IN2 { pinmux = <0x42a10110 5 0x0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexcan2_rx: IOMUXC_GPIO_AD_01_FLEXCAN2_RX { pinmux = <0x42a10110 1 0x42a104a4 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexio2_d01: IOMUXC_GPIO_AD_01_FLEXIO2_D01 { pinmux = <0x42a10110 8 0x0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexpwm1_pwm0_b: IOMUXC_GPIO_AD_01_FLEXPWM1_PWM0_B { pinmux = <0x42a10110 4 0x42a10500 2 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpio4_io01: IOMUXC_GPIO_AD_01_GPIO4_IO01 { pinmux = <0x42a10110 5 0x0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpt2_capture2: IOMUXC_GPIO_AD_01_GPT2_CAPTURE2 { pinmux = <0x42a10110 3 0x0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_mic_bitstream0: IOMUXC_GPIO_AD_01_MIC_BITSTREAM0 { pinmux = <0x42a10110 2 0x42a106d0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_qtimer4_timer1: IOMUXC_GPIO_AD_01_QTIMER4_TIMER1 { pinmux = <0x42a10110 9 0x42a10880 1 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_sinc1_mod_clk1: IOMUXC_GPIO_AD_01_SINC1_MOD_CLK1 { pinmux = <0x42a10110 6 0x0 0 0x42a10358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_acmp1_in3: IOMUXC_GPIO_AD_02_ACMP1_IN3 { pinmux = <0x42a10114 5 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_adc1_ch7a: IOMUXC_GPIO_AD_02_ADC1_CH7A { pinmux = <0x42a10114 5 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_flexio2_d02: IOMUXC_GPIO_AD_02_FLEXIO2_D02 { pinmux = <0x42a10114 8 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_flexpwm1_pwm1_a: IOMUXC_GPIO_AD_02_FLEXPWM1_PWM1_A { pinmux = <0x42a10114 4 0x42a104f8 1 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpio4_io02: IOMUXC_GPIO_AD_02_GPIO4_IO02 { pinmux = <0x42a10114 5 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpt2_compare1: IOMUXC_GPIO_AD_02_GPT2_COMPARE1 { pinmux = <0x42a10114 3 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_mic_bitstream1: IOMUXC_GPIO_AD_02_MIC_BITSTREAM1 { pinmux = <0x42a10114 2 0x42a106d4 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_qtimer4_timer2: IOMUXC_GPIO_AD_02_QTIMER4_TIMER2 { pinmux = <0x42a10114 9 0x42a10884 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_sinc1_mod_clk2: IOMUXC_GPIO_AD_02_SINC1_MOD_CLK2 { pinmux = <0x42a10114 6 0x0 0 0x42a1035c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_acmp1_in4: IOMUXC_GPIO_AD_03_ACMP1_IN4 { pinmux = <0x42a10118 5 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_adc1_ch7b: IOMUXC_GPIO_AD_03_ADC1_CH7B { pinmux = <0x42a10118 5 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_flexio2_d03: IOMUXC_GPIO_AD_03_FLEXIO2_D03 { pinmux = <0x42a10118 8 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_flexpwm1_pwm1_b: IOMUXC_GPIO_AD_03_FLEXPWM1_PWM1_B { pinmux = <0x42a10118 4 0x42a10504 1 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpio4_io03: IOMUXC_GPIO_AD_03_GPIO4_IO03 { pinmux = <0x42a10118 5 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpt2_compare2: IOMUXC_GPIO_AD_03_GPT2_COMPARE2 { pinmux = <0x42a10118 3 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_mic_bitstream2: IOMUXC_GPIO_AD_03_MIC_BITSTREAM2 { pinmux = <0x42a10118 2 0x42a106d8 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_qtimer4_timer3: IOMUXC_GPIO_AD_03_QTIMER4_TIMER3 { pinmux = <0x42a10118 9 0x0 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_sinc1_emclk0: IOMUXC_GPIO_AD_03_SINC1_EMCLK0 { pinmux = <0x42a10118 6 0x42a108e4 0 0x42a10360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_acmp2_in1: IOMUXC_GPIO_AD_04_ACMP2_IN1 { pinmux = <0x42a1011c 5 0x0 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_adc1_ch6a: IOMUXC_GPIO_AD_04_ADC1_CH6A { pinmux = <0x42a1011c 5 0x0 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_flexio2_d04: IOMUXC_GPIO_AD_04_FLEXIO2_D04 { pinmux = <0x42a1011c 8 0x0 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_flexpwm1_pwm2_b: IOMUXC_GPIO_AD_04_FLEXPWM1_PWM2_B { pinmux = <0x42a1011c 4 0x42a10508 1 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpio4_io04: IOMUXC_GPIO_AD_04_GPIO4_IO04 { pinmux = <0x42a1011c 5 0x0 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpt2_compare3: IOMUXC_GPIO_AD_04_GPT2_COMPARE3 { pinmux = <0x42a1011c 3 0x0 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_mic_bitstream3: IOMUXC_GPIO_AD_04_MIC_BITSTREAM3 { pinmux = <0x42a1011c 2 0x42a106dc 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_qtimer5_timer0: IOMUXC_GPIO_AD_04_QTIMER5_TIMER0 { pinmux = <0x42a1011c 9 0x42a10888 1 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_sinc1_embit0: IOMUXC_GPIO_AD_04_SINC1_EMBIT0 { pinmux = <0x42a1011c 6 0x42a108d4 0 0x42a10364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_acmp2_in2: IOMUXC_GPIO_AD_05_ACMP2_IN2 { pinmux = <0x42a10120 5 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_adc1_ch6b: IOMUXC_GPIO_AD_05_ADC1_CH6B { pinmux = <0x42a10120 5 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_ccm_enet_ref_clk_25m: IOMUXC_GPIO_AD_05_CCM_ENET_REF_CLK_25M { pinmux = <0x42a10120 7 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_flexio2_d05: IOMUXC_GPIO_AD_05_FLEXIO2_D05 { pinmux = <0x42a10120 8 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_flexpwm1_pwm2_a: IOMUXC_GPIO_AD_05_FLEXPWM1_PWM2_A { pinmux = <0x42a10120 4 0x42a104fc 1 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpio4_io05: IOMUXC_GPIO_AD_05_GPIO4_IO05 { pinmux = <0x42a10120 5 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpt2_clk: IOMUXC_GPIO_AD_05_GPT2_CLK { pinmux = <0x42a10120 3 0x0 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_qtimer5_timer1: IOMUXC_GPIO_AD_05_QTIMER5_TIMER1 { pinmux = <0x42a10120 9 0x42a1088c 1 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_sinc1_emclk1: IOMUXC_GPIO_AD_05_SINC1_EMCLK1 { pinmux = <0x42a10120 6 0x42a108e8 0 0x42a10368>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_adc1_ch5a: IOMUXC_GPIO_AD_06_ADC1_CH5A { pinmux = <0x42a10124 5 0x0 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_flexcan3_tx: IOMUXC_GPIO_AD_06_FLEXCAN3_TX { pinmux = <0x42a10124 1 0x0 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_flexio2_d06: IOMUXC_GPIO_AD_06_FLEXIO2_D06 { pinmux = <0x42a10124 8 0x0 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_flexpwm1_pwm0_x: IOMUXC_GPIO_AD_06_FLEXPWM1_PWM0_X { pinmux = <0x42a10124 4 0x0 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_gpio4_io06: IOMUXC_GPIO_AD_06_GPIO4_IO06 { pinmux = <0x42a10124 5 0x0 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_qtimer5_timer2: IOMUXC_GPIO_AD_06_QTIMER5_TIMER2 { pinmux = <0x42a10124 9 0x42a10890 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_sinc1_embit1: IOMUXC_GPIO_AD_06_SINC1_EMBIT1 { pinmux = <0x42a10124 6 0x42a108d8 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_06_usb_otg2_oc: IOMUXC_GPIO_AD_06_USB_OTG2_OC { pinmux = <0x42a10124 0 0x42a10914 0 0x42a1036c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_adc1_ch5b: IOMUXC_GPIO_AD_07_ADC1_CH5B { pinmux = <0x42a10128 5 0x0 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_flexcan3_rx: IOMUXC_GPIO_AD_07_FLEXCAN3_RX { pinmux = <0x42a10128 1 0x42a104a8 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_flexio2_d07: IOMUXC_GPIO_AD_07_FLEXIO2_D07 { pinmux = <0x42a10128 8 0x0 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_flexpwm1_pwm1_x: IOMUXC_GPIO_AD_07_FLEXPWM1_PWM1_X { pinmux = <0x42a10128 4 0x0 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_gpio4_io07: IOMUXC_GPIO_AD_07_GPIO4_IO07 { pinmux = <0x42a10128 5 0x0 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_qtimer5_timer3: IOMUXC_GPIO_AD_07_QTIMER5_TIMER3 { pinmux = <0x42a10128 9 0x0 0 0x42a10370>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_07_sinc1_emclk2: IOMUXC_GPIO_AD_07_SINC1_EMCLK2 { pinmux = <0x42a10128 6 0x42a108ec 0 0x42a10370>; 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