/* * Copyright 2023, NXP * SPDX-License-Identifier: Apache-2.0 * * Note: File generated by imx_cfg_utils.py * from configuration data for MIMXRT1176AVM8A */ /* * SOC level pinctrl defintions * These definitions define SOC level defaults for each pin, * and select the pinmux for the pin. Pinmux entries are a tuple of: * * the mux_register and input_daisy reside in the IOMUXC peripheral, and * the pinctrl driver will write the mux_mode and input_daisy values into * each register, respectively. The config_register is used to configure * the pin based on the devicetree properties set */ &iomuxc { /omit-if-no-ref/ iomuxc_gpio_ad_00_acmp1_in1: IOMUXC_GPIO_AD_00_ACMP1_IN1 { pinmux = <0x400e810c 5 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_can2_tx: IOMUXC_GPIO_AD_00_CAN2_TX { pinmux = <0x400e810c 1 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_enet_1g_1588_event1_in: IOMUXC_GPIO_AD_00_ENET_1G_1588_EVENT1_IN { pinmux = <0x400e810c 2 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexio2_flexio00: IOMUXC_GPIO_AD_00_FLEXIO2_FLEXIO00 { pinmux = <0x400e810c 8 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexpwm1_pwm0_a: IOMUXC_GPIO_AD_00_FLEXPWM1_PWM0_A { pinmux = <0x400e810c 4 0x400e8500 1 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_flexspi2_b_ss1_b: IOMUXC_GPIO_AD_00_FLEXSPI2_B_SS1_B { pinmux = <0x400e810c 9 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpio8_io31: IOMUXC_GPIO_AD_00_GPIO8_IO31 { pinmux = <0x400e810c 10 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpio_mux2_io31: IOMUXC_GPIO_AD_00_GPIO_MUX2_IO31 { pinmux = <0x400e810c 5 0x0 0 0x400e8350>; pin-pue; gpr = <0x400e40a4 0xf 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpio_mux2_io31_cm7: IOMUXC_GPIO_AD_00_GPIO_MUX2_IO31_CM7 { pinmux = <0x400e810c 5 0x0 0 0x400e8350>; pin-pue; gpr = <0x400e40a4 0xf 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_gpt2_capture1: IOMUXC_GPIO_AD_00_GPT2_CAPTURE1 { pinmux = <0x400e810c 3 0x0 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_lpuart7_tx: IOMUXC_GPIO_AD_00_LPUART7_TX { pinmux = <0x400e810c 6 0x400e8630 0 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_00_sim1_trxd: IOMUXC_GPIO_AD_00_SIM1_TRXD { pinmux = <0x400e810c 0 0x400e869c 1 0x400e8350>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_acmp1_in2: IOMUXC_GPIO_AD_01_ACMP1_IN2 { pinmux = <0x400e8110 5 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_can2_rx: IOMUXC_GPIO_AD_01_CAN2_RX { pinmux = <0x400e8110 1 0x400e849c 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_enet_1g_1588_event1_out: IOMUXC_GPIO_AD_01_ENET_1G_1588_EVENT1_OUT { pinmux = <0x400e8110 2 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexio2_flexio01: IOMUXC_GPIO_AD_01_FLEXIO2_FLEXIO01 { pinmux = <0x400e8110 8 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexpwm1_pwm0_b: IOMUXC_GPIO_AD_01_FLEXPWM1_PWM0_B { pinmux = <0x400e8110 4 0x400e850c 1 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_flexspi2_a_ss1_b: IOMUXC_GPIO_AD_01_FLEXSPI2_A_SS1_B { pinmux = <0x400e8110 9 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpio9_io00: IOMUXC_GPIO_AD_01_GPIO9_IO00 { pinmux = <0x400e8110 10 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpio_mux3_io00: IOMUXC_GPIO_AD_01_GPIO_MUX3_IO00 { pinmux = <0x400e8110 5 0x0 0 0x400e8354>; pin-pue; gpr = <0x400e40a8 0x0 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpio_mux3_io00_cm7: IOMUXC_GPIO_AD_01_GPIO_MUX3_IO00_CM7 { pinmux = <0x400e8110 5 0x0 0 0x400e8354>; pin-pue; gpr = <0x400e40a8 0x0 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_gpt2_capture2: IOMUXC_GPIO_AD_01_GPT2_CAPTURE2 { pinmux = <0x400e8110 3 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_lpuart7_rx: IOMUXC_GPIO_AD_01_LPUART7_RX { pinmux = <0x400e8110 6 0x400e862c 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_01_sim1_clk: IOMUXC_GPIO_AD_01_SIM1_CLK { pinmux = <0x400e8110 0 0x0 0 0x400e8354>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_acmp1_in3: IOMUXC_GPIO_AD_02_ACMP1_IN3 { pinmux = <0x400e8114 5 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_enet_1g_1588_event2_in: IOMUXC_GPIO_AD_02_ENET_1G_1588_EVENT2_IN { pinmux = <0x400e8114 2 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_flexio2_flexio02: IOMUXC_GPIO_AD_02_FLEXIO2_FLEXIO02 { pinmux = <0x400e8114 8 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_flexpwm1_pwm1_a: IOMUXC_GPIO_AD_02_FLEXPWM1_PWM1_A { pinmux = <0x400e8114 4 0x400e8504 1 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpio9_io01: IOMUXC_GPIO_AD_02_GPIO9_IO01 { pinmux = <0x400e8114 10 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpio_mux3_io01: IOMUXC_GPIO_AD_02_GPIO_MUX3_IO01 { pinmux = <0x400e8114 5 0x0 0 0x400e8358>; pin-pue; gpr = <0x400e40a8 0x1 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpio_mux3_io01_cm7: IOMUXC_GPIO_AD_02_GPIO_MUX3_IO01_CM7 { pinmux = <0x400e8114 5 0x0 0 0x400e8358>; pin-pue; gpr = <0x400e40a8 0x1 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_gpt2_compare1: IOMUXC_GPIO_AD_02_GPT2_COMPARE1 { pinmux = <0x400e8114 3 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_lpuart7_cts_b: IOMUXC_GPIO_AD_02_LPUART7_CTS_B { pinmux = <0x400e8114 1 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_lpuart8_tx: IOMUXC_GPIO_AD_02_LPUART8_TX { pinmux = <0x400e8114 6 0x400e8638 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_sim1_rst_b: IOMUXC_GPIO_AD_02_SIM1_RST_B { pinmux = <0x400e8114 0 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_02_video_mux_ext_dcic1: IOMUXC_GPIO_AD_02_VIDEO_MUX_EXT_DCIC1 { pinmux = <0x400e8114 9 0x0 0 0x400e8358>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_acmp1_in4: IOMUXC_GPIO_AD_03_ACMP1_IN4 { pinmux = <0x400e8118 5 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_enet_1g_1588_event2_out: IOMUXC_GPIO_AD_03_ENET_1G_1588_EVENT2_OUT { pinmux = <0x400e8118 2 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_flexio2_flexio03: IOMUXC_GPIO_AD_03_FLEXIO2_FLEXIO03 { pinmux = <0x400e8118 8 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_flexpwm1_pwm1_b: IOMUXC_GPIO_AD_03_FLEXPWM1_PWM1_B { pinmux = <0x400e8118 4 0x400e8510 1 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpio9_io02: IOMUXC_GPIO_AD_03_GPIO9_IO02 { pinmux = <0x400e8118 10 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpio_mux3_io02: IOMUXC_GPIO_AD_03_GPIO_MUX3_IO02 { pinmux = <0x400e8118 5 0x0 0 0x400e835c>; pin-pue; gpr = <0x400e40a8 0x2 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpio_mux3_io02_cm7: IOMUXC_GPIO_AD_03_GPIO_MUX3_IO02_CM7 { pinmux = <0x400e8118 5 0x0 0 0x400e835c>; pin-pue; gpr = <0x400e40a8 0x2 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_gpt2_compare2: IOMUXC_GPIO_AD_03_GPT2_COMPARE2 { pinmux = <0x400e8118 3 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_lpuart7_rts_b: IOMUXC_GPIO_AD_03_LPUART7_RTS_B { pinmux = <0x400e8118 1 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_lpuart8_rx: IOMUXC_GPIO_AD_03_LPUART8_RX { pinmux = <0x400e8118 6 0x400e8634 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_sim1_sven: IOMUXC_GPIO_AD_03_SIM1_SVEN { pinmux = <0x400e8118 0 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_03_video_mux_ext_dcic2: IOMUXC_GPIO_AD_03_VIDEO_MUX_EXT_DCIC2 { pinmux = <0x400e8118 9 0x0 0 0x400e835c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_acmp2_in1: IOMUXC_GPIO_AD_04_ACMP2_IN1 { pinmux = <0x400e811c 5 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_enet_1g_1588_event3_in: IOMUXC_GPIO_AD_04_ENET_1G_1588_EVENT3_IN { pinmux = <0x400e811c 2 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_flexio2_flexio04: IOMUXC_GPIO_AD_04_FLEXIO2_FLEXIO04 { pinmux = <0x400e811c 8 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_flexpwm1_pwm2_a: IOMUXC_GPIO_AD_04_FLEXPWM1_PWM2_A { pinmux = <0x400e811c 4 0x400e8508 1 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpio9_io03: IOMUXC_GPIO_AD_04_GPIO9_IO03 { pinmux = <0x400e811c 10 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpio_mux3_io03: IOMUXC_GPIO_AD_04_GPIO_MUX3_IO03 { pinmux = <0x400e811c 5 0x0 0 0x400e8360>; pin-pue; gpr = <0x400e40a8 0x3 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpio_mux3_io03_cm7: IOMUXC_GPIO_AD_04_GPIO_MUX3_IO03_CM7 { pinmux = <0x400e811c 5 0x0 0 0x400e8360>; pin-pue; gpr = <0x400e40a8 0x3 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_gpt2_compare3: IOMUXC_GPIO_AD_04_GPT2_COMPARE3 { pinmux = <0x400e811c 3 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_lpuart8_cts_b: IOMUXC_GPIO_AD_04_LPUART8_CTS_B { pinmux = <0x400e811c 1 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_qtimer4_timer0: IOMUXC_GPIO_AD_04_QTIMER4_TIMER0 { pinmux = <0x400e811c 9 0x400e8660 1 0x400e8360>; pin-pue; gpr = <0x400e403c 0x8 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_sim1_pd: IOMUXC_GPIO_AD_04_SIM1_PD { pinmux = <0x400e811c 0 0x400e86a0 1 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_04_wdog1_wdog_b: IOMUXC_GPIO_AD_04_WDOG1_WDOG_B { pinmux = <0x400e811c 6 0x0 0 0x400e8360>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_acmp2_in2: IOMUXC_GPIO_AD_05_ACMP2_IN2 { pinmux = <0x400e8120 5 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_enet_1g_1588_event3_out: IOMUXC_GPIO_AD_05_ENET_1G_1588_EVENT3_OUT { pinmux = <0x400e8120 2 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_flexio2_flexio05: IOMUXC_GPIO_AD_05_FLEXIO2_FLEXIO05 { pinmux = <0x400e8120 8 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_flexpwm1_pwm2_b: IOMUXC_GPIO_AD_05_FLEXPWM1_PWM2_B { pinmux = <0x400e8120 4 0x400e8514 1 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpio9_io04: IOMUXC_GPIO_AD_05_GPIO9_IO04 { pinmux = <0x400e8120 10 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpio_mux3_io04: IOMUXC_GPIO_AD_05_GPIO_MUX3_IO04 { pinmux = <0x400e8120 5 0x0 0 0x400e8364>; pin-pue; gpr = <0x400e40a8 0x4 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpio_mux3_io04_cm7: IOMUXC_GPIO_AD_05_GPIO_MUX3_IO04_CM7 { pinmux = <0x400e8120 5 0x0 0 0x400e8364>; pin-pue; gpr = <0x400e40a8 0x4 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_gpt2_clk: IOMUXC_GPIO_AD_05_GPT2_CLK { pinmux = <0x400e8120 3 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_lpuart8_rts_b: IOMUXC_GPIO_AD_05_LPUART8_RTS_B { pinmux = <0x400e8120 1 0x0 0 0x400e8364>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_ad_05_qtimer4_timer1: IOMUXC_GPIO_AD_05_QTIMER4_TIMER1 { pinmux = <0x400e8120 9 0x400e8664 1 0x400e8364>; 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pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_00_src_bt_cfg06: IOMUXC_GPIO_DISP_B2_00_SRC_BT_CFG06 { pinmux = <0x400e8214 6 0x0 0 0x400e8458>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_00_video_mux_lcdif_data08: IOMUXC_GPIO_DISP_B2_00_VIDEO_MUX_LCDIF_DATA08 { pinmux = <0x400e8214 0 0x0 0 0x400e8458>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_00_wdog1_wdog_b: IOMUXC_GPIO_DISP_B2_00_WDOG1_WDOG_B { pinmux = <0x400e8214 1 0x0 0 0x400e8458>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_01_ccm_enet_ref_clk_25m: IOMUXC_GPIO_DISP_B2_01_CCM_ENET_REF_CLK_25M { pinmux = <0x400e8218 9 0x0 0 0x400e845c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_01_ewm_ewm_out_b: IOMUXC_GPIO_DISP_B2_01_EWM_EWM_OUT_B { pinmux = <0x400e8218 8 0x0 0 0x400e845c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_01_gpio11_io02: IOMUXC_GPIO_DISP_B2_01_GPIO11_IO02 { pinmux = <0x400e8218 10 0x0 0 0x400e845c>; pin-pue; }; /omit-if-no-ref/ iomuxc_gpio_disp_b2_01_gpio_mux5_io02: IOMUXC_GPIO_DISP_B2_01_GPIO_MUX5_IO02 { pinmux = <0x400e8218 5 0x0 0 0x400e845c>; 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/omit-if-no-ref/ iomuxc_gpio_emc_b2_17_qtimer3_timer0: IOMUXC_GPIO_EMC_B2_17_QTIMER3_TIMER0 { pinmux = <0x400e80fc 9 0x400e8654 1 0x400e8340>; pin-pdrv; gpr = <0x400e4038 0x8 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_17_sai3_mclk: IOMUXC_GPIO_EMC_B2_17_SAI3_MCLK { pinmux = <0x400e80fc 3 0x0 0 0x400e8340>; pin-pdrv; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_17_semc_dm03: IOMUXC_GPIO_EMC_B2_17_SEMC_DM03 { pinmux = <0x400e80fc 0 0x0 0 0x400e8340>; pin-pdrv; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_17_wdog1_wdog_any: IOMUXC_GPIO_EMC_B2_17_WDOG1_WDOG_ANY { pinmux = <0x400e80fc 8 0x0 0 0x400e8340>; pin-pdrv; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_17_xbar1_xbar_in15: IOMUXC_GPIO_EMC_B2_17_XBAR1_XBAR_IN15 { pinmux = <0x400e80fc 1 0x0 0 0x400e8340>; pin-pdrv; gpr = <0x400e4050 0xb 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_17_xbar1_xbar_inout15: IOMUXC_GPIO_EMC_B2_17_XBAR1_XBAR_INOUT15 { pinmux = <0x400e80fc 1 0x0 0 0x400e8340>; pin-pdrv; gpr = <0x400e4050 0xb 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_emc_b2_18_enet_1g_rx_er: IOMUXC_GPIO_EMC_B2_18_ENET_1G_RX_ER { pinmux = <0x400e8100 2 0x400e84e4 0 0x400e8344>; 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pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_02_lpspi5_sck: IOMUXC_LPSR_GPIO_LPSR_02_LPSPI5_SCK { pinmux = <0x40c08008 1 0x40c08098 0 0x40c08048>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_02_mqs_right: IOMUXC_LPSR_GPIO_LPSR_02_MQS_RIGHT { pinmux = <0x40c08008 3 0x0 0 0x40c08048>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_02_sai4_tx_data: IOMUXC_LPSR_GPIO_LPSR_02_SAI4_TX_DATA { pinmux = <0x40c08008 2 0x0 0 0x40c08048>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_02_src_boot_mode00: IOMUXC_LPSR_GPIO_LPSR_02_SRC_BOOT_MODE00 { pinmux = <0x40c08008 0 0x0 0 0x40c08048>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_03_gpio12_io03: IOMUXC_LPSR_GPIO_LPSR_03_GPIO12_IO03 { pinmux = <0x40c0800c 10 0x0 0 0x40c0804c>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_03_gpio_mux6_io03: IOMUXC_LPSR_GPIO_LPSR_03_GPIO_MUX6_IO03 { pinmux = <0x40c0800c 5 0x0 0 0x40c0804c>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_03_lpspi5_pcs0: IOMUXC_LPSR_GPIO_LPSR_03_LPSPI5_PCS0 { pinmux = <0x40c0800c 1 0x40c08094 0 0x40c0804c>; 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pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_04_lpuart11_tx: IOMUXC_LPSR_GPIO_LPSR_04_LPUART11_TX { pinmux = <0x40c08010 6 0x40c080a8 0 0x40c08050>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_04_lpuart12_rts_b: IOMUXC_LPSR_GPIO_LPSR_04_LPUART12_RTS_B { pinmux = <0x40c08010 3 0x0 0 0x40c08050>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_04_sai4_tx_bclk: IOMUXC_LPSR_GPIO_LPSR_04_SAI4_TX_BCLK { pinmux = <0x40c08010 2 0x40c080d8 0 0x40c08050>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_05_gpio12_io05: IOMUXC_LPSR_GPIO_LPSR_05_GPIO12_IO05 { pinmux = <0x40c08014 10 0x0 0 0x40c08054>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_05_gpio_mux6_io05: IOMUXC_LPSR_GPIO_LPSR_05_GPIO_MUX6_IO05 { pinmux = <0x40c08014 5 0x0 0 0x40c08054>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_05_lpi2c5_scl: IOMUXC_LPSR_GPIO_LPSR_05_LPI2C5_SCL { pinmux = <0x40c08014 0 0x40c08084 0 0x40c08054>; pin-lpsr; }; /omit-if-no-ref/ iomuxc_lpsr_gpio_lpsr_05_lpspi5_sdi: IOMUXC_LPSR_GPIO_LPSR_05_LPSPI5_SDI { pinmux = <0x40c08014 1 0x40c0809c 0 0x40c08054>; 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