/* * NOTE: File generated by lpc_cfg_utils.py * from MIMXRT685SFVKB/signal_configuration.xml * * Copyright (c) 2022, NXP * SPDX-License-Identifier: Apache-2.0 */ #ifndef _ZEPHYR_DTS_BINDING_MIMXRT685SFVKB_ #define _ZEPHYR_DTS_BINDING_MIMXRT685SFVKB_ #define IOPCTL_MUX(offset, mux) \ ((((offset) & 0xFFF) << 20) | \ (((mux) & 0xF) << 0)) #define CTIMER0_MATCH0_PIO0_0 IOPCTL_MUX(0, 4) /* PIO0_0 */ #define DMA0_TRIG0_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG10_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG11_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG12_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG13_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG14_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG15_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG16_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG17_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG18_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG19_PIO0_0 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SCT0_IN5_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN6_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define USDHC0_USDHC_DATA1_PIO2_1 IOPCTL_MUX(65, 1) /* PIO2_1 */ #define GPIO_PIO22_PIO2_2 IOPCTL_MUX(66, 0) /* PIO2_2 */ #define SCT0_OUT0_PIO2_2 IOPCTL_MUX(66, 2) /* PIO2_2 */ #define USDHC0_USDHC_DATA2_PIO2_2 IOPCTL_MUX(66, 1) /* PIO2_2 */ #define GPIO_PIO23_PIO2_3 IOPCTL_MUX(67, 0) /* PIO2_3 */ #define SCT0_OUT1_PIO2_3 IOPCTL_MUX(67, 2) /* PIO2_3 */ #define USDHC0_USDHC_DATA3_PIO2_3 IOPCTL_MUX(67, 1) /* PIO2_3 */ #define GPIO_PIO24_PIO2_4 IOPCTL_MUX(68, 0) /* PIO2_4 */ #define SCT0_OUT2_PIO2_4 IOPCTL_MUX(68, 2) /* PIO2_4 */ #define SD0_DS_PIO2_4 IOPCTL_MUX(68, 5) /* PIO2_4 */ #define SD0_WR_PRT_PIO2_4 IOPCTL_MUX(68, 1) /* PIO2_4 */ #define GPIO_PIO25_PIO2_5 IOPCTL_MUX(69, 0) /* PIO2_5 */ #define SCT0_OUT3_PIO2_5 IOPCTL_MUX(69, 2) /* PIO2_5 */ #define USDHC0_USDHC_DATA4_PIO2_5 IOPCTL_MUX(69, 1) /* PIO2_5 */ #define CTIMER1_MATCH0_PIO2_6 IOPCTL_MUX(70, 4) /* PIO2_6 */ #define GPIO_PIO26_PIO2_6 IOPCTL_MUX(70, 0) /* PIO2_6 */ #define SCT0_IN0_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN1_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN2_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN3_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN4_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN5_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN6_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define USDHC0_USDHC_DATA5_PIO2_6 IOPCTL_MUX(70, 1) /* PIO2_6 */ #define CTIMER1_MATCH1_PIO2_7 IOPCTL_MUX(71, 4) /* PIO2_7 */ #define GPIO_PIO27_PIO2_7 IOPCTL_MUX(71, 0) /* PIO2_7 */ #define SCT0_IN0_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN1_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN2_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN3_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN4_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN5_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN6_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define USDHC0_USDHC_DATA6_PIO2_7 IOPCTL_MUX(71, 1) /* PIO2_7 */ #define CTIMER1_MATCH2_PIO2_8 IOPCTL_MUX(72, 4) /* PIO2_8 */ #define GPIO_PIO28_PIO2_8 IOPCTL_MUX(72, 0) /* PIO2_8 */ #define SCT0_OUT4_PIO2_8 IOPCTL_MUX(72, 2) /* PIO2_8 */ #define USDHC0_USDHC_DATA7_PIO2_8 IOPCTL_MUX(72, 1) /* PIO2_8 */ #define CTIMER1_MATCH3_PIO2_9 IOPCTL_MUX(73, 4) /* PIO2_9 */ #define GPIO_PIO29_PIO2_9 IOPCTL_MUX(73, 0) /* PIO2_9 */ #define SCT0_OUT5_PIO2_9 IOPCTL_MUX(73, 2) /* PIO2_9 */ #define SD0_CARD_DET_N_PIO2_9 IOPCTL_MUX(73, 1) /* PIO2_9 */ #define CTIMER2_MATCH0_PIO2_10 IOPCTL_MUX(74, 4) /* PIO2_10 */ #define GPIO_PIO210_PIO2_10 IOPCTL_MUX(74, 0) /* PIO2_10 */ #define SCT0_IN0_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN1_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN2_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN3_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN4_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN5_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN6_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SD0_RESET_N_PIO2_10 IOPCTL_MUX(74, 1) /* PIO2_10 */ #define CTIMER2_MATCH1_PIO2_11 IOPCTL_MUX(75, 4) /* PIO2_11 */ #define GPIO_PIO211_PIO2_11 IOPCTL_MUX(75, 0) /* PIO2_11 */ #define SCT0_IN0_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN1_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN2_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN3_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN4_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN5_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN6_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SD0_VOLT_PIO2_11 IOPCTL_MUX(75, 1) /* PIO2_11 */ #define CTIMER2_MATCH2_PIO2_12 IOPCTL_MUX(76, 4) /* PIO2_12 */ #define GPIO_PIO212_PIO2_12 IOPCTL_MUX(76, 0) /* PIO2_12 */ #define SCT0_OUT6_PIO2_12 IOPCTL_MUX(76, 2) /* PIO2_12 */ #define CMP0_OUT_PIO2_13 IOPCTL_MUX(77, 7) /* PIO2_13 */ #define CTIMER2_MATCH3_PIO2_13 IOPCTL_MUX(77, 4) /* PIO2_13 */ #define GPIO_PIO213_PIO2_13 IOPCTL_MUX(77, 0) /* PIO2_13 */ #define SCT0_OUT7_PIO2_13 IOPCTL_MUX(77, 2) /* PIO2_13 */ #define CMP_IN1_PIO2_14 IOPCTL_MUX(78, 0) /* PIO2_14 */ #define CTIMER0_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER3_CAPTURE0_PIO2_14 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/* PIO2_17 */ #define FLEXSPI0B_DATA4_PIO2_17 IOPCTL_MUX(81, 6) /* PIO2_17 */ #define GPIO_PIO217_PIO2_17 IOPCTL_MUX(81, 0) /* PIO2_17 */ #define DMIC0_CLK4_5_PIO2_18 IOPCTL_MUX(82, 1) /* PIO2_18 */ #define FLEXSPI0B_DATA5_PIO2_18 IOPCTL_MUX(82, 6) /* PIO2_18 */ #define GPIO_PIO218_PIO2_18 IOPCTL_MUX(82, 0) /* PIO2_18 */ #define DMIC0_CLK6_7_PIO2_19 IOPCTL_MUX(83, 1) /* PIO2_19 */ #define FLEXSPI0B_SS0_N_PIO2_19 IOPCTL_MUX(83, 6) /* PIO2_19 */ #define GPIO_PIO219_PIO2_19 IOPCTL_MUX(83, 0) /* PIO2_19 */ #define DMIC0_DATA0_1_PIO2_20 IOPCTL_MUX(84, 1) /* PIO2_20 */ #define GPIO_PIO220_PIO2_20 IOPCTL_MUX(84, 0) /* PIO2_20 */ #define CTIMER0_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER0_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER0_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER0_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER1_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER1_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER1_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER1_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER2_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER2_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER2_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER2_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER3_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER3_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER3_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER3_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER4_CAPTURE0_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER4_CAPTURE1_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER4_CAPTURE2_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define CTIMER4_CAPTURE3_PIO2_21 IOPCTL_MUX(85, 4) /* PIO2_21 */ #define DMIC0_DATA2_3_PIO2_21 IOPCTL_MUX(85, 1) /* PIO2_21 */ #define FLEXSPI0B_SS1_N_PIO2_21 IOPCTL_MUX(85, 6) /* PIO2_21 */ #define GPIO_PIO221_PIO2_21 IOPCTL_MUX(85, 0) /* PIO2_21 */ #define DMIC0_DATA4_5_PIO2_22 IOPCTL_MUX(86, 1) /* PIO2_22 */ #define FLEXSPI0B_DATA6_PIO2_22 IOPCTL_MUX(86, 6) /* PIO2_22 */ #define GPIO_PIO222_PIO2_22 IOPCTL_MUX(86, 0) /* PIO2_22 */ #define DMIC0_DATA6_7_PIO2_23 IOPCTL_MUX(87, 1) /* PIO2_23 */ #define FLEXSPI0B_DATA7_PIO2_23 IOPCTL_MUX(87, 6) /* PIO2_23 */ #define GPIO_PIO223_PIO2_23 IOPCTL_MUX(87, 0) /* PIO2_23 */ #define GPIO_INT_BMAT_PIO2_24 IOPCTL_MUX(88, 6) /* PIO2_24 */ #define GPIO_PIO224_PIO2_24 IOPCTL_MUX(88, 0) /* PIO2_24 */ #define SWO_PIO2_24 IOPCTL_MUX(88, 1) /* PIO2_24 */ #define GPIO_PIO225_PIO2_25 IOPCTL_MUX(89, 0) /* PIO2_25 */ #define SWCLK_PIO2_25 IOPCTL_MUX(89, 1) /* PIO2_25 */ #define GPIO_PIO226_PIO2_26 IOPCTL_MUX(90, 0) /* PIO2_26 */ #define SWDIO_PIO2_26 IOPCTL_MUX(90, 1) /* PIO2_26 */ #define GPIO_PIO227_PIO2_27 IOPCTL_MUX(91, 0) /* PIO2_27 */ #define USB1_OVERCURRENTN_PIO2_27 IOPCTL_MUX(91, 1) /* PIO2_27 */ #define GPIO_PIO228_PIO2_28 IOPCTL_MUX(92, 0) /* PIO2_28 */ #define USB1_PORTPWRN_PIO2_28 IOPCTL_MUX(92, 1) /* PIO2_28 */ #define CLKOUT_PIO2_29 IOPCTL_MUX(93, 5) /* PIO2_29 */ #define GPIO_PIO229_PIO2_29 IOPCTL_MUX(93, 0) /* PIO2_29 */ #define I3C0_SCL_PIO2_29 IOPCTL_MUX(93, 1) /* PIO2_29 */ #define SCT0_OUT0_PIO2_29 IOPCTL_MUX(93, 2) /* PIO2_29 */ #define CLKIN_PIO2_30 IOPCTL_MUX(94, 5) /* PIO2_30 */ #define CMP0_OUT_PIO2_30 IOPCTL_MUX(94, 7) /* PIO2_30 */ #define GPIO_PIO230_PIO2_30 IOPCTL_MUX(94, 0) /* PIO2_30 */ #define I3C0_SDA_PIO2_30 IOPCTL_MUX(94, 1) /* PIO2_30 */ #define SCT0_OUT3_PIO2_30 IOPCTL_MUX(94, 2) /* PIO2_30 */ #define CMP_IN2_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ #define CTIMER0_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define GPIO_PIO231_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ #define I3C0_PUR_PIO2_31 IOPCTL_MUX(95, 1) /* PIO2_31 */ #define SCT0_OUT7_PIO2_31 IOPCTL_MUX(95, 2) /* PIO2_31 */ #define SWO_PIO2_31 IOPCTL_MUX(95, 5) /* PIO2_31 */ #define UTICK0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 3) /* PIO2_31 */ #endif