/* * NOTE: File generated by gen_soc_headers.py * from MIMXRT595SFFOC/signal_configuration.xml * * Copyright 2022, 2024 NXP * SPDX-License-Identifier: Apache-2.0 */ #ifndef _ZEPHYR_DTS_BINDING_MIMXRT595SFFOC_ #define _ZEPHYR_DTS_BINDING_MIMXRT595SFFOC_ #define IOPCTL_MUX(offset, mux) \ ((((offset) & 0xFFF) << 20) | \ (((mux) & 0xF) << 0)) #define CTIMER0_MATCH0_PIO0_0 IOPCTL_MUX(0, 4) /* PIO0_0 */ #define DMA0_TRIG0_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG10_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG11_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG12_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG13_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG14_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG15_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG16_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG17_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG18_PIO0_0 IOPCTL_MUX(0, 0) /* PIO0_0 */ #define DMA0_TRIG19_PIO0_0 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DMA1_TRIG34_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG35_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG36_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG3_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG4_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG5_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG6_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG7_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG8_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define DMA1_TRIG9_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define GPIO_PIO131_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT0_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT1_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT2_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT3_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT4_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT5_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT6_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define PINT_PINT7_PIO1_31 IOPCTL_MUX(63, 0) /* PIO1_31 */ #define SCT0_IN0_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN1_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN2_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN3_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN4_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN5_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SCT0_IN6_PIO1_31 IOPCTL_MUX(63, 2) /* PIO1_31 */ #define SD0_CMD_PIO1_31 IOPCTL_MUX(63, 1) /* PIO1_31 */ #define GPIO_PIO20_PIO2_0 IOPCTL_MUX(64, 0) /* PIO2_0 */ #define SCT0_IN0_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN1_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN2_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN3_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN4_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN5_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SCT0_IN6_PIO2_0 IOPCTL_MUX(64, 2) /* PIO2_0 */ #define SMARTDMA_SMARTDMA_PIO0_PIO2_0 IOPCTL_MUX(64, 15) /* PIO2_0 */ #define USDHC0_USDHC_DATA0_PIO2_0 IOPCTL_MUX(64, 1) /* PIO2_0 */ #define GPIO_PIO21_PIO2_1 IOPCTL_MUX(65, 0) /* PIO2_1 */ #define SCT0_IN0_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN1_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN2_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN3_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN4_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN5_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SCT0_IN6_PIO2_1 IOPCTL_MUX(65, 2) /* PIO2_1 */ #define SMARTDMA_SMARTDMA_PIO1_PIO2_1 IOPCTL_MUX(65, 15) /* PIO2_1 */ #define USDHC0_USDHC_DATA1_PIO2_1 IOPCTL_MUX(65, 1) /* PIO2_1 */ #define GPIO_PIO22_PIO2_2 IOPCTL_MUX(66, 0) /* PIO2_2 */ #define SCT0_OUT0_PIO2_2 IOPCTL_MUX(66, 2) /* PIO2_2 */ #define SMARTDMA_SMARTDMA_PIO2_PIO2_2 IOPCTL_MUX(66, 15) /* PIO2_2 */ #define USDHC0_USDHC_DATA2_PIO2_2 IOPCTL_MUX(66, 1) /* PIO2_2 */ #define GPIO_PIO23_PIO2_3 IOPCTL_MUX(67, 0) /* PIO2_3 */ #define SCT0_OUT1_PIO2_3 IOPCTL_MUX(67, 2) /* PIO2_3 */ #define SMARTDMA_SMARTDMA_PIO3_PIO2_3 IOPCTL_MUX(67, 15) /* PIO2_3 */ #define USDHC0_USDHC_DATA3_PIO2_3 IOPCTL_MUX(67, 1) /* PIO2_3 */ #define GPIO_PIO24_PIO2_4 IOPCTL_MUX(68, 0) /* PIO2_4 */ #define SCT0_OUT2_PIO2_4 IOPCTL_MUX(68, 2) /* PIO2_4 */ #define SD0_DS_PIO2_4 IOPCTL_MUX(68, 5) /* PIO2_4 */ #define SD0_WR_PRT_PIO2_4 IOPCTL_MUX(68, 1) /* PIO2_4 */ #define SMARTDMA_SMARTDMA_PIO4_PIO2_4 IOPCTL_MUX(68, 15) /* PIO2_4 */ #define FC8_SCK_PIO2_5 IOPCTL_MUX(69, 5) /* PIO2_5 */ #define GPIO_PIO25_PIO2_5 IOPCTL_MUX(69, 0) /* PIO2_5 */ #define SCT0_OUT3_PIO2_5 IOPCTL_MUX(69, 2) /* PIO2_5 */ #define SMARTDMA_SMARTDMA_PIO5_PIO2_5 IOPCTL_MUX(69, 15) /* PIO2_5 */ #define USDHC0_USDHC_DATA4_PIO2_5 IOPCTL_MUX(69, 1) /* PIO2_5 */ #define CTIMER1_MATCH0_PIO2_6 IOPCTL_MUX(70, 4) /* PIO2_6 */ #define FC8_TXD_SCL_MISO_WS_PIO2_6 IOPCTL_MUX(70, 5) /* PIO2_6 */ #define GPIO_PIO26_PIO2_6 IOPCTL_MUX(70, 0) /* PIO2_6 */ #define SCT0_IN0_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN1_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN2_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN3_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN4_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN5_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SCT0_IN6_PIO2_6 IOPCTL_MUX(70, 2) /* PIO2_6 */ #define SMARTDMA_SMARTDMA_PIO6_PIO2_6 IOPCTL_MUX(70, 15) /* PIO2_6 */ #define USDHC0_USDHC_DATA5_PIO2_6 IOPCTL_MUX(70, 1) /* PIO2_6 */ #define CTIMER1_MATCH1_PIO2_7 IOPCTL_MUX(71, 4) /* PIO2_7 */ #define FC8_RXD_SDA_MOSI_DATA_PIO2_7 IOPCTL_MUX(71, 5) /* PIO2_7 */ #define GPIO_PIO27_PIO2_7 IOPCTL_MUX(71, 0) /* PIO2_7 */ #define SCT0_IN0_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN1_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN2_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN3_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN4_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN5_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SCT0_IN6_PIO2_7 IOPCTL_MUX(71, 2) /* PIO2_7 */ #define SMARTDMA_SMARTDMA_PIO7_PIO2_7 IOPCTL_MUX(71, 15) /* PIO2_7 */ #define USDHC0_USDHC_DATA6_PIO2_7 IOPCTL_MUX(71, 1) /* PIO2_7 */ #define CTIMER1_MATCH2_PIO2_8 IOPCTL_MUX(72, 4) /* PIO2_8 */ #define FC8_CTS_SDA_SSEL0_PIO2_8 IOPCTL_MUX(72, 5) /* PIO2_8 */ #define GPIO_PIO28_PIO2_8 IOPCTL_MUX(72, 0) /* PIO2_8 */ #define SCT0_OUT4_PIO2_8 IOPCTL_MUX(72, 2) /* PIO2_8 */ #define SMARTDMA_SMARTDMA_PIO8_PIO2_8 IOPCTL_MUX(72, 15) /* PIO2_8 */ #define USDHC0_USDHC_DATA7_PIO2_8 IOPCTL_MUX(72, 1) /* PIO2_8 */ #define CTIMER1_MATCH3_PIO2_9 IOPCTL_MUX(73, 4) /* PIO2_9 */ #define FC8_CTS_SDA_SSEL1_PIO2_9 IOPCTL_MUX(73, 5) /* PIO2_9 */ #define GPIO_PIO29_PIO2_9 IOPCTL_MUX(73, 0) /* PIO2_9 */ #define SCT0_OUT5_PIO2_9 IOPCTL_MUX(73, 2) /* PIO2_9 */ #define SD0_CARD_DET_N_PIO2_9 IOPCTL_MUX(73, 1) /* PIO2_9 */ #define SMARTDMA_SMARTDMA_PIO9_PIO2_9 IOPCTL_MUX(73, 15) /* PIO2_9 */ #define CTIMER2_MATCH0_PIO2_10 IOPCTL_MUX(74, 4) /* PIO2_10 */ #define FC8_SSEL2_PIO2_10 IOPCTL_MUX(74, 5) /* PIO2_10 */ #define GPIO_PIO210_PIO2_10 IOPCTL_MUX(74, 0) /* PIO2_10 */ #define SCT0_IN0_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN1_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN2_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN3_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN4_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN5_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SCT0_IN6_PIO2_10 IOPCTL_MUX(74, 2) /* PIO2_10 */ #define SD0_RESET_N_PIO2_10 IOPCTL_MUX(74, 1) /* PIO2_10 */ #define SMARTDMA_SMARTDMA_PIO10_PIO2_10 IOPCTL_MUX(74, 15) /* PIO2_10 */ #define CTIMER2_MATCH1_PIO2_11 IOPCTL_MUX(75, 4) /* PIO2_11 */ #define FC8_SSEL3_PIO2_11 IOPCTL_MUX(75, 5) /* PIO2_11 */ #define GPIO_PIO211_PIO2_11 IOPCTL_MUX(75, 0) /* PIO2_11 */ #define SCT0_IN0_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN1_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN2_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN3_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN4_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN5_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SCT0_IN6_PIO2_11 IOPCTL_MUX(75, 2) /* PIO2_11 */ #define SD0_VOLT_PIO2_11 IOPCTL_MUX(75, 1) /* PIO2_11 */ #define SMARTDMA_SMARTDMA_PIO11_PIO2_11 IOPCTL_MUX(75, 15) /* PIO2_11 */ #define ACMP0_ACMP_IN1_PIO2_14 IOPCTL_MUX(78, 0) /* PIO2_14 */ #define CTIMER0_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER0_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER1_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER2_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER3_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER3_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER3_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER3_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER4_CAPTURE0_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER4_CAPTURE1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER4_CAPTURE2_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define CTIMER4_CAPTURE3_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define FLEXIO0_TRIG1_PIO2_14 IOPCTL_MUX(78, 4) /* PIO2_14 */ #define GPIO_PIO214_PIO2_14 IOPCTL_MUX(78, 0) /* PIO2_14 */ #define PIN_32KHZ_CLKOUT_PIO2_14 IOPCTL_MUX(78, 7) /* PIO2_14 */ #define SCT0_OUT8_PIO2_14 IOPCTL_MUX(78, 2) /* PIO2_14 */ #define SMARTDMA_SMARTDMA_PIO14_PIO2_14 IOPCTL_MUX(78, 15) /* PIO2_14 */ #define ACMP0_ACMP_IN4_PIO2_15 IOPCTL_MUX(79, 0) /* PIO2_15 */ #define CLKIN_PIO2_15 IOPCTL_MUX(79, 7) /* PIO2_15 */ #define GPIO_PIO215_PIO2_15 IOPCTL_MUX(79, 0) /* PIO2_15 */ #define SCT0_OUT9_PIO2_15 IOPCTL_MUX(79, 2) /* PIO2_15 */ #define SMARTDMA_SMARTDMA_PIO15_PIO2_15 IOPCTL_MUX(79, 15) /* PIO2_15 */ #define GPIO_INT_BMAT_PIO2_24 IOPCTL_MUX(88, 6) /* PIO2_24 */ #define GPIO_PIO224_PIO2_24 IOPCTL_MUX(88, 0) /* PIO2_24 */ #define SMARTDMA_SMARTDMA_PIO24_PIO2_24 IOPCTL_MUX(88, 15) /* PIO2_24 */ #define SWO_PIO2_24 IOPCTL_MUX(88, 1) /* PIO2_24 */ #define GPIO_PIO225_PIO2_25 IOPCTL_MUX(89, 0) /* PIO2_25 */ #define SMARTDMA_SMARTDMA_PIO25_PIO2_25 IOPCTL_MUX(89, 15) /* PIO2_25 */ #define SWCLK_PIO2_25 IOPCTL_MUX(89, 1) /* PIO2_25 */ #define GPIO_PIO226_PIO2_26 IOPCTL_MUX(90, 0) /* PIO2_26 */ #define SMARTDMA_SMARTDMA_PIO26_PIO2_26 IOPCTL_MUX(90, 15) /* PIO2_26 */ #define SWDIO_PIO2_26 IOPCTL_MUX(90, 1) /* PIO2_26 */ #define GPIO_PIO227_PIO2_27 IOPCTL_MUX(91, 0) /* PIO2_27 */ #define SMARTDMA_SMARTDMA_PIO27_PIO2_27 IOPCTL_MUX(91, 15) /* PIO2_27 */ #define USB1_OVERCURRENTN_PIO2_27 IOPCTL_MUX(91, 1) /* PIO2_27 */ #define GPIO_PIO228_PIO2_28 IOPCTL_MUX(92, 0) /* PIO2_28 */ #define SMARTDMA_SMARTDMA_PIO28_PIO2_28 IOPCTL_MUX(92, 15) /* PIO2_28 */ #define USB1_PORTPWRN_PIO2_28 IOPCTL_MUX(92, 1) /* PIO2_28 */ #define CLKOUT_PIO2_29 IOPCTL_MUX(93, 5) /* PIO2_29 */ #define GPIO_PIO229_PIO2_29 IOPCTL_MUX(93, 0) /* PIO2_29 */ #define I3C0_SCL_PIO2_29 IOPCTL_MUX(93, 1) /* PIO2_29 */ #define SCT0_OUT0_PIO2_29 IOPCTL_MUX(93, 2) /* PIO2_29 */ #define SMARTDMA_SMARTDMA_PIO29_PIO2_29 IOPCTL_MUX(93, 15) /* PIO2_29 */ #define CLKIN_PIO2_30 IOPCTL_MUX(94, 5) /* PIO2_30 */ #define CMP0_OUT_PIO2_30 IOPCTL_MUX(94, 7) /* PIO2_30 */ #define GPIO_PIO230_PIO2_30 IOPCTL_MUX(94, 0) /* PIO2_30 */ #define I3C0_SDA_PIO2_30 IOPCTL_MUX(94, 1) /* PIO2_30 */ #define SCT0_OUT3_PIO2_30 IOPCTL_MUX(94, 2) /* PIO2_30 */ #define SMARTDMA_SMARTDMA_PIO30_PIO2_30 IOPCTL_MUX(94, 15) /* PIO2_30 */ #define ACMP0_ACMP_IN2_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ #define CTIMER0_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER1_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER2_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER3_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE0_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE1_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE2_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define CTIMER4_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 4) /* PIO2_31 */ #define GPIO_PIO231_PIO2_31 IOPCTL_MUX(95, 0) /* PIO2_31 */ #define I3C0_PUR_PIO2_31 IOPCTL_MUX(95, 1) /* PIO2_31 */ #define SCT0_OUT7_PIO2_31 IOPCTL_MUX(95, 2) /* PIO2_31 */ #define SMARTDMA_SMARTDMA_PIO31_PIO2_31 IOPCTL_MUX(95, 15) /* PIO2_31 */ #define SWO_PIO2_31 IOPCTL_MUX(95, 5) /* PIO2_31 */ #define UTICK0_CAPTURE3_PIO2_31 IOPCTL_MUX(95, 3) /* PIO2_31 */ #define DMIC0_CLK23_PIO3_1 IOPCTL_MUX(97, 1) /* PIO3_1 */ #define DMIC0_DATA23_PIO3_1 IOPCTL_MUX(97, 2) /* PIO3_1 */ #define FC0_TXD_SCL_MISO_WS_PIO3_1 IOPCTL_MUX(97, 5) /* PIO3_1 */ #define GPIO_PIO31_PIO3_1 IOPCTL_MUX(97, 0) /* PIO3_1 */ #define I3C1_SCL_PIO3_1 IOPCTL_MUX(97, 6) /* PIO3_1 */ #define DMIC0_CLK45_PIO3_2 IOPCTL_MUX(98, 1) /* PIO3_2 */ #define DMIC0_DATA45_PIO3_2 IOPCTL_MUX(98, 2) /* PIO3_2 */ #define FC0_RXD_SDA_MOSI_DATA_PIO3_2 IOPCTL_MUX(98, 5) /* PIO3_2 */ #define GPIO_PIO32_PIO3_2 IOPCTL_MUX(98, 0) /* PIO3_2 */ #define I3C1_SDA_PIO3_2 IOPCTL_MUX(98, 6) /* PIO3_2 */ #define CMP0_OUT_PIO3_3 IOPCTL_MUX(99, 7) /* PIO3_3 */ #define DMIC0_CLK67_PIO3_3 IOPCTL_MUX(99, 1) /* PIO3_3 */ #define DMIC0_DATA67_PIO3_3 IOPCTL_MUX(99, 2) /* PIO3_3 */ #define FC0_CTS_SDA_SSEL0_PIO3_3 IOPCTL_MUX(99, 5) /* PIO3_3 */ #define GPIO_PIO33_PIO3_3 IOPCTL_MUX(99, 0) /* PIO3_3 */ #define I3C1_PUR_PIO3_3 IOPCTL_MUX(99, 6) /* PIO3_3 */ #define LCDIF_lcdif_data23_PIO3_3 IOPCTL_MUX(99, 3) /* PIO3_3 */ #define CTIMER0_MATCH0_PIO3_8 IOPCTL_MUX(104, 4) /* PIO3_8 */ #define FC10_SCK_PIO3_8 IOPCTL_MUX(104, 6) /* PIO3_8 */ #define GPIO_PIO38_PIO3_8 IOPCTL_MUX(104, 0) /* PIO3_8 */ #define LCDIF_lcdif_data9_PIO3_8 IOPCTL_MUX(104, 2) /* PIO3_8 */ #define SD1_CLK_PIO3_8 IOPCTL_MUX(104, 1) /* PIO3_8 */ #define CTIMER0_MATCH1_PIO3_9 IOPCTL_MUX(105, 4) /* PIO3_9 */ #define FC10_TXD_SCL_MISO_PIO3_9 IOPCTL_MUX(105, 6) /* PIO3_9 */ #define GPIO_PIO39_PIO3_9 IOPCTL_MUX(105, 0) /* PIO3_9 */ #define LCDIF_lcdif_data10_PIO3_9 IOPCTL_MUX(105, 2) /* PIO3_9 */ #define SD1_CMD_PIO3_9 IOPCTL_MUX(105, 1) /* PIO3_9 */ #define CTIMER0_MATCH2_PIO3_10 IOPCTL_MUX(106, 4) /* PIO3_10 */ #define FC10_RXD_SDA_MOSI_PIO3_10 IOPCTL_MUX(106, 6) /* PIO3_10 */ #define GPIO_PIO310_PIO3_10 IOPCTL_MUX(106, 0) /* PIO3_10 */ #define LCDIF_lcdif_data11_PIO3_10 IOPCTL_MUX(106, 2) /* PIO3_10 */ #define USDHC1_USDHC_DATA0_PIO3_10 IOPCTL_MUX(106, 1) /* PIO3_10 */ #define CTIMER0_MATCH3_PIO3_11 IOPCTL_MUX(107, 4) /* PIO3_11 */ #define FC10_CTS_SDA_SSELN0_PIO3_11 IOPCTL_MUX(107, 6) /* PIO3_11 */ #define GPIO_PIO311_PIO3_11 IOPCTL_MUX(107, 0) /* PIO3_11 */ #define LCDIF_lcdif_data12_PIO3_11 IOPCTL_MUX(107, 2) /* PIO3_11 */ #define USDHC1_USDHC_DATA1_PIO3_11 IOPCTL_MUX(107, 1) /* PIO3_11 */ #define CTIMER0_CAPTURE0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER0_CAPTURE1_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER0_CAPTURE2_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER0_CAPTURE3_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER1_CAPTURE0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER1_CAPTURE1_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER1_CAPTURE2_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER1_CAPTURE3_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER2_CAPTURE0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER2_CAPTURE1_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER2_CAPTURE2_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER2_CAPTURE3_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER3_CAPTURE0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER3_CAPTURE1_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER3_CAPTURE2_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER3_CAPTURE3_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER4_CAPTURE0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER4_CAPTURE1_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER4_CAPTURE2_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define CTIMER4_CAPTURE3_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define FC10_RTS_SCL_SSELN1_PIO3_12 IOPCTL_MUX(108, 6) /* PIO3_12 */ #define FLEXIO0_TRIG0_PIO3_12 IOPCTL_MUX(108, 4) /* PIO3_12 */ #define GPIO_PIO312_PIO3_12 IOPCTL_MUX(108, 0) /* PIO3_12 */ #define LCDIF_lcdif_data13_PIO3_12 IOPCTL_MUX(108, 2) /* PIO3_12 */ #define USDHC1_USDHC_DATA2_PIO3_12 IOPCTL_MUX(108, 1) /* PIO3_12 */ #define CTIMER0_CAPTURE0_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER0_CAPTURE1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER0_CAPTURE2_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER0_CAPTURE3_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER1_CAPTURE0_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER1_CAPTURE1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER1_CAPTURE2_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER1_CAPTURE3_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER2_CAPTURE0_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER2_CAPTURE1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER2_CAPTURE2_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER2_CAPTURE3_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER3_CAPTURE0_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER3_CAPTURE1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER3_CAPTURE2_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER3_CAPTURE3_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER4_CAPTURE0_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER4_CAPTURE1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER4_CAPTURE2_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define CTIMER4_CAPTURE3_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define FC10_SSELN2_PIO3_13 IOPCTL_MUX(109, 6) /* PIO3_13 */ #define FLEXIO0_TRIG1_PIO3_13 IOPCTL_MUX(109, 4) /* PIO3_13 */ #define GPIO_PIO313_PIO3_13 IOPCTL_MUX(109, 0) /* PIO3_13 */ #define LCDIF_lcdif_data14_PIO3_13 IOPCTL_MUX(109, 2) /* PIO3_13 */ #define USDHC1_USDHC_DATA3_PIO3_13 IOPCTL_MUX(109, 1) /* PIO3_13 */ #define ACMP0_ACMP_IN5_PIO3_14 IOPCTL_MUX(110, 0) /* PIO3_14 */ #define CTIMER3_MATCH0_PIO3_14 IOPCTL_MUX(110, 4) /* PIO3_14 */ #define FC10_SSELN3_PIO3_14 IOPCTL_MUX(110, 6) /* PIO3_14 */ #define GPIO_PIO314_PIO3_14 IOPCTL_MUX(110, 0) /* PIO3_14 */ #define LCDIF_lcdif_data15_PIO3_14 IOPCTL_MUX(110, 2) /* PIO3_14 */ #define SD1_DS_PIO3_14 IOPCTL_MUX(110, 5) /* PIO3_14 */ #define SD1_WR_PRT_PIO3_14 IOPCTL_MUX(110, 1) /* PIO3_14 */ #define CTIMER3_MATCH1_PIO3_15 IOPCTL_MUX(111, 4) /* PIO3_15 */ #define FC5_SCK_PIO3_15 IOPCTL_MUX(111, 5) /* PIO3_15 */ #define GPIO_PIO315_PIO3_15 IOPCTL_MUX(111, 0) /* PIO3_15 */ #define LCDIF_lcdif_data16_PIO3_15 IOPCTL_MUX(111, 2) /* PIO3_15 */ #define USDHC1_USDHC_DATA4_PIO3_15 IOPCTL_MUX(111, 1) /* PIO3_15 */ #define CTIMER3_MATCH2_PIO3_16 IOPCTL_MUX(112, 4) /* PIO3_16 */ #define FC5_TXD_SCL_MISO_WS_PIO3_16 IOPCTL_MUX(112, 5) /* PIO3_16 */ #define GPIO_PIO316_PIO3_16 IOPCTL_MUX(112, 0) /* PIO3_16 */ #define LCDIF_lcdif_data17_PIO3_16 IOPCTL_MUX(112, 2) /* PIO3_16 */ #define USDHC1_USDHC_DATA5_PIO3_16 IOPCTL_MUX(112, 1) /* PIO3_16 */ #define CTIMER3_MATCH3_PIO3_17 IOPCTL_MUX(113, 4) /* PIO3_17 */ #define FC5_RXD_SDA_MOSI_DATA_PIO3_17 IOPCTL_MUX(113, 5) /* PIO3_17 */ #define GPIO_PIO317_PIO3_17 IOPCTL_MUX(113, 0) /* PIO3_17 */ #define LCDIF_lcdif_data18_PIO3_17 IOPCTL_MUX(113, 2) /* PIO3_17 */ #define USDHC1_USDHC_DATA6_PIO3_17 IOPCTL_MUX(113, 1) /* PIO3_17 */ #define CTIMER4_MATCH0_PIO3_18 IOPCTL_MUX(114, 4) /* PIO3_18 */ #define FC5_CTS_SDA_SSEL0_PIO3_18 IOPCTL_MUX(114, 5) /* PIO3_18 */ #define GPIO_PIO318_PIO3_18 IOPCTL_MUX(114, 0) /* PIO3_18 */ #define LCDIF_lcdif_data19_PIO3_18 IOPCTL_MUX(114, 2) /* PIO3_18 */ #define USDHC1_USDHC_DATA7_PIO3_18 IOPCTL_MUX(114, 1) /* PIO3_18 */ #define CTIMER4_MATCH1_PIO3_19 IOPCTL_MUX(115, 4) /* PIO3_19 */ #define GPIO_PIO319_PIO3_19 IOPCTL_MUX(115, 0) /* PIO3_19 */ #define LCDIF_lcdif_data20_PIO3_19 IOPCTL_MUX(115, 2) /* PIO3_19 */ #define MCLK_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN0_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN1_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN2_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN3_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN4_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN5_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SCT0_IN6_PIO3_19 IOPCTL_MUX(115, 5) /* PIO3_19 */ #define SD1_CARD_DET_N_PIO3_19 IOPCTL_MUX(115, 1) /* PIO3_19 */ #define CTIMER4_MATCH2_PIO3_20 IOPCTL_MUX(116, 4) /* PIO3_20 */ #define GPIO_PIO320_PIO3_20 IOPCTL_MUX(116, 0) /* PIO3_20 */ #define LCDIF_lcdif_data21_PIO3_20 IOPCTL_MUX(116, 2) /* PIO3_20 */ #define SD1_RESET_N_PIO3_20 IOPCTL_MUX(116, 1) /* PIO3_20 */ #define CTIMER4_MATCH3_PIO3_21 IOPCTL_MUX(117, 4) /* PIO3_21 */ #define GPIO_INT_BMAT_PIO3_21 IOPCTL_MUX(117, 6) /* PIO3_21 */ #define GPIO_PIO321_PIO3_21 IOPCTL_MUX(117, 0) /* PIO3_21 */ #define LCDIF_lcdif_data22_PIO3_21 IOPCTL_MUX(117, 2) /* PIO3_21 */ #define SD1_VOLT_PIO3_21 IOPCTL_MUX(117, 1) /* PIO3_21 */ #define FC6_SCK_PIO3_25 IOPCTL_MUX(121, 1) /* PIO3_25 */ #define GPIO_PIO325_PIO3_25 IOPCTL_MUX(121, 0) /* PIO3_25 */ #define FC6_TXD_SCL_MISO_WS_PIO3_26 IOPCTL_MUX(122, 1) /* PIO3_26 */ #define GPIO_PIO326_PIO3_26 IOPCTL_MUX(122, 0) /* PIO3_26 */ #define FC6_RXD_SDA_MOSI_DATA_PIO3_27 IOPCTL_MUX(123, 1) /* PIO3_27 */ #define GPIO_PIO327_PIO3_27 IOPCTL_MUX(123, 0) /* PIO3_27 */ #define FC6_CTS_SDA_SSEL0_PIO3_28 IOPCTL_MUX(124, 1) /* PIO3_28 */ #define GPIO_PIO328_PIO3_28 IOPCTL_MUX(124, 0) /* PIO3_28 */ #define FC6_RTS_SCL_SSEL1_PIO3_29 IOPCTL_MUX(125, 1) /* PIO3_29 */ #define GPIO_PIO329_PIO3_29 IOPCTL_MUX(125, 0) /* PIO3_29 */ #define CLKOUT_PIO4_0 IOPCTL_MUX(128, 7) /* PIO4_0 */ #define FC7_SCK_PIO4_0 IOPCTL_MUX(128, 1) /* PIO4_0 */ #define FREQME_IN0_PIO4_0 IOPCTL_MUX(128, 4) /* PIO4_0 */ #define FREQME_IN1_PIO4_0 IOPCTL_MUX(128, 4) /* PIO4_0 */ #define GPIO_PIO40_PIO4_0 IOPCTL_MUX(128, 0) /* PIO4_0 */ #define CLKIN_PIO4_1 IOPCTL_MUX(129, 7) /* PIO4_1 */ #define FC7_TXD_SCL_MISO_WS_PIO4_1 IOPCTL_MUX(129, 1) /* PIO4_1 */ #define GPIO_PIO41_PIO4_1 IOPCTL_MUX(129, 0) /* PIO4_1 */ #define FC7_RXD_SDA_MOSI_DATA_PIO4_2 IOPCTL_MUX(130, 1) /* PIO4_2 */ #define GPIO_PIO42_PIO4_2 IOPCTL_MUX(130, 0) /* PIO4_2 */ #define FC7_CTS_SDA_SSEL0_PIO4_3 IOPCTL_MUX(131, 1) /* PIO4_3 */ #define GPIO_PIO43_PIO4_3 IOPCTL_MUX(131, 0) /* PIO4_3 */ #define FC1_SCK_PIO4_4 IOPCTL_MUX(132, 5) /* PIO4_4 */ #define FC7_RTS_SCL_SSEL1_PIO4_4 IOPCTL_MUX(132, 1) /* PIO4_4 */ #define GPIO_PIO44_PIO4_4 IOPCTL_MUX(132, 0) /* PIO4_4 */ #define FC1_TXD_SCL_MISO_WS_PIO4_5 IOPCTL_MUX(133, 5) /* PIO4_5 */ #define FC7_SSEL2_PIO4_5 IOPCTL_MUX(133, 1) /* PIO4_5 */ #define GPIO_PIO45_PIO4_5 IOPCTL_MUX(133, 0) /* PIO4_5 */ #define FC1_RXD_SDA_MOSI_DATA_PIO4_6 IOPCTL_MUX(134, 5) /* PIO4_6 */ #define FC7_SSEL3_PIO4_6 IOPCTL_MUX(134, 1) /* PIO4_6 */ #define GPIO_PIO46_PIO4_6 IOPCTL_MUX(134, 0) /* PIO4_6 */ #define FC2_SCK_PIO4_11 IOPCTL_MUX(139, 1) /* PIO4_11 */ #define FLEXSPI1_SCLK_PIO4_11 IOPCTL_MUX(139, 2) /* PIO4_11 */ #define GPIO_PIO411_PIO4_11 IOPCTL_MUX(139, 0) /* PIO4_11 */ #define SD1_CLK_PIO4_11 IOPCTL_MUX(139, 4) /* PIO4_11 */ #define FC2_TXD_SCL_MISO_WS_PIO4_12 IOPCTL_MUX(140, 1) /* PIO4_12 */ #define FLEXSPI1_DATA0_PIO4_12 IOPCTL_MUX(140, 2) /* PIO4_12 */ #define GPIO_PIO412_PIO4_12 IOPCTL_MUX(140, 0) /* PIO4_12 */ #define SD1_CMD_PIO4_12 IOPCTL_MUX(140, 4) /* PIO4_12 */ #define FC2_RXD_SDA_MOSI_DATA_PIO4_13 IOPCTL_MUX(141, 1) /* PIO4_13 */ #define FLEXSPI1_DATA1_PIO4_13 IOPCTL_MUX(141, 2) /* PIO4_13 */ #define GPIO_PIO413_PIO4_13 IOPCTL_MUX(141, 0) /* PIO4_13 */ #define USDHC1_USDHC_DATA0_PIO4_13 IOPCTL_MUX(141, 4) /* PIO4_13 */ #define FC2_CTS_SDA_SSEL0_PIO4_14 IOPCTL_MUX(142, 1) /* PIO4_14 */ #define FLEXSPI1_DATA2_PIO4_14 IOPCTL_MUX(142, 2) /* PIO4_14 */ #define GPIO_PIO414_PIO4_14 IOPCTL_MUX(142, 0) /* PIO4_14 */ #define USDHC1_USDHC_DATA1_PIO4_14 IOPCTL_MUX(142, 4) /* PIO4_14 */ #define FC2_RTS_SCL_SSEL1_PIO4_15 IOPCTL_MUX(143, 1) /* PIO4_15 */ #define FLEXSPI1_DATA3_PIO4_15 IOPCTL_MUX(143, 2) /* PIO4_15 */ #define GPIO_PIO415_PIO4_15 IOPCTL_MUX(143, 0) /* PIO4_15 */ #define USDHC1_USDHC_DATA2_PIO4_15 IOPCTL_MUX(143, 4) /* PIO4_15 */ #define FC2_SSEL2_PIO4_16 IOPCTL_MUX(144, 1) /* PIO4_16 */ #define FLEXSPI1_DQS_PIO4_16 IOPCTL_MUX(144, 2) /* PIO4_16 */ #define GPIO_PIO416_PIO4_16 IOPCTL_MUX(144, 0) /* PIO4_16 */ #define USDHC1_USDHC_DATA3_PIO4_16 IOPCTL_MUX(144, 4) /* PIO4_16 */ #define FC2_SSEL3_PIO4_17 IOPCTL_MUX(145, 1) /* PIO4_17 */ #define FLEXSPI1_SCLK_N_PIO4_17 IOPCTL_MUX(145, 3) /* PIO4_17 */ #define FLEXSPI1_SS1_N_PIO4_17 IOPCTL_MUX(145, 2) /* PIO4_17 */ #define GPIO_PIO417_PIO4_17 IOPCTL_MUX(145, 0) /* PIO4_17 */ #define SD1_WR_PRT_PIO4_17 IOPCTL_MUX(145, 4) /* PIO4_17 */ #define ADC0_CH6_PIO4_18 IOPCTL_MUX(146, 0) /* PIO4_18 */ #define FLEXSPI1_SS0_N_PIO4_18 IOPCTL_MUX(146, 2) /* PIO4_18 */ #define GPIO_PIO418_PIO4_18 IOPCTL_MUX(146, 0) /* PIO4_18 */ #define USDHC1_USDHC_DATA4_PIO4_18 IOPCTL_MUX(146, 4) /* PIO4_18 */ #define DBI_CSX_PIO4_20 IOPCTL_MUX(148, 1) /* PIO4_20 */ #define FC11_SCK_PIO4_20 IOPCTL_MUX(148, 6) /* PIO4_20 */ #define FLEXIO0_IO0_PIO4_20 IOPCTL_MUX(148, 8) /* PIO4_20 */ #define GPIO_PIO420_PIO4_20 IOPCTL_MUX(148, 0) /* PIO4_20 */ #define USDHC1_USDHC_DATA6_PIO4_20 IOPCTL_MUX(148, 4) /* PIO4_20 */ #define DBI_DSX_PIO4_21 IOPCTL_MUX(149, 1) /* PIO4_21 */ #define FC11_TXD_SCL_MISO_PIO4_21 IOPCTL_MUX(149, 6) /* PIO4_21 */ #define FLEXIO0_IO1_PIO4_21 IOPCTL_MUX(149, 8) /* PIO4_21 */ #define GPIO_PIO421_PIO4_21 IOPCTL_MUX(149, 0) /* PIO4_21 */ #define USDHC1_USDHC_DATA7_PIO4_21 IOPCTL_MUX(149, 4) /* PIO4_21 */ #define FC11_RXD_SDA_MOSI_PIO4_22 IOPCTL_MUX(150, 6) /* PIO4_22 */ #define FLEXIO0_IO2_PIO4_22 IOPCTL_MUX(150, 8) /* PIO4_22 */ #define GPIO_PIO422_PIO4_22 IOPCTL_MUX(150, 0) /* PIO4_22 */ #define SD1_CARD_DET_N_PIO4_22 IOPCTL_MUX(150, 4) /* PIO4_22 */ #define DBI_RWDX_PIO4_23 IOPCTL_MUX(151, 1) /* PIO4_23 */ #define FC11_CTS_SDA_SSELN0_PIO4_23 IOPCTL_MUX(151, 6) /* PIO4_23 */ #define FLEXIO0_IO3_PIO4_23 IOPCTL_MUX(151, 8) /* PIO4_23 */ #define GPIO_PIO423_PIO4_23 IOPCTL_MUX(151, 0) /* PIO4_23 */ #define LCD_ENABLE_PIO4_23 IOPCTL_MUX(151, 2) /* PIO4_23 */ #define SD1_RESET_N_PIO4_23 IOPCTL_MUX(151, 4) /* PIO4_23 */ #define TRACECLK_PIO4_23 IOPCTL_MUX(151, 7) /* PIO4_23 */ #define DBI_WRX_PIO4_24 IOPCTL_MUX(152, 1) /* PIO4_24 */ #define FC11_RTS_SCL_SSELN1_PIO4_24 IOPCTL_MUX(152, 6) /* PIO4_24 */ #define FLEXIO0_IO4_PIO4_24 IOPCTL_MUX(152, 8) /* PIO4_24 */ #define GPIO_PIO424_PIO4_24 IOPCTL_MUX(152, 0) /* PIO4_24 */ #define LCD_DTCLK_PIO4_24 IOPCTL_MUX(152, 2) /* PIO4_24 */ #define SD1_VOLT_PIO4_24 IOPCTL_MUX(152, 4) /* PIO4_24 */ #define SWD_TRACEDATA0_PIO4_24 IOPCTL_MUX(152, 7) /* PIO4_24 */ #define DBI_E_PIO4_25 IOPCTL_MUX(153, 1) /* PIO4_25 */ #define FC11_SSELN2_PIO4_25 IOPCTL_MUX(153, 6) /* PIO4_25 */ #define FLEXIO0_IO5_PIO4_25 IOPCTL_MUX(153, 8) /* PIO4_25 */ #define GPIO_PIO425_PIO4_25 IOPCTL_MUX(153, 0) /* PIO4_25 */ #define LCD_HSYNC_PIO4_25 IOPCTL_MUX(153, 2) /* PIO4_25 */ #define SWD_TRACEDATA1_PIO4_25 IOPCTL_MUX(153, 7) /* PIO4_25 */ #define FC11_SSELN3_PIO4_26 IOPCTL_MUX(154, 6) /* PIO4_26 */ #define FLEXIO0_IO6_PIO4_26 IOPCTL_MUX(154, 8) /* PIO4_26 */ #define GPIO_PIO426_PIO4_26 IOPCTL_MUX(154, 0) /* PIO4_26 */ #define LCD_VSYNC_PIO4_26 IOPCTL_MUX(154, 1) /* PIO4_26 */ #define SWD_TRACEDATA2_PIO4_26 IOPCTL_MUX(154, 7) /* PIO4_26 */ #define FLEXIO0_IO7_PIO4_27 IOPCTL_MUX(155, 8) /* PIO4_27 */ #define GPIO_PIO427_PIO4_27 IOPCTL_MUX(155, 0) /* PIO4_27 */ #define LCDIF_dbi_data0_PIO4_27 IOPCTL_MUX(155, 2) /* PIO4_27 */ #define LCDIF_lcdif_data0_PIO4_27 IOPCTL_MUX(155, 1) /* PIO4_27 */ #define SWD_TRACEDATA3_PIO4_27 IOPCTL_MUX(155, 7) /* PIO4_27 */ #define FLEXIO0_IO8_PIO4_28 IOPCTL_MUX(156, 8) /* PIO4_28 */ #define GPIO_PIO428_PIO4_28 IOPCTL_MUX(156, 0) /* PIO4_28 */ #define LCDIF_dbi_data1_PIO4_28 IOPCTL_MUX(156, 2) /* PIO4_28 */ #define LCDIF_lcdif_data1_PIO4_28 IOPCTL_MUX(156, 1) /* PIO4_28 */ #define FC12_SCK_PIO4_29 IOPCTL_MUX(157, 6) /* PIO4_29 */ #define FLEXIO0_IO9_PIO4_29 IOPCTL_MUX(157, 8) /* PIO4_29 */ #define GPIO_PIO429_PIO4_29 IOPCTL_MUX(157, 0) /* PIO4_29 */ #define LCDIF_dbi_data2_PIO4_29 IOPCTL_MUX(157, 2) /* PIO4_29 */ #define LCDIF_lcdif_data2_PIO4_29 IOPCTL_MUX(157, 1) /* PIO4_29 */ #define FC12_TXD_SCL_MISO_PIO4_30 IOPCTL_MUX(158, 6) /* PIO4_30 */ #define FLEXIO0_IO10_PIO4_30 IOPCTL_MUX(158, 8) /* PIO4_30 */ #define GPIO_PIO430_PIO4_30 IOPCTL_MUX(158, 0) /* PIO4_30 */ #define LCDIF_dbi_data3_PIO4_30 IOPCTL_MUX(158, 2) /* PIO4_30 */ #define LCDIF_lcdif_data3_PIO4_30 IOPCTL_MUX(158, 1) /* PIO4_30 */ #define FC12_RXD_SDA_MOSI_PIO4_31 IOPCTL_MUX(159, 6) /* PIO4_31 */ #define FLEXIO0_IO11_PIO4_31 IOPCTL_MUX(159, 8) /* PIO4_31 */ #define GPIO_PIO431_PIO4_31 IOPCTL_MUX(159, 0) /* PIO4_31 */ #define LCDIF_dbi_data4_PIO4_31 IOPCTL_MUX(159, 2) /* PIO4_31 */ #define LCDIF_lcdif_data4_PIO4_31 IOPCTL_MUX(159, 1) /* PIO4_31 */ #define FC12_CTS_SDA_SSELN0_PIO5_0 IOPCTL_MUX(160, 6) /* PIO5_0 */ #define FLEXIO0_IO12_PIO5_0 IOPCTL_MUX(160, 8) /* PIO5_0 */ #define GPIO_PIO50_PIO5_0 IOPCTL_MUX(160, 0) /* PIO5_0 */ #define LCDIF_dbi_data5_PIO5_0 IOPCTL_MUX(160, 2) /* PIO5_0 */ #define LCDIF_lcdif_data5_PIO5_0 IOPCTL_MUX(160, 1) /* PIO5_0 */ #define FC12_RTS_SCL_SSELN1_PIO5_1 IOPCTL_MUX(161, 6) /* PIO5_1 */ #define FLEXIO0_IO13_PIO5_1 IOPCTL_MUX(161, 8) /* PIO5_1 */ #define GPIO_PIO51_PIO5_1 IOPCTL_MUX(161, 0) /* PIO5_1 */ #define LCDIF_dbi_data6_PIO5_1 IOPCTL_MUX(161, 2) /* PIO5_1 */ #define LCDIF_lcdif_data6_PIO5_1 IOPCTL_MUX(161, 1) /* PIO5_1 */ #define FC12_SSELN2_PIO5_2 IOPCTL_MUX(162, 6) /* PIO5_2 */ #define FLEXIO0_IO14_PIO5_2 IOPCTL_MUX(162, 8) /* PIO5_2 */ #define GPIO_PIO52_PIO5_2 IOPCTL_MUX(162, 0) /* PIO5_2 */ #define LCDIF_dbi_data7_PIO5_2 IOPCTL_MUX(162, 2) /* PIO5_2 */ #define LCDIF_lcdif_data7_PIO5_2 IOPCTL_MUX(162, 1) /* PIO5_2 */ #define LOW_FREQ_CLKOUT_PIO5_2 IOPCTL_MUX(162, 7) /* PIO5_2 */ #define FC12_SSELN3_PIO5_3 IOPCTL_MUX(163, 6) /* PIO5_3 */ #define FLEXIO0_IO15_PIO5_3 IOPCTL_MUX(163, 8) /* PIO5_3 */ #define GPIO_PIO53_PIO5_3 IOPCTL_MUX(163, 0) /* PIO5_3 */ #define LCDIF_dbi_data8_PIO5_3 IOPCTL_MUX(163, 2) /* PIO5_3 */ #define LCDIF_lcdif_data8_PIO5_3 IOPCTL_MUX(163, 1) /* PIO5_3 */ #define LOW_FREQ_CLKOUT_N_PIO5_3 IOPCTL_MUX(163, 7) /* PIO5_3 */ #define DMIC0_CLK01_PIO5_4 IOPCTL_MUX(164, 4) /* PIO5_4 */ #define GPIO_PIO54_PIO5_4 IOPCTL_MUX(164, 0) /* PIO5_4 */ #define LCDIF_dbi_data9_PIO5_4 IOPCTL_MUX(164, 2) /* PIO5_4 */ #define LCDIF_lcdif_data9_PIO5_4 IOPCTL_MUX(164, 1) /* PIO5_4 */ #define DMIC0_DATA01_PIO5_8 IOPCTL_MUX(168, 4) /* PIO5_8 */ #define GPIO_PIO58_PIO5_8 IOPCTL_MUX(168, 0) /* PIO5_8 */ #define LCDIF_dbi_data13_PIO5_8 IOPCTL_MUX(168, 2) /* PIO5_8 */ #define LCDIF_lcdif_data13_PIO5_8 IOPCTL_MUX(168, 1) /* PIO5_8 */ #define FC4_CTS_SDA_SSEL0_PIO5_15 IOPCTL_MUX(175, 4) /* PIO5_15 */ #define FLEXSPI1_DATA4_PIO5_15 IOPCTL_MUX(175, 2) /* PIO5_15 */ #define GPIO_PIO515_PIO5_15 IOPCTL_MUX(175, 0) /* PIO5_15 */ #define LCDIF_lcdif_data20_PIO5_15 IOPCTL_MUX(175, 1) /* PIO5_15 */ #define FC4_RTS_SCL_SSEL1_PIO5_16 IOPCTL_MUX(176, 4) /* PIO5_16 */ #define FLEXSPI1_DATA5_PIO5_16 IOPCTL_MUX(176, 2) /* PIO5_16 */ #define GPIO_PIO516_PIO5_16 IOPCTL_MUX(176, 0) /* PIO5_16 */ #define LCDIF_lcdif_data21_PIO5_16 IOPCTL_MUX(176, 1) /* PIO5_16 */ #define FC4_SSEL2_PIO5_17 IOPCTL_MUX(177, 4) /* PIO5_17 */ #define FLEXSPI1_DATA6_PIO5_17 IOPCTL_MUX(177, 2) /* PIO5_17 */ #define GPIO_PIO517_PIO5_17 IOPCTL_MUX(177, 0) /* PIO5_17 */ #define LCDIF_lcdif_data22_PIO5_17 IOPCTL_MUX(177, 1) /* PIO5_17 */ #define FC4_SSEL3_PIO5_18 IOPCTL_MUX(178, 4) /* PIO5_18 */ #define FLEXSPI1_DATA7_PIO5_18 IOPCTL_MUX(178, 2) /* PIO5_18 */ #define GPIO_PIO518_PIO5_18 IOPCTL_MUX(178, 0) /* PIO5_18 */ #define LCDIF_lcdif_data23_PIO5_18 IOPCTL_MUX(178, 1) /* PIO5_18 */ #endif