/* * Copyright 2024 NXP * SPDX-License-Identifier: Apache-2.0 * * Note: File generated by gen_soc_headers.py * from configuration data for MIMX9596AVZXN */ /* * SOC level pinctrl defintions * These definitions define SOC level defaults for each pin, * and select the pinmux for the pin. Pinmux entries are a tuple of: * * the mux_register and input_daisy reside in the IOMUXC peripheral, and * the pinctrl driver will write the mux_mode and input_daisy values into * each register, respectively. The config_register is used to configure * the pin based on the devicetree properties set */ &scmi_iomuxc { /omit-if-no-ref/ iomuxc_ccm_clko1_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko1: IOMUXC_CCM_CLKO1_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO1 { pinmux = <0x443c00a8 0 0x0 0 0x443c02ac>; }; /omit-if-no-ref/ iomuxc_ccm_clko1_flexio_flexio_bit_flexio1_flexio_bit26: IOMUXC_CCM_CLKO1_FLEXIO_FLEXIO_BIT_FLEXIO1_FLEXIO_BIT26 { pinmux = <0x443c00a8 4 0x443c0458 0 0x443c02ac>; }; /omit-if-no-ref/ iomuxc_ccm_clko1_gpio_io_bit_gpio3_io_bit26: IOMUXC_CCM_CLKO1_GPIO_IO_BIT_GPIO3_IO_BIT26 { pinmux = <0x443c00a8 5 0x0 0 0x443c02ac>; }; /omit-if-no-ref/ iomuxc_ccm_clko1_netc_tmr_1588_trig1_netc_tmr_1588_trig1: IOMUXC_CCM_CLKO1_NETC_TMR_1588_TRIG1_NETC_TMR_1588_TRIG1 { pinmux = <0x443c00a8 1 0x443c0434 0 0x443c02ac>; }; /omit-if-no-ref/ iomuxc_ccm_clko2_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko2: IOMUXC_CCM_CLKO2_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO2 { pinmux = <0x443c00ac 0 0x0 0 0x443c02b0>; }; /omit-if-no-ref/ iomuxc_ccm_clko2_flexio_flexio_bit_flexio1_flexio_bit27: IOMUXC_CCM_CLKO2_FLEXIO_FLEXIO_BIT_FLEXIO1_FLEXIO_BIT27 { pinmux = <0x443c00ac 4 0x443c045c 0 0x443c02b0>; }; /omit-if-no-ref/ iomuxc_ccm_clko2_gpio_io_bit_gpio3_io_bit27: IOMUXC_CCM_CLKO2_GPIO_IO_BIT_GPIO3_IO_BIT27 { pinmux = <0x443c00ac 5 0x0 0 0x443c02b0>; }; /omit-if-no-ref/ iomuxc_ccm_clko2_netc_tmr_1588_pp1_netc_tmr_1588_pp1: IOMUXC_CCM_CLKO2_NETC_TMR_1588_PP1_NETC_TMR_1588_PP1 { pinmux = <0x443c00ac 1 0x0 0 0x443c02b0>; }; /omit-if-no-ref/ iomuxc_ccm_clko3_can_tx_can3_tx: IOMUXC_CCM_CLKO3_CAN_TX_CAN3_TX { pinmux = <0x443c00b0 2 0x0 0 0x443c02b4>; }; /omit-if-no-ref/ iomuxc_ccm_clko3_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko3: IOMUXC_CCM_CLKO3_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO3 { pinmux = <0x443c00b0 0 0x0 0 0x443c02b4>; }; /omit-if-no-ref/ iomuxc_ccm_clko3_flexio_flexio_bit_flexio2_flexio_bit28: IOMUXC_CCM_CLKO3_FLEXIO_FLEXIO_BIT_FLEXIO2_FLEXIO_BIT28 { pinmux = <0x443c00b0 4 0x0 0 0x443c02b4>; }; /omit-if-no-ref/ iomuxc_ccm_clko3_gpio_io_bit_gpio4_io_bit28: IOMUXC_CCM_CLKO3_GPIO_IO_BIT_GPIO4_IO_BIT28 { pinmux = <0x443c00b0 5 0x0 0 0x443c02b4>; }; /omit-if-no-ref/ iomuxc_ccm_clko3_netc_tmr_1588_trig2_netc_tmr_1588_trig2: IOMUXC_CCM_CLKO3_NETC_TMR_1588_TRIG2_NETC_TMR_1588_TRIG2 { pinmux = <0x443c00b0 1 0x443c0438 0 0x443c02b4>; }; /omit-if-no-ref/ iomuxc_ccm_clko4_can_rx_can3_rx: IOMUXC_CCM_CLKO4_CAN_RX_CAN3_RX { pinmux = <0x443c00b4 2 0x443c0448 0 0x443c02b8>; }; /omit-if-no-ref/ iomuxc_ccm_clko4_ccmsrcgpcmix_clko_ccmsrcgpcmix_clko4: IOMUXC_CCM_CLKO4_CCMSRCGPCMIX_CLKO_CCMSRCGPCMIX_CLKO4 { pinmux = <0x443c00b4 0 0x0 0 0x443c02b8>; }; /omit-if-no-ref/ iomuxc_ccm_clko4_flexio_flexio_bit_flexio2_flexio_bit29: IOMUXC_CCM_CLKO4_FLEXIO_FLEXIO_BIT_FLEXIO2_FLEXIO_BIT29 { pinmux = <0x443c00b4 4 0x0 0 0x443c02b8>; }; /omit-if-no-ref/ iomuxc_ccm_clko4_gpio_io_bit_gpio4_io_bit29: IOMUXC_CCM_CLKO4_GPIO_IO_BIT_GPIO4_IO_BIT29 { pinmux = <0x443c00b4 5 0x0 0 0x443c02b8>; }; /omit-if-no-ref/ iomuxc_ccm_clko4_netc_tmr_1588_pp2_netc_tmr_1588_pp2: IOMUXC_CCM_CLKO4_NETC_TMR_1588_PP2_NETC_TMR_1588_PP2 { pinmux = <0x443c00b4 1 0x0 0 0x443c02b8>; }; /omit-if-no-ref/ iomuxc_dap_tclk_swclk_can_rx_can4_rx: IOMUXC_DAP_TCLK_SWCLK_CAN_RX_CAN4_RX { pinmux = <0x443c0008 2 0x443c044c 0 0x443c020c>; }; /omit-if-no-ref/ iomuxc_dap_tclk_swclk_flexio_flexio_bit_flexio1_flexio_bit30: IOMUXC_DAP_TCLK_SWCLK_FLEXIO_FLEXIO_BIT_FLEXIO1_FLEXIO_BIT30 { pinmux = <0x443c0008 4 0x443c0460 0 0x443c020c>; }; /omit-if-no-ref/ iomuxc_dap_tclk_swclk_gpio_io_bit_gpio3_io_bit30: IOMUXC_DAP_TCLK_SWCLK_GPIO_IO_BIT_GPIO3_IO_BIT30 { pinmux = <0x443c0008 5 0x0 0 0x443c020c>; }; /omit-if-no-ref/ iomuxc_dap_tclk_swclk_jtag_mux_tck_jtag_mux_tck: IOMUXC_DAP_TCLK_SWCLK_JTAG_MUX_TCK_JTAG_MUX_TCK { pinmux = <0x443c0008 0 0x443c060c 0 0x443c020c>; }; /omit-if-no-ref/ iomuxc_dap_tclk_swclk_lpuart_cts_b_lpuart5_cts_b: IOMUXC_DAP_TCLK_SWCLK_LPUART_CTS_B_LPUART5_CTS_B { pinmux = <0x443c0008 6 0x443c056c 0 0x443c020c>; }; /omit-if-no-ref/ iomuxc_dap_tdi_can_tx_can2_tx: IOMUXC_DAP_TDI_CAN_TX_CAN2_TX { pinmux = <0x443c0000 3 0x0 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_flexio_flexio_bit_flexio2_flexio_bit30: IOMUXC_DAP_TDI_FLEXIO_FLEXIO_BIT_FLEXIO2_FLEXIO_BIT30 { pinmux = <0x443c0000 4 0x0 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_gpio_io_bit_gpio3_io_bit28: IOMUXC_DAP_TDI_GPIO_IO_BIT_GPIO3_IO_BIT28 { pinmux = <0x443c0000 5 0x0 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_jtag_mux_tdi_jtag_mux_tdi: IOMUXC_DAP_TDI_JTAG_MUX_TDI_JTAG_MUX_TDI { pinmux = <0x443c0000 0 0x443c0610 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_lpuart_rx_lpuart5_rx: IOMUXC_DAP_TDI_LPUART_RX_LPUART5_RX { pinmux = <0x443c0000 6 0x443c0570 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_mqs_left_mqs2_left: IOMUXC_DAP_TDI_MQS_LEFT_MQS2_LEFT { pinmux = <0x443c0000 1 0x0 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdi_netc_tmr_1588_alarm1_netc_tmr_1588_alarm1: IOMUXC_DAP_TDI_NETC_TMR_1588_ALARM1_NETC_TMR_1588_ALARM1 { pinmux = <0x443c0000 2 0x0 0 0x443c0204>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_can_rx_can2_rx: IOMUXC_DAP_TDO_TRACESWO_CAN_RX_CAN2_RX { pinmux = <0x443c000c 3 0x443c0444 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_flexio_flexio_bit_flexio1_flexio_bit31: IOMUXC_DAP_TDO_TRACESWO_FLEXIO_FLEXIO_BIT_FLEXIO1_FLEXIO_BIT31 { pinmux = <0x443c000c 4 0x443c0464 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_gpio_io_bit_gpio3_io_bit31: IOMUXC_DAP_TDO_TRACESWO_GPIO_IO_BIT_GPIO3_IO_BIT31 { pinmux = <0x443c000c 5 0x0 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_jtag_mux_tdo_jtag_mux_tdo: IOMUXC_DAP_TDO_TRACESWO_JTAG_MUX_TDO_JTAG_MUX_TDO { pinmux = <0x443c000c 0 0x0 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_lpuart_tx_lpuart5_tx: IOMUXC_DAP_TDO_TRACESWO_LPUART_TX_LPUART5_TX { pinmux = <0x443c000c 6 0x443c0574 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_mqs_right_mqs2_right: IOMUXC_DAP_TDO_TRACESWO_MQS_RIGHT_MQS2_RIGHT { pinmux = <0x443c000c 1 0x0 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tdo_traceswo_netc_tmr_1588_alarm2_netc_tmr_1588_alarm2: IOMUXC_DAP_TDO_TRACESWO_NETC_TMR_1588_ALARM2_NETC_TMR_1588_ALARM2 { pinmux = <0x443c000c 2 0x0 0 0x443c0210>; }; /omit-if-no-ref/ iomuxc_dap_tms_swdio_can_tx_can4_tx: IOMUXC_DAP_TMS_SWDIO_CAN_TX_CAN4_TX { pinmux = <0x443c0004 2 0x0 0 0x443c0208>; }; /omit-if-no-ref/ iomuxc_dap_tms_swdio_flexio_flexio_bit_flexio2_flexio_bit31: IOMUXC_DAP_TMS_SWDIO_FLEXIO_FLEXIO_BIT_FLEXIO2_FLEXIO_BIT31 { pinmux = <0x443c0004 4 0x0 0 0x443c0208>; }; /omit-if-no-ref/ iomuxc_dap_tms_swdio_gpio_io_bit_gpio3_io_bit29: IOMUXC_DAP_TMS_SWDIO_GPIO_IO_BIT_GPIO3_IO_BIT29 { pinmux = <0x443c0004 5 0x0 0 0x443c0208>; }; /omit-if-no-ref/ iomuxc_dap_tms_swdio_jtag_mux_tms_jtag_mux_tms: IOMUXC_DAP_TMS_SWDIO_JTAG_MUX_TMS_JTAG_MUX_TMS { pinmux = <0x443c0004 0 0x443c0614 0 0x443c0208>; }; /omit-if-no-ref/ iomuxc_dap_tms_swdio_lpuart_rts_b_lpuart5_rts_b: IOMUXC_DAP_TMS_SWDIO_LPUART_RTS_B_LPUART5_RTS_B { pinmux = <0x443c0004 6 0x0 0 0x443c0208>; }; /omit-if-no-ref/ iomuxc_enet1_mdc_flexio_flexio_bit_flexio2_flexio_bit0: IOMUXC_ENET1_MDC_FLEXIO_FLEXIO_BIT_FLEXIO2_FLEXIO_BIT0 { pinmux = <0x443c00b8 4 0x0 0 0x443c02bc>; }; /omit-if-no-ref/ iomuxc_enet1_mdc_gpio_io_bit_gpio4_io_bit0: IOMUXC_ENET1_MDC_GPIO_IO_BIT_GPIO4_IO_BIT0 { pinmux = <0x443c00b8 5 0x0 0 0x443c02bc>; }; /omit-if-no-ref/ iomuxc_enet1_mdc_i3c_scl_i3c2_scl: IOMUXC_ENET1_MDC_I3C_SCL_I3C2_SCL { pinmux = <0x443c00b8 2 0x443c04f8 0 0x443c02bc>; }; /omit-if-no-ref/ iomuxc_enet1_mdc_lpuart_dcd_b_lpuart3_dcd_b: IOMUXC_ENET1_MDC_LPUART_DCD_B_LPUART3_DCD_B { pinmux = <0x443c00b8 1 0x0 0 0x443c02bc>; }; /omit-if-no-ref/ iomuxc_enet1_mdc_netc_mdc_netc_mdc: IOMUXC_ENET1_MDC_NETC_MDC_NETC_MDC { pinmux = <0x443c00b8 0 0x443c0424 0 0x443c02bc>; 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