/* * Copyright (c) 2022, NXP * SPDX-License-Identifier: Apache-2.0 * * Note: File generated by rt_cfg_utils.py * from configuration data for MIMXRT1062CVJ5A */ /* * SOC level pinctrl defintions * These definitions define SOC level defaults for each pin, * and select the pinmux for the pin. Pinmux entries are a tuple of: * * the mux_register and input_daisy reside in the IOMUXC peripheral, and * the pinctrl driver will write the mux_mode and input_daisy values into * each register, respectively. The config_register is used to configure * the pin based on the devicetree properties set */ /* * NOTE: file fixup performed by rt_fixup_pinmux.py * to correct missing daisy register values */ &iomuxc { /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_acmp1_in4: IOMUXC_GPIO_AD_B0_00_ACMP1_IN4 { pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_flexpwm2_pwma3: IOMUXC_GPIO_AD_B0_00_FLEXPWM2_PWMA3 { pinmux = <0x401f80bc 0 0x401f8474 2 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpio1_io00: IOMUXC_GPIO_AD_B0_00_GPIO1_IO00 { pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; gpr = <0x400ac068 0x0 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_gpio6_io00: IOMUXC_GPIO_AD_B0_00_GPIO6_IO00 { pinmux = <0x401f80bc 5 0x0 0 0x401f82ac>; gpr = <0x400ac068 0x0 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_lpi2c1_scls: IOMUXC_GPIO_AD_B0_00_LPI2C1_SCLS { pinmux = <0x401f80bc 4 0x0 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_lpspi3_sck: IOMUXC_GPIO_AD_B0_00_LPSPI3_SCK { pinmux = <0x401f80bc 7 0x401f8510 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_ref_32k_out: IOMUXC_GPIO_AD_B0_00_REF_32K_OUT { pinmux = <0x401f80bc 2 0x0 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_usb_otg2_id: IOMUXC_GPIO_AD_B0_00_USB_OTG2_ID { pinmux = <0x401f80bc 3 0x401f83f8 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_usdhc1_reset_b: IOMUXC_GPIO_AD_B0_00_USDHC1_RESET_B { pinmux = <0x401f80bc 6 0x0 0 0x401f82ac>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_xbar1_xbar_in14: IOMUXC_GPIO_AD_B0_00_XBAR1_XBAR_IN14 { pinmux = <0x401f80bc 1 0x401f8644 0 0x401f82ac>; gpr = <0x400ac018 0x1a 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_00_xbar1_xbar_inout14: IOMUXC_GPIO_AD_B0_00_XBAR1_XBAR_INOUT14 { pinmux = <0x401f80bc 1 0x401f8644 0 0x401f82ac>; gpr = <0x400ac018 0x1a 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_acmp2_in4: IOMUXC_GPIO_AD_B0_01_ACMP2_IN4 { pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_ewm_out_b: IOMUXC_GPIO_AD_B0_01_EWM_OUT_B { pinmux = <0x401f80c0 6 0x0 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_flexpwm2_pwmb3: IOMUXC_GPIO_AD_B0_01_FLEXPWM2_PWMB3 { pinmux = <0x401f80c0 0 0x401f8484 2 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpio1_io01: IOMUXC_GPIO_AD_B0_01_GPIO1_IO01 { pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; gpr = <0x400ac068 0x1 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_gpio6_io01: IOMUXC_GPIO_AD_B0_01_GPIO6_IO01 { pinmux = <0x401f80c0 5 0x0 0 0x401f82b0>; gpr = <0x400ac068 0x1 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_lpi2c1_sdas: IOMUXC_GPIO_AD_B0_01_LPI2C1_SDAS { pinmux = <0x401f80c0 4 0x0 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_lpspi3_sdo: IOMUXC_GPIO_AD_B0_01_LPSPI3_SDO { pinmux = <0x401f80c0 7 0x401f8518 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_ref_24m_out: IOMUXC_GPIO_AD_B0_01_REF_24M_OUT { pinmux = <0x401f80c0 2 0x0 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_usb_otg1_id: IOMUXC_GPIO_AD_B0_01_USB_OTG1_ID { pinmux = <0x401f80c0 3 0x401f83f4 0 0x401f82b0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_01_xbar1_xbar_in15: IOMUXC_GPIO_AD_B0_01_XBAR1_XBAR_IN15 { pinmux = <0x401f80c0 1 0x401f8648 0 0x401f82b0>; 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}; /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_lpspi3_sdi: IOMUXC_GPIO_AD_B0_02_LPSPI3_SDI { pinmux = <0x401f80c4 7 0x401f8514 0 0x401f82b4>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_lpuart6_tx: IOMUXC_GPIO_AD_B0_02_LPUART6_TX { pinmux = <0x401f80c4 2 0x401f8554 1 0x401f82b4>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_usb_otg1_pwr: IOMUXC_GPIO_AD_B0_02_USB_OTG1_PWR { pinmux = <0x401f80c4 3 0x0 0 0x401f82b4>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_xbar1_xbar_in16: IOMUXC_GPIO_AD_B0_02_XBAR1_XBAR_IN16 { pinmux = <0x401f80c4 1 0x401f864c 0 0x401f82b4>; gpr = <0x400ac018 0x1c 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_02_xbar1_xbar_inout16: IOMUXC_GPIO_AD_B0_02_XBAR1_XBAR_INOUT16 { pinmux = <0x401f80c4 1 0x401f864c 0 0x401f82b4>; gpr = <0x400ac018 0x1c 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_acmp4_in4: IOMUXC_GPIO_AD_B0_03_ACMP4_IN4 { pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_flexcan2_rx: IOMUXC_GPIO_AD_B0_03_FLEXCAN2_RX { pinmux = <0x401f80c8 0 0x401f8450 1 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_flexpwm1_pwmx1: IOMUXC_GPIO_AD_B0_03_FLEXPWM1_PWMX1 { pinmux = <0x401f80c8 4 0x0 0 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_gpio1_io03: IOMUXC_GPIO_AD_B0_03_GPIO1_IO03 { pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; gpr = <0x400ac068 0x3 0x0>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_gpio6_io03: IOMUXC_GPIO_AD_B0_03_GPIO6_IO03 { pinmux = <0x401f80c8 5 0x0 0 0x401f82b8>; gpr = <0x400ac068 0x3 0x1>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_lpspi3_pcs0: IOMUXC_GPIO_AD_B0_03_LPSPI3_PCS0 { pinmux = <0x401f80c8 7 0x401f850c 0 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_lpuart6_rx: IOMUXC_GPIO_AD_B0_03_LPUART6_RX { pinmux = <0x401f80c8 2 0x401f8550 1 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_ref_24m_out: IOMUXC_GPIO_AD_B0_03_REF_24M_OUT { pinmux = <0x401f80c8 6 0x0 0 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_usb_otg1_oc: IOMUXC_GPIO_AD_B0_03_USB_OTG1_OC { pinmux = <0x401f80c8 3 0x401f85d0 0 0x401f82b8>; }; /omit-if-no-ref/ iomuxc_gpio_ad_b0_03_xbar1_xbar_in17: IOMUXC_GPIO_AD_B0_03_XBAR1_XBAR_IN17 { pinmux = <0x401f80c8 1 0x401f862c 1 0x401f82b8>; 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