/* * Copyright (c) 2022, NXP * SPDX-License-Identifier: Apache-2.0 * * Note: File generated by imx_cfg_utils.py * from configuration data for MIMX8MM6DVTLZ */ /* * SOC level pinctrl defintions * These definitions define SOC level defaults for each pin, * and select the pinmux for the pin. Pinmux entries are a tuple of: * * the mux_register and input_daisy reside in the IOMUXC peripheral, and * the pinctrl driver will write the mux_mode and input_daisy values into * each register, respectively. The config_register is used to configure * the pin based on the devicetree properties set */ &iomuxc { /omit-if-no-ref/ iomuxc_boot_mode0_src_boot_mode_src_boot_mode0: IOMUXC_BOOT_MODE0_SRC_BOOT_MODE_SRC_BOOT_MODE0 { pinmux = <0x0 0 0x0 0 0x30330258>; }; /omit-if-no-ref/ iomuxc_boot_mode1_src_boot_mode_src_boot_mode1: IOMUXC_BOOT_MODE1_SRC_BOOT_MODE_SRC_BOOT_MODE1 { pinmux = <0x0 0 0x0 0 0x3033025c>; }; /omit-if-no-ref/ iomuxc_ecspi1_miso_ecspi_miso_ecspi1_miso: IOMUXC_ECSPI1_MISO_ECSPI_MISO_ECSPI1_MISO { pinmux = <0x303301fc 0 0x0 0 0x30330464>; }; /omit-if-no-ref/ iomuxc_ecspi1_miso_gpio_io_gpio5_io08: IOMUXC_ECSPI1_MISO_GPIO_IO_GPIO5_IO08 { pinmux = <0x303301fc 5 0x0 0 0x30330464>; }; /omit-if-no-ref/ iomuxc_ecspi1_miso_uart_cts_b_uart3_cts_b: IOMUXC_ECSPI1_MISO_UART_CTS_B_UART3_CTS_B { pinmux = <0x303301fc 1 0x0 0 0x30330464>; }; /omit-if-no-ref/ iomuxc_ecspi1_miso_uart_rts_b_uart3_cts_b: IOMUXC_ECSPI1_MISO_UART_RTS_B_UART3_CTS_B { pinmux = <0x303301fc 1 0x30330500 0 0x30330464>; }; /omit-if-no-ref/ iomuxc_ecspi1_mosi_ecspi_mosi_ecspi1_mosi: IOMUXC_ECSPI1_MOSI_ECSPI_MOSI_ECSPI1_MOSI { pinmux = <0x303301f8 0 0x0 0 0x30330460>; }; /omit-if-no-ref/ iomuxc_ecspi1_mosi_gpio_io_gpio5_io07: IOMUXC_ECSPI1_MOSI_GPIO_IO_GPIO5_IO07 { pinmux = <0x303301f8 5 0x0 0 0x30330460>; }; /omit-if-no-ref/ iomuxc_ecspi1_mosi_uart_rx_uart3_tx: IOMUXC_ECSPI1_MOSI_UART_RX_UART3_TX { pinmux = <0x303301f8 1 0x30330504 1 0x30330460>; }; /omit-if-no-ref/ iomuxc_ecspi1_mosi_uart_tx_uart3_tx: IOMUXC_ECSPI1_MOSI_UART_TX_UART3_TX { pinmux = <0x303301f8 1 0x0 0 0x30330460>; }; /omit-if-no-ref/ iomuxc_ecspi1_sclk_ecspi_sclk_ecspi1_sclk: IOMUXC_ECSPI1_SCLK_ECSPI_SCLK_ECSPI1_SCLK { pinmux = <0x303301f4 0 0x0 0 0x3033045c>; }; /omit-if-no-ref/ iomuxc_ecspi1_sclk_gpio_io_gpio5_io06: IOMUXC_ECSPI1_SCLK_GPIO_IO_GPIO5_IO06 { pinmux = <0x303301f4 5 0x0 0 0x3033045c>; }; /omit-if-no-ref/ iomuxc_ecspi1_sclk_uart_rx_uart3_rx: IOMUXC_ECSPI1_SCLK_UART_RX_UART3_RX { pinmux = <0x303301f4 1 0x30330504 0 0x3033045c>; }; /omit-if-no-ref/ iomuxc_ecspi1_sclk_uart_tx_uart3_rx: IOMUXC_ECSPI1_SCLK_UART_TX_UART3_RX { pinmux = <0x303301f4 1 0x0 0 0x3033045c>; }; /omit-if-no-ref/ iomuxc_ecspi1_ss0_ecspi_ss_ecspi1_ss0: IOMUXC_ECSPI1_SS0_ECSPI_SS_ECSPI1_SS0 { pinmux = <0x30330200 0 0x0 0 0x30330468>; }; /omit-if-no-ref/ iomuxc_ecspi1_ss0_gpio_io_gpio5_io09: IOMUXC_ECSPI1_SS0_GPIO_IO_GPIO5_IO09 { pinmux = <0x30330200 5 0x0 0 0x30330468>; }; /omit-if-no-ref/ iomuxc_ecspi1_ss0_uart_cts_b_uart3_rts_b: IOMUXC_ECSPI1_SS0_UART_CTS_B_UART3_RTS_B { pinmux = <0x30330200 1 0x0 0 0x30330468>; }; /omit-if-no-ref/ iomuxc_ecspi1_ss0_uart_rts_b_uart3_rts_b: IOMUXC_ECSPI1_SS0_UART_RTS_B_UART3_RTS_B { pinmux = <0x30330200 1 0x30330500 1 0x30330468>; }; /omit-if-no-ref/ iomuxc_ecspi2_miso_ecspi_miso_ecspi2_miso: IOMUXC_ECSPI2_MISO_ECSPI_MISO_ECSPI2_MISO { pinmux = <0x3033020c 0 0x0 0 0x30330474>; }; /omit-if-no-ref/ iomuxc_ecspi2_miso_gpio_io_gpio5_io12: IOMUXC_ECSPI2_MISO_GPIO_IO_GPIO5_IO12 { pinmux = <0x3033020c 5 0x0 0 0x30330474>; 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}; /omit-if-no-ref/ iomuxc_enet_rd1_gpio_io_gpio1_io27: IOMUXC_ENET_RD1_GPIO_IO_GPIO1_IO27 { pinmux = <0x30330094 5 0x0 0 0x303302fc>; }; /omit-if-no-ref/ iomuxc_enet_rd2_enet_rgmii_rd_enet1_rgmii_rd2: IOMUXC_ENET_RD2_ENET_RGMII_RD_ENET1_RGMII_RD2 { pinmux = <0x30330098 0 0x0 0 0x30330300>; }; /omit-if-no-ref/ iomuxc_enet_rd2_gpio_io_gpio1_io28: IOMUXC_ENET_RD2_GPIO_IO_GPIO1_IO28 { pinmux = <0x30330098 5 0x0 0 0x30330300>; }; /omit-if-no-ref/ iomuxc_enet_rd3_enet_rgmii_rd_enet1_rgmii_rd3: IOMUXC_ENET_RD3_ENET_RGMII_RD_ENET1_RGMII_RD3 { pinmux = <0x3033009c 0 0x0 0 0x30330304>; }; /omit-if-no-ref/ iomuxc_enet_rd3_gpio_io_gpio1_io29: IOMUXC_ENET_RD3_GPIO_IO_GPIO1_IO29 { pinmux = <0x3033009c 5 0x0 0 0x30330304>; }; /omit-if-no-ref/ iomuxc_enet_rxc_enet_rgmii_rxc_enet1_rgmii_rxc: IOMUXC_ENET_RXC_ENET_RGMII_RXC_ENET1_RGMII_RXC { pinmux = <0x3033008c 0 0x0 0 0x303302f4>; }; /omit-if-no-ref/ iomuxc_enet_rxc_enet_rx_er_enet1_rx_er: IOMUXC_ENET_RXC_ENET_RX_ER_ENET1_RX_ER { pinmux = <0x3033008c 1 0x0 0 0x303302f4>; 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