/* * Copyright (c) 2019, Linaro * Copyright (c) 2022, NXP * * SPDX-License-Identifier: Apache-2.0 */ #include &flexspi2 { status = "okay"; reg = <0x402a4000 0x4000>, <0x70000000 DT_SIZE_M(4)>; /* WINBOND */ w25q32jvwj0: w25q32jvwj@0 { compatible = "nxp,imx-flexspi-nor"; size = <33554432>; reg = <0>; spi-max-frequency = <133000000>; status = "okay"; jedec-id = [ef 40 16]; erase-block-size = <4096>; write-block-size = <1>; }; }; /* * GPIO pinmux options. These options define the pinmux settings * for GPIO ports on the package, so that the GPIO driver can * select GPIO mux options during GPIO configuration. */ &gpio1{ pinmux = <&iomuxc_gpio_ad_b0_00_gpio1_io00>, <&iomuxc_gpio_ad_b0_01_gpio1_io01>, <&iomuxc_gpio_ad_b0_02_gpio1_io02>, <&iomuxc_gpio_ad_b0_03_gpio1_io03>, <&iomuxc_gpio_ad_b0_04_gpio1_io04>, <&iomuxc_gpio_ad_b0_05_gpio1_io05>, <&iomuxc_gpio_ad_b0_06_gpio1_io06>, <&iomuxc_gpio_ad_b0_07_gpio1_io07>, <&iomuxc_gpio_ad_b0_08_gpio1_io08>, <&iomuxc_gpio_ad_b0_09_gpio1_io09>, <&iomuxc_gpio_ad_b0_10_gpio1_io10>, <&iomuxc_gpio_ad_b0_11_gpio1_io11>, <&iomuxc_gpio_ad_b0_12_gpio1_io12>, <&iomuxc_gpio_ad_b0_13_gpio1_io13>, <&iomuxc_gpio_ad_b0_14_gpio1_io14>, <&iomuxc_gpio_ad_b0_15_gpio1_io15>, <&iomuxc_gpio_ad_b1_00_gpio1_io16>, <&iomuxc_gpio_ad_b1_01_gpio1_io17>, <&iomuxc_gpio_ad_b1_02_gpio1_io18>, <&iomuxc_gpio_ad_b1_03_gpio1_io19>, <&iomuxc_gpio_ad_b1_04_gpio1_io20>, <&iomuxc_gpio_ad_b1_05_gpio1_io21>, <&iomuxc_gpio_ad_b1_06_gpio1_io22>, <&iomuxc_gpio_ad_b1_07_gpio1_io23>, <&iomuxc_gpio_ad_b1_08_gpio1_io24>, <&iomuxc_gpio_ad_b1_09_gpio1_io25>, <&iomuxc_gpio_ad_b1_10_gpio1_io26>, <&iomuxc_gpio_ad_b1_11_gpio1_io27>, <&iomuxc_gpio_ad_b1_12_gpio1_io28>, <&iomuxc_gpio_ad_b1_13_gpio1_io29>, <&iomuxc_gpio_ad_b1_14_gpio1_io30>, <&iomuxc_gpio_ad_b1_15_gpio1_io31>; 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