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26 #define GPIO_CONTROL(gpio) (0x00000100 + ((gpio) << 2)) macro120 val = readl(reg_base + GPIO_CONTROL(gpio)) & GPIO_GPCTR0_IOTR_MASK; in bcm_kona_gpio_get_dir()204 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_input()207 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_input()228 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_output()231 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_output()284 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_set_debounce()295 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_set_debounce()429 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_irq_set_type()432 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_irq_set_type()
