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34 #define GPIO_CONTROL(gpio) (0x00000100 + ((gpio) << 2)) macro128 val = readl(reg_base + GPIO_CONTROL(gpio)) & GPIO_GPCTR0_IOTR_MASK; in bcm_kona_gpio_get_dir()212 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_input()215 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_input()236 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_output()239 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_direction_output()292 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_set_debounce()303 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_set_debounce()437 val = readl(reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_irq_set_type()440 writel(val, reg_base + GPIO_CONTROL(gpio)); in bcm_kona_gpio_irq_set_type()
