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82 …_parameters(smu, pcie_gen_cap, pcie_width_cap) smu_ppt_funcs(update_pcie_parameters, 0, smu, pcie_… argument
300 uint32_t pcie_width_cap);
847 …(*update_pcie_parameters)(struct smu_context *smu, uint32_t pcie_gen_cap, uint32_t pcie_width_cap);
2424 uint32_t pcie_width_cap) in smu_v13_0_update_pcie_parameters() argument2437 if (pcie_table->pcie_lane[num_of_levels - 1] < pcie_width_cap) in smu_v13_0_update_pcie_parameters()2438 pcie_width_cap = pcie_table->pcie_lane[num_of_levels - 1]; in smu_v13_0_update_pcie_parameters()2443 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v13_0_update_pcie_parameters()2449 if (pcie_table->pcie_lane[i] > pcie_width_cap) in smu_v13_0_update_pcie_parameters()2450 pcie_table->pcie_lane[i] = pcie_width_cap; in smu_v13_0_update_pcie_parameters()
2380 uint32_t pcie_width_cap) in navi10_update_pcie_parameters() argument2396 (pcie_gen_cap << 8)) | ((pptable->PcieLaneCount[i] <= pcie_width_cap) ? in navi10_update_pcie_parameters()2397 pptable->PcieLaneCount[i] : pcie_width_cap); in navi10_update_pcie_parameters()2408 if (pptable->PcieLaneCount[i] > pcie_width_cap) in navi10_update_pcie_parameters()2409 dpm_context->dpm_tables.pcie_table.pcie_lane[i] = pcie_width_cap; in navi10_update_pcie_parameters()
2089 uint32_t pcie_width_cap) in sienna_cichlid_update_pcie_parameters() argument2107 max_lane_width = MIN(pcie_width_cap, table_member2[1]); in sienna_cichlid_update_pcie_parameters()
