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Searched refs:IP2_31_28 (Results 1 – 8 of 8) sorted by relevance

/Linux-v6.6/drivers/pinctrl/renesas/
Dpfc-r8a77970.c116 #define GPSR2_0 F_(VI0_CLK, IP2_31_28)
187 #define IP2_31_28 FM(VI0_CLK) FM(MSIOF2_SCK) FM(SCK3) F_(0, 0) FM(HSCK3) F_(0, 0) F_(0, 0) F_(0… macro
276 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
484 PINMUX_IPSR_GPSR(IP2_31_28, VI0_CLK),
485 PINMUX_IPSR_GPSR(IP2_31_28, MSIOF2_SCK),
486 PINMUX_IPSR_GPSR(IP2_31_28, SCK3),
487 PINMUX_IPSR_GPSR(IP2_31_28, HSCK3),
2253 IP2_31_28
Dpfc-r8a77980.c131 #define GPSR2_0 F_(VI0_CLK, IP2_31_28)
221 #define IP2_31_28 FM(VI0_CLK) FM(MSIOF2_SCK) FM(SCK3) F_(0, 0) FM(HSCK3) F_(0, 0) F_(0, 0) F_(0… macro
326 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
568 PINMUX_IPSR_GPSR(IP2_31_28, VI0_CLK),
569 PINMUX_IPSR_GPSR(IP2_31_28, MSIOF2_SCK),
570 PINMUX_IPSR_GPSR(IP2_31_28, SCK3),
571 PINMUX_IPSR_GPSR(IP2_31_28, HSCK3),
2707 IP2_31_28
Dpfc-r8a77990.c110 #define GPSR1_0 F_(A0, IP2_31_28)
237 #define IP2_31_28 FM(A0) FM(IRQ0) FM(PWM2_A) FM(MSIOF3_SS1_B) FM(VI5_CLK_A) FM(DU_CDE) FM(HRX3… macro
393 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
654 PINMUX_IPSR_GPSR(IP2_31_28, A0),
655 PINMUX_IPSR_GPSR(IP2_31_28, IRQ0),
656 PINMUX_IPSR_MSEL(IP2_31_28, PWM2_A, SEL_PWM2_0),
657 PINMUX_IPSR_MSEL(IP2_31_28, MSIOF3_SS1_B, SEL_MSIOF3_1),
658 PINMUX_IPSR_MSEL(IP2_31_28, VI5_CLK_A, SEL_VIN5_0),
659 PINMUX_IPSR_GPSR(IP2_31_28, DU_CDE),
660 PINMUX_IPSR_MSEL(IP2_31_28, HRX3_D, SEL_HSCIF3_3),
[all …]
Dpfc-r8a77995.c72 #define GPSR1_16 F_(DU_DR0, IP2_31_28)
233 #define IP2_31_28 FM(DU_DR0) FM(LCDOUT16) FM(RX4_B) F_(0, 0) F_(0, 0) F_(0, 0) F_(0, 0) F_(0, 0… macro
367 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
625 PINMUX_IPSR_GPSR(IP2_31_28, DU_DR0),
626 PINMUX_IPSR_GPSR(IP2_31_28, LCDOUT16),
627 PINMUX_IPSR_MSEL(IP2_31_28, RX4_B, SEL_SCIF4_1),
2694 IP2_31_28
Dpfc-r8a77965.c124 #define GPSR1_8 F_(A8, IP2_31_28)
282 #define IP2_31_28 FM(A8) FM(RX3_B) FM(MSIOF2_SYNC_A) FM(HRX4_B) F_(0, 0) F_(0, 0) F_(0, 0) FM(… macro
457 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
801 PINMUX_IPSR_GPSR(IP2_31_28, A8),
802 PINMUX_IPSR_MSEL(IP2_31_28, RX3_B, SEL_SCIF3_1),
803 PINMUX_IPSR_MSEL(IP2_31_28, MSIOF2_SYNC_A, SEL_MSIOF2_0),
804 PINMUX_IPSR_MSEL(IP2_31_28, HRX4_B, SEL_HSCIF4_1),
805 PINMUX_IPSR_MSEL(IP2_31_28, SDA6_A, SEL_I2C6_0),
806 PINMUX_IPSR_MSEL(IP2_31_28, AVB_AVTP_MATCH_B, SEL_ETHERAVB_1),
807 PINMUX_IPSR_MSEL(IP2_31_28, PWM1_B, SEL_PWM1_1),
[all …]
Dpfc-r8a77951.c119 #define GPSR1_8 F_(A8, IP2_31_28)
279 #define IP2_31_28 FM(A8) FM(RX3_B) FM(MSIOF2_SYNC_A) FM(HRX4_B) F_(0, 0) F_(0, 0) F_(0, 0) FM(… macro
452 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
795 PINMUX_IPSR_GPSR(IP2_31_28, A8),
796 PINMUX_IPSR_MSEL(IP2_31_28, RX3_B, SEL_SCIF3_1),
797 PINMUX_IPSR_MSEL(IP2_31_28, MSIOF2_SYNC_A, SEL_MSIOF2_0),
798 PINMUX_IPSR_MSEL(IP2_31_28, HRX4_B, SEL_HSCIF4_1),
799 PINMUX_IPSR_MSEL(IP2_31_28, SDA6_A, SEL_I2C6_0),
800 PINMUX_IPSR_MSEL(IP2_31_28, AVB_AVTP_MATCH_B, SEL_ETHERAVB_1),
801 PINMUX_IPSR_MSEL(IP2_31_28, PWM1_B, SEL_PWM1_1),
[all …]
Dpfc-r8a7796.c124 #define GPSR1_8 F_(A8, IP2_31_28)
282 #define IP2_31_28 FM(A8) FM(RX3_B) FM(MSIOF2_SYNC_A) FM(HRX4_B) F_(0, 0) F_(0, 0) F_(0, 0) FM(… macro
457 FM(IP0_31_28) IP0_31_28 FM(IP1_31_28) IP1_31_28 FM(IP2_31_28) IP2_31_28 FM(IP3_31_28) IP3_31_28 \
799 PINMUX_IPSR_GPSR(IP2_31_28, A8),
800 PINMUX_IPSR_MSEL(IP2_31_28, RX3_B, SEL_SCIF3_1),
801 PINMUX_IPSR_MSEL(IP2_31_28, MSIOF2_SYNC_A, SEL_MSIOF2_0),
802 PINMUX_IPSR_MSEL(IP2_31_28, HRX4_B, SEL_HSCIF4_1),
803 PINMUX_IPSR_MSEL(IP2_31_28, SDA6_A, SEL_I2C6_0),
804 PINMUX_IPSR_MSEL(IP2_31_28, AVB_AVTP_MATCH_B, SEL_ETHERAVB_1),
805 PINMUX_IPSR_MSEL(IP2_31_28, PWM1_B, SEL_PWM1_1),
[all …]
Dpfc-r8a77470.c643 PINMUX_IPSR_GPSR(IP2_31_28, D13),
644 PINMUX_IPSR_MSEL(IP2_31_28, MSIOF2_SYNC_A, SEL_MSIOF2_0),
645 PINMUX_IPSR_MSEL(IP2_31_28, RX4_C, SEL_SCIF4_2),