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82 void __iomem *pcie_reg_base; member113 writel(ps->pcie_irq_mask, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_enable_hdp_irqs()122 writel(0x0, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_disable_hdp_irqs()132 writel(ps->pcie_irq_mask, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_en_rxdone_irq()142 writel(ps->pcie_irq_mask, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_dis_rxdone_irq()152 writel(ps->pcie_irq_mask, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_en_txdone_irq()162 writel(ps->pcie_irq_mask, PCIE_HDP_INT_EN(ps->pcie_reg_base)); in qtnf_dis_txdone_irq()271 PCIE_HDP_TX_HOST_Q_BASE_H(ps->pcie_reg_base)); in pearl_alloc_bd_table()274 PCIE_HDP_TX_HOST_Q_BASE_L(ps->pcie_reg_base)); in pearl_alloc_bd_table()276 PCIE_HDP_TX_HOST_Q_SZ_CTRL(ps->pcie_reg_base)); in pearl_alloc_bd_table()[all …]
147 phys_addr_t pcie_reg_base; /* Physical PCIe Controller Base */ member441 pcie->pcie_reg_base = res->start; in mobiveil_pcie_parse_dt()562 phys_addr_t msg_addr = pcie->pcie_reg_base; in mobiveil_pcie_enable_msi()731 phys_addr_t addr = pcie->pcie_reg_base + (data->hwirq * sizeof(int)); in mobiveil_compose_msi_msg()
