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58 #define CLK_CPU_HAS_DIV1 (1 << 0) macro
173 if (cpuclk->flags & CLK_CPU_HAS_DIV1) { in exynos_cpuclk_pre_rate_change()215 if (cpuclk->flags & CLK_CPU_HAS_DIV1) { in exynos_cpuclk_pre_rate_change()
1307 CLK_CPU_NEEDS_DEBUG_ALT_DIV | CLK_CPU_HAS_DIV1); in exynos4_clk_init()1322 CLK_CPU_NEEDS_DEBUG_ALT_DIV | CLK_CPU_HAS_DIV1); in exynos4_clk_init()
826 CLK_CPU_HAS_DIV1); in exynos5250_clk_init()
819 CLK_CPU_HAS_DIV1); in exynos3250_cmu_init()