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84 #define XAXIDMA_CR_RESET_MASK 0x00000004 /* Reset DMA engine */ macro
444 axienet_dma_out32(lp, offset, XAXIDMA_CR_RESET_MASK); in __axienet_device_reset()446 while (axienet_dma_in32(lp, offset) & XAXIDMA_CR_RESET_MASK) { in __axienet_device_reset()
37 #define XAXIDMA_CR_RESET_MASK 0x4 /* Reset DMA engine */ macro347 nixge_dma_write_reg(priv, offset, XAXIDMA_CR_RESET_MASK); in __nixge_device_reset()349 !(status & XAXIDMA_CR_RESET_MASK), 10, in __nixge_device_reset()