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68 #define CONTROL_BASE_ADDR 0x4800 macro69 #define PCIE_CORE_CTRL0_REG (CONTROL_BASE_ADDR + 0x0)88 #define PCIE_CORE_CTRL1_REG (CONTROL_BASE_ADDR + 0x4)90 #define PCIE_CORE_CTRL2_REG (CONTROL_BASE_ADDR + 0x8)96 #define PCIE_ISR0_REG (CONTROL_BASE_ADDR + 0x40)97 #define PCIE_ISR0_MASK_REG (CONTROL_BASE_ADDR + 0x44)102 #define PCIE_ISR1_REG (CONTROL_BASE_ADDR + 0x48)103 #define PCIE_ISR1_MASK_REG (CONTROL_BASE_ADDR + 0x4C)108 #define PCIE_MSI_ADDR_LOW_REG (CONTROL_BASE_ADDR + 0x50)109 #define PCIE_MSI_ADDR_HIGH_REG (CONTROL_BASE_ADDR + 0x54)[all …]
