Lines Matching refs:clkr
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61 .parent_hws = (const struct clk_hw *[]){ &gpll0_early.clkr.hw },
74 { .hw = &gpll0.clkr.hw },
85 .clkr.hw.init = &(struct clk_init_data){
100 .parent_hws = (const struct clk_hw *[]){ &gpll1.clkr.hw },
115 { .hw = &gpll0.clkr.hw },
123 .clkr = {
141 .clkr.hw.init = &(struct clk_init_data)
144 .parent_hws = (const struct clk_hw *[]){ &gpll2_early.clkr.hw },
158 { .hw = &gpll0.clkr.hw },
159 { .hw = &gpll2.clkr.hw },
171 { .hw = &gpll0.clkr.hw },
173 { .hw = &gpll2.clkr.hw },
188 .clkr.hw.init = &(struct clk_init_data){
204 .clkr.hw.init = &(struct clk_init_data){
219 .parent_hws = (const struct clk_hw *[]){ &bimc_pll.clkr.hw },
233 { .hw = &gpll0.clkr.hw },
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1465 .clkr = {
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1478 [GPLL0] = &gpll0.clkr,
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1483 [GPLL2_EARLY] = &gpll2_early.clkr,
1484 [BIMC_PLL] = &bimc_pll.clkr,
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1505 [BLSP1_UART4_APPS_CLK_SRC] = &blsp1_uart4_apps_clk_src.clkr,
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1531 [GCC_BLSP1_UART1_APPS_CLK] = &gcc_blsp1_uart1_apps_clk.clkr,
1532 [GCC_BLSP1_UART2_APPS_CLK] = &gcc_blsp1_uart2_apps_clk.clkr,
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1537 [GCC_BOOT_ROM_AHB_CLK] = &gcc_boot_rom_ahb_clk.clkr,
1538 [GCC_CRYPTO_AHB_CLK] = &gcc_crypto_ahb_clk.clkr,
1539 [GCC_CRYPTO_AXI_CLK] = &gcc_crypto_axi_clk.clkr,
1540 [GCC_CRYPTO_CLK] = &gcc_crypto_clk.clkr,
1541 [GCC_GP1_CLK] = &gcc_gp1_clk.clkr,
1542 [GCC_GP2_CLK] = &gcc_gp2_clk.clkr,
1543 [GCC_GP3_CLK] = &gcc_gp3_clk.clkr,
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1545 [GCC_PDM2_CLK] = &gcc_pdm2_clk.clkr,
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1551 [GCC_SDCC2_APPS_CLK] = &gcc_sdcc2_apps_clk.clkr,
1552 [GCC_SMMU_CFG_CLK] = &gcc_smmu_cfg_clk.clkr,
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1557 [GCC_APSS_TCU_CLK] = &gcc_apss_tcu_clk.clkr,
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1563 [GCC_USB_HSIC_IO_CAL_CLK_SRC] = &usb_hsic_io_cal_clk_src.clkr,
1564 [GCC_USB_HSIC_SYSTEM_CLK_SRC] = &usb_hsic_system_clk_src.clkr,